From 0fd26088fcd563c4d01aa3cc91e85c64f564df31 Mon Sep 17 00:00:00 2001 From: Marcel Date: Sat, 1 Apr 2023 17:53:36 +0200 Subject: [PATCH] Sync Repo --- .../Burger_Time_MiST/Burgertime.qpf | 30 + .../Burgertime.qsf} | 36 +- .../Burgertime.sdc} | 12 +- .../Burger_Time_MiST/README.txt | 2 +- .../Burger_Time_MiST/burger_time_mist.qpf | 31 - .../Burger_Time_MiST/burger_time_mist.qsf | 166 -- .../Burger_Time_MiST/burger_time_mist.sdc | 135 -- .../meta/Burger Time (Set 1).mra | 86 + .../Burger_Time_MiST/meta/Treasure Island.mra | 96 + .../rtl/Burgertime_MiST.sv} | 222 +-- .../Burger_Time_MiST/rtl/Roms/bg_graphx_1.vhd | 143 -- .../Burger_Time_MiST/rtl/Roms/bg_graphx_2.vhd | 50 - .../Burger_Time_MiST/rtl/Roms/bg_graphx_3.vhd | 143 -- .../Burger_Time_MiST/rtl/Roms/bg_map.vhd | 150 -- .../rtl/Roms/burger_time_prog.vhd | 1046 ---------- .../rtl/Roms/burger_time_sound_prog.vhd | 278 --- .../rtl/Roms/fg_sp_graphx_1.vhd | 470 ----- .../rtl/Roms/fg_sp_graphx_2.vhd | 438 ----- .../rtl/Roms/fg_sp_graphx_3.vhd | 470 ----- .../rtl/burger_time _sound.vhd | 426 ----- .../Burger_Time_MiST/rtl/burger_time.vhd | 360 ++-- .../Burger_Time_MiST/rtl/burger_time_mist.sv | 163 -- .../rtl/burger_time_sound.vhd} | 8 +- .../rtl/dpram.vhd} | 65 +- .../Burger_Time_MiST/rtl/pll.qip | 1689 ++++++++++++++++- .../Burger_Time_MiST/rtl/pll.v | 54 +- .../rtl/sdram.sv | 0 .../Treasure_Island_MiST/README.txt | 246 --- .../Treasure_Island_MiST/Treasure_Island.qpf | 31 - .../Treasure_Island_MiST/clean.bat | 15 - .../rtl/Roms/bg_graphx_1.vhd | 150 -- .../rtl/Roms/bg_graphx_2.vhd | 150 -- .../rtl/Roms/bg_graphx_3.vhd | 150 -- .../Treasure_Island_MiST/rtl/Roms/bg_map.vhd | 278 --- .../rtl/Roms/fg_sp_graphx_1.vhd | 534 ------ .../rtl/Roms/fg_sp_graphx_2.vhd | 534 ------ .../rtl/Roms/fg_sp_graphx_3.vhd | 534 ------ .../rtl/Treasure_Island_Top.vhd | 751 -------- .../Treasure_Island_MiST/rtl/build_id.tcl | 35 - .../Treasure_Island_MiST/rtl/pll.qip | 4 - .../Treasure_Island_MiST/rtl/pll.v | 348 ---- 41 files changed, 2310 insertions(+), 8219 deletions(-) create mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/Burgertime.qpf rename Arcade_MiST/Data East Burger Time Hardware/{Treasure_Island_MiST/Treasure_Island.qsf => Burger_Time_MiST/Burgertime.qsf} (91%) rename Arcade_MiST/Data East Burger Time Hardware/{Treasure_Island_MiST/Treasure_Island.sdc => Burger_Time_MiST/Burgertime.sdc} (87%) delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/burger_time_mist.qpf delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/burger_time_mist.qsf delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/burger_time_mist.sdc create mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/meta/Burger Time (Set 1).mra create mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/meta/Treasure Island.mra rename Arcade_MiST/Data East Burger Time Hardware/{Treasure_Island_MiST/rtl/Treasure_Island.sv => Burger_Time_MiST/rtl/Burgertime_MiST.sv} (71%) delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/Roms/bg_graphx_1.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/Roms/bg_graphx_2.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/Roms/bg_graphx_3.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/Roms/bg_map.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/Roms/burger_time_prog.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/Roms/burger_time_sound_prog.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/Roms/fg_sp_graphx_1.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/Roms/fg_sp_graphx_2.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/Roms/fg_sp_graphx_3.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/burger_time _sound.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/burger_time_mist.sv rename Arcade_MiST/Data East Burger Time Hardware/{Treasure_Island_MiST/rtl/Treasure_Island_Sound.vhd => Burger_Time_MiST/rtl/burger_time_sound.vhd} (98%) rename Arcade_MiST/Data East Burger Time Hardware/{Treasure_Island_MiST/rtl/gen_ram.vhd => Burger_Time_MiST/rtl/dpram.vhd} (53%) rename Arcade_MiST/Data East Burger Time Hardware/{Treasure_Island_MiST => Burger_Time_MiST}/rtl/sdram.sv (100%) delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/README.txt delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/Treasure_Island.qpf delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/clean.bat delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Roms/bg_graphx_1.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Roms/bg_graphx_2.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Roms/bg_graphx_3.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Roms/bg_map.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Roms/fg_sp_graphx_1.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Roms/fg_sp_graphx_2.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Roms/fg_sp_graphx_3.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Treasure_Island_Top.vhd delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/build_id.tcl delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/pll.qip delete mode 100644 Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/pll.v diff --git a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/Burgertime.qpf b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/Burgertime.qpf new file mode 100644 index 00000000..8626687d --- /dev/null +++ b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/Burgertime.qpf @@ -0,0 +1,30 @@ +# -------------------------------------------------------------------------- # +# +# Copyright (C) 1991-2014 Altera Corporation +# Your use of Altera Corporation's design tools, logic functions +# and other software and tools, and its AMPP partner logic +# functions, and any output files from any of the foregoing +# (including device programming or simulation files), and any +# associated documentation or information are expressly subject +# to the terms and conditions of the Altera Program License +# Subscription Agreement, Altera MegaCore Function License +# Agreement, or other applicable license agreement, including, +# without limitation, that your use is for the sole purpose of +# programming logic devices manufactured by Altera and sold by +# Altera or its authorized distributors. Please refer to the +# applicable agreement for further details. +# +# -------------------------------------------------------------------------- # +# +# Quartus II 64-Bit +# Version 13.1.4 Build 182 03/12/2014 SJ Full Version +# Date created = 19:35:28 January 31, 2023 +# +# -------------------------------------------------------------------------- # + +QUARTUS_VERSION = "13.1" +DATE = "19:35:28 January 31, 2023" + +# Revisions + +PROJECT_REVISION = "Burgertime" diff --git a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/Treasure_Island.qsf b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/Burgertime.qsf similarity index 91% rename from Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/Treasure_Island.qsf rename to Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/Burgertime.qsf index f6555b3c..2240326c 100644 --- a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/Treasure_Island.qsf +++ b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/Burgertime.qsf @@ -25,7 +25,7 @@ # Notes: # # 1) The default values for assignments are stored in the file: -# Treasure_Island_assignment_defaults.qdf +# Burgertime_assignment_defaults.qdf # If this file doesn't exist, see file: # assignment_defaults.qdf # @@ -44,23 +44,6 @@ set_global_assignment -name PROJECT_CREATION_TIME_DATE "17:45:13 JUNE 17,2016" set_global_assignment -name LAST_QUARTUS_VERSION 13.1 set_global_assignment -name PROJECT_OUTPUT_DIRECTORY output_files set_global_assignment -name PRE_FLOW_SCRIPT_FILE "quartus_sh:rtl/build_id.tcl" -set_global_assignment -name SYSTEMVERILOG_FILE rtl/Treasure_Island.sv -set_global_assignment -name VHDL_FILE rtl/Treasure_Island_Top.vhd -set_global_assignment -name VHDL_FILE rtl/Treasure_Island_Sound.vhd -set_global_assignment -name VHDL_FILE rtl/gen_ram.vhd -set_global_assignment -name SYSTEMVERILOG_FILE rtl/sdram.sv -set_global_assignment -name VERILOG_FILE rtl/pll.v -set_global_assignment -name VHDL_FILE rtl/Roms/bg_map.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/fg_sp_graphx_1.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/fg_sp_graphx_2.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/fg_sp_graphx_3.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/bg_graphx_1.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/bg_graphx_2.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/bg_graphx_3.vhd -set_global_assignment -name VHDL_FILE ../../../common/Sound/ym2149/YM2149.vhd -set_global_assignment -name VHDL_FILE ../../../common/Sound/ym2149/vol_table_array.vhd -set_global_assignment -name QIP_FILE ../../../common/CPU/T65/T65.qip -set_global_assignment -name QIP_FILE ../../../common/mist/mist.qip # Pin & Location Assignments # ========================== @@ -145,7 +128,7 @@ set_global_assignment -name MAX_CORE_JUNCTION_TEMP 85 # Analysis & Synthesis Assignments # ================================ set_global_assignment -name FAMILY "Cyclone III" -set_global_assignment -name TOP_LEVEL_ENTITY Treasure_Island +set_global_assignment -name TOP_LEVEL_ENTITY Burgertime_MiST set_global_assignment -name DEVICE_FILTER_PIN_COUNT 144 set_global_assignment -name DEVICE_FILTER_SPEED_GRADE 8 @@ -187,7 +170,7 @@ set_global_assignment -name OUTPUT_IO_TIMING_FAR_END_VMEAS "HALF SIGNAL SWING" - set_global_assignment -name OUTPUT_IO_TIMING_FAR_END_VMEAS "HALF SIGNAL SWING" -fall # ----------------------------- -# start ENTITY(Treasure_Island) +# start ENTITY(Burgertime) # start DESIGN_PARTITION(Top) # --------------------------- @@ -201,6 +184,17 @@ set_global_assignment -name OUTPUT_IO_TIMING_FAR_END_VMEAS "HALF SIGNAL SWING" - # end DESIGN_PARTITION(Top) # ------------------------- -# end ENTITY(Treasure_Island) +# end ENTITY(Burgertime) # --------------------------- +set_global_assignment -name SYSTEMVERILOG_FILE rtl/Burgertime_MiST.sv +set_global_assignment -name VHDL_FILE rtl/burger_time.vhd +set_global_assignment -name VHDL_FILE rtl/burger_time_sound.vhd +set_global_assignment -name VHDL_FILE rtl/gen_ram.vhd +set_global_assignment -name VHDL_FILE rtl/dpram.vhd +set_global_assignment -name SYSTEMVERILOG_FILE rtl/sdram.sv +set_global_assignment -name VERILOG_FILE rtl/pll.v +set_global_assignment -name VHDL_FILE ../../../common/Sound/ym2149/YM2149.vhd +set_global_assignment -name VHDL_FILE ../../../common/Sound/ym2149/vol_table_array.vhd +set_global_assignment -name QIP_FILE ../../../common/CPU/T65/T65.qip +set_global_assignment -name QIP_FILE ../../../common/mist/mist.qip set_instance_assignment -name PARTITION_HIERARCHY root_partition -to | -section_id Top \ No newline at end of file diff --git a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/Treasure_Island.sdc b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/Burgertime.sdc similarity index 87% rename from Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/Treasure_Island.sdc rename to Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/Burgertime.sdc index 82bcebce..50afc029 100644 --- a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/Treasure_Island.sdc +++ b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/Burgertime.sdc @@ -53,9 +53,9 @@ set_time_format -unit ns -decimal_places 3 create_clock -name {SPI_SCK} -period 41.666 -waveform { 20.8 41.666 } [get_ports {SPI_SCK}] -set sys_clk "pll|altpll_component|auto_generated|pll1|clk[0]" +set sys_clk "pll|altpll_component|auto_generated|pll1|clk[1]" set vid_clk "pll|altpll_component|auto_generated|pll1|clk[1]" -set sdram_clk "pll|altpll_component|auto_generated|pll1|clk[1]" +set sdram_clk "pll|altpll_component|auto_generated|pll1|clk[0]" #************************************************************** # Create Generated Clock #************************************************************** @@ -82,8 +82,8 @@ set_input_delay -add_delay -clock_fall -clock [get_clocks {SPI_SCK}] 1.000 [ge set_input_delay -add_delay -clock_fall -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_SS2}] set_input_delay -add_delay -clock_fall -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_SS3}] -#set_input_delay -clock [get_clocks $sdram_clk] -reference_pin [get_ports {SDRAM_CLK}] -max 6.6 [get_ports SDRAM_DQ[*]] -#set_input_delay -clock [get_clocks $sdram_clk] -reference_pin [get_ports {SDRAM_CLK}] -min 3.5 [get_ports SDRAM_DQ[*]] +set_input_delay -clock [get_clocks $sdram_clk] -reference_pin [get_ports {SDRAM_CLK}] -max 6.6 [get_ports SDRAM_DQ[*]] +set_input_delay -clock [get_clocks $sdram_clk] -reference_pin [get_ports {SDRAM_CLK}] -min 3.5 [get_ports SDRAM_DQ[*]] #************************************************************** # Set Output Delay @@ -95,8 +95,8 @@ set_output_delay -add_delay -clock_fall -clock [get_clocks $sys_clk] 1.000 [ge set_output_delay -add_delay -clock_fall -clock [get_clocks $sys_clk] 1.000 [get_ports {LED}] set_output_delay -add_delay -clock_fall -clock [get_clocks $vid_clk] 1.000 [get_ports {VGA_*}] -#set_output_delay -clock [get_clocks $sdram_clk] -reference_pin [get_ports {SDRAM_CLK}] -max 1.5 [get_ports {SDRAM_D* SDRAM_A* SDRAM_BA* SDRAM_n* SDRAM_CKE}] -#set_output_delay -clock [get_clocks $sdram_clk] -reference_pin [get_ports {SDRAM_CLK}] -min -0.8 [get_ports {SDRAM_D* SDRAM_A* SDRAM_BA* SDRAM_n* SDRAM_CKE}] +set_output_delay -clock [get_clocks $sdram_clk] -reference_pin [get_ports {SDRAM_CLK}] -max 1.5 [get_ports {SDRAM_D* SDRAM_A* SDRAM_BA* SDRAM_n* SDRAM_CKE}] +set_output_delay -clock [get_clocks $sdram_clk] -reference_pin [get_ports {SDRAM_CLK}] -min -0.8 [get_ports {SDRAM_D* SDRAM_A* SDRAM_BA* SDRAM_n* SDRAM_CKE}] #************************************************************** # Set Clock Groups diff --git a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/README.txt b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/README.txt index 59aadefd..80f942e4 100644 --- a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/README.txt +++ b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/README.txt @@ -1,6 +1,6 @@ --------------------------------------------------------------------------------- -- --- Arcade: Burger Time for MiST by Gehstock +-- Arcade: Treasure Island for MiST -- 18 December 2017 -- --------------------------------------------------------------------------------- diff --git a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/burger_time_mist.qpf b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/burger_time_mist.qpf deleted file mode 100644 index 233545f9..00000000 --- a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/burger_time_mist.qpf +++ /dev/null @@ -1,31 +0,0 @@ -# -------------------------------------------------------------------------- # -# -# Copyright (C) 2016 Intel Corporation. All rights reserved. -# Your use of Intel Corporation's design tools, logic functions -# and other software and tools, and its AMPP partner logic -# functions, and any output files from any of the foregoing -# (including device programming or simulation files), and any -# associated documentation or information are expressly subject -# to the terms and conditions of the Intel Program License -# Subscription Agreement, the Intel Quartus Prime License Agreement, -# the Intel MegaCore Function License Agreement, or other -# applicable license agreement, including, without limitation, -# that your use is for the sole purpose of programming logic -# devices manufactured by Intel and sold by Intel or its -# authorized distributors. Please refer to the applicable -# agreement for further details. -# -# -------------------------------------------------------------------------- # -# -# Quartus Prime -# Version 16.1.0 Build 196 10/24/2016 SJ Lite Edition -# Date created = 21:51:49 December 06, 2017 -# -# -------------------------------------------------------------------------- # - -QUARTUS_VERSION = "16.1" -DATE = "21:51:49 December 06, 2017" - -# Revisions - -PROJECT_REVISION = "burger_time_mist" diff --git a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/burger_time_mist.qsf b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/burger_time_mist.qsf deleted file mode 100644 index 5f2080d0..00000000 --- a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/burger_time_mist.qsf +++ /dev/null @@ -1,166 +0,0 @@ -# -------------------------------------------------------------------------- # -# -# Copyright (C) 1991-2013 Altera Corporation -# Your use of Altera Corporation's design tools, logic functions -# and other software and tools, and its AMPP partner logic -# functions, and any output files from any of the foregoing -# (including device programming or simulation files), and any -# associated documentation or information are expressly subject -# to the terms and conditions of the Altera Program License -# Subscription Agreement, Altera MegaCore Function License -# Agreement, or other applicable license agreement, including, -# without limitation, that your use is for the sole purpose of -# programming logic devices manufactured by Altera and sold by -# Altera or its authorized distributors. Please refer to the -# applicable agreement for further details. -# -# -------------------------------------------------------------------------- # -# -# Quartus II 64-Bit -# Version 13.1.0 Build 162 10/23/2013 SJ Web Edition -# Date created = 14:52:55 December 26, 2017 -# -# -------------------------------------------------------------------------- # -# -# Notes: -# -# 1) The default values for assignments are stored in the file: -# burnin_rubber_mist_assignment_defaults.qdf -# If this file doesn't exist, see file: -# assignment_defaults.qdf -# -# 2) Altera recommends that you do not modify this file. This -# file is updated automatically by the Quartus II software -# and any changes you make may be lost or overwritten. -# -# -------------------------------------------------------------------------- # - - - -# Project-Wide Assignments -# ======================== -set_global_assignment -name ORIGINAL_QUARTUS_VERSION 15.1.0 -set_global_assignment -name PROJECT_CREATION_TIME_DATE "17:45:13 JUNE 17,2016" -set_global_assignment -name LAST_QUARTUS_VERSION 13.1 -set_global_assignment -name PROJECT_OUTPUT_DIRECTORY output_files -set_global_assignment -name PRE_FLOW_SCRIPT_FILE "quartus_sh:rtl/build_id.tcl" -# Pin & Location Assignments -# ========================== -set_location_assignment PIN_7 -to LED -set_location_assignment PIN_54 -to CLOCK_27 -set_location_assignment PIN_144 -to VGA_R[5] -set_location_assignment PIN_143 -to VGA_R[4] -set_location_assignment PIN_142 -to VGA_R[3] -set_location_assignment PIN_141 -to VGA_R[2] -set_location_assignment PIN_137 -to VGA_R[1] -set_location_assignment PIN_135 -to VGA_R[0] -set_location_assignment PIN_133 -to VGA_B[5] -set_location_assignment PIN_132 -to VGA_B[4] -set_location_assignment PIN_125 -to VGA_B[3] -set_location_assignment PIN_121 -to VGA_B[2] -set_location_assignment PIN_120 -to VGA_B[1] -set_location_assignment PIN_115 -to VGA_B[0] -set_location_assignment PIN_114 -to VGA_G[5] -set_location_assignment PIN_113 -to VGA_G[4] -set_location_assignment PIN_112 -to VGA_G[3] -set_location_assignment PIN_111 -to VGA_G[2] -set_location_assignment PIN_110 -to VGA_G[1] -set_location_assignment PIN_106 -to VGA_G[0] -set_location_assignment PIN_136 -to VGA_VS -set_location_assignment PIN_119 -to VGA_HS -set_location_assignment PIN_65 -to AUDIO_L -set_location_assignment PIN_80 -to AUDIO_R -set_location_assignment PIN_105 -to SPI_DO -set_location_assignment PIN_88 -to SPI_DI -set_location_assignment PIN_126 -to SPI_SCK -set_location_assignment PIN_127 -to SPI_SS2 -set_location_assignment PIN_91 -to SPI_SS3 -set_location_assignment PIN_13 -to CONF_DATA0 -set_location_assignment PLL_1 -to "pll:pll|altpll:altpll_component" - -# Classic Timing Assignments -# ========================== -set_global_assignment -name MIN_CORE_JUNCTION_TEMP 0 -set_global_assignment -name MAX_CORE_JUNCTION_TEMP 85 - -# Analysis & Synthesis Assignments -# ================================ -set_global_assignment -name FAMILY "Cyclone III" -set_global_assignment -name TOP_LEVEL_ENTITY burger_time_mist -set_global_assignment -name DEVICE_FILTER_PIN_COUNT 144 -set_global_assignment -name DEVICE_FILTER_SPEED_GRADE 8 - -# Fitter Assignments -# ================== -set_global_assignment -name DEVICE EP3C25E144C8 -set_global_assignment -name CYCLONEIII_CONFIGURATION_SCHEME "PASSIVE SERIAL" -set_global_assignment -name CRC_ERROR_OPEN_DRAIN OFF -set_global_assignment -name FORCE_CONFIGURATION_VCCIO ON -set_global_assignment -name STRATIX_DEVICE_IO_STANDARD "3.3-V LVTTL" -set_global_assignment -name CYCLONEII_RESERVE_NCEO_AFTER_CONFIGURATION "USE AS REGULAR IO" -set_global_assignment -name RESERVE_DATA0_AFTER_CONFIGURATION "USE AS REGULAR IO" -set_global_assignment -name RESERVE_DATA1_AFTER_CONFIGURATION "USE AS REGULAR IO" -set_global_assignment -name RESERVE_DATA7_THROUGH_DATA2_AFTER_CONFIGURATION "USE AS REGULAR IO" -set_global_assignment -name RESERVE_FLASH_NCE_AFTER_CONFIGURATION "USE AS REGULAR IO" -set_global_assignment -name RESERVE_OTHER_AP_PINS_AFTER_CONFIGURATION "USE AS REGULAR IO" -set_global_assignment -name RESERVE_DCLK_AFTER_CONFIGURATION "USE AS REGULAR IO" - -# Assembler Assignments -# ===================== -set_global_assignment -name USE_CONFIGURATION_DEVICE OFF -set_global_assignment -name GENERATE_RBF_FILE ON - -# SignalTap II Assignments -# ======================== -set_global_assignment -name ENABLE_SIGNALTAP OFF -set_global_assignment -name USE_SIGNALTAP_FILE stp1.stp - -# Power Estimation Assignments -# ============================ -set_global_assignment -name POWER_PRESET_COOLING_SOLUTION "23 MM HEAT SINK WITH 200 LFPM AIRFLOW" -set_global_assignment -name POWER_BOARD_THERMAL_MODEL "NONE (CONSERVATIVE)" - -# Advanced I/O Timing Assignments -# =============================== -set_global_assignment -name OUTPUT_IO_TIMING_NEAR_END_VMEAS "HALF VCCIO" -rise -set_global_assignment -name OUTPUT_IO_TIMING_NEAR_END_VMEAS "HALF VCCIO" -fall -set_global_assignment -name OUTPUT_IO_TIMING_FAR_END_VMEAS "HALF SIGNAL SWING" -rise -set_global_assignment -name OUTPUT_IO_TIMING_FAR_END_VMEAS "HALF SIGNAL SWING" -fall - -# -------------------------------- -# start ENTITY(burnin_rubber_mist) - - # start DESIGN_PARTITION(Top) - # --------------------------- - - # Incremental Compilation Assignments - # =================================== - - # end DESIGN_PARTITION(Top) - # ------------------------- - -# end ENTITY(burnin_rubber_mist) -# ------------------------------ -set_global_assignment -name PARTITION_NETLIST_TYPE SOURCE -section_id Top -set_global_assignment -name PARTITION_FITTER_PRESERVATION_LEVEL PLACEMENT_AND_ROUTING -section_id Top -set_global_assignment -name PARTITION_COLOR 16764057 -section_id Top -set_global_assignment -name SYSTEMVERILOG_FILE rtl/burger_time_mist.sv -set_global_assignment -name VHDL_FILE rtl/burger_time.vhd -set_global_assignment -name VHDL_FILE "rtl/burger_time _sound.vhd" -set_global_assignment -name QIP_FILE rtl/pll.qip -set_global_assignment -name VERILOG_FILE rtl/keyboard.v -set_global_assignment -name VHDL_FILE rtl/gen_ram.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/fg_sp_graphx_3.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/fg_sp_graphx_2.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/fg_sp_graphx_1.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/burger_time_sound_prog.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/burger_time_prog.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/bg_map.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/bg_graphx_3.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/bg_graphx_2.vhd -set_global_assignment -name VHDL_FILE rtl/Roms/bg_graphx_1.vhd -set_global_assignment -name VHDL_FILE ../../../common/Sound/ym2149/YM2149.vhd -set_global_assignment -name VHDL_FILE ../../../common/Sound/ym2149/vol_table_array.vhd -set_global_assignment -name QIP_FILE ../../../common/CPU/T65/T65.qip -set_global_assignment -name QIP_FILE ../../../common/mist/mist.qip -set_instance_assignment -name PARTITION_HIERARCHY root_partition -to | -section_id Top \ No newline at end of file diff --git a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/burger_time_mist.sdc b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/burger_time_mist.sdc deleted file mode 100644 index 82bcebce..00000000 --- a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/burger_time_mist.sdc +++ /dev/null @@ -1,135 +0,0 @@ -## Generated SDC file "vectrex_MiST.out.sdc" - -## Copyright (C) 1991-2013 Altera Corporation -## Your use of Altera Corporation's design tools, logic functions -## and other software and tools, and its AMPP partner logic -## functions, and any output files from any of the foregoing -## (including device programming or simulation files), and any -## associated documentation or information are expressly subject -## to the terms and conditions of the Altera Program License -## Subscription Agreement, Altera MegaCore Function License -## Agreement, or other applicable license agreement, including, -## without limitation, that your use is for the sole purpose of -## programming logic devices manufactured by Altera and sold by -## Altera or its authorized distributors. Please refer to the -## applicable agreement for further details. - - -## VENDOR "Altera" -## PROGRAM "Quartus II" -## VERSION "Version 13.1.0 Build 162 10/23/2013 SJ Web Edition" - -## DATE "Sun Jun 24 12:53:00 2018" - -## -## DEVICE "EP3C25E144C8" -## - -# Clock constraints - -# Automatically constrain PLL and other generated clocks -derive_pll_clocks -create_base_clocks - -# Automatically calculate clock uncertainty to jitter and other effects. -derive_clock_uncertainty - -# tsu/th constraints - -# tco constraints - -# tpd constraints - -#************************************************************** -# Time Information -#************************************************************** - -set_time_format -unit ns -decimal_places 3 - - - -#************************************************************** -# Create Clock -#************************************************************** - -create_clock -name {SPI_SCK} -period 41.666 -waveform { 20.8 41.666 } [get_ports {SPI_SCK}] - -set sys_clk "pll|altpll_component|auto_generated|pll1|clk[0]" -set vid_clk "pll|altpll_component|auto_generated|pll1|clk[1]" -set sdram_clk "pll|altpll_component|auto_generated|pll1|clk[1]" -#************************************************************** -# Create Generated Clock -#************************************************************** - - -#************************************************************** -# Set Clock Latency -#************************************************************** - - - -#************************************************************** -# Set Clock Uncertainty -#************************************************************** - -#************************************************************** -# Set Input Delay -#************************************************************** - -set_input_delay -add_delay -clock_fall -clock [get_clocks {CLOCK_27}] 1.000 [get_ports {CLOCK_27}] -set_input_delay -add_delay -clock_fall -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {CONF_DATA0}] -set_input_delay -add_delay -clock_fall -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_DI}] -set_input_delay -add_delay -clock_fall -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_SCK}] -set_input_delay -add_delay -clock_fall -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_SS2}] -set_input_delay -add_delay -clock_fall -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_SS3}] - -#set_input_delay -clock [get_clocks $sdram_clk] -reference_pin [get_ports {SDRAM_CLK}] -max 6.6 [get_ports SDRAM_DQ[*]] -#set_input_delay -clock [get_clocks $sdram_clk] -reference_pin [get_ports {SDRAM_CLK}] -min 3.5 [get_ports SDRAM_DQ[*]] - -#************************************************************** -# Set Output Delay -#************************************************************** - -set_output_delay -add_delay -clock_fall -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_DO}] -set_output_delay -add_delay -clock_fall -clock [get_clocks $sys_clk] 1.000 [get_ports {AUDIO_L}] -set_output_delay -add_delay -clock_fall -clock [get_clocks $sys_clk] 1.000 [get_ports {AUDIO_R}] -set_output_delay -add_delay -clock_fall -clock [get_clocks $sys_clk] 1.000 [get_ports {LED}] -set_output_delay -add_delay -clock_fall -clock [get_clocks $vid_clk] 1.000 [get_ports {VGA_*}] - -#set_output_delay -clock [get_clocks $sdram_clk] -reference_pin [get_ports {SDRAM_CLK}] -max 1.5 [get_ports {SDRAM_D* SDRAM_A* SDRAM_BA* SDRAM_n* SDRAM_CKE}] -#set_output_delay -clock [get_clocks $sdram_clk] -reference_pin [get_ports {SDRAM_CLK}] -min -0.8 [get_ports {SDRAM_D* SDRAM_A* SDRAM_BA* SDRAM_n* SDRAM_CKE}] - -#************************************************************** -# Set Clock Groups -#************************************************************** - -set_clock_groups -asynchronous -group [get_clocks {SPI_SCK}] -group [get_clocks {pll|altpll_component|auto_generated|pll1|clk[*]}] - -#************************************************************** -# Set False Path -#************************************************************** - - - -#************************************************************** -# Set Multicycle Path -#************************************************************** - -set_multicycle_path -to {VGA_*[*]} -setup 2 -set_multicycle_path -to {VGA_*[*]} -hold 1 - -#************************************************************** -# Set Maximum Delay -#************************************************************** - - - -#************************************************************** -# Set Minimum Delay -#************************************************************** - - - -#************************************************************** -# Set Input Transition -#************************************************************** - diff --git a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/meta/Burger Time (Set 1).mra b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/meta/Burger Time (Set 1).mra new file mode 100644 index 00000000..d761bc22 --- /dev/null +++ b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/meta/Burger Time (Set 1).mra @@ -0,0 +1,86 @@ + + Burger Time + + no + no + Set 1 + + + + 1982 + Data East + Platform - Climb + + btime + btime + 0229 + burgertime + + + 15kHz + vertical (cw) + no + + 2 (alternating) + 4-way + + 1 + + + + + + + + + + + + + + + + + + + ff + + + + + + + + + + + + + + + + + + + 00 + + + + + + + + + + + + + + 20210430005030 + diff --git a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/meta/Treasure Island.mra b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/meta/Treasure Island.mra new file mode 100644 index 00000000..048ed5c4 --- /dev/null +++ b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/meta/Treasure Island.mra @@ -0,0 +1,96 @@ + + Treasure Island + + no + no + + + + + 1982 + Data East + + + tisland + btime + 0220 + burgertime + + + 15kHz + vertical (cw) + no + + 2 (alternating) + 8-way + + 1 + + + + + + + + + + + + + + + + + 1 + + + FF + + + + + + + + + + + + + + + + + + + 00 + + + + + + + + + + + + + + + 24 + + + + + + + + + diff --git a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Treasure_Island.sv b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/Burgertime_MiST.sv similarity index 71% rename from Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Treasure_Island.sv rename to Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/Burgertime_MiST.sv index b6c5a9e0..f3b2ebcd 100644 --- a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Treasure_Island.sv +++ b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/Burgertime_MiST.sv @@ -1,4 +1,4 @@ -module Treasure_Island +module Burgertime_MiST ( output LED, output [5:0] VGA_R, @@ -28,53 +28,74 @@ module Treasure_Island output SDRAM_CKE ); -`include "rtl\build_id.v" +`include "build_id.v" localparam CONF_STR = { - "TREASURE;ROM;", + "BTIME;;", "O2,Rotate Controls,Off,On;", "O34,Scanlines,Off,25%,50%,75%;", "O5,Blend,Off,On;", + "DIP;", "T0,Reset;", "V,v1.0.",`BUILD_DATE }; - -assign LED = ~ioctl_downl; -assign AUDIO_R = AUDIO_L; -assign SDRAM_CLK = clk_72; -assign SDRAM_CKE = 1; -wire [31:0] status; -wire [1:0] buttons; -wire [1:0] switches; -wire [9:0] kbjoy; -wire [7:0] joystick_0; -wire [7:0] joystick_1; -wire scandoublerD; -wire ypbpr; -wire key_strobe; -wire key_pressed; -wire [7:0] key_code; +wire rotate = status[2]; +wire [1:0] scanlines = status[4:3]; +wire blend = status[5]; +wire [7:0] dsw1 = status[15:8]; +wire [7:0] dsw2 = status[23:16]; -wire [10:0] audio; - - -wire hs, vs, cs; -wire [2:0] r, g; -wire [1:0] b; -wire blankn; - - - -wire clk_72, clk_12; +wire clk_48, clk_12; wire pll_locked; pll pll( .inclk0(CLOCK_27), .areset(0), - .c0(clk_72), + .c0(clk_48), .c1(clk_12), .locked(pll_locked) + ); + +assign LED = ~ioctl_downl; +assign AUDIO_R = AUDIO_L; +assign SDRAM_CLK = clk_48; +assign SDRAM_CKE = 1; + +wire [31:0] status; +wire [1:0] buttons; +wire [1:0] switches; +wire [7:0] joystick_0; +wire [7:0] joystick_1; +wire [6:0] core_mod; +wire scandoublerD; +wire ypbpr; +wire no_csync; +wire key_strobe; +wire key_pressed; +wire [7:0] key_code; + +user_io #( + .STRLEN(($size(CONF_STR)>>3))) +user_io( + .clk_sys (clk_12 ), + .conf_str (CONF_STR ), + .SPI_CLK (SPI_SCK ), + .SPI_SS_IO (CONF_DATA0 ), + .SPI_MISO (SPI_DO ), + .SPI_MOSI (SPI_DI ), + .buttons (buttons ), + .switches (switches ), + .scandoubler_disable (scandoublerD ), + .core_mod (core_mod ), + .ypbpr (ypbpr ), + .no_csync (no_csync ), + .key_strobe (key_strobe ), + .key_pressed (key_pressed ), + .key_code (key_code ), + .joystick_0 (joystick_0 ), + .joystick_1 (joystick_1 ), + .status (status ) ); wire ioctl_downl; @@ -84,7 +105,7 @@ wire [24:0] ioctl_addr; wire [7:0] ioctl_dout; data_io data_io( - .clk_sys ( clk_72 ), + .clk_sys ( clk_48 ), .SPI_SCK ( SPI_SCK ), .SPI_SS2 ( SPI_SS2 ), .SPI_DI ( SPI_DI ), @@ -95,19 +116,24 @@ data_io data_io( .ioctl_dout ( ioctl_dout ) ); -reg port1_req, port2_req; -wire [24:0] bg_ioctl_addr = ioctl_addr - 17'h10000; +reg reset = 1; +reg rom_loaded = 0; +always @(posedge clk_48) begin + reg ioctl_downlD; + ioctl_downlD <= ioctl_downl; + if (ioctl_downlD & ~ioctl_downl) rom_loaded <= 1; + reset <= status[0] | buttons[1] | ~rom_loaded; +end + +reg port1_req; wire [14:0] prg_rom_addr; wire [11:0] snd_rom_addr; wire [15:0] prg_rom_do, snd_rom_do; - -wire [13:0] BGCH_A; -wire [15:0] BGCH_D; -sdram sdram( +sdram #(48) sdram( .*, .init_n ( pll_locked ), - .clk ( clk_72 ), + .clk ( clk_48 ), // port1 used for main + aux CPU .port1_req ( port1_req ), @@ -117,73 +143,74 @@ sdram sdram( .port1_we ( ioctl_downl ), .port1_d ( {ioctl_dout, ioctl_dout} ), .port1_q ( ), - + .cpu1_addr ( ioctl_downl ? 16'hffff : {2'b00, prg_rom_addr[14:1]} ), .cpu1_q ( prg_rom_do ), .cpu2_addr ( ioctl_downl ? 16'hffff : {snd_rom_addr[11:1] + 16'h4000} ), .cpu2_q ( snd_rom_do ), // port2 for graphics - .port2_req ( port2_req ), + .port2_req ( ), .port2_ack ( ), - .port2_a ( bg_ioctl_addr[23:1] ), - .port2_ds ( {bg_ioctl_addr[0], ~bg_ioctl_addr[0]} ), - .port2_we ( ioctl_downl ), - .port2_d ( {ioctl_dout, ioctl_dout} ), + .port2_a ( ), + .port2_ds ( ), + .port2_we ( ), + .port2_d ( ), .port2_q ( ), - .bg_addr ( BGCH_A ), - .bg_q ( BGCH_D ) + .bg_addr ( ), + .bg_q ( ) ); // ROM download controller -always @(posedge clk_72) begin +always @(posedge clk_48) begin reg ioctl_wr_last = 0; ioctl_wr_last <= ioctl_wr; if (ioctl_downl) begin if (~ioctl_wr_last && ioctl_wr) begin port1_req <= ~port1_req; - port2_req <= ~port2_req; end end end -reg reset = 1; -reg rom_loaded = 0; -always @(posedge clk_72) begin - reg ioctl_downlD; - ioctl_downlD <= ioctl_downl; - if (ioctl_downlD & ~ioctl_downl) rom_loaded <= 1; - reset <= status[0] | buttons[1] | ~rom_loaded; -end +wire [10:0] audio; +wire hs, vs, cs; +wire [2:0] r, g; +wire [1:0] b; +wire hb, vb, blankn = ~(hb | vb); -Treasure_Island_Top Treasure_Island_Top( - .clock_12 (clk_12), - .reset (reset), - .video_r (r), - .video_g (g), - .video_b (b), - .video_csync (cs), - .video_blankn (blankn), - .video_hs (hs), - .video_vs (vs), - .audio_out (audio), - .P1 ({2'b11, 1'b1, m_fireA, m_down, m_up, m_left, m_right}), - .P2 ({2'b11, 1'b1, m_fire2A, m_down2, m_up2, m_left2, m_right2}), - .SYS ({m_coin2, m_coin1, 2'b11, 1'b1, m_tilt, m_two_players, m_one_player}), - .DSW1 ({7'b011_1111}), - .DSW2 ({8'b1110_1011}), - .prg_rom_addr(prg_rom_addr), - .prg_rom_do(prg_rom_addr[0] ? prg_rom_do[15:8] : prg_rom_do[7:0]), - .snd_rom_addr(snd_rom_addr), - .snd_rom_do(snd_rom_addr[0] ? snd_rom_do[15:8] : snd_rom_do[7:0]), - .dbg_cpu_addr() +burger_time burger_time ( + .clock_12 (clk_12), + .reset (reset), + .hwsel (core_mod), + .video_r (r), + .video_g (g), + .video_b (b), + .video_csync (cs), + .video_hblank (hb), + .video_vblank (vb), + .video_hs (hs), + .video_vs (vs), + .audio_out (audio), + .P1 (~{3'd0, m_fireA, m_down, m_up, m_left, m_right}), + .P2 (~{3'd0, m_fire2A, m_down2, m_up2, m_left2, m_right2}), + .SYS ({m_coin2, m_coin1, 3'b111, ~m_tilt, ~m_two_players, ~m_one_player}), + .DSW1 (dsw1 ^ 8'h3f), + .DSW2 (~dsw2), + .prg_rom_addr (prg_rom_addr), + .prg_rom_do (prg_rom_addr[0] ? prg_rom_do[15:8] : prg_rom_do[7:0]), + .snd_rom_addr (snd_rom_addr), + .snd_rom_do (snd_rom_addr[0] ? snd_rom_do[15:8] : snd_rom_do[7:0]), + + .dl_clk ( clk_48 ), + .dl_addr ( ioctl_addr[16:0] ), + .dl_data ( ioctl_dout ), + .dl_wr ( ioctl_wr ) ); - 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if sound_req = '1' then - sound_code <= sound_code_in; - cpu_irq_n <= '0'; - end if; - if sound_code_cs = '1' then - cpu_irq_n <= '1'; - end if; - end if; -end process; - --- nmi autorisation management -process (reset, clock_12) -begin - if reset = '1' then - nmi_reg <= '0'; - else - if rising_edge(clock_12) then - if nmi_reg_we = '1' then - nmi_reg <= cpu_do(0); - end if; - end if; - end if; -end process; - --- nmi -cpu_nmi_n <= '0' when nmi_reg = '1' and sound_timing = '1' else '1'; - --- demux AY chips output -process (ayx_clock) -begin - if rising_edge(ayx_clock) then - if ay1_audio_chan = "00" then ay1_chan_a <= ay1_audio_muxed; end if; - if ay1_audio_chan = "01" then ay1_chan_b <= ay1_audio_muxed; end if; - if ay1_audio_chan = "10" then ay1_chan_c <= ay1_audio_muxed; end if; - if ay2_audio_chan = "00" then ay2_chan_a <= ay2_audio_muxed; end if; - if ay2_audio_chan = "01" then ay2_chan_b <= ay2_audio_muxed; end if; - if ay2_audio_chan = "10" then ay2_chan_c <= ay2_audio_muxed; end if; - end if; -end process; - --- AOP Rauch passe bande filter --- --- ----------o------------ --- u4^ | | | --- | --- C4 | | R5 | --- | --- | | | --- | | C3 | | --- --| R1 |----o----||---o------|\ | --- ^ | ------> u3 | \__o--- --- | | | / ^ --- |uin | | R2 --|/ | --- | | | | | uout --- | | | | --- ------------o--------------o---------- --- --- --- i1 = (sin+u3)/R1 --- i2 = -u3/R2 --- i3 = (u4-u3)/R5 --- i4 = i2-i1-i3 --- --- u3(t+dt) = u3(t) + i3(t)*dt/C3; --- u4(t+dt) = u4(t) + i4(t)*dt/C4; - --- uout = u4-u3 - --- R1 = 5000; --- R2 = 10000; --- C3 = 0.068e-6; --- C4 = 0.068e-6; --- R5 = 47000; --- --- dt = 1/f_ech = 1/23437 --- dt/C3 = dt/C4 = 627 --- --- (i3(t)*dt/C3)*8192 = du3*8192 = ((u4-u3)/47000*627)*8192 --- = (u4-u3)*109 --- --- (i4(t)*dt/C4)*8192 = du4*8192 = (-u3/10000 -(uin+u3)/5000 -(u4-u3)/47000)*627*8192 --- = -u3(514+1027-109) - uin*1027 - u4*109 --- = -(u4*109 + u3*1432 + uin*1027) --- - --- down sample to 23.437kHz and filter AY2 channel A -uin <= to_integer(unsigned(ay2_chan_a)); - -process (clock_12) -begin - if rising_edge(clock_12) then - - if clock_div1 = "000000000" then - du3 <= u4*109 - u3*109; - du4 <= u4*109 + u3*1432 + uin*1027*16; -- add gain(16) to uin - end if; - - if clock_div1 = "000000001" then - u3 <= u3 + du3/8192; - u4 <= u4 - du4/8192; - end if; - - if clock_div1 = "000000010" then - uout <= (u4 - u3) / 8; -- adjust output gain - end if; - - -- limit signed dynamique before return to unsigned - if clock_div1 = "000000011" then - if uout > 127 then - uout_lim <= 127; - elsif uout < -127 then - uout_lim <= -127; - else - uout_lim <= uout; - end if; - end if; - - if clock_div1 = "000000100" then - - audio_out <= ("000"&ay1_chan_a(7 downto 0)) + - ("000"&ay1_chan_b(7 downto 0)) + - ("000"&ay1_chan_c(7 downto 0)) + - ("000"&std_logic_vector(to_unsigned(uout_lim+128,8)))+ - ("000"&ay2_chan_b(7 downto 0)) + - ("000"&ay2_chan_c(7 downto 0)); - end if; - - end if; -end process; - ---------------------------- --- components ---------------------------- - -cpu_inst : entity work.T65 -port map -( - Mode => "00", -- 6502 - Res_n => reset_n, - Enable => '1', - Clk => clock_500K, - Rdy => '1', - Abort_n => '1', - IRQ_n => cpu_irq_n, - NMI_n => cpu_nmi_n, - SO_n => '1',--cpu_so_n, - R_W_n => cpu_rw_n, - Sync => cpu_sync, -- open - EF => open, - MF => open, - XF => open, - ML_n => open, - VP_n => open, - VDA => open, - VPA => open, - A => cpu_addr, - DI => cpu_di, - DO => cpu_do -); - - --- working ram -wram : entity work.gen_ram -generic map( dWidth => 8, aWidth => 11) -port map( - clk => clock_12n, - we => wram_we, - addr => cpu_addr(10 downto 0), - d => cpu_do, - q => wram_do -); - --- program rom -program_rom: entity work.burger_time_sound_prog -port map( - clk => clock_12n, - addr => cpu_addr(11 downto 0), - data => prog_rom_do -); - --- AY-3-8910 #1 -ay_3_8910_1 : entity work.YM2149 -port map( - -- data bus - I_DA => cpu_do, -- in std_logic_vector(7 downto 0); - O_DA => open, -- out std_logic_vector(7 downto 0); - O_DA_OE_L => open, -- out std_logic; - -- control - I_A9_L => '0', -- in std_logic; - I_A8 => '1', -- in std_logic; - I_BDIR => ay1_bdir, -- in std_logic; - I_BC2 => '1', -- in std_logic; - I_BC1 => ay1_bc1, -- in std_logic; - I_SEL_L => '1', -- in std_logic; - - O_AUDIO => ay1_audio_muxed, -- out std_logic_vector(7 downto 0); - O_CHAN => ay1_audio_chan, -- out std_logic_vector(1 downto 0); - - -- port a - I_IOA => X"00", -- in std_logic_vector(7 downto 0); - O_IOA => open, -- out std_logic_vector(7 downto 0); - O_IOA_OE_L => open, -- out std_logic; - -- port b - I_IOB => X"00", -- in std_logic_vector(7 downto 0); - O_IOB => open, -- out std_logic_vector(7 downto 0); - O_IOB_OE_L => open, -- out std_logic; - - ENA => '1', -- in std_logic; -- clock enable for higher speed operation - RESET_L => reset_n, -- in std_logic; - CLK => ayx_clock -- in std_logic -- note 6 Mhz -); - --- AY-3-8910 #2 -ay_3_8910_2 : entity work.YM2149 -port map( - -- data bus - I_DA => cpu_do, -- in std_logic_vector(7 downto 0); - O_DA => open, -- out std_logic_vector(7 downto 0); - O_DA_OE_L => open, -- out std_logic; - -- control - I_A9_L => '0', -- in std_logic; - I_A8 => '1', -- in std_logic; - I_BDIR => ay2_bdir, -- in std_logic; - I_BC2 => '1', -- in std_logic; - I_BC1 => ay2_bc1, -- in std_logic; - I_SEL_L => '1', -- in std_logic; - - O_AUDIO => ay2_audio_muxed, -- out std_logic_vector(7 downto 0); - O_CHAN => ay2_audio_chan, -- out std_logic_vector(1 downto 0); - - -- port a - I_IOA => (others => '0'), -- in std_logic_vector(7 downto 0); - O_IOA => open, -- out std_logic_vector(7 downto 0); - O_IOA_OE_L => open, -- out std_logic; - -- port b - I_IOB => (others => '0'), -- in std_logic_vector(7 downto 0); - O_IOB => open, -- out std_logic_vector(7 downto 0); - O_IOB_OE_L => open, -- out std_logic; - - ENA => '1', --cpu_ena, -- in std_logic; -- clock enable for higher speed operation - RESET_L => reset_n, -- in std_logic; - CLK => ayx_clock -- in std_logic -- note 6 Mhz -); - - -end SYN; diff --git a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/burger_time.vhd b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/burger_time.vhd index deb6fd4d..42bd1832 100644 --- a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/burger_time.vhd +++ b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/burger_time.vhd @@ -34,35 +34,33 @@ port ( clock_12 : in std_logic; reset : in std_logic; - + hwsel : in integer range 0 to 1; + video_r : out std_logic_vector(2 downto 0); video_g : out std_logic_vector(2 downto 0); video_b : out std_logic_vector(1 downto 0); video_hs : out std_logic; video_vs : out std_logic; - video_blankn : out std_logic; + video_hblank : out std_logic; + video_vblank : out std_logic; video_csync : out std_logic; - audio_out : out std_logic_vector(10 downto 0); - - start2 : in std_logic; - start1 : in std_logic; - coin1 : in std_logic; - - fire1 : in std_logic; - right1 : in std_logic; - left1 : in std_logic; - down1 : in std_logic; - up1 : in std_logic; - - fire2 : in std_logic; - right2 : in std_logic; - left2 : in std_logic; - down2 : in std_logic; - up2 : in std_logic; - - dbg_cpu_addr: out std_logic_vector(15 downto 0) + audio_out : out std_logic_vector(10 downto 0); + P1 : in std_logic_vector(7 downto 0); + P2 : in std_logic_vector(7 downto 0); + SYS : in std_logic_vector(7 downto 0); + DSW1 : in std_logic_vector(6 downto 0); + DSW2 : in std_logic_vector(7 downto 0); + prg_rom_addr : out std_logic_vector(14 downto 0); + prg_rom_do : in std_logic_vector(7 downto 0); + snd_rom_addr : out std_logic_vector(11 downto 0); + snd_rom_do : in std_logic_vector(7 downto 0); + + dl_clk : in std_logic; + dl_addr : in std_logic_vector(16 downto 0); + dl_data : in std_logic_vector(7 downto 0); + dl_wr : in std_logic ); end burger_time; @@ -142,6 +140,9 @@ architecture syn of burger_time is signal fg_grphx_1_do : std_logic_vector( 7 downto 0); signal fg_grphx_2_do : std_logic_vector( 7 downto 0); signal fg_grphx_3_do : std_logic_vector( 7 downto 0); + signal fg_sp_grphx_1_do : std_logic_vector( 7 downto 0); + signal fg_sp_grphx_2_do : std_logic_vector( 7 downto 0); + signal fg_sp_grphx_3_do : std_logic_vector( 7 downto 0); signal fg_sp_grphx_1 : std_logic_vector( 7 downto 0); signal fg_sp_grphx_2 : std_logic_vector( 7 downto 0); signal fg_sp_grphx_3 : std_logic_vector( 7 downto 0); @@ -158,7 +159,7 @@ architecture syn of burger_time is signal palette_do : std_logic_vector(7 downto 0); -- background map rom - signal bg_map_addr : std_logic_vector(10 downto 0); + signal bg_map_addr : std_logic_vector(11 downto 0); signal bg_map_do : std_logic_vector(7 downto 0); -- background control @@ -181,9 +182,23 @@ architecture syn of burger_time is -- misc signal raz_nmi_we : std_logic; - signal coin1_r : std_logic; + signal coin_r : std_logic; signal sound_req : std_logic; - + + signal bg_map_we : std_logic; + signal bg_graphx_1_we : std_logic; + signal bg_graphx_2_we : std_logic; + signal bg_graphx_3_we : std_logic; + signal fg_sp_graphx_1_we : std_logic; + signal fg_sp_graphx_2_we : std_logic; + signal fg_sp_graphx_3_we : std_logic; + signal fg_graphx_1_we : std_logic; + signal fg_graphx_2_we : std_logic; + signal fg_graphx_3_we : std_logic; + + constant HW_BTIME : integer := 0; + constant HW_TISLAND : integer := 1; + begin --process (clock_12, cpu_sync) @@ -241,60 +256,11 @@ end process; hcnt_flip <= hcnt when cocktail_flip = '0' else not hcnt; vcnt_flip <= not vcnt when cocktail_flip = '0' else vcnt; - ---ROM_START( btime ) --- ROM_REGION( 0x10000, "maincpu", 0 ) --- ROM_LOAD( "aa04.9b", 0xc000, 0x1000, CRC(368a25b5) SHA1(ed3f3712423979dcb351941fa85dce6a0a7bb16b) ) --- ROM_LOAD( "aa06.13b", 0xd000, 0x1000, CRC(b4ba400d) SHA1(8c77397e934907bc47a739f263196a0f2f81ba3d) ) --- ROM_LOAD( "aa05.10b", 0xe000, 0x1000, CRC(8005bffa) SHA1(d0da4e360039f6a8d8142a4e8e05c1f90c0af68a) ) --- ROM_LOAD( "aa07.15b", 0xf000, 0x1000, CRC(086440ad) SHA1(4a32bc92f8ff5fbe112f56e62d2c03da8851a7b9) ) --- --- ROM_REGION( 0x10000, "audiocpu", 0 ) --- ROM_LOAD( "ab14.12h", 0xe000, 0x1000, CRC(f55e5211) SHA1(27940026d0c6212d1138d2fd88880df697218627) ) --- --- ROM_REGION( 0x6000, "gfx1", 0 ) --- ROM_LOAD( "aa12.7k", 0x0000, 0x1000, CRC(c4617243) SHA1(24204d591aa2c264a852ee9ba8c4be63efd97728) ) /* charset #1 */ --- ROM_LOAD( "ab13.9k", 0x1000, 0x1000, CRC(ac01042f) SHA1(e64b6381a9298eaf74e79fa5f1ea8e9596c58a49) ) --- ROM_LOAD( "ab10.10k", 0x2000, 0x1000, CRC(854a872a) SHA1(3d2ecfd54a5a9d68b53cf4b4ee1f2daa6aef2123) ) --- ROM_LOAD( "ab11.12k", 0x3000, 0x1000, CRC(d4848014) SHA1(0a55b091cd4e7f317c35defe13d5051b26042eee) ) --- ROM_LOAD( "aa8.13k", 0x4000, 0x1000, CRC(8650c788) SHA1(d9b1ee2d1f2fd66705d497c80252861b49aa9254) ) --- ROM_LOAD( "ab9.15k", 0x5000, 0x1000, CRC(8dec15e6) SHA1(b72633de6268ce16742bba4dcba835df860d6c2f) ) --- --- ROM_REGION( 0x1800, "gfx2", 0 ) --- ROM_LOAD( "ab00.1b", 0x0000, 0x0800, CRC(c7a14485) SHA1(6a0a8e6b7860859f22daa33634e34fbf91387659) ) /* charset #2 */ --- ROM_LOAD( "ab01.3b", 0x0800, 0x0800, CRC(25b49078) SHA1(4abdcbd4f3362c3e4463a1274731289f1a72d2e6) ) --- ROM_LOAD( "ab02.4b", 0x1000, 0x0800, CRC(b8ef56c3) SHA1(4a03bf011dc1fb2902f42587b1174b880cf06df1) ) --- --- ROM_REGION( 0x0800, "bg_map", 0 ) /* background tilemaps */ --- ROM_LOAD( "ab03.6b", 0x0000, 0x0800, CRC(d26bc1f3) SHA1(737af6e264183a1f151f277a07cf250d6abb3fd8) ) ---ROM_END - ---static ADDRESS_MAP_START( btime_map, AS_PROGRAM, 8, btime_state ) --- AM_RANGE(0x0000, 0x07ff) AM_RAM AM_SHARE("rambase") --- AM_RANGE(0x0c00, 0x0c0f) AM_RAM_DEVWRITE("palette", palette_device, write) AM_SHARE("palette") --- AM_RANGE(0x1000, 0x13ff) AM_RAM AM_SHARE("videoram") --- AM_RANGE(0x1400, 0x17ff) AM_RAM AM_SHARE("colorram") --- AM_RANGE(0x1800, 0x1bff) AM_READWRITE(btime_mirrorvideoram_r, btime_mirrorvideoram_w) --- AM_RANGE(0x1c00, 0x1fff) AM_READWRITE(btime_mirrorcolorram_r, btime_mirrorcolorram_w) --- AM_RANGE(0x4000, 0x4000) AM_READ_PORT("P1") AM_WRITENOP --- AM_RANGE(0x4001, 0x4001) AM_READ_PORT("P2") --- AM_RANGE(0x4002, 0x4002) AM_READ_PORT("SYSTEM") AM_WRITE(btime_video_control_w) --- AM_RANGE(0x4003, 0x4003) AM_READ_PORT("DSW1") AM_WRITE(audio_command_w) --- AM_RANGE(0x4004, 0x4004) AM_READ_PORT("DSW2") AM_WRITE(bnj_scroll1_w) --- AM_RANGE(0xb000, 0xffff) AM_ROM ---ADDRESS_MAP_END - --- dip_sw1 -- unkown/cocktail/hatch/test/coinage_b[2]/coinage_a[2] --- dip_sw2 -- off/off/off/eol pepper/enemies/bonus[2]/lives --- btn_p1 -- nu/nu/unkonw/jump/down/up/left/right --- btn_p2 -- nu/nu/unkonw/jump/down/up/left/right --- btn_system -- coin2/coin1/unknown/unknown/unkown/tilt/start2/start1 - -dip_sw1 <= "00111111"; -dip_sw2 <= "11101011"; -btn_p1 <= not("000"&fire1 & down1 & up1 & left1 & right1); -btn_p2 <= not("000"&fire2 & down2 & up2 & left2 & right2); -btn_system <= ('0'&coin1) & not("0000"&start2&start1); +dip_sw1 <= vblank & DSW1; +dip_sw2 <= DSW2; +btn_p1 <= P1; +btn_p2 <= P2; +btn_system <= SYS; -- misc (coin, nmi, cocktail) process (reset,clock_12) @@ -303,26 +269,24 @@ begin cpu_nmi_n <= '1'; had_written <='0'; cocktail_flip <= '0'; - else - if rising_edge(clock_12)then - coin1_r <= coin1; - if coin1_r = '0' and coin1 = '1' then + elsif rising_edge(clock_12)then + coin_r <= btn_system(6) or btn_system(7); + if coin_r = '0' and (btn_system(6) = '1' or btn_system(7) = '1') then cpu_nmi_n <= '0'; - end if; + end if; if raz_nmi_we = '1' then - cpu_nmi_n <= '1'; + cpu_nmi_n <= '1'; end if; if cpu_ena = '1' then if cpu_rw_n = '0' then had_written <= '1'; - elsif cpu_sync = '1' then - had_written <= '0'; + elsif cpu_sync = '1' then + had_written <= '0'; end if; end if; if cocktail_we = '1' then cocktail_flip <= dip_sw1(6) and cpu_do(0); end if; - end if; end if; end process; @@ -334,10 +298,10 @@ wram_cs <= '1' when cpu_addr(15 downto 11) = "00000" else '0'; -- wo io_cs <= '1' when cpu_addr(15 downto 3) = "0100000000000" else '0'; -- player/dip_sw 4000-4007 (4004) fg_ram_cs <= '1' when cpu_addr(15 downto 12) = "0001" else '0'; -- foreground ram 1000-1fff palette_cs <= '1' when cpu_addr(15 downto 4) = "000011000000" else '0'; -- palette ram 0c00-0c0f -prog_rom_cs <= '1' when cpu_addr(15 downto 14) = "11" else '0'; -- program rom c000-ffff +prog_rom_cs <= '1' when cpu_addr(15) = '1' else '0'; -- program rom 9000-ffff -- write enable -wram_we <= '1' when wram_cs = '1' and cpu_rw_n = '0' and cpu_ena = '1' else '0'; -- 0000-07ff +wram_we <= '1' when wram_cs = '1' and cpu_rw_n = '0' and cpu_ena = '1' else '0'; -- 0000-07ff raz_nmi_we <= '1' when io_cs = '1' and cpu_addr(2 downto 0) = "000" and cpu_rw_n = '0' and cpu_ena = '1' else '0'; -- 4000 scroll1_we <= '1' when io_cs = '1' and cpu_addr(2 downto 0) = "100" and cpu_rw_n = '0' and cpu_ena = '1' else '0'; -- 4004 scroll2_we <= '1' when io_cs = '1' and cpu_addr(2 downto 0) = "101" and cpu_rw_n = '0' and cpu_ena = '1' else '0'; -- 4005 @@ -350,7 +314,7 @@ palette_we <= '1' when palette_cs = '1' and cpu_rw_n = -- cpu di mux cpu_di <= wram_do when wram_cs = '1' else prog_rom_do when prog_rom_cs = '1' else - vblank&dip_sw1(6 downto 0) when (io_cs = '1') and (cpu_addr(2 downto 0) = "011") else + dip_sw1 when (io_cs = '1') and (cpu_addr(2 downto 0) = "011") else dip_sw2 when (io_cs = '1') and (cpu_addr(2 downto 0) = "100") else btn_p1 when (io_cs = '1') and (cpu_addr(2 downto 0) = "000") else btn_p2 when (io_cs = '1') and (cpu_addr(2 downto 0) = "001") else @@ -362,7 +326,7 @@ cpu_di <= wram_do when wram_cs = '1' else -- decrypt fetched instruction decrypt <= '1' when ((cpu_addr(15 downto 0) and X"0104") = X"0104") and (cpu_sync = '1') and (had_written = '1') else '0'; cpu_di_dec <= cpu_di when decrypt = '0' else - cpu_di(6) & cpu_di(5) & cpu_di(3) & cpu_di(4) & cpu_di(2) & cpu_di(7) & cpu_di(1 downto 0); + cpu_di(6) & cpu_di(5) & cpu_di(3) & cpu_di(4) & cpu_di(2) & cpu_di(7) & cpu_di(1 downto 0); ---------------------------- -- foreground and sprites -- @@ -446,9 +410,15 @@ begin if rising_edge(clock_12) and clock_6 = '1' then if hcnt(2 downto 0) = "101" then if display_tile = '1' then - fg_sp_grphx_1 <= fg_grphx_1_do; - fg_sp_grphx_2 <= fg_grphx_2_do; - fg_sp_grphx_3 <= fg_grphx_3_do; + if hcnt8_r = '1' or hwsel = HW_BTIME then + fg_sp_grphx_1 <= fg_sp_grphx_1_do; + fg_sp_grphx_2 <= fg_sp_grphx_2_do; + fg_sp_grphx_3 <= fg_sp_grphx_3_do; + else + fg_sp_grphx_1 <= fg_grphx_1_do; + fg_sp_grphx_2 <= fg_grphx_2_do; + fg_sp_grphx_3 <= fg_grphx_3_do; + end if; fg_low_priority <= '1'; --fg_grphx_addr(10); -- #fg_ram_low_do(7) (always 1 for burger time) else fg_sp_grphx_1 <= (others =>'0'); @@ -475,7 +445,7 @@ sprite_buffer_di <= "000" when hcnt8_rr = '0' else -- clear ram after sprite_buffer_do when fg_sp_bits = "000" else fg_sp_bits; -- sp vs sp priority rules -- read sprite buffer -process (clock_12) +process (clock_12,clock_6) begin if rising_edge(clock_12) and clock_6 = '0' then if hcnt8_rr = '0' then @@ -494,7 +464,7 @@ fg_bits <= sp_bits_out when (fg_sp_bits = "000") or (sp_bits_out/="000" and fg_l ---------------- -- latch scroll1 & 2 data -process (clock_12n) +process (clock_12n,clock_6) begin if rising_edge(clock_12n) and clock_6 = '1' then if scroll1_we = '1' then @@ -510,10 +480,10 @@ end process; bg_scan_hcnt <= (hcnt_flip) + (scroll1(1 downto 0)&scroll2) + "0011110010" when cocktail_flip = '0' else (hcnt_flip) + (scroll1(1 downto 0)&scroll2) + "1100000101"; -bg_map_addr <= scroll1(2) & bg_scan_hcnt(9 downto 4) & vcnt_flip(7 downto 4); +bg_map_addr <= '0'&scroll1(2) & bg_scan_hcnt(9 downto 4) & vcnt_flip(7 downto 4); -- manage background graphics rom address -process (clock_12) +process (clock_12,clock_6) begin if rising_edge(clock_12) and clock_6 = '0' then if bg_scan_hcnt(2 downto 0) = "000" then @@ -523,7 +493,7 @@ begin end process; -- latch and shift background graphics -process (clock_12) +process (clock_12,clock_6) begin if rising_edge(clock_12) and clock_6 = '1' then if scroll1(4) = '0' then @@ -555,9 +525,9 @@ bg_bits <= bg_grphx_3(0) & bg_grphx_2(0) & bg_grphx_1(0) when cocktail_flip = '0 palette_addr <= cpu_addr(3 downto 0) when palette_we = '1' else '1'&bg_bits when fg_bits = "000" else '0'&fg_bits; - + -- get palette output -process (clock_12) +process (clock_12,clock_6) begin if rising_edge(clock_12) and clock_6 = '0' then video_r <= not palette_do(2 downto 0); @@ -572,7 +542,7 @@ end process; video_csync <= csync; -process(clock_12) +process(clock_12,clock_6) constant hcnt_base : integer := 312; --320 variable vsync_cnt : std_logic_vector(3 downto 0); begin @@ -624,8 +594,6 @@ if rising_edge(clock_12) and clock_6 = '1' then end if; -- external sync and blank outputs - video_blankn <= not (hblank or vblank); - video_hs <= hsync0; if vsync_cnt = 0 then video_vs <= '0'; @@ -634,6 +602,9 @@ if rising_edge(clock_12) and clock_6 = '1' then end if; end process; + +video_hblank <= hblank; +video_vblank <= vblank; --------------------------- -- components @@ -678,12 +649,15 @@ port map( ); -- program rom -program_rom: entity work.burger_time_prog -port map( - clk => clock_12n, - addr => cpu_addr(13 downto 0), - data => prog_rom_do -); +--program_rom: entity work.prog +--port map( +-- clk => clock_12n, +-- addr => cpu_addr(14 downto 0), +-- data => prog_rom_do +--); + +prg_rom_addr <= cpu_addr(14 downto 0); +prog_rom_do <= prg_rom_do; -- foreground ram low fg_ram_low : entity work.gen_ram @@ -707,30 +681,93 @@ port map( q => fg_ram_high_do ); --- foreground and sprite graphix rom bit #1 -fg_sp_graphx_1: entity work.fg_sp_graphx_1 +-- foreground/sprite roms + +fg_sp_graphx_1: entity work.dpram +generic map( dWidth => 8, aWidth => 13) port map( - clk => clock_12n, - addr => fg_grphx_addr, - data => fg_grphx_1_do + clk_a => clock_12n, + addr_a => fg_grphx_addr, + q_a => fg_sp_grphx_1_do, + clk_b => dl_clk, + addr_b => dl_addr(12 downto 0), + we_b => fg_sp_graphx_1_we, + d_b => dl_data ); --- foreground and sprite graphix rom bit #2 -fg_sp_graphx_2: entity work.fg_sp_graphx_2 +fg_sp_graphx_1_we <= '1' when dl_wr = '1' and dl_addr(16 downto 13) = "0110" else '0'; -- 0C000 - 0DFFF + +fg_sp_graphx_2: entity work.dpram +generic map( dWidth => 8, aWidth => 13) port map( - clk => clock_12n, - addr => fg_grphx_addr, - data => fg_grphx_2_do + clk_a => clock_12n, + addr_a => fg_grphx_addr, + q_a => fg_sp_grphx_2_do, + clk_b => dl_clk, + addr_b => dl_addr(12 downto 0), + we_b => fg_sp_graphx_2_we, + d_b => dl_data ); --- foreground and sprite graphix rom bit #3 -fg_sp_graphx_3: entity work.fg_sp_graphx_3 +fg_sp_graphx_2_we <= '1' when dl_wr = '1' and dl_addr(16 downto 13) = "0111" else '0'; -- 0E000 - 0FFFF + +fg_sp_graphx_3: entity work.dpram +generic map( dWidth => 8, aWidth => 13) port map( - clk => clock_12n, - addr => fg_grphx_addr, - data => fg_grphx_3_do + clk_a => clock_12n, + addr_a => fg_grphx_addr, + q_a => fg_sp_grphx_3_do, + clk_b => dl_clk, + addr_b => dl_addr(12 downto 0), + we_b => fg_sp_graphx_3_we, + d_b => dl_data ); +fg_sp_graphx_3_we <= '1' when dl_wr = '1' and dl_addr(16 downto 13) = "1000" else '0'; -- 10000 - 11FFF + +-- foreground only rom (tisland, zoar) +fg_graphx_1: entity work.dpram +generic map( dWidth => 8, aWidth => 12) +port map( + clk_a => clock_12n, + addr_a => fg_grphx_addr(11 downto 0), + q_a => fg_grphx_1_do, + clk_b => dl_clk, + addr_b => dl_addr(11 downto 0), + we_b => fg_graphx_1_we, + d_b => dl_data +); + +fg_graphx_1_we <= '1' when dl_wr = '1' and dl_addr(16 downto 12) = "10010" else '0'; -- 12000 - 12FFF + +fg_graphx_2: entity work.dpram +generic map( dWidth => 8, aWidth => 12) +port map( + clk_a => clock_12n, + addr_a => fg_grphx_addr(11 downto 0), + q_a => fg_grphx_2_do, + clk_b => dl_clk, + addr_b => dl_addr(11 downto 0), + we_b => fg_graphx_2_we, + d_b => dl_data +); + +fg_graphx_2_we <= '1' when dl_wr = '1' and dl_addr(16 downto 12) = "10011" else '0'; -- 13000 - 13FFF + +fg_graphx_3: entity work.dpram +generic map( dWidth => 8, aWidth => 12) +port map( + clk_a => clock_12n, + addr_a => fg_grphx_addr(11 downto 0), + q_a => fg_grphx_3_do, + clk_b => dl_clk, + addr_b => dl_addr(11 downto 0), + we_b => fg_graphx_3_we, + d_b => dl_data +); + +fg_graphx_3_we <= '1' when dl_wr = '1' and dl_addr(16 downto 12) = "10100" else '0'; -- 14000 - 14FFF + -- sprite buffer ram sprite_buffer_ram : entity work.gen_ram generic map( dWidth => 3, aWidth => 8) @@ -753,40 +790,64 @@ port map( q => palette_do ); --- background map rom -bg_map: entity work.bg_map +bg_map: entity work.dpram +generic map( dWidth => 8, aWidth => 12) port map( - clk => clock_12n, - addr => bg_map_addr, - data => bg_map_do + clk_a => clock_12n, + addr_a => bg_map_addr, + q_a => bg_map_do, + clk_b => dl_clk, + addr_b => dl_addr(11 downto 0), + we_b => bg_map_we, + d_b => dl_data ); --- background graphix rom bit #1 -bg_graphx_1: entity work.bg_graphx_1 +bg_map_we <= '1' when dl_wr = '1' and dl_addr(16 downto 12) = "01001" else '0'; -- 09000 - 09FFF + +bg_graphx_1: entity work.dpram +generic map( dWidth => 8, aWidth => 11) port map( - clk => clock_12n, - addr => bg_grphx_addr, - data => bg_grphx_1_do + clk_a => clock_12n, + addr_a => bg_grphx_addr, + q_a => bg_grphx_1_do, + clk_b => dl_clk, + addr_b => dl_addr(10 downto 0), + we_b => bg_graphx_1_we, + d_b => dl_data ); --- background graphix rom bit #2 -bg_graphx_2: entity work.bg_graphx_2 +bg_graphx_1_we <= '1' when dl_wr = '1' and dl_addr(16 downto 11) = "010100" else '0'; -- 0A000 - 0A7FF + +bg_graphx_2: entity work.dpram +generic map( dWidth => 8, aWidth => 11) port map( - clk => clock_12n, - addr => bg_grphx_addr, - data => bg_grphx_2_do + clk_a => clock_12n, + addr_a => bg_grphx_addr, + q_a => bg_grphx_2_do, + clk_b => dl_clk, + addr_b => dl_addr(10 downto 0), + we_b => bg_graphx_2_we, + d_b => dl_data ); --- background graphix rom bit #3 -bg_graphx_3: entity work.bg_graphx_3 +bg_graphx_2_we <= '1' when dl_wr = '1' and dl_addr(16 downto 11) = "010101" else '0'; -- 0A800 - 0AFFF + +bg_graphx_3: entity work.dpram +generic map( dWidth => 8, aWidth => 11) port map( - clk => clock_12n, - addr => bg_grphx_addr, - data => bg_grphx_3_do + clk_a => clock_12n, + addr_a => bg_grphx_addr, + q_a => bg_grphx_3_do, + clk_b => dl_clk, + addr_b => dl_addr(10 downto 0), + we_b => bg_graphx_3_we, + d_b => dl_data ); --- burger time sound part -burger_tiime_sound: entity work.burger_time_sound +bg_graphx_3_we <= '1' when dl_wr = '1' and dl_addr(16 downto 11) = "010110" else '0'; -- 0B000 - 0B7FF + +-- sound part +Sound: entity work.burger_time_sound port map( clock_12 => clock_12, reset => reset, @@ -796,8 +857,9 @@ port map( sound_timing => vcnt(3), audio_out => audio_out, - - dbg_cpu_addr => dbg_cpu_addr + snd_rom_addr => snd_rom_addr, + snd_rom_do => snd_rom_do, + dbg_cpu_addr => open ); end SYN; diff --git a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/burger_time_mist.sv b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/burger_time_mist.sv deleted file mode 100644 index a5a49360..00000000 --- a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/burger_time_mist.sv +++ /dev/null @@ -1,163 +0,0 @@ -module burger_time_mist( - output LED, - output [5:0] VGA_R, - output [5:0] VGA_G, - output [5:0] VGA_B, - output VGA_HS, - output VGA_VS, - output AUDIO_L, - output AUDIO_R, - input SPI_SCK, - output SPI_DO, - input SPI_DI, - input SPI_SS2, - input SPI_SS3, - input CONF_DATA0, - input CLOCK_27 -); - -`include "rtl\build_id.v" - -localparam CONF_STR = { - "BurgerTime;;", - "O2,Rotate Controls,Off,On;", - "O34,Scanlines,Off,25%,50%,75%;", - "O6,Blend,Off,On;", - "T0,Reset;", - "V,v1.15.",`BUILD_DATE - }; - -assign LED = 1; -assign AUDIO_R = AUDIO_L; - -wire clk_48, clk_12, clk_6, clk_24; -wire pll_locked; - -pll pll( - .inclk0(CLOCK_27), - .areset(0), - .c0(clk_12), - .c1(clk_24) - ); - -wire [63:0] status; -wire [1:0] buttons; -wire [1:0] switches; -wire [31:0] joystick_0,joystick_1; -wire scandoublerD; -wire ypbpr; -wire key_strobe; -wire key_pressed; -wire [7:0] key_code; -wire no_csync; -wire [10:0] audio; -wire hs, vs, cs; -wire [2:0] r, g; -wire [1:0] b; -wire blankn; - -burger_time burger_time( - .clock_12(clk_12), - .reset(status[0] | buttons[1]), - .video_r(r), - .video_g(g), - .video_b(b), - .video_csync(cs), - .video_blankn(blankn), - .video_hs(hs), - .video_vs(vs), - .audio_out(audio), - .start2(m_two_players), - .start1(m_one_player), - .coin1(m_coin1), - - .fire1(m_fireA), - .right1(m_right), - .left1(m_left), - .down1(m_down), - .up1(m_up), - - .fire2(m_fire2A), - .right2(m_right2), - .left2(m_left2), - .down2(m_down2), - .up2(m_up2) - ); - -mist_video #( - .COLOR_DEPTH(3), - .SD_HCNT_WIDTH(10)) -mist_video( - .clk_sys ( clk_24 ), - .SPI_SCK ( SPI_SCK ), - .SPI_SS3 ( SPI_SS3 ), - .SPI_DI ( SPI_DI ), - .R ( blankn ? r : 0 ), - .G ( blankn ? g : 0 ), - .B ( blankn ? {b[1], b} : 0 ), - .HSync ( hs ), - .VSync ( vs ), - .VGA_R ( VGA_R ), - .VGA_G ( VGA_G ), - .VGA_B ( VGA_B ), - .VGA_VS ( VGA_VS ), - .VGA_HS ( VGA_HS ), - .scanlines (scandoublerD ? 2'b00 : status[4:3]), - .rotate ( {1'b1,status[2]} ), - .ce_divider ( 1'b1 ), - .blend ( status[6] ), - .scandoubler_disable(scandoublerD ), - .no_csync ( no_csync ), - .ypbpr ( ypbpr ) - ); - -user_io #( - .STRLEN(($size(CONF_STR)>>3))) -user_io( - .clk_sys (clk_24 ), - .conf_str (CONF_STR ), - .SPI_CLK (SPI_SCK ), - .SPI_SS_IO (CONF_DATA0 ), - .SPI_MISO (SPI_DO ), - .SPI_MOSI (SPI_DI ), - .buttons (buttons ), - .switches (switches ), - .scandoubler_disable (scandoublerD ), - .ypbpr (ypbpr ), - .no_csync (no_csync ), - .key_strobe (key_strobe ), - .key_pressed (key_pressed ), - .key_code (key_code ), - .joystick_0 (joystick_0 ), - .joystick_1 (joystick_1 ), - .status (status ) - ); - -dac #(11) dac( - .clk_i(clk_12), - .res_n_i(1), - .dac_i(audio), - .dac_o(AUDIO_L) - ); - -wire m_up, m_down, m_left, m_right, m_fireA, m_fireB, m_fireC, m_fireD, m_fireE, m_fireF; -wire m_up2, m_down2, m_left2, m_right2, m_fire2A, m_fire2B, m_fire2C, m_fire2D, m_fire2E, m_fire2F; -wire m_tilt, m_coin1, m_coin2, m_coin3, m_coin4, m_one_player, m_two_players, m_three_players, m_four_players; - -arcade_inputs inputs ( - .clk ( clk_24 ), - .key_strobe ( key_strobe ), - .key_pressed ( key_pressed ), - .key_code ( key_code ), - .joystick_0 ( joystick_0 ), - .joystick_1 ( joystick_1 ), - .rotate ( status[2] ), - .orientation ( 2'b11 ), - .joyswap ( 1'b0 ), - .oneplayer ( 1'b0 ), - .controls ( {m_tilt, m_coin4, m_coin3, m_coin2, m_coin1, m_four_players, m_three_players, m_two_players, m_one_player} ), - .player1 ( {m_fireF, m_fireE, m_fireD, m_fireC, m_fireB, m_fireA, m_up, m_down, m_left, m_right} ), - .player2 ( {m_fire2F, m_fire2E, m_fire2D, m_fire2C, m_fire2B, m_fire2A, m_up2, m_down2, m_left2, m_right2} ) -); - -endmodule diff --git a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Treasure_Island_Sound.vhd b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/burger_time_sound.vhd similarity index 98% rename from Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Treasure_Island_Sound.vhd rename to Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/burger_time_sound.vhd index 07e834a6..a37cf7d0 100644 --- a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Treasure_Island_Sound.vhd +++ b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/burger_time_sound.vhd @@ -29,7 +29,7 @@ use ieee.std_logic_1164.ALL; use ieee.std_logic_unsigned.all; use ieee.numeric_std.all; -entity Treasure_Island_Sound is +entity burger_time_sound is port ( clock_12 : in std_logic; @@ -41,12 +41,12 @@ port audio_out : out std_logic_vector(10 downto 0); snd_rom_addr : out std_logic_vector(11 downto 0); - snd_rom_do : in std_logic_vector(7 downto 0); + snd_rom_do : in std_logic_vector(7 downto 0); dbg_cpu_addr: out std_logic_vector(15 downto 0) ); -end Treasure_Island_Sound; +end burger_time_sound; -architecture syn of Treasure_Island_Sound is +architecture syn of burger_time_sound is -- clocks, reset signal clock_12n : std_logic; diff --git a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/gen_ram.vhd b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/dpram.vhd similarity index 53% rename from Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/gen_ram.vhd rename to Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/dpram.vhd index f1a95608..284194c5 100644 --- a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/gen_ram.vhd +++ b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/dpram.vhd @@ -12,7 +12,7 @@ -- -- ----------------------------------------------------------------------- -- --- gen_rwram.vhd +-- dpram.vhd -- -- ----------------------------------------------------------------------- -- @@ -26,59 +26,56 @@ use IEEE.numeric_std.ALL; -- ----------------------------------------------------------------------- -entity gen_ram is +entity dpram is generic ( dWidth : integer := 8; aWidth : integer := 10 ); port ( - clk : in std_logic; - we : in std_logic; - addr : in std_logic_vector((aWidth-1) downto 0); - d : in std_logic_vector((dWidth-1) downto 0); - q : out std_logic_vector((dWidth-1) downto 0) + clk_a : in std_logic; + we_a : in std_logic := '0'; + addr_a : in std_logic_vector((aWidth-1) downto 0); + d_a : in std_logic_vector((dWidth-1) downto 0) := (others => '0'); + q_a : out std_logic_vector((dWidth-1) downto 0); + + clk_b : in std_logic; + we_b : in std_logic := '0'; + addr_b : in std_logic_vector((aWidth-1) downto 0); + d_b : in std_logic_vector((dWidth-1) downto 0) := (others => '0'); + q_b : out std_logic_vector((dWidth-1) downto 0) ); end entity; -- ----------------------------------------------------------------------- -architecture rtl of gen_ram is +architecture rtl of dpram is subtype addressRange is integer range 0 to ((2**aWidth)-1); type ramDef is array(addressRange) of std_logic_vector((dWidth-1) downto 0); signal ram: ramDef; - - signal rAddrReg : std_logic_vector((aWidth-1) downto 0); - signal qReg : std_logic_vector((dWidth-1) downto 0); + signal addr_a_reg: std_logic_vector((aWidth-1) downto 0); + signal addr_b_reg: std_logic_vector((aWidth-1) downto 0); begin --- ----------------------------------------------------------------------- --- Signals to entity interface --- ----------------------------------------------------------------------- --- q <= qReg; -- ----------------------------------------------------------------------- --- Memory write --- ----------------------------------------------------------------------- - process(clk) + process(clk_a) begin - if rising_edge(clk) then - if we = '1' then - ram(to_integer(unsigned(addr))) <= d; + if rising_edge(clk_a) then + if we_a = '1' then + ram(to_integer(unsigned(addr_a))) <= d_a; end if; + q_a <= ram(to_integer(unsigned(addr_a))); + end if; + end process; + + process(clk_b) + begin + if rising_edge(clk_b) then + if we_b = '1' then + ram(to_integer(unsigned(addr_b))) <= d_b; + end if; + q_b <= ram(to_integer(unsigned(addr_b))); end if; end process; --- ----------------------------------------------------------------------- --- Memory read --- ----------------------------------------------------------------------- -process(clk) - begin - if rising_edge(clk) then --- qReg <= ram(to_integer(unsigned(rAddrReg))); --- rAddrReg <= addr; ----- qReg <= ram(to_integer(unsigned(addr))); - q <= ram(to_integer(unsigned(addr))); - end if; - end process; ---q <= ram(to_integer(unsigned(addr))); end architecture; diff --git a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/pll.qip b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/pll.qip index afd958be..b3fbf031 100644 --- a/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/pll.qip +++ b/Arcade_MiST/Data East Burger Time Hardware/Burger_Time_MiST/rtl/pll.qip @@ -1,4 +1,1685 @@ -set_global_assignment -name IP_TOOL_NAME "ALTPLL" -set_global_assignment -name IP_TOOL_VERSION "13.1" -set_global_assignment -name VERILOG_FILE [file join $::quartus(qip_path) "pll.v"] -set_global_assignment -name MISC_FILE [file join $::quartus(qip_path) "pll.ppf"] + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + Mist_FPGA/pll.qip at tisland · gyurco/Mist_FPGA · GitHub + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + + +
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DO NOT EDIT THIS FILE! // -// 13.1.4 Build 182 03/12/2014 Patches 4.26 SJ Web Edition +// 13.1.4 Build 182 03/12/2014 SJ Web Edition // ************************************************************ @@ -40,12 +40,14 @@ module pll ( areset, inclk0, c0, - c1); + c1, + locked); input areset; input inclk0; output c0; output c1; + output locked; `ifndef ALTERA_RESERVED_QIS // synopsys translate_off `endif @@ -55,18 +57,21 @@ module pll ( `endif wire [4:0] sub_wire0; - wire [0:0] sub_wire5 = 1'h0; - wire [0:0] sub_wire2 = sub_wire0[0:0]; + wire sub_wire2; + wire [0:0] sub_wire6 = 1'h0; + wire [0:0] sub_wire3 = sub_wire0[0:0]; wire [1:1] sub_wire1 = sub_wire0[1:1]; wire c1 = sub_wire1; - wire c0 = sub_wire2; - wire sub_wire3 = inclk0; - wire [1:0] sub_wire4 = {sub_wire5, sub_wire3}; + wire locked = sub_wire2; + wire c0 = sub_wire3; + wire sub_wire4 = inclk0; + wire [1:0] sub_wire5 = {sub_wire6, sub_wire4}; altpll altpll_component ( .areset (areset), - .inclk (sub_wire4), + .inclk (sub_wire5), .clk (sub_wire0), + .locked (sub_wire2), .activeclock (), .clkbad (), .clkena ({6{1'b1}}), @@ -82,7 +87,6 @@ module pll ( .fbout (), .fref (), .icdrclk (), - .locked (), .pfdena (1'b1), .phasecounterselect ({4{1'b1}}), .phasedone (), @@ -105,11 +109,11 @@ module pll ( altpll_component.bandwidth_type = "AUTO", altpll_component.clk0_divide_by = 9, altpll_component.clk0_duty_cycle = 50, - altpll_component.clk0_multiply_by = 4, + altpll_component.clk0_multiply_by = 16, altpll_component.clk0_phase_shift = "0", altpll_component.clk1_divide_by = 9, altpll_component.clk1_duty_cycle = 50, - altpll_component.clk1_multiply_by = 8, + altpll_component.clk1_multiply_by = 4, altpll_component.clk1_phase_shift = "0", altpll_component.compensate_clock = "CLK0", altpll_component.inclk0_input_frequency = 37037, @@ -128,7 +132,7 @@ module pll ( altpll_component.port_fbin = "PORT_UNUSED", altpll_component.port_inclk0 = "PORT_USED", altpll_component.port_inclk1 = "PORT_UNUSED", - altpll_component.port_locked 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Retrieval info: PRIVATE: LVDS_PHASE_SHIFT_UNIT0 STRING "deg" -// Retrieval info: PRIVATE: LVDS_PHASE_SHIFT_UNIT1 STRING "deg" +// Retrieval info: PRIVATE: LVDS_PHASE_SHIFT_UNIT1 STRING "ps" // Retrieval info: PRIVATE: MIG_DEVICE_SPEED_GRADE STRING "Any" // Retrieval info: PRIVATE: MIRROR_CLK0 STRING "0" // Retrieval info: PRIVATE: MIRROR_CLK1 STRING "0" -// Retrieval info: PRIVATE: MULT_FACTOR0 NUMERIC "8" +// Retrieval info: PRIVATE: MULT_FACTOR0 NUMERIC "70" // Retrieval info: PRIVATE: MULT_FACTOR1 NUMERIC "4" // Retrieval info: PRIVATE: NORMAL_MODE_RADIO STRING "1" -// Retrieval info: PRIVATE: OUTPUT_FREQ0 STRING "12.00000000" -// Retrieval info: PRIVATE: OUTPUT_FREQ1 STRING "24.00000000" +// Retrieval info: PRIVATE: OUTPUT_FREQ0 STRING "48.00000000" +// Retrieval info: PRIVATE: OUTPUT_FREQ1 STRING "12.00000000" // Retrieval info: PRIVATE: OUTPUT_FREQ_MODE0 STRING "1" // Retrieval info: PRIVATE: OUTPUT_FREQ_MODE1 STRING "1" // Retrieval info: PRIVATE: OUTPUT_FREQ_UNIT0 STRING "MHz" @@ -265,11 +270,11 @@ endmodule // Retrieval info: CONSTANT: BANDWIDTH_TYPE STRING "AUTO" // Retrieval info: CONSTANT: CLK0_DIVIDE_BY NUMERIC "9" // Retrieval info: CONSTANT: CLK0_DUTY_CYCLE NUMERIC "50" -// Retrieval info: CONSTANT: CLK0_MULTIPLY_BY NUMERIC "4" +// Retrieval info: CONSTANT: CLK0_MULTIPLY_BY NUMERIC "16" // Retrieval info: CONSTANT: CLK0_PHASE_SHIFT STRING "0" // Retrieval info: CONSTANT: CLK1_DIVIDE_BY NUMERIC "9" // Retrieval info: CONSTANT: CLK1_DUTY_CYCLE NUMERIC "50" -// Retrieval info: CONSTANT: CLK1_MULTIPLY_BY NUMERIC "8" +// Retrieval info: CONSTANT: CLK1_MULTIPLY_BY NUMERIC "4" // Retrieval info: CONSTANT: CLK1_PHASE_SHIFT STRING "0" // Retrieval info: CONSTANT: COMPENSATE_CLOCK STRING "CLK0" // Retrieval info: CONSTANT: INCLK0_INPUT_FREQUENCY NUMERIC "37037" @@ -287,7 +292,7 @@ endmodule // Retrieval info: CONSTANT: PORT_FBIN STRING "PORT_UNUSED" // Retrieval info: CONSTANT: PORT_INCLK0 STRING "PORT_USED" // Retrieval info: CONSTANT: PORT_INCLK1 STRING "PORT_UNUSED" -// Retrieval info: CONSTANT: PORT_LOCKED STRING "PORT_UNUSED" +// Retrieval info: CONSTANT: PORT_LOCKED STRING "PORT_USED" // Retrieval info: CONSTANT: PORT_PFDENA STRING "PORT_UNUSED" // Retrieval info: CONSTANT: PORT_PHASECOUNTERSELECT STRING "PORT_UNUSED" // Retrieval info: CONSTANT: PORT_PHASEDONE STRING "PORT_UNUSED" @@ -318,17 +323,20 @@ endmodule // Retrieval info: CONSTANT: PORT_extclk1 STRING "PORT_UNUSED" // Retrieval info: CONSTANT: PORT_extclk2 STRING "PORT_UNUSED" // Retrieval info: CONSTANT: PORT_extclk3 STRING "PORT_UNUSED" +// Retrieval info: CONSTANT: SELF_RESET_ON_LOSS_LOCK STRING "OFF" // Retrieval info: CONSTANT: WIDTH_CLOCK NUMERIC "5" // Retrieval info: USED_PORT: @clk 0 0 5 0 OUTPUT_CLK_EXT VCC "@clk[4..0]" // Retrieval info: USED_PORT: areset 0 0 0 0 INPUT GND "areset" // Retrieval info: USED_PORT: c0 0 0 0 0 OUTPUT_CLK_EXT VCC "c0" // Retrieval info: USED_PORT: c1 0 0 0 0 OUTPUT_CLK_EXT VCC "c1" // Retrieval info: USED_PORT: inclk0 0 0 0 0 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Hardware/Treasure_Island_MiST/README.txt b/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/README.txt deleted file mode 100644 index 80f942e4..00000000 --- a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/README.txt +++ /dev/null @@ -1,246 +0,0 @@ ---------------------------------------------------------------------------------- --- --- Arcade: Treasure Island for MiST --- 18 December 2017 --- ---------------------------------------------------------------------------------- --- Copyright (c) DAR - Dez 2017 --- https://sourceforge.net/projects/darfpga/files/Software%20VHDL/burger_time/ ---------------------------------------------------------------------------------- --- --- Only controls are rotated on VGA output. --- --- --- Keyboard inputs : --- --- ESC : Coin --- F1 : Start 1 player --- F2 : Start 2 players --- SPACE : Pepper --- LALT : --- ARROW KEYS : Movement --- --- Joystick support. --- ---------------------------------------------------------------------------------- - ---------------------------------------------------------------------------------- --- Burger Time by Dar (darfpga@aol.fr) (27/12/2017) --- http://darfpga.blogspot.fr ---------------------------------------------------------------------------------- --- Educational use only --- Do not redistribute synthetized file with roms --- Do not redistribute roms whatever the form --- Use at your own risk ---------------------------------------------------------------------------------- --- gen_ram.vhd & io_ps2_keyboard --------------------------------- --- Copyright 2005-2008 by Peter Wendrich (pwsoft@syntiac.com) --- http://www.syntiac.com/fpga64.html ---------------------------------------------------------------------------------- --- T65(b) core.Ver 301 by MikeJ March 2005 --- Latest version from www.fpgaarcade.com (original www.opencores.org) ---------------------------------------------------------------------------------- --- YM2149 (AY-3-8910) --- Copyright (c) MikeJ - Jan 2005 ---------------------------------------------------------------------------------- --- Use burger_time_de10_lite.sdc to compile (Timequest constraints) --- /!\ --- Don't forget to set device configuration mode with memory initialization --- (Assignments/Device/Pin options/Configuration mode) ---------------------------------------------------------------------------------- ---------------------------------------------------------------------------------- --- --- Main features : --- PS2 keyboard input @gpio pins 35/34 (beware voltage translation/protection) --- Audio pwm output @gpio pins 1/3 (beware voltage translation/protection) --- --- Uses 1 pll for 12MHz generation from 50MHz --- --- Board key : --- 0 : reset game --- --- Keyboard players inputs : --- --- F3 : Add coin --- F2 : Start 2 players --- F1 : Start 1 player --- SPACE : pepper --- RIGHT arrow : move right --- LEFT arrow : move left --- UP arrow : move up --- DOWN arrow : move down --- --- Other details : see burger_time.vhd --- For USB inputs and SGT5000 audio output see my other project: xevious_de10_lite ---------------------------------------------------------------------------------- --- Use burger_time_de10_lite.sdc to compile (Timequest constraints) --- /!\ --- Don't forget to set device configuration mode with memory initialization --- (Assignments/Device/Pin options/Configuration mode) ---------------------------------------------------------------------------------- ---------------------------------------------------------------------------------- --- Features : --- TV 15KHz mode only (atm) --- Coctail mode ok --- Sound ok --- No external RAM/SDRAM required - --- Use with MAME roms from btime.zip --- --- Use make_burger_time_proms.bat to build vhd file from binaries - --- Burger Time Hardware caracteristics : --- --- VIDEO : 1x6502@750kHz CPU accessing its program rom, working ram, --- foreground and sprite data ram, I/O, sound board register and trigger. --- 16Kx8bits program rom --- 2Kb8bits working ram --- --- One char 8x8 tile map 32x30 + sprites data --- 1Kx8bits + 1Kx2bits --- 3x8Kx8bits graphics rom 3bits/pixel --- 8 colors with ram palette --- --- 8 sprites 16*16 with priorities and flip H/V --- use char graphics rom and colors --- --- Char/sprites 8 colors among 256 colors --- 8bits 3red/3green/2blue --- --- Sprites buffer rams 3x256bits --- --- Background static tile map with scroll --- 2K*8bits tile map rom --- 3x2K*8bits graphics rom 3bits/pixel --- 8 colors with ram palette --- 16x16 tiles --- --- SOUND : 1x6502@500kHz CPU accessing its program rom, working ram, 2x-AY3-8910, --- command registers, triggers. --- 2Kx8bits working ram --- 4Kx8bits program rom --- --- 1xAY-3-8910 --- 3 sound channels --- 1xAY-3-8910 --- 3 sound channels --- --- Pass band active filter on channel A of AY#2 --- -+----------------------------------------------------------------------------------+ -; Fitter Summary ; -+------------------------------------+---------------------------------------------+ -; Fitter Status ; Successful - Wed Dec 27 10:02:23 2017 ; -; Quartus Prime Version ; 16.1.0 Build 196 10/24/2016 SJ Lite Edition ; -; Revision Name ; burger_time_de10_lite ; -; Top-level Entity Name ; burger_time_de10_lite ; -; Family ; MAX 10 ; -; Device ; 10M50DAF484C6GES ; -; Timing Models ; Preliminary ; -; Total logic elements ; 3,540 / 49,760 ( 7 % ) ; -; Total combinational functions ; 3,382 / 49,760 ( 7 % ) ; -; Dedicated logic registers ; 1,090 / 49,760 ( 2 % ) ; -; Total registers ; 1090 ; -; Total pins ; 105 / 360 ( 29 % ) ; -; Total virtual pins ; 0 ; -; Total memory bits ; 465,792 / 1,677,312 ( 28 % ) ; -; Embedded Multiplier 9-bit elements ; 0 / 288 ( 0 % ) ; -; Total PLLs ; 1 / 4 ( 25 % ) ; -; UFM blocks ; 0 / 1 ( 0 % ) ; -; ADC blocks ; 0 / 2 ( 0 % ) ; -+------------------------------------+---------------------------------------------+ - ---------------- -VHDL File list ---------------- - -max10_pll_12M.vhd Pll 12MHz and 14 MHz from 50MHz altera mf - -rtl_dar/burger_time_de10_lite.vhd Top level for de10_lite board - -rtl_dar/burger_time.vhd Main video board logic -rtl_dar/burger_time_sound.vhd Main sound board logic - -rtl_mikej/YM2149_linmix_sep.vhd Copyright (c) MikeJ - Jan 2005 - -t65/T65.vhd Copyright (c) MikeJ - Jan 2005t65/T65_Pack.vhdt65/T65_MCode.vhdt65/T65_ALU.vhd -rtl_dar/kbd_joystick.vhd Keyboard key to player/coin input -rtl_dar/io_ps2_keyboard.vhd Copyright 2005-2008 by Peter Wendrich (pwsoft@syntiac.com) -rtl_dar/gen_ram.vhd Generic RAM (Peter Wendrich + DAR Modification) -rtl_dar/decodeur_7_seg.vhd 7 segments display decoder - -burger_time_prog.vhd Burger Time video board PROMs -fg_sp_graphx_3.vhd -fg_sp_graphx_2.vhd -fg_sp_graphx_1.vhd -bg_map.vhd -bg_graphx_3.vhd -bg_graphx_2.vhd -bg_graphx_1.vhd - -burger_time_sound_prog.vhd Burger Time sound board PROM - ----------------------- -Quartus project files ----------------------- -de10_lite/burger_time_de10_lite.sdc Timequest constraints file -de10_lite/burger_time_de10_lite.qsf de10_lite settings (files,pins...) -de10_lite/burger_time_de10_lite.qpf de10_lite project - ------------------------------ -Required ROMs (Not included) ------------------------------ -You need the following 15 ROMs binary files from btime.zip (MAME) - -aa04.9b, aa06.13b, aa05.10b, aa07.15b -aa12.7k, ab13.9k -ab10.10k, ab11.12k -aa8.13k, ab9.15k -ab00.1b -ab01.3b -ab02.4b -ab03.6b -ab14.12h - ------- -Tools ------- -You need to build vhdl files from the binary file : - - Unzip the roms file in the tools/burger_time_unzip directory - - Double click (execute) the script tools/make_burger_time_proms.bat to get the following files - -burger_time_prog.vhd : aa04.9b + aa06.13b + aa05.10b + aa07.15b -fg_sp_graphx_1.vhd : aa12.7k + ab13.9k -fg_sp_graphx_2.vhd : ab10.10k + ab11.12k -fg_sp_graphx_3.vhd : aa8.13k + ab9.15k -bg_graphx_1.vhd : ab00.1b -bg_graphx_2.vhd : ab01.3b -bg_graphx_3.vhd : ab02.4b -bg_map.vhd : ab03.6b -burger_time_sound_prog.vhd : ab14.12h - -*DO NOT REDISTRIBUTE THESE FILES* - -VHDL files are needed to compile and include roms into the project - -The script make_burger_time_proms.bat uses make_vhdl_prom executables delivered both in linux and windows version. The script itself is delivered only in windows version (.bat) but should be easily ported to linux. - -Source code of make_vhdl_prom.c is also delivered. - ---------------------------------- -Compiling for de10_lite ---------------------------------- -You can build the project with ROM image embeded in the sof file. -*DO NOT REDISTRIBUTE THESE FILES* - -3 steps - - - put the VHDL ROM files (.vhd) into the rtl_dar directory - - build burger_time_de10_lite - - program burger_time_de10_lite.sof - ------------------------- ------------------------- -End of file ------------------------- diff --git a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/Treasure_Island.qpf b/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/Treasure_Island.qpf deleted file mode 100644 index d2240cd3..00000000 --- a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/Treasure_Island.qpf +++ /dev/null @@ -1,31 +0,0 @@ -# -------------------------------------------------------------------------- # -# -# Copyright (C) 2016 Intel Corporation. All rights reserved. -# Your use of Intel Corporation's design tools, logic functions -# and other software and tools, and its AMPP partner logic -# functions, and any output files from any of the foregoing -# (including device programming or simulation files), and any -# associated documentation or information are expressly subject -# to the terms and conditions of the Intel Program License -# Subscription Agreement, the Intel Quartus Prime License Agreement, -# the Intel MegaCore Function License Agreement, or other -# applicable license agreement, including, without limitation, -# that your use is for the sole purpose of programming logic -# devices manufactured by Intel and sold by Intel or its -# authorized distributors. Please refer to the applicable -# agreement for further details. -# -# -------------------------------------------------------------------------- # -# -# Quartus Prime -# Version 16.1.0 Build 196 10/24/2016 SJ Lite Edition -# Date created = 21:51:49 December 06, 2017 -# -# -------------------------------------------------------------------------- # - -QUARTUS_VERSION = "16.1" -DATE = "21:51:49 December 06, 2017" - -# Revisions - -PROJECT_REVISION = "Treasure_Island" diff --git a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/clean.bat b/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/clean.bat deleted file mode 100644 index 83fb0c47..00000000 --- a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/clean.bat +++ /dev/null @@ -1,15 +0,0 @@ -@echo off -del /s *.bak -del /s *.orig -del /s *.rej -rmdir /s /q db -rmdir /s /q incremental_db -rmdir /s /q output_files -rmdir /s /q simulation -rmdir /s /q greybox_tmp -del PLLJ_PLLSPE_INFO.txt -del *.qws -del *.ppf -del *.qip -del *.ddb -pause diff --git a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Roms/bg_graphx_1.vhd b/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Roms/bg_graphx_1.vhd deleted file mode 100644 index 7793ab29..00000000 --- a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/Roms/bg_graphx_1.vhd +++ /dev/null @@ -1,150 +0,0 @@ -library ieee; -use ieee.std_logic_1164.all,ieee.numeric_std.all; - -entity bg_graphx_1 is -port ( - clk : in std_logic; - addr : in std_logic_vector(10 downto 0); - data : out std_logic_vector(7 downto 0) -); -end entity; - -architecture prom of bg_graphx_1 is - type rom is array(0 to 2047) of std_logic_vector(7 downto 0); - signal rom_data: rom := ( - X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00", - X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00", - X"00",X"00",X"08",X"00",X"00",X"80",X"80",X"81",X"81",X"80",X"80",X"00",X"00",X"08",X"00",X"00", - X"FC",X"FC",X"FC",X"FC",X"FC",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FC",X"FC",X"FC",X"FC",X"FC", - X"00",X"FB",X"FD",X"FB",X"F7",X"F7",X"FF",X"0F",X"1F",X"FF",X"BF",X"BF",X"BF",X"3F",X"7F",X"FF", - X"FF",X"FE",X"FC",X"FE",X"FD",X"FD",X"FF",X"F8",X"F0",X"FF",X"EF",X"EF",X"EF",X"9F",X"7E",X"00", - X"FF",X"3F",X"BF",X"7F",X"BF",X"BF",X"FF",X"1F",X"0F",X"FF",X"F7",X"F7",X"F7",X"FB",X"7B",X"00", - X"00",X"7F",X"9F",X"EF",X"EF",X"EF",X"FF",X"F0",X"F8",X"FF",X"FD",X"FD",X"FE",X"FC",X"FF",X"FF", - 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"01" when cpu_ena = '1' and cpu_addr(11) = '1' else - "10" when cpu_ena = '0' and hcnt(8) = '0' else - "11"; - -with fg_ram_addr_sel select -fg_ram_addr <= cpu_addr(4 downto 0) & cpu_addr(9 downto 5) when "00", -- cpu mirrored addressing - cpu_addr(9 downto 0) when "01", -- cpu normal addressing - vcnt_flip(7 downto 3) & hcnt_flip(7 downto 3) when "10", -- foreground tile scan addressing - "00000" & hcnt(6 downto 2) when others; -- sprite data scan addressing - --- latch sprite data, --- manage fg and sprite graphix rom address --- manage sprite line buffer address -process (clock_12, clock_6) -begin - if rising_edge(clock_12) and clock_6 = '1' then - - if hcnt(3 downto 0) = "0000" then - sprite_attr <= fg_ram_low_do(2 downto 0); - end if; - if hcnt(3 downto 0) = "0100" then - sprite_tile <= fg_ram_low_do(7 downto 0); - end if; - if hcnt(3 downto 0) = "1000" then - if sprite_attr(1) = '0' then - sprite_line <= vcnt_flip(7 downto 0) - 0 + fg_ram_low_do(7 downto 0); - else - sprite_line <= (vcnt_flip(7 downto 0) - 0 + fg_ram_low_do(7 downto 0)) xor X"0F"; -- flip V - end if; - end if; - - if hcnt(2 downto 0) = "100" then - hcnt8_r <= hcnt(8); - fg_grphx_addr_early <= fg_ram_high_do & fg_ram_low_do & vcnt_flip(2 downto 0); -- fg_ram_low_do(7) = '1' => low priority foreground - if hcnt8_r = '1' then - fg_grphx_addr <= sprite_tile & not (sprite_attr(2) xor hcnt_flip(3) xor cocktail_flip) & sprite_line(3 downto 0); - if hcnt(3) = '1' then - if (sprite_line(7 downto 4) = "1111") and (sprite_attr(0) = '1') then - display_tile <= '1'; - else - display_tile <= '0'; - end if; - end if; - else - fg_grphx_addr <= fg_grphx_addr_early; - display_tile <= '1'; - end if; - end if; - - if hcnt8_r = '1' then - if hcnt(3 downto 0) = X"D" then - sprite_buffer_addr <= fg_ram_low_do(7 downto 0); - hcnt8_rr <= '1'; - else - sprite_buffer_addr <= sprite_buffer_addr + '1'; - end if; - else - if hcnt(7 downto 0) = X"0D" then - sprite_buffer_addr <= X"01"; -- (others => '0'); - hcnt8_rr <= '0'; - else - sprite_buffer_addr <= sprite_buffer_addr + '1'; - end if; - end if; - - end if; -end process; - -sprite_buffer_addr_flip <= not (sprite_buffer_addr) when hcnt8_rr = '0' and cocktail_flip = '1' else sprite_buffer_addr; - --- latch and shift foreground and sprite graphics -process (clock_12, clock_6) -begin - if rising_edge(clock_12) and clock_6 = '1' then - if hcnt(2 downto 0) = "101" then - if display_tile = '1' then - fg_sp_grphx_1 <= fg_grphx_1_do; - fg_sp_grphx_2 <= fg_grphx_2_do; - fg_sp_grphx_3 <= fg_grphx_3_do; - fg_low_priority <= '1'; --fg_grphx_addr(10); -- #fg_ram_low_do(7) (always 1 for burger time) - else - fg_sp_grphx_1 <= (others =>'0'); - fg_sp_grphx_2 <= (others =>'0'); - fg_sp_grphx_3 <= (others =>'0'); - end if; - elsif cocktail_flip = '0' or hcnt8_rr = '1' then - fg_sp_grphx_1 <= '0' & fg_sp_grphx_1(7 downto 1); - fg_sp_grphx_2 <= '0' & fg_sp_grphx_2(7 downto 1); - fg_sp_grphx_3 <= '0' & fg_sp_grphx_3(7 downto 1); - else - fg_sp_grphx_1 <= fg_sp_grphx_1(6 downto 0) & '0'; - fg_sp_grphx_2 <= fg_sp_grphx_2(6 downto 0) & '0'; - fg_sp_grphx_3 <= fg_sp_grphx_3(6 downto 0) & '0'; - end if; - end if; -end process; - -fg_sp_bits <= fg_sp_grphx_3(0) & fg_sp_grphx_2(0) & fg_sp_grphx_1(0) when cocktail_flip = '0' or hcnt8_rr = '1' else - fg_sp_grphx_3(7) & fg_sp_grphx_2(7) & fg_sp_grphx_1(7); - --- data to sprite buffer -sprite_buffer_di <= "000" when hcnt8_rr = '0' else -- clear ram after read - sprite_buffer_do when fg_sp_bits = "000" else fg_sp_bits; -- sp vs sp priority rules - --- read sprite buffer -process (clock_12,clock_6) -begin - if rising_edge(clock_12) and clock_6 = '0' then - if hcnt8_rr = '0' then - sp_bits_out <= sprite_buffer_do; - else - sp_bits_out <= "000"; - end if; - end if; -end process; - --- mux foreground and sprite buffer output with priorities -fg_bits <= sp_bits_out when (fg_sp_bits = "000") or (sp_bits_out/="000" and fg_low_priority = '1') else fg_sp_bits; - ----------------- --- background -- ----------------- - --- latch scroll1 & 2 data -process (clock_12n,clock_6) -begin - if rising_edge(clock_12n) and clock_6 = '1' then - if scroll1_we = '1' then - scroll1 <= cpu_do(4 downto 0); - end if; - if scroll2_we = '1' then - scroll2 <= cpu_do; - end if; - end if; -end process; - --- manage background rom map address -bg_scan_hcnt <= (hcnt_flip) + (scroll1(1 downto 0)&scroll2) + "0011110010" when cocktail_flip = '0' else - (hcnt_flip) + (scroll1(1 downto 0)&scroll2) + "1100000101"; - -bg_map_addr <= scroll1(2) & bg_scan_hcnt(9 downto 4) & vcnt_flip(8 downto 4);--todo ---bg_map_addr <= scroll1(2) & bg_scan_hcnt(9 downto 4) & vcnt_flip(7 downto 4); - --- manage background graphics rom address -process (clock_12,clock_6) -begin - if rising_edge(clock_12) and clock_6 = '0' then - if bg_scan_hcnt(2 downto 0) = "000" then - bg_grphx_addr <= bg_map_do(5 downto 0) & bg_scan_hcnt(3) & vcnt_flip(3 downto 0); - end if; - end if; -end process; - --- latch and shift background graphics -process (clock_12,clock_6) -begin - if rising_edge(clock_12) and clock_6 = '1' then - if scroll1(4) = '0' then - bg_grphx_1 <= (others => '0'); - bg_grphx_2 <= (others => '0'); - bg_grphx_3 <= (others => '0'); - else - if bg_scan_hcnt(2 downto 0) = "000" then - bg_grphx_1 <= bg_grphx_1_do; - bg_grphx_2 <= bg_grphx_2_do; - bg_grphx_3 <= bg_grphx_3_do; - elsif cocktail_flip = '0' then - bg_grphx_1 <= '0' & bg_grphx_1(7 downto 1); - bg_grphx_2 <= '0' & bg_grphx_2(7 downto 1); - bg_grphx_3 <= '0' & bg_grphx_3(7 downto 1); - else - bg_grphx_1 <= bg_grphx_1(6 downto 0) & '0'; - bg_grphx_2 <= bg_grphx_2(6 downto 0) & '0'; - bg_grphx_3 <= bg_grphx_3(6 downto 0) & '0'; - end if; - end if; - end if; -end process; - -bg_bits <= bg_grphx_3(0) & bg_grphx_2(0) & bg_grphx_1(0) when cocktail_flip = '0' else - bg_grphx_3(7) & bg_grphx_2(7) & bg_grphx_1(7); - --- manage color palette address -palette_addr <= cpu_addr(3 downto 0) when palette_we = '1' else - '1'&bg_bits when fg_bits = "000" else - '0'&fg_bits; - --- get palette output -process (clock_12,clock_6) -begin - if rising_edge(clock_12) and clock_6 = '0' then - video_r <= not palette_do(2 downto 0); - video_g <= not palette_do(5 downto 3); - video_b <= not palette_do(7 downto 6); - end if; -end process; - ----------------------------- --- video syncs and blanks -- ----------------------------- - -video_csync <= csync; - -process(clock_12,clock_6) - constant hcnt_base : integer := 312; --320 - variable vsync_cnt : std_logic_vector(3 downto 0); -begin - -if rising_edge(clock_12) and clock_6 = '1' then - - if hcnt = hcnt_base+0 then hsync0 <= '0'; - elsif hcnt = hcnt_base+24 then hsync0 <= '1'; - end if; - - if hcnt = hcnt_base+0 then hsync1 <= '0'; - elsif hcnt = hcnt_base+12 then hsync1 <= '1'; - elsif hcnt = hcnt_base+192-384 then hsync1 <= '0'; - elsif hcnt = hcnt_base+204-384 then hsync1 <= '1'; - end if; - - if hcnt = hcnt_base+0 then hsync2 <= '0'; - elsif hcnt = hcnt_base+192-12-384 then hsync2 <= '1'; - elsif hcnt = hcnt_base+192-384 then hsync2 <= '0'; - elsif hcnt = hcnt_base+0-12 then hsync2 <= '1'; - end if; - - if hcnt = hcnt_base then - if vcnt = 246 then - vsync_cnt := X"0"; - else - if vsync_cnt < X"F" then vsync_cnt := vsync_cnt + '1'; end if; - end if; - end if; - - if vsync_cnt = 0 then csync <= hsync1; - elsif vsync_cnt = 1 then csync <= hsync1; - elsif vsync_cnt = 2 then csync <= hsync1; - elsif vsync_cnt = 3 then csync <= hsync2; - elsif vsync_cnt = 4 then csync <= hsync2; - elsif vsync_cnt = 5 then csync <= hsync2; - elsif vsync_cnt = 6 then csync <= hsync1; - elsif vsync_cnt = 7 then csync <= hsync1; - elsif vsync_cnt = 8 then csync <= hsync1; - else csync <= hsync0; - end if; - - if hcnt = 267 then hblank <= '1'; - elsif hcnt = 14 then hblank <= '0'; - end if; - - if vcnt = 248 then vblank <= '1'; - elsif vcnt = 8 then vblank <= '0'; - end if; - - -- external sync and blank outputs - video_blankn <= not (hblank or vblank); - - video_hs <= hsync0; - - if vsync_cnt = 0 then video_vs <= '0'; - elsif vsync_cnt = 8 then video_vs <= '1'; - end if; - -end if; -end process; - ---------------------------- --- components ---------------------------- - -cpu_inst : entity work.T65 -port map -( - Mode => "00", -- 6502 - Res_n => reset_n, - Enable => cpu_ena, - Clk => clock_12, - Rdy => '1', - Abort_n => '1', - IRQ_n => '1',--cpu_irq_n, - NMI_n => cpu_nmi_n, - SO_n => '1',--cpu_so_n, - R_W_n => cpu_rw_n, - Sync => cpu_sync, -- open - EF => open, - MF => open, - XF => open, - ML_n => open, - VP_n => open, - VDA => open, - VPA => open, - A => cpu_addr, - DI => cpu_di_dec, - DO => cpu_do -); - - --- working ram -wram : entity work.gen_ram -generic map( dWidth => 8, aWidth => 11) -port map( - clk => clock_12n, - we => wram_we, - addr => cpu_addr( 10 downto 0), - d => cpu_do, - q => wram_do -); - --- program rom ---program_rom: entity work.prog ---port map( --- clk => clock_12n, --- addr => cpu_addr(14 downto 0), --- data => prog_rom_do ---); - -prg_rom_addr <= cpu_addr(14 downto 0); -prog_rom_do <= prg_rom_do; - --- foreground ram low -fg_ram_low : entity work.gen_ram -generic map( dWidth => 8, aWidth => 10) -port map( - clk => clock_12n, - we => fg_ram_low_we, - addr => fg_ram_addr, - d => cpu_do, - q => fg_ram_low_do -); - --- foreground ram high -fg_ram_high : entity work.gen_ram -generic map( dWidth => 2, aWidth => 10) -port map( - clk => clock_12n, - we => fg_ram_high_we, - addr => fg_ram_addr, - d => cpu_do(1 downto 0), - q => fg_ram_high_do -); - --- foreground and sprite graphix rom bit #1 -fg_sp_graphx_1: entity work.fg_sp_graphx_1 -port map( - clk => clock_12n, - addr => fg_grphx_addr, - data => fg_grphx_1_do -); - --- foreground and sprite graphix rom bit #2 -fg_sp_graphx_2: entity work.fg_sp_graphx_2 -port map( - clk => clock_12n, - addr => fg_grphx_addr, - data => fg_grphx_2_do -); - --- foreground and sprite graphix rom bit #3 -fg_sp_graphx_3: entity work.fg_sp_graphx_3 -port map( - clk => clock_12n, - addr => fg_grphx_addr, - data => fg_grphx_3_do -); - --- sprite buffer ram -sprite_buffer_ram : entity work.gen_ram -generic map( dWidth => 3, aWidth => 8) -port map( - clk => clock_12n, - we => clock_6, - addr => sprite_buffer_addr_flip, - d => sprite_buffer_di, - q => sprite_buffer_do -); - --- color palette ram -color_ram : entity work.gen_ram -generic map( dWidth => 8, aWidth => 4) -port map( - clk => clock_12n, - we => palette_we, - addr => palette_addr, - d => cpu_do, - q => palette_do -); - --- background map rom -bg_map: entity work.bg_map -port map( - clk => clock_12n, - addr => bg_map_addr, - data => bg_map_do -); - --- background graphix rom bit #1 -bg_graphx_1: entity work.bg_graphx_1 -port map( - clk => clock_12n, - addr => bg_grphx_addr, - data => bg_grphx_1_do -); - --- background graphix rom bit #2 -bg_graphx_2: entity work.bg_graphx_2 -port map( - clk => clock_12n, - addr => bg_grphx_addr, - data => bg_grphx_2_do -); - ----- background graphix rom bit #3 -bg_graphx_3: entity work.bg_graphx_3 -port map( - clk => clock_12n, - addr => bg_grphx_addr, - data => bg_grphx_3_do -); - --- sound part -Sound: entity work.Treasure_Island_Sound -port map( - clock_12 => clock_12, - reset => reset, - - sound_req => sound_req, - sound_code_in => cpu_do, - sound_timing => vcnt(3), - - audio_out => audio_out, - snd_rom_addr => snd_rom_addr, - snd_rom_do => snd_rom_do, - dbg_cpu_addr => dbg_cpu_addr -); - -end SYN; diff --git a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/build_id.tcl b/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/build_id.tcl deleted file mode 100644 index 938515d8..00000000 --- a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/build_id.tcl +++ /dev/null @@ -1,35 +0,0 @@ -# ================================================================================ -# -# Build ID Verilog Module Script -# Jeff Wiencrot - 8/1/2011 -# -# Generates a Verilog module that contains a timestamp, -# from the current build. These values are available from the build_date, build_time, -# physical_address, and host_name output ports of the build_id module in the build_id.v -# Verilog source file. -# -# ================================================================================ - -proc generateBuildID_Verilog {} { - - # Get the timestamp (see: http://www.altera.com/support/examples/tcl/tcl-date-time-stamp.html) - set buildDate [ clock format [ clock seconds ] -format %y%m%d ] - set buildTime [ clock format [ clock seconds ] -format %H%M%S ] - - # Create a Verilog file for output - set outputFileName "rtl/build_id.v" - set outputFile [open $outputFileName "w"] - - # Output the Verilog source - puts $outputFile "`define BUILD_DATE \"$buildDate\"" - puts $outputFile "`define BUILD_TIME \"$buildTime\"" - close $outputFile - - # Send confirmation message to the Messages window - post_message "Generated build identification Verilog module: [pwd]/$outputFileName" - post_message "Date: $buildDate" - post_message "Time: $buildTime" -} - -# Comment out this line to prevent the process from automatically executing when the file is sourced: -generateBuildID_Verilog \ No newline at end of file diff --git a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/pll.qip b/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/pll.qip deleted file mode 100644 index afd958be..00000000 --- a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/pll.qip +++ /dev/null @@ -1,4 +0,0 @@ -set_global_assignment -name IP_TOOL_NAME "ALTPLL" -set_global_assignment -name IP_TOOL_VERSION "13.1" -set_global_assignment -name VERILOG_FILE [file join $::quartus(qip_path) "pll.v"] -set_global_assignment -name MISC_FILE [file join $::quartus(qip_path) "pll.ppf"] diff --git a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/pll.v b/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/pll.v deleted file mode 100644 index 802e8399..00000000 --- a/Arcade_MiST/Data East Burger Time Hardware/Treasure_Island_MiST/rtl/pll.v +++ /dev/null @@ -1,348 +0,0 @@ -// megafunction wizard: %ALTPLL% -// GENERATION: STANDARD -// VERSION: WM1.0 -// MODULE: altpll - -// ============================================================ -// File Name: pll.v -// Megafunction Name(s): -// altpll -// -// Simulation Library Files(s): -// altera_mf -// ============================================================ -// ************************************************************ -// THIS IS A WIZARD-GENERATED FILE. DO NOT EDIT THIS FILE! -// -// 13.1.4 Build 182 03/12/2014 SJ Full Version -// ************************************************************ - - -//Copyright (C) 1991-2014 Altera Corporation -//Your use of Altera Corporation's design tools, logic functions -//and other software and tools, and its AMPP partner logic -//functions, and any output files from any of the foregoing -//(including device programming or simulation files), and any -//associated documentation or information are expressly subject -//to the terms and conditions of the Altera Program License -//Subscription Agreement, Altera MegaCore Function License -//Agreement, or other applicable license agreement, including, -//without limitation, that your use is for the sole purpose of -//programming logic devices manufactured by Altera and sold by -//Altera or its authorized distributors. Please refer to the -//applicable agreement for further details. - - -// synopsys translate_off -`timescale 1 ps / 1 ps -// synopsys translate_on -module pll ( - areset, - inclk0, - c0, - c1, - locked); - - input areset; - input inclk0; - output c0; - output c1; - output locked; -`ifndef ALTERA_RESERVED_QIS -// synopsys translate_off -`endif - tri0 areset; -`ifndef ALTERA_RESERVED_QIS -// synopsys translate_on -`endif - - wire [4:0] sub_wire0; - wire sub_wire2; - wire [0:0] sub_wire6 = 1'h0; - wire [0:0] sub_wire3 = sub_wire0[0:0]; - wire [1:1] sub_wire1 = sub_wire0[1:1]; - wire c1 = sub_wire1; - wire locked = sub_wire2; - wire c0 = sub_wire3; - wire sub_wire4 = inclk0; - wire [1:0] sub_wire5 = {sub_wire6, sub_wire4}; - - altpll altpll_component ( - .areset (areset), - .inclk (sub_wire5), - .clk (sub_wire0), - .locked (sub_wire2), - .activeclock (), - .clkbad (), - .clkena ({6{1'b1}}), - .clkloss (), - .clkswitch (1'b0), - .configupdate (1'b0), - .enable0 (), - .enable1 (), - .extclk (), - .extclkena ({4{1'b1}}), - .fbin (1'b1), - .fbmimicbidir (), - .fbout (), - .fref (), - .icdrclk (), - .pfdena (1'b1), - .phasecounterselect ({4{1'b1}}), - .phasedone (), - .phasestep (1'b1), - .phaseupdown (1'b1), - .pllena (1'b1), - .scanaclr (1'b0), - .scanclk (1'b0), - .scanclkena (1'b1), - .scandata (1'b0), - .scandataout (), - .scandone (), - .scanread (1'b0), - .scanwrite (1'b0), - .sclkout0 (), - .sclkout1 (), - .vcooverrange (), - .vcounderrange ()); - defparam - altpll_component.bandwidth_type = "AUTO", - altpll_component.clk0_divide_by = 3, - altpll_component.clk0_duty_cycle = 50, - altpll_component.clk0_multiply_by = 8, - altpll_component.clk0_phase_shift = "0", - altpll_component.clk1_divide_by = 9, - altpll_component.clk1_duty_cycle = 50, - altpll_component.clk1_multiply_by = 4, - altpll_component.clk1_phase_shift = "0", - altpll_component.compensate_clock = "CLK0", - altpll_component.inclk0_input_frequency = 37037, - altpll_component.intended_device_family = "Cyclone III", - altpll_component.lpm_hint = "CBX_MODULE_PREFIX=pll", - altpll_component.lpm_type = "altpll", - altpll_component.operation_mode = "NORMAL", - altpll_component.pll_type = "AUTO", - altpll_component.port_activeclock = "PORT_UNUSED", - altpll_component.port_areset = "PORT_USED", - altpll_component.port_clkbad0 = "PORT_UNUSED", - altpll_component.port_clkbad1 = "PORT_UNUSED", - altpll_component.port_clkloss = "PORT_UNUSED", - altpll_component.port_clkswitch = "PORT_UNUSED", - altpll_component.port_configupdate = "PORT_UNUSED", - altpll_component.port_fbin = "PORT_UNUSED", - altpll_component.port_inclk0 = "PORT_USED", - altpll_component.port_inclk1 = "PORT_UNUSED", - altpll_component.port_locked = "PORT_USED", - altpll_component.port_pfdena = "PORT_UNUSED", - altpll_component.port_phasecounterselect = "PORT_UNUSED", - altpll_component.port_phasedone = "PORT_UNUSED", - altpll_component.port_phasestep = "PORT_UNUSED", - altpll_component.port_phaseupdown = "PORT_UNUSED", - altpll_component.port_pllena = "PORT_UNUSED", - altpll_component.port_scanaclr = "PORT_UNUSED", - altpll_component.port_scanclk = "PORT_UNUSED", - altpll_component.port_scanclkena = "PORT_UNUSED", - altpll_component.port_scandata = "PORT_UNUSED", - altpll_component.port_scandataout = "PORT_UNUSED", - altpll_component.port_scandone = "PORT_UNUSED", - altpll_component.port_scanread = "PORT_UNUSED", - altpll_component.port_scanwrite = "PORT_UNUSED", - altpll_component.port_clk0 = "PORT_USED", - altpll_component.port_clk1 = "PORT_USED", - altpll_component.port_clk2 = "PORT_UNUSED", - altpll_component.port_clk3 = "PORT_UNUSED", - altpll_component.port_clk4 = "PORT_UNUSED", - altpll_component.port_clk5 = "PORT_UNUSED", - altpll_component.port_clkena0 = "PORT_UNUSED", - altpll_component.port_clkena1 = "PORT_UNUSED", - altpll_component.port_clkena2 = "PORT_UNUSED", - altpll_component.port_clkena3 = "PORT_UNUSED", - altpll_component.port_clkena4 = "PORT_UNUSED", - altpll_component.port_clkena5 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