diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/README.txt b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/README.txt index 0b2c323e..1885b754 100644 --- a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/README.txt +++ b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/README.txt @@ -1,7 +1,8 @@ Super Bagman Port to Mist FPGA by Gehstock -Lack of BRAM -deactivate Tile Bit1 and Speech +ToDO: CleanUp + +SBAGMAN.ROM is required at the root of the SD-Card. ------------------------------------------------- Bagman (STERN) FPGA - (darfpga@aol.fr) diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/SBAGMAN.ROM b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/Release/SBAGMAN.ROM similarity index 100% rename from Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/SBAGMAN.ROM rename to Arcade_MiST/Bagman Hardware/Super Bagman_MiST/Release/SBAGMAN.ROM diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/Release/SuperBagman.rbf b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/Release/SuperBagman.rbf new file mode 100644 index 00000000..a12aa2bb Binary files /dev/null and b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/Release/SuperBagman.rbf differ diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/Snapshot/SuperBagman.rbf b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/Snapshot/SuperBagman.rbf deleted file mode 100644 index 153271f8..00000000 Binary files a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/Snapshot/SuperBagman.rbf and /dev/null differ diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/SuperBagman.qsf b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/SuperBagman.qsf index ff03a6cd..13656712 100644 --- a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/SuperBagman.qsf +++ b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/SuperBagman.qsf @@ -18,14 +18,14 @@ # # Quartus II 64-Bit # Version 13.1.4 Build 182 03/12/2014 SJ Web Edition -# Date created = 16:46:43 March 20, 2019 +# Date created = 01:39:42 September 09, 2019 # # -------------------------------------------------------------------------- # # # Notes: # # 1) The default values for assignments are stored in the file: -# Bagman_assignment_defaults.qdf +# SuperBagman_assignment_defaults.qdf # If this file doesn't exist, see file: # assignment_defaults.qdf # @@ -44,6 +44,35 @@ set_global_assignment -name LAST_QUARTUS_VERSION 13.1 set_global_assignment -name PROJECT_CREATION_TIME_DATE "19:48:06 MAY 24,2017" set_global_assignment -name PRE_FLOW_SCRIPT_FILE "quartus_sh:rtl/build_id.tcl" set_global_assignment -name PROJECT_OUTPUT_DIRECTORY output_files +set_global_assignment -name SYSTEMVERILOG_FILE rtl/bagman_mist.sv +set_global_assignment -name VHDL_FILE rtl/bagman.vhd +set_global_assignment -name VHDL_FILE rtl/bagman_pal16r6.vhd +set_global_assignment -name VHDL_FILE rtl/bagman_speech.vhd +set_global_assignment -name VHDL_FILE rtl/plc10_speech_synthetizer.vhd +set_global_assignment -name VHDL_FILE rtl/rom/sbagman_program2.vhd +set_global_assignment -name VHDL_FILE rtl/rom/sbagman_tile_bit1.vhd +set_global_assignment -name VHDL_FILE rtl/rom/sbagman_tile_bit0.vhd +set_global_assignment -name VHDL_FILE rtl/rom/sbagman_palette.vhd +set_global_assignment -name VHDL_FILE rtl/rom/sbagman_speech2.vhd +set_global_assignment -name VHDL_FILE rtl/rom/sbagman_speech1.vhd +set_global_assignment -name VHDL_FILE rtl/T80/T80s.vhd +set_global_assignment -name VHDL_FILE rtl/T80/T80_Reg.vhd +set_global_assignment -name VHDL_FILE rtl/T80/T80_Pack.vhd +set_global_assignment -name VHDL_FILE rtl/T80/T80_MCode.vhd +set_global_assignment -name VHDL_FILE rtl/T80/T80_ALU.vhd +set_global_assignment -name VHDL_FILE rtl/T80/T80.vhd +set_global_assignment -name VHDL_FILE rtl/ym_2149_linmix.vhd +set_global_assignment -name SYSTEMVERILOG_FILE rtl/video_mixer.sv +set_global_assignment -name VHDL_FILE rtl/video_gen.vhd +set_global_assignment -name SYSTEMVERILOG_FILE rtl/scandoubler.sv +set_global_assignment -name SYSTEMVERILOG_FILE rtl/osd.sv +set_global_assignment -name SYSTEMVERILOG_FILE rtl/mist_io.sv +set_global_assignment -name SYSTEMVERILOG_FILE rtl/hq2x.sv +set_global_assignment -name VHDL_FILE rtl/gen_ram.vhd +set_global_assignment -name SYSTEMVERILOG_FILE rtl/dac.sv +set_global_assignment -name VERILOG_FILE rtl/pll.v +set_global_assignment -name SYSTEMVERILOG_FILE rtl/sdram.sv +set_global_assignment -name VERILOG_FILE rtl/data_io.v # Pin & Location Assignments # ========================== @@ -78,6 +107,45 @@ set_location_assignment PIN_127 -to SPI_SS2 set_location_assignment PIN_91 -to SPI_SS3 set_location_assignment PIN_90 -to SPI_SS4 set_location_assignment PIN_13 -to CONF_DATA0 +set_location_assignment PIN_49 -to SDRAM_A[0] +set_location_assignment PIN_44 -to SDRAM_A[1] +set_location_assignment PIN_42 -to SDRAM_A[2] +set_location_assignment PIN_39 -to SDRAM_A[3] +set_location_assignment PIN_4 -to SDRAM_A[4] +set_location_assignment PIN_6 -to SDRAM_A[5] +set_location_assignment PIN_8 -to SDRAM_A[6] +set_location_assignment PIN_10 -to SDRAM_A[7] +set_location_assignment PIN_11 -to SDRAM_A[8] +set_location_assignment PIN_28 -to SDRAM_A[9] +set_location_assignment PIN_50 -to SDRAM_A[10] +set_location_assignment PIN_30 -to SDRAM_A[11] +set_location_assignment PIN_32 -to SDRAM_A[12] +set_location_assignment PIN_83 -to SDRAM_DQ[0] +set_location_assignment PIN_79 -to SDRAM_DQ[1] +set_location_assignment PIN_77 -to SDRAM_DQ[2] +set_location_assignment PIN_76 -to SDRAM_DQ[3] +set_location_assignment PIN_72 -to SDRAM_DQ[4] +set_location_assignment PIN_71 -to SDRAM_DQ[5] +set_location_assignment PIN_69 -to SDRAM_DQ[6] +set_location_assignment PIN_68 -to SDRAM_DQ[7] +set_location_assignment PIN_86 -to SDRAM_DQ[8] +set_location_assignment PIN_87 -to SDRAM_DQ[9] +set_location_assignment PIN_98 -to SDRAM_DQ[10] +set_location_assignment PIN_99 -to SDRAM_DQ[11] +set_location_assignment PIN_100 -to SDRAM_DQ[12] +set_location_assignment PIN_101 -to SDRAM_DQ[13] +set_location_assignment PIN_103 -to SDRAM_DQ[14] +set_location_assignment PIN_104 -to SDRAM_DQ[15] +set_location_assignment PIN_58 -to SDRAM_BA[0] +set_location_assignment PIN_51 -to SDRAM_BA[1] +set_location_assignment PIN_85 -to SDRAM_DQMH +set_location_assignment PIN_67 -to SDRAM_DQML +set_location_assignment PIN_60 -to SDRAM_nRAS +set_location_assignment PIN_64 -to SDRAM_nCAS +set_location_assignment PIN_66 -to SDRAM_nWE +set_location_assignment PIN_59 -to SDRAM_nCS +set_location_assignment PIN_33 -to SDRAM_CKE +set_location_assignment PIN_43 -to SDRAM_CLK # Classic Timing Assignments # ========================== @@ -145,32 +213,4 @@ set_global_assignment -name OUTPUT_IO_TIMING_FAR_END_VMEAS "HALF SIGNAL SWING" - # end ENTITY(bagman_mist) # ----------------------- -set_global_assignment -name SYSTEMVERILOG_FILE rtl/bagman_mist.sv -set_global_assignment -name VHDL_FILE rtl/bagman.vhd -set_global_assignment -name VHDL_FILE rtl/bagman_pal16r6.vhd -set_global_assignment -name VHDL_FILE rtl/bagman_speech.vhd -set_global_assignment -name VHDL_FILE rtl/plc10_speech_synthetizer.vhd -set_global_assignment -name VHDL_FILE rtl/rom/sbagman_program.vhd -set_global_assignment -name VHDL_FILE rtl/rom/sbagman_program2.vhd -set_global_assignment -name VHDL_FILE rtl/rom/sbagman_tile_bit1.vhd -set_global_assignment -name VHDL_FILE rtl/rom/sbagman_tile_bit0.vhd -set_global_assignment -name VHDL_FILE rtl/rom/sbagman_speech2.vhd -set_global_assignment -name VHDL_FILE rtl/rom/sbagman_speech1.vhd -set_global_assignment -name VHDL_FILE rtl/rom/bagman_palette.vhd -set_global_assignment -name VHDL_FILE rtl/T80/T80s.vhd -set_global_assignment -name VHDL_FILE rtl/T80/T80_Reg.vhd -set_global_assignment -name VHDL_FILE rtl/T80/T80_Pack.vhd -set_global_assignment -name VHDL_FILE rtl/T80/T80_MCode.vhd -set_global_assignment -name VHDL_FILE rtl/T80/T80_ALU.vhd -set_global_assignment -name VHDL_FILE rtl/T80/T80.vhd -set_global_assignment -name VHDL_FILE rtl/ym_2149_linmix.vhd -set_global_assignment -name SYSTEMVERILOG_FILE rtl/video_mixer.sv -set_global_assignment -name VHDL_FILE rtl/video_gen.vhd -set_global_assignment -name SYSTEMVERILOG_FILE rtl/scandoubler.sv -set_global_assignment -name SYSTEMVERILOG_FILE rtl/osd.sv -set_global_assignment -name SYSTEMVERILOG_FILE rtl/mist_io.sv -set_global_assignment -name SYSTEMVERILOG_FILE rtl/hq2x.sv -set_global_assignment -name VHDL_FILE rtl/gen_ram.vhd -set_global_assignment -name SYSTEMVERILOG_FILE rtl/dac.sv -set_global_assignment -name VERILOG_FILE rtl/pll.v set_instance_assignment -name PARTITION_HIERARCHY root_partition -to | -section_id Top \ No newline at end of file diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/bagman.vhd b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/bagman.vhd index 28b7a68a..d98467d3 100644 --- a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/bagman.vhd +++ b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/bagman.vhd @@ -21,7 +21,9 @@ port( video_hs : out std_logic; video_vs : out std_logic; audio_out : out std_logic_vector(12 downto 0); - + roms_addr : out std_logic_vector(14 downto 0); + roms_do : in std_logic_vector(7 downto 0); + roms_rd : out std_logic; start2 : in std_logic; start1 : in std_logic; coin1 : in std_logic; @@ -535,7 +537,7 @@ port map ( ); -- sprite palette rom -palette : entity work.bagman_palette +palette : entity work.sbagman_palette port map ( addr => pixel_color_r, clk => clock_12, @@ -594,15 +596,15 @@ port map ( ); -- bagman_speech ---bagman_speech : entity work.bagman_speech ---port map( --- Clk1MHz => clock_1mhz, --- hclkn => cpu_clock, --- adrCpu => cpu_addr(2 downto 0), --- doCpu => cpu_do(0), --- weSelSpeech => speech_we_n, --- SpeechSample => speech_sample ---); +bagman_speech : entity work.bagman_speech +port map( + Clk1MHz => clock_1mhz, + hclkn => cpu_clock, + adrCpu => cpu_addr(2 downto 0), + doCpu => cpu_do(0), + weSelSpeech => speech_we_n, + SpeechSample => speech_sample +); -- random generator pal16r6 : entity work.bagman_pal16r6 @@ -612,13 +614,17 @@ port map( data => pal16r6_data ); +roms_addr <= cpu_addr(14 downto 0); +prog_do <= roms_do; +roms_rd <= '1'; + -- program rom -program : entity work.sbagman_program -port map ( - addr => cpu_addr(14 downto 0), - clk => clock_12n, - data => prog_do -); +--program : entity work.sbagman_program +--port map ( +-- addr => cpu_addr(14 downto 0), +-- clk => clock_12n, +-- data => prog_do +--); program2 : entity work.sbagman_program2 port map ( @@ -669,11 +675,11 @@ port map ( ); -- sprite and background graphics rom ---tile_bit1 : entity work.sbagman_tile_bit1 ---port map ( --- addr => tile_graph_rom_addr, --- clk => clock_12n, --- data => tile_graph_rom_bit1_do ---); +tile_bit1 : entity work.sbagman_tile_bit1 +port map ( + addr => tile_graph_rom_addr, + clk => clock_12n, + data => tile_graph_rom_bit1_do +); ------------------------------------------ end architecture; \ No newline at end of file diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/bagman_mist.sv b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/bagman_mist.sv index 748347c4..48ced2f8 100644 --- a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/bagman_mist.sv +++ b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/bagman_mist.sv @@ -13,7 +13,19 @@ module bagman_mist ( input SPI_SS2, input SPI_SS3, input CONF_DATA0, - input CLOCK_27 + input CLOCK_27, + output [12:0] SDRAM_A, + inout [15:0] SDRAM_DQ, + output SDRAM_DQML, + output SDRAM_DQMH, + output SDRAM_nWE, + output SDRAM_nCAS, + output SDRAM_nRAS, + output SDRAM_nCS, + output [1:0] SDRAM_BA, + output SDRAM_CLK, + output SDRAM_CKE + ); `include "rtl\build_id.sv" @@ -28,13 +40,16 @@ localparam CONF_STR = { assign LED = 1; assign AUDIO_R = AUDIO_L; +assign SDRAM_CLK = clock_96; -wire clock_24, clock_12, clock_6; +wire clock_24, clock_12, clock_6, clock_96, pll_locked; pll pll( .inclk0(CLOCK_27), .c0(clock_24), .c1(clock_12), - .c2(clock_6) + .c2(clock_6), + .c3(clock_96), + .locked(pll_locked) ); wire [31:0] status; @@ -52,6 +67,41 @@ wire hb, vb; wire blankn = ~(hb | vb); wire [2:0] r, g; wire [1:0] b; +wire [14:0] rom_addr; +wire [15:0] rom_do; +wire rom_rd; +wire ioctl_downl; +wire [7:0] ioctl_index; +wire ioctl_wr; +wire [24:0] ioctl_addr; +wire [7:0] ioctl_dout; + +data_io data_io ( + .clk_sys ( clock_96 ), + .SPI_SCK ( SPI_SCK ), + .SPI_SS2 ( SPI_SS2 ), + .SPI_DI ( SPI_DI ), + .ioctl_download( ioctl_downl ), + .ioctl_index ( ioctl_index ), + .ioctl_wr ( ioctl_wr ), + .ioctl_addr ( ioctl_addr ), + .ioctl_dout ( ioctl_dout ) +); + +sdram cart +( + .*, + .init ( ~pll_locked ), + .clk ( clock_96 ), + .wtbt ( 2'b00 ), + .dout ( rom_do ), + .din ( {ioctl_dout, ioctl_dout} ), + .addr ( ioctl_downl ? ioctl_addr : rom_addr ), + .we ( ioctl_downl & ioctl_wr ), + .rd ( !ioctl_downl), + .ready() +); + bagman bagman( .clock_12(clock_12), @@ -64,6 +114,9 @@ bagman bagman( .video_hs(hs), .video_vs(vs), .audio_out(audio), + .roms_addr ( rom_addr ), + .roms_do ( rom_do[7:0] ), + .roms_rd ( rom_rd ), .start2(btn_two_players), .start1(btn_one_player), .coin1(btn_coin), @@ -108,7 +161,7 @@ video_mixer video_mixer( mist_io #( .STRLEN(($size(CONF_STR)>>3))) mist_io( - .clk_sys (clock_24 ), + .clk_sys (clock_96 ), .conf_str (CONF_STR ), .SPI_SCK (SPI_SCK ), .CONF_DATA0 (CONF_DATA0 ), diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/bagman_palette.vhd b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/bagman_palette.vhd deleted file mode 100644 index e5b82ca7..00000000 --- a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/bagman_palette.vhd +++ /dev/null @@ -1,26 +0,0 @@ -library ieee; -use ieee.std_logic_1164.all,ieee.numeric_std.all; - -entity bagman_palette is -port ( - clk : in std_logic; - addr : in std_logic_vector(5 downto 0); - data : out std_logic_vector(7 downto 0) -); -end entity; - -architecture prom of bagman_palette is - type rom is array(0 to 63) of std_logic_vector(7 downto 0); - signal rom_data: rom := ( - X"00",X"07",X"3F",X"C0",X"00",X"07",X"3F",X"C0",X"00",X"07",X"38",X"EA",X"00",X"FB",X"C7",X"3E", - X"00",X"07",X"EA",X"FF",X"00",X"0F",X"8F",X"FA",X"00",X"07",X"27",X"F0",X"00",X"2F",X"F7",X"A7", - X"00",X"2F",X"4F",X"FF",X"00",X"07",X"3F",X"C0",X"00",X"17",X"27",X"E8",X"00",X"07",X"1F",X"FF", - X"00",X"27",X"EA",X"FF",X"00",X"3D",X"FF",X"E8",X"00",X"38",X"38",X"38",X"00",X"26",X"1D",X"FC"); -begin -process(clk) -begin - if rising_edge(clk) then - data <= rom_data(to_integer(unsigned(addr))); - end if; -end process; -end architecture; diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/bagman_program.vhd b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/bagman_program.vhd deleted file mode 100644 index a7ac2acb..00000000 --- a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/bagman_program.vhd +++ /dev/null @@ -1,1558 +0,0 @@ -library ieee; -use ieee.std_logic_1164.all,ieee.numeric_std.all; - -entity bagman_program is -port ( - clk : in std_logic; - addr : in std_logic_vector(14 downto 0); - data : out std_logic_vector(7 downto 0) -); -end entity; - -architecture prom of bagman_program is - type rom is array(0 to 24575) of std_logic_vector(7 downto 0); - signal rom_data: rom := ( - X"C3",X"00",X"12",X"04",X"03",X"40",X"64",X"06",X"C0",X"40",X"41",X"14",X"9D",X"08",X"24",X"A0", - X"42",X"06",X"26",X"48",X"18",X"00",X"20",X"40",X"07",X"24",X"0C",X"50",X"01",X"C0",X"04",X"04", - X"41",X"05",X"01",X"00",X"CC",X"C1",X"60",X"C0",X"29",X"04",X"1C",X"E1",X"08",X"C0",X"01",X"41", - X"04",X"50",X"02",X"40",X"48",X"C0",X"42",X"2B",X"F5",X"C5",X"D5",X"E5",X"DD",X"E5",X"FD",X"E5", - X"D9",X"C5",X"D5",X"E5",X"08",X"F5",X"CD",X"47",X"3C",X"AF",X"32",X"00",X"A0",X"F3",X"CD",X"23", - X"31",X"CD",X"FA",X"38",X"3A",X"42",X"61",X"3C",X"32",X"42",X"61",X"3A",X"74",X"62",X"FE",X"01", - X"28",X"05",X"3A",X"ED",X"61",X"FE",X"00",X"CC",X"7F",X"0F",X"3A",X"6F",X"62",X"FE",X"01",X"CA", - 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http://code.google.com/p/mist-board/ +// +// Copyright (c) 2014 Till Harbaum +// +// This source file is free software: you can redistribute it and/or modify +// it under the terms of the GNU General Public License as published +// by the Free Software Foundation, either version 3 of the License, or +// (at your option) any later version. +// +// This source file is distributed in the hope that it will be useful, +// but WITHOUT ANY WARRANTY; without even the implied warranty of +// MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the +// GNU General Public License for more details. +// +// You should have received a copy of the GNU General Public License +// along with this program. If not, see . +// +/////////////////////////////////////////////////////////////////////// + +module data_io +( + input clk_sys, + input SPI_SCK, + input SPI_SS2, + input SPI_DI, + + // ARM -> FPGA download + output reg ioctl_download = 0, // signal indicating an active download + output reg [7:0] ioctl_index, // menu index used to upload the file + output ioctl_wr, + output reg [24:0] ioctl_addr, + output reg [7:0] ioctl_dout +); + +/////////////////////////////// DOWNLOADING /////////////////////////////// + +reg [7:0] data_w; +reg [24:0] addr_w; +reg rclk = 0; + +localparam UIO_FILE_TX = 8'h53; +localparam UIO_FILE_TX_DAT = 8'h54; +localparam UIO_FILE_INDEX = 8'h55; + +// data_io has its own SPI interface to the io controller +always@(posedge SPI_SCK, posedge SPI_SS2) begin + reg [6:0] sbuf; + reg [7:0] cmd; + reg [4:0] cnt; + reg [24:0] addr; + + if(SPI_SS2) cnt <= 0; + else begin + rclk <= 0; + + // don't shift in last bit. It is evaluated directly + // when writing to ram + if(cnt != 15) sbuf <= { sbuf[5:0], SPI_DI}; + + // increase target address after write + if(rclk) addr <= addr + 1'd1; + + // count 0-7 8-15 8-15 ... + if(cnt < 15) cnt <= cnt + 1'd1; + else cnt <= 8; + + // finished command byte + if(cnt == 7) cmd <= {sbuf, SPI_DI}; + + // prepare/end transmission + if((cmd == UIO_FILE_TX) && (cnt == 15)) begin + // prepare + if(SPI_DI) begin + addr <= 0; + ioctl_download <= 1; + end else begin + addr_w <= addr; + ioctl_download <= 0; + end + end + + // command 0x54: UIO_FILE_TX + if((cmd == UIO_FILE_TX_DAT) && (cnt == 15)) begin + addr_w <= addr; + data_w <= {sbuf, SPI_DI}; + rclk <= 1; + end + + // expose file (menu) index + if((cmd == UIO_FILE_INDEX) && (cnt == 15)) ioctl_index <= {sbuf, SPI_DI}; + end +end + +assign ioctl_wr = |ioctl_wrd; +reg [1:0] ioctl_wrd; + +always@(negedge clk_sys) begin + reg rclkD, rclkD2; + + rclkD <= rclk; + rclkD2 <= rclkD; + ioctl_wrd<= {ioctl_wrd[0],1'b0}; + + if(rclkD & ~rclkD2) begin + ioctl_dout <= data_w; + ioctl_addr <= addr_w; + ioctl_wrd <= 2'b11; + end +end + +endmodule diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/pll.v b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/pll.v index 34c7949f..973a7f0a 100644 --- a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/pll.v +++ b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/pll.v @@ -41,31 +41,35 @@ module pll ( c0, c1, c2, + c3, locked); input inclk0; output c0; output c1; output c2; + output c3; output locked; wire [4:0] sub_wire0; - wire sub_wire2; - wire [0:0] sub_wire7 = 1'h0; - wire [2:2] sub_wire4 = sub_wire0[2:2]; - wire [0:0] sub_wire3 = sub_wire0[0:0]; + wire sub_wire3; + wire [0:0] sub_wire8 = 1'h0; + wire [2:2] sub_wire5 = sub_wire0[2:2]; + wire [0:0] sub_wire4 = sub_wire0[0:0]; + wire [3:3] sub_wire2 = sub_wire0[3:3]; wire [1:1] sub_wire1 = sub_wire0[1:1]; wire c1 = sub_wire1; - wire locked = sub_wire2; - wire c0 = sub_wire3; - wire c2 = sub_wire4; - wire sub_wire5 = inclk0; - wire [1:0] sub_wire6 = {sub_wire7, sub_wire5}; + wire c3 = sub_wire2; + wire locked = sub_wire3; + wire c0 = sub_wire4; + wire c2 = sub_wire5; + wire sub_wire6 = inclk0; + wire [1:0] sub_wire7 = {sub_wire8, sub_wire6}; altpll altpll_component ( - .inclk (sub_wire6), + .inclk (sub_wire7), .clk (sub_wire0), - .locked (sub_wire2), + .locked (sub_wire3), .activeclock (), .areset (1'b0), .clkbad (), @@ -114,6 +118,10 @@ module pll ( altpll_component.clk2_duty_cycle = 50, altpll_component.clk2_multiply_by = 47, altpll_component.clk2_phase_shift = "0", + altpll_component.clk3_divide_by = 26, + altpll_component.clk3_duty_cycle = 50, + altpll_component.clk3_multiply_by = 47, + altpll_component.clk3_phase_shift = "0", altpll_component.compensate_clock = "CLK0", altpll_component.inclk0_input_frequency = 37037, altpll_component.intended_device_family = "Cyclone III", @@ -149,7 +157,7 @@ module pll ( altpll_component.port_clk0 = "PORT_USED", altpll_component.port_clk1 = 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Bagman_MiST/rtl/rom/9.9m deleted file mode 100644 index 17a52098..00000000 --- a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/9.9m +++ /dev/null @@ -1 +0,0 @@ -àààààÛFààÛÛÛÛÛÛÛÛÛààÛÛÛÛÛÛFààÛÛààààààÛFààÛÛÛÛÛÛÛÛÛàßÛÛÛÛÛÛFààÛÛààà‚ààPFààPÛ@ÛÛÛÛÛFààP[Z[ÛÛFJàPÛààà‚ààPFààPÛÛÛÛÛÛÛFààPZ[ZÛÛFKIPÛààà‚àßûùßßPÛÛÛZFäþùßßP[Z[ÛÛFààPÛàÀà‚àÿÿÿÿÿPÛZ[FàÿÿÿÿPÛ[ÛÛFààPÛààà‚àÞúüÞÞPÛÛ[ZFàÞúÞÞPÛÛÛÛÛFààPÛààà‚JàPFééPÛÛZ[FààFJàPÛÛÛÛFJàPÛàààƒKIPFééèÛÛ[ZFààFKIP ÛÛÛÛFKIPÛààààààPìðééÉÛZ[FààFàßûþþþþþùßßPÛààààààPÛñééÉÚ[ZFààFàÿÿÿÿÿÿÿÿÿÿPÛààààààPÛìðééÉÛ[FààFJÞúýüÞÞúüÞÞPÛàààUQWPÛÛñééÉÚZFààFKIÛÛFKIPFJàPÛàààVRàPÛAìðééÉ[FàßûßßÛîààPFKIPÛààààààPÛÛñééÉÚFàÿÿÿÿÛíïààPFààPÛààààààPÛÛÛìðééÉFåýýýýÛîàààPFààPÛààààààPÛÛÛÛñééÉÚÛ ÛÛíïàà]ÛFààPÛààààààPÛÛÛÛìðééÉÛÛÛÛÛîààà^ÛFààPÛààààààPÛ ÛÛÛñééÉÚÛÛÛíïàà]\ÛFààPÛààààààPÛÛÛÛÛìðééÉÛÛîààà^ÛÛFààPÛààààààPÛÛÛÛÛñééÉÚÛíïàà]\GÛFààPÛààààààPÛÛÛÛÛìðééÉFààà^ÛHÛFààPÛàààJàPÛÛ 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\ No newline at end of file diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/SBAGMAN2.ROM b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/SBAGMAN2.ROM deleted file mode 100644 index 52e7f71c..00000000 Binary files a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/SBAGMAN2.ROM and /dev/null differ diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/bagman_palette b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/bagman_palette deleted file mode 100644 index 26c21c35..00000000 Binary files a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/bagman_palette and /dev/null differ diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/make_sbagman_proms.bat b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/make_sbagman_proms.bat deleted file mode 100644 index 5d0129be..00000000 --- a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/make_sbagman_proms.bat +++ /dev/null @@ -1,17 +0,0 @@ -copy /B 5.9e + 6.9f + 7.9j + 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Bagman_MiST/rtl/rom/p3.bin b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/p3.bin deleted file mode 100644 index 15a8fad3..00000000 Binary files a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/p3.bin and /dev/null differ diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/r3.bin b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/r3.bin deleted file mode 100644 index 54d35691..00000000 Binary files a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/r3.bin and /dev/null differ diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/sbagman.zip b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/sbagman.zip deleted file mode 100644 index 7a351559..00000000 Binary files a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/sbagman.zip and /dev/null differ diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/bagman_palette.vhd b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/sbagman_palette.vhd similarity index 92% rename from Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/bagman_palette.vhd rename to Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/sbagman_palette.vhd index e5b82ca7..fb30bc18 100644 --- a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/bagman_palette.vhd +++ b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/sbagman_palette.vhd @@ -1,7 +1,7 @@ library ieee; use ieee.std_logic_1164.all,ieee.numeric_std.all; -entity bagman_palette is +entity sbagman_palette is port ( clk : in std_logic; addr : in std_logic_vector(5 downto 0); @@ -9,7 +9,7 @@ port ( ); end entity; -architecture prom of bagman_palette is +architecture prom of sbagman_palette is type rom is array(0 to 63) of std_logic_vector(7 downto 0); signal rom_data: rom := ( X"00",X"07",X"3F",X"C0",X"00",X"07",X"3F",X"C0",X"00",X"07",X"38",X"EA",X"00",X"FB",X"C7",X"3E", diff --git a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/sbagman_program.vhd b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/sbagman_program.vhd deleted file mode 100644 index 215a2b93..00000000 --- a/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/rom/sbagman_program.vhd +++ /dev/null @@ -1,1558 +0,0 @@ -library ieee; -use ieee.std_logic_1164.all,ieee.numeric_std.all; - -entity sbagman_program is -port ( - clk : in std_logic; - addr : in std_logic_vector(14 downto 0); - data : out std_logic_vector(7 downto 0) -); -end entity; - -architecture prom of sbagman_program is - type rom is array(0 to 24575) of std_logic_vector(7 downto 0); - signal rom_data: rom := ( - X"C3",X"A8",X"EC",X"9B",X"AE",X"7B",X"04",X"80",X"E4",X"0E",X"00",X"11",X"4F",X"92",X"60",X"A3", - X"C4",X"F7",X"04",X"02",X"F7",X"FE",X"03",X"19",X"06",X"13",X"80",X"00",X"6D",X"9F",X"42",X"02", - X"E2",X"16",X"00",X"08",X"97",X"73",X"58",X"00",X"B6",X"1F",X"00",X"08",X"85",X"57",X"00",X"01", - X"F2",X"5B",X"01",X"00",X"A2",X"5C",X"00",X"10",X"F3",X"F5",X"C5",X"D5",X"E5",X"DD",X"E5",X"FD", - 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Bagman_MiST/rtl/sdram.sv b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/sdram.sv new file mode 100644 index 00000000..8f927d05 --- /dev/null +++ b/Arcade_MiST/Bagman Hardware/Super Bagman_MiST/rtl/sdram.sv @@ -0,0 +1,254 @@ +// +// sdram.v +// +// Static RAM controller implementation using SDRAM MT48LC16M16A2 +// +// Copyright (c) 2015,2016 Sorgelig +// +// Some parts of SDRAM code used from project: +// http://hamsterworks.co.nz/mediawiki/index.php/Simple_SDRAM_Controller +// +// This source file is free software: you can redistribute it and/or modify +// it under the terms of the GNU General Public License as published +// by the Free Software Foundation, either version 3 of the License, or +// (at your option) any later version. +// +// This source file is distributed in the hope that it will be useful, +// but WITHOUT ANY WARRANTY; without even the implied warranty of +// MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the +// GNU General Public License for more details. +// +// You should have received a copy of the GNU General Public License +// along with this program. If not, see . +// +// ------------------------------------------ +// +// v2.1 - Add universal 8/16 bit mode. +// + +module sdram +( + input init, // reset to initialize RAM + input clk, // clock ~100MHz + // + // SDRAM_* - signals to the MT48LC16M16 chip + inout reg [15:0] SDRAM_DQ, // 16 bit bidirectional data bus + output reg [12:0] SDRAM_A, // 13 bit multiplexed address bus + output reg SDRAM_DQML, // two byte masks + output reg SDRAM_DQMH, // + output reg [1:0] SDRAM_BA, // two banks + output SDRAM_nCS, // a single chip select + output SDRAM_nWE, // write enable + output SDRAM_nRAS, // row address select + output SDRAM_nCAS, // columns address select + output SDRAM_CKE, // clock enable + // + input [1:0] wtbt, // 16bit mode: bit1 - write high byte, bit0 - write low byte, + // 8bit mode: 2'b00 - use addr[0] to decide which byte to write + // Ignored while reading. + // + input [24:0] addr, // 25 bit address for 8bit mode. addr[0] = 0 for 16bit mode for correct operations. + output [15:0] dout, // data output to cpu + input [15:0] din, // data input from cpu + input we, // cpu requests write + input rd, // cpu requests read + output reg ready // dout is valid. Ready to accept new read/write. +); + +assign SDRAM_nCS = command[3]; +assign SDRAM_nRAS = command[2]; +assign SDRAM_nCAS = command[1]; +assign SDRAM_nWE = command[0]; +assign SDRAM_CKE = cke; + +// no burst configured +localparam BURST_LENGTH = 3'b000; // 000=1, 001=2, 010=4, 011=8 +localparam ACCESS_TYPE = 1'b0; // 0=sequential, 1=interleaved +localparam CAS_LATENCY = 3'd2; // 2 for < 100MHz, 3 for >100MHz +localparam OP_MODE = 2'b00; // only 00 (standard operation) allowed +localparam NO_WRITE_BURST = 1'b1; // 0= write burst enabled, 1=only single access write +localparam MODE = {3'b000, NO_WRITE_BURST, OP_MODE, CAS_LATENCY, ACCESS_TYPE, BURST_LENGTH}; + +localparam sdram_startup_cycles= 14'd12100;// 100us, plus a little more, @ 100MHz +localparam cycles_per_refresh = 14'd186; // (64000*36)/8192-1 Calc'd as (64ms @ 36MHz)/8192 rose +localparam startup_refresh_max = 14'b11111111111111; + +// SDRAM commands +localparam CMD_INHIBIT = 4'b1111; +localparam CMD_NOP = 4'b0111; +localparam CMD_ACTIVE = 4'b0011; +localparam CMD_READ = 4'b0101; +localparam CMD_WRITE = 4'b0100; +localparam CMD_BURST_TERMINATE = 4'b0110; +localparam CMD_PRECHARGE = 4'b0010; +localparam CMD_AUTO_REFRESH = 4'b0001; +localparam CMD_LOAD_MODE = 4'b0000; + +reg [13:0] refresh_count = startup_refresh_max - sdram_startup_cycles; +reg [3:0] command = CMD_INHIBIT; +reg cke = 0; +reg [24:0] save_addr; +reg [15:0] data; + +assign dout = save_addr[0] ? {data[7:0], data[15:8]} : {data[15:8], data[7:0]}; +typedef enum +{ + STATE_STARTUP, + STATE_OPEN_1, + STATE_WRITE, + STATE_READ, + STATE_IDLE, STATE_IDLE_1, STATE_IDLE_2, STATE_IDLE_3, + STATE_IDLE_4, STATE_IDLE_5, STATE_IDLE_6, STATE_IDLE_7 +} state_t; + +state_t state = STATE_STARTUP; + +always @(posedge clk) begin + reg old_we, old_rd; + reg [CAS_LATENCY:0] data_ready_delay; + + reg [15:0] new_data; + reg [1:0] new_wtbt; + reg new_we; + reg new_rd; + reg save_we = 1; + + + command <= CMD_NOP; + refresh_count <= refresh_count+1'b1; + + data_ready_delay <= {1'b0, data_ready_delay[CAS_LATENCY:1]}; + + if(data_ready_delay[0]) data <= SDRAM_DQ; + + case(state) + STATE_STARTUP: begin + //------------------------------------------------------------------------ + //-- This is the initial startup state, where we wait for at least 100us + //-- before starting the start sequence + //-- + //-- The initialisation is sequence is + //-- * de-assert SDRAM_CKE + //-- * 100us wait, + //-- * assert SDRAM_CKE + //-- * wait at least one cycle, + //-- * PRECHARGE + //-- * wait 2 cycles + //-- * REFRESH, + //-- * tREF wait + //-- * REFRESH, + //-- * tREF wait + //-- * LOAD_MODE_REG + //-- * 2 cycles wait + //------------------------------------------------------------------------ + cke <= 1; + SDRAM_DQ <= 16'bZZZZZZZZZZZZZZZZ; + SDRAM_DQML <= 1; + SDRAM_DQMH <= 1; + SDRAM_A <= 0; + SDRAM_BA <= 0; + + // All the commands during the startup are NOPS, except these + if(refresh_count == startup_refresh_max-31) begin + // ensure all rows are closed + command <= CMD_PRECHARGE; + SDRAM_A[10] <= 1; // all banks + SDRAM_BA <= 2'b00; + end else if (refresh_count == startup_refresh_max-23) begin + // these refreshes need to be at least tREF (66ns) apart + command <= CMD_AUTO_REFRESH; + end else if (refresh_count == startup_refresh_max-15) + command <= CMD_AUTO_REFRESH; + else if (refresh_count == startup_refresh_max-7) begin + // Now load the mode register + command <= CMD_LOAD_MODE; + SDRAM_A <= MODE; + end + + //------------------------------------------------------ + //-- if startup is complete then go into idle mode, + //-- get prepared to accept a new command, and schedule + //-- the first refresh cycle + //------------------------------------------------------ + if(!refresh_count) begin + state <= STATE_IDLE; + ready <= 1; + refresh_count <= 0; + end + end + + STATE_IDLE_7: state <= STATE_IDLE_6; + STATE_IDLE_6: state <= STATE_IDLE_5; + STATE_IDLE_5: state <= STATE_IDLE_4; + STATE_IDLE_4: state <= STATE_IDLE_3; + STATE_IDLE_3: state <= STATE_IDLE_2; + STATE_IDLE_2: state <= STATE_IDLE_1; + STATE_IDLE_1: begin + SDRAM_DQ <= 16'bZZZZZZZZZZZZZZZZ; + state <= STATE_IDLE; + // mask possible refresh to reduce colliding. + if(refresh_count > cycles_per_refresh) begin + //------------------------------------------------------------------------ + //-- Start the refresh cycle. + //-- This tasks tRFC (66ns), so 2 idle cycles are needed @ 36MHz + //------------------------------------------------------------------------ + state <= STATE_IDLE_2; + command <= CMD_AUTO_REFRESH; + refresh_count <= refresh_count - cycles_per_refresh + 1'd1; + end + end + + STATE_IDLE: begin + // Priority is to issue a refresh if one is outstanding + if(refresh_count > (cycles_per_refresh<<1)) state <= STATE_IDLE_1; + else if(new_rd | new_we) begin + new_we <= 0; + new_rd <= 0; + save_addr<= addr; + save_we <= new_we; + state <= STATE_OPEN_1; + command <= CMD_ACTIVE; + SDRAM_A <= addr[13:1]; + SDRAM_BA <= addr[24:23]; + end + end + + // ACTIVE-to-READ or WRITE delay >20ns (1 cycle @ 36 MHz)(-75) + STATE_OPEN_1: begin + SDRAM_A <= {4'b0010, save_addr[22:14]}; + SDRAM_DQML <= save_we & (new_wtbt ? ~new_wtbt[0] : save_addr[0]); + SDRAM_DQMH <= save_we & (new_wtbt ? ~new_wtbt[1] : ~save_addr[0]); + state <= save_we ? STATE_WRITE : STATE_READ; + end + + STATE_READ: begin + state <= STATE_IDLE_5; + command <= CMD_READ; + SDRAM_DQ <= 16'bZZZZZZZZZZZZZZZZ; + + // Schedule reading the data values off the bus + data_ready_delay[CAS_LATENCY] <= 1; + end + + STATE_WRITE: begin + state <= STATE_IDLE_5; + command <= CMD_WRITE; + SDRAM_DQ <= new_wtbt ? new_data : {new_data[7:0], new_data[7:0]}; + ready <= 1; + end + endcase + + if(init) begin + state <= STATE_STARTUP; + refresh_count <= startup_refresh_max - sdram_startup_cycles; + end + + old_we <= we; + old_rd <= rd; + if(we & ~old_we) {ready, new_we, new_data, new_wtbt} <= {1'b0, 1'b1, din, wtbt}; + else + if((rd & ~old_rd) || (rd & old_rd & (save_addr != addr))) {ready, new_rd} <= {1'b0, 1'b1}; + +end + +endmodule