diff --git a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centipede.qpf b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centiped.qpf similarity index 97% rename from Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centipede.qpf rename to Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centiped.qpf index bbd04726..81af7a3d 100644 --- a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centipede.qpf +++ b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centiped.qpf @@ -27,4 +27,4 @@ DATE = "14:59:16 November 16, 2017" # Revisions -PROJECT_REVISION = "Centipede" \ No newline at end of file +PROJECT_REVISION = "Centiped" \ No newline at end of file diff --git a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centipede.qsf b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centiped.qsf similarity index 96% rename from Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centipede.qsf rename to Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centiped.qsf index 6968eb00..41271f8d 100644 --- a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centipede.qsf +++ b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centiped.qsf @@ -145,21 +145,17 @@ set_global_assignment -name OUTPUT_IO_TIMING_FAR_END_VMEAS "HALF SIGNAL SWING" - set_global_assignment -name PARTITION_NETLIST_TYPE SOURCE -section_id Top set_global_assignment -name PARTITION_FITTER_PRESERVATION_LEVEL PLACEMENT_AND_ROUTING -section_id Top set_global_assignment -name PARTITION_COLOR 16764057 -section_id Top +set_global_assignment -name ENABLE_SIGNALTAP OFF +set_global_assignment -name USE_SIGNALTAP_FILE output_files/cent.stp set_global_assignment -name SYSTEMVERILOG_FILE rtl/Centipede_MiST.sv set_global_assignment -name VERILOG_FILE rtl/centipede.v set_global_assignment -name VERILOG_FILE rtl/pf_ram.v -set_global_assignment -name VHDL_FILE rtl/roms/F7.vhd -set_global_assignment -name VHDL_FILE rtl/roms/HJ7.vhd -set_global_assignment -name VHDL_FILE rtl/roms/PROG.vhd -set_global_assignment -name VHDL_FILE rtl/roms/P4.vhd set_global_assignment -name VHDL_FILE rtl/spram.vhd set_global_assignment -name VHDL_FILE rtl/dpram.vhd set_global_assignment -name VHDL_FILE rtl/pll.vhd -set_global_assignment -name QIP_FILE ../../../common/mist/mist.qip set_global_assignment -name SYSTEMVERILOG_FILE rtl/POKEY.sv set_global_assignment -name SYSTEMVERILOG_FILE rtl/matoro.sv +set_global_assignment -name QIP_FILE ../../../common/mist/mist.qip set_global_assignment -name QIP_FILE ../../../common/CPU/T65/T65.qip -set_global_assignment -name ENABLE_SIGNALTAP OFF -set_global_assignment -name USE_SIGNALTAP_FILE output_files/cent.stp set_global_assignment -name SIGNALTAP_FILE output_files/cent.stp set_instance_assignment -name PARTITION_HIERARCHY root_partition -to | -section_id Top \ No newline at end of file diff --git a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centipede.sdc b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centiped.sdc similarity index 87% rename from Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centipede.sdc rename to Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centiped.sdc index 1d0f7c84..69dc312a 100644 --- a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centipede.sdc +++ b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/Centiped.sdc @@ -72,12 +72,12 @@ create_clock -name {SPI_SCK} -period 41.666 -waveform { 20.8 41.666 } [get_port # Set Input Delay #************************************************************** -set_input_delay -add_delay -clock_fall -clock [get_clocks {CLOCK_27}] 1.000 [get_ports {CLOCK_27}] -set_input_delay -add_delay -clock_fall -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {CONF_DATA0}] -set_input_delay -add_delay -clock_fall -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_DI}] -set_input_delay -add_delay -clock_fall -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_SCK}] -set_input_delay -add_delay -clock_fall -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_SS2}] -set_input_delay -add_delay -clock_fall -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_SS3}] +set_input_delay -add_delay -clock [get_clocks {CLOCK_27}] 1.000 [get_ports {CLOCK_27}] +set_input_delay -add_delay -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {CONF_DATA0}] +set_input_delay -add_delay -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_DI}] +set_input_delay -add_delay -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_SCK}] +set_input_delay -add_delay -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_SS2}] +set_input_delay -add_delay -clock [get_clocks {SPI_SCK}] 1.000 [get_ports {SPI_SS3}] #************************************************************** # Set Output Delay diff --git a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/README.txt b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/README.txt index 126df0b2..be27738e 100644 --- a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/README.txt +++ b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/README.txt @@ -1,15 +1,28 @@ Arcade: Centipede port to MiST by Gehstock 24 November 2018 --- --- - Only controls and OSD are rotated on Video output. +Millipede added by Gyorgy Szombathelyi - Keyboard inputs : +April 2021 - ESC : Coin/Start Player --- - SPACE : Fire or Fire Button --- - ARROW KEYS : Movements \ No newline at end of file +-- +-- +-- Usage: +-- - Create ROM and ARC files from the MRA files using the MRA utility. +-- Example: mra -A -z /path/to/mame/roms Centipede.mra +-- - Copy the ROM files to the root of the SD Card +-- - Copy the RBF and ARC files to the same folder on the SD Card +-- +-- MRA utility: https://github.com/sebdel/mra-tools-c/ +-- + +-- Only controls and OSD are rotated on Video output. + +-- Keyboard inputs : + +-- ESC : Coin/Start Player +-- +-- CTRL : Fire or Fire Button +-- +-- ARROW KEYS : Movements \ No newline at end of file diff --git a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/meta/Centipede (revision 4).mra b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/meta/Centipede (revision 4).mra new file mode 100644 index 00000000..90f3d924 --- /dev/null +++ b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/meta/Centipede (revision 4).mra @@ -0,0 +1,38 @@ + + Centipede (revision 4) + 0220 + centiped + 20200430141713 + 1980 + Atari + Maze / Bugs + Maze / Centipede + Maze / Spiders + centiped + + + + + + + + + + + + + + + + + + + + + + + + + + + \ No newline at end of file diff --git a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/meta/Centipede.mra b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/meta/Centipede.mra new file mode 100644 index 00000000..9b7a0dcc --- /dev/null +++ b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/meta/Centipede.mra @@ -0,0 +1,37 @@ + + Centipede (revision 3) + 0218 + centiped3 + 20200225084106 + 1980 + Atari + Maze / Bugs + Maze / Centipede + Maze / Spiders + centiped + + + + + + + + + + + + + + + + + + + + + + + + + + \ No newline at end of file diff --git a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/meta/Millipede.mra b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/meta/Millipede.mra new file mode 100644 index 00000000..52decf04 --- /dev/null +++ b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/meta/Millipede.mra @@ -0,0 +1,33 @@ + + Millipede + 0218 + milliped + 20200225084106 + 1980 + Atari + Maze / Bugs + Maze / Centipede + Maze / Spiders + centiped + + + + + + + 1 + + + + + + + + + + + + + + + \ No newline at end of file diff --git a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/Centipede_MiST.sv b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/Centipede_MiST.sv index 8929dc6a..e4e2a64f 100644 --- a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/Centipede_MiST.sv +++ b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/Centipede_MiST.sv @@ -40,16 +40,13 @@ module Centipede_MiST `include "rtl\build_id.v" localparam CONF_STR = { - "Centipede;;", + "CENTIPED;;", "O2,Rotate Controls,Off,On;", "O34,Scanlines,Off,25%,50%,75%;", "O5,Blend,Off,On;", "O7,Test,Off,On;", - "O89,Language,English,German,French,Spanish;", - "OAB,Lives,2,3,4,5;", - "OCD,Bonus Life,10000,12000,15000,20000;", - "OE,Difficulty,Hard,Easy;", - "OF,Credit minimum,1,2;", + "DIP;", + "R64,Save highscores;", "T0,Reset;", "V,v1.50.",`BUILD_DATE }; @@ -60,11 +57,13 @@ wire blend = status[5]; wire joyswap = status[6]; wire service = status[7]; +wire milliped = core_mod[0]; + wire [15:0] dipsw; assign dipsw[ 7:0] = status[15:8]; assign dipsw[15:8] = 8'h01; -assign LED = 1; +assign LED = ~(ioctl_downl | ioctl_upl); assign AUDIO_R = AUDIO_L; wire clk_24, clk_12, clk_100mhz; @@ -76,29 +75,55 @@ pll pll( .c2(clk_12), .c4(clk_100mhz) ); - + wire [31:0] status; wire [1:0] buttons; wire [1:0] switches; wire [7:0] joystick_0; wire [7:0] joystick_1; wire scandoublerD; +wire [7:0] core_mod; wire ypbpr; wire no_csync; wire key_pressed; wire [7:0] key_code; wire key_strobe; -wire [7:0] RGB; +wire [7:0] RGB; wire hs, vs, vb, hb; -reg blankn; +wire blankn = ~(hb | vb); wire [3:0] audio; -always @(posedge clk_12) blankn <= ~(hb | vb); +wire ioctl_downl; +wire ioctl_upl; +wire [7:0] ioctl_index; +wire ioctl_wr; +wire [24:0] ioctl_addr; +wire [7:0] ioctl_dout; +wire [7:0] ioctl_din; + +data_io data_io( + .clk_sys ( clk_12 ), + .SPI_SCK ( SPI_SCK ), + .SPI_SS2 ( SPI_SS2 ), + .SPI_DI ( SPI_DI ), + .SPI_DO ( SPI_DO ), + .ioctl_download( ioctl_downl ), + .ioctl_upload ( ioctl_upl ), + .ioctl_index ( ioctl_index ), + .ioctl_wr ( ioctl_wr ), + .ioctl_addr ( ioctl_addr ), + .ioctl_dout ( ioctl_dout ), + .ioctl_din ( ioctl_din ) +); + +reg reset; +always @(posedge clk_12) reset <= status[0] | buttons[1] | ioctl_downl; centipede centipede( .clk_100mhz(clk_100mhz), .clk_12mhz(clk_12), - .reset(status[0] | buttons[1]), + .reset(reset), + .milli(milliped), .playerinput_i(~{ 1'b0, 1'b0, m_coin1, service, 1'b0, 1'b0, m_two_players, m_one_player, m_fireB, m_fireA }), .trakball_i(), .joystick_i(~{m_right , m_left, m_down, m_up, m_right , m_left, m_down, m_up}), @@ -109,17 +134,26 @@ centipede centipede( .vsync_o(vs), .hblank_o(hb), .vblank_o(vb), - .audio_o(audio) + .audio_o(audio), + // ROM download + .dl_addr(ioctl_addr[14:0]), + .dl_data(ioctl_dout), + .dl_we(ioctl_wr && ioctl_index == 0), + // High score table save-load + .hsram_addr(ioctl_addr[5:0]), + .hsram_dout(ioctl_din), + .hsram_din(ioctl_dout), + .hsram_we(ioctl_wr && ioctl_index == 8'hff) ); - + mist_video #(.COLOR_DEPTH(3), .SD_HCNT_WIDTH(10)) mist_video( .clk_sys ( clk_24 ), .SPI_SCK ( SPI_SCK ), .SPI_SS3 ( SPI_SS3 ), .SPI_DI ( SPI_DI ), - .R (blankn ? RGB[2:0] : 0), - .G (blankn ? RGB[5:3] : 0), - .B (blankn ? RGB[7:6] : 0), + .R (blankn ? RGB[2:0] : 0), + .G (blankn ? RGB[5:3] : 0), + .B (blankn ? RGB[7:6] : 0), .HSync ( hs ), .VSync ( vs ), .VGA_R ( VGA_R ), @@ -127,14 +161,15 @@ mist_video #(.COLOR_DEPTH(3), .SD_HCNT_WIDTH(10)) mist_video( .VGA_B ( VGA_B ), .VGA_VS ( VGA_VS ), .VGA_HS ( VGA_HS ), + .scanlines ( scanlines ), .rotate ( { 1'b0, rotate } ), .ce_divider ( 1'b1 ), .blend ( blend ), .scandoubler_disable(scandoublerD ), .no_csync ( no_csync ), .ypbpr ( ypbpr ) - ); - + ); + user_io #( .STRLEN(($size(CONF_STR)>>3))) user_io( @@ -146,17 +181,18 @@ user_io( .SPI_MOSI (SPI_DI ), .buttons (buttons ), .switches (switches ), - .scandoubler_disable (scandoublerD ), + .scandoubler_disable (scandoublerD ), .ypbpr (ypbpr ), .no_csync (no_csync ), + .core_mod (core_mod ), .key_strobe (key_strobe ), .key_pressed (key_pressed ), .key_code (key_code ), .joystick_0 (joystick_0 ), .joystick_1 (joystick_1 ), .status (status ) - ); - + ); + dac #( .C_bits(15)) dac ( @@ -165,7 +201,7 @@ dac ( .dac_i({2{audio,audio}}), .dac_o(AUDIO_L) ); - + wire m_up, m_down, m_left, m_right, m_fireA, m_fireB, m_fireC, m_fireD, m_fireE, m_fireF; wire m_up2, m_down2, m_left2, m_right2, m_fire2A, m_fire2B, m_fire2C, m_fire2D, m_fire2E, m_fire2F; wire m_tilt, m_coin1, m_coin2, m_coin3, m_coin4, m_one_player, m_two_players, m_three_players, m_four_players; @@ -178,12 +214,12 @@ arcade_inputs inputs ( .joystick_0 ( joystick_0 ), .joystick_1 ( joystick_1 ), .rotate ( rotate ), - .orientation ( 2'b01 ), + .orientation ( 2'b01 ), .joyswap ( joyswap ), - .oneplayer ( 1'b1 ), + .oneplayer ( 1'b1 ), .controls ( {m_tilt, m_coin4, m_coin3, m_coin2, m_coin1, m_four_players, m_three_players, m_two_players, m_one_player} ), .player1 ( {m_fireF, m_fireE, m_fireD, m_fireC, m_fireB, m_fireA, m_up, m_down, m_left, m_right} ), .player2 ( {m_fire2F, m_fire2E, m_fire2D, m_fire2C, m_fire2B, m_fire2A, m_up2, m_down2, m_left2, m_right2} ) -); +); endmodule diff --git a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/centipede.v b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/centipede.v index 541a2069..67f79219 100644 --- a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/centipede.v +++ b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/centipede.v @@ -14,11 +14,17 @@ // The game code also relies on the pokey's random number generation working correctly and caused me to // do some debugging of the pokey code I was using. // Edit: Changed 2018 Gehstock +// +// György Szombathelyi 04/2021 +// - Made it synchronous (still left some combinatorial async resets for an exercise to the reader) +// - Fixed the high score RAM +// - Added Millipede module centipede( input clk_100mhz, input clk_12mhz, input reset, + input milli, input [9:0] playerinput_i, input [7:0] trakball_i, input [7:0] joystick_i, @@ -31,7 +37,16 @@ module centipede( output vsync_o, output hblank_o, output vblank_o, - output [3:0] audio_o + output [3:0] audio_o, + + input [14:0] dl_addr, + input [7:0] dl_data, + input dl_we, + + input [5:0] hsram_addr, + output [7:0] hsram_dout, + input [7:0] hsram_din, + input hsram_we ); // @@ -44,16 +59,16 @@ module centipede( reg phi0a; // - wire rom_n; - wire ram0_n; - wire steerclr_n, watchdog_n, out0_n, irqres_n; - wire pokey_n, pokey2_n, swrd_n, pf_n; - wire coloram_n, ea_read_n, ea_ctrl_n, ea_addr_n; - wire in0_n, in1_n; + reg rom_n; + reg ram0_n; + reg steerclr_n, watchdog_n, out0_n, irqres_n; + reg pokey_n, pokey2_n, swrd_n, pf_n; + reg coloram_n, ea_read_n, ea_ctrl_n, ea_addr_n; + reg in0_n, in1_n; - wire pframrd_n; - wire pfwr3_n, pfwr2_n, pfwr1_n, pfwr0_n; - wire pfrd3_n, pfrd2_n, pfrd1_n, pfrd0_n; + reg pframrd_n; + reg pfwr3_n, pfwr2_n, pfwr1_n, pfwr0_n; + reg pfrd3_n, pfrd2_n, pfrd1_n, pfrd0_n; wire [9:0] adecode; wire pac_n; @@ -92,13 +107,13 @@ module centipede( wire s_4h_n_en; wire s_256hd_n; wire s_256h2d_n; - wire vblankd_n; + wire vblankd_n; wire s_6_12; - - reg s_256h2d; - reg s_256hd; - reg vblankd; - + + reg s_256h2d; + reg s_256hd; + reg vblankd; + wire pload_n; wire write_n; wire brw_n; @@ -125,15 +140,15 @@ module centipede( wire pf_addr_stamp; wire [31:0] pfd; - reg [29:16] pfd_hold; - reg [29:16] pfd_hold2; + reg [31:16] pfd_hold; + reg [31:16] pfd_hold2; reg [1:0] gry; wire [1:0] y; reg [1:0] mr; wire [7:0] line_ram_addr; - reg [1:0] line_ram[0:255]; + reg [3:0] line_ram[0:255]; reg [7:0] line_ram_ctr; wire line_ram_ctr_load; wire line_ram_ctr_clr; @@ -147,7 +162,7 @@ module centipede( wire [7:0] pf_rom1_out, pf_rom0_out; wire [7:0] pf_rom1_out_rev, pf_rom0_out_rev; - reg [7:0] pic; + reg [7:0] pic, picD; // @@ -160,22 +175,14 @@ module centipede( reg hs; wire hs_set; - wire hs_addr_clk; - wire hs_ctrl_clk; - // wire comp_sync; - reg [3:0] rgbi; - wire [3:0] coloram_out; - wire [3:0] coloram_rgbi; + reg [7:0] rgbi; + wire [7:0] coloram_out; + wire [7:0] coloram_rgbi; wire coloram_w_n; reg coloren; - wire [1:0] rama_sel; - wire [1:0] rama_hi; - wire [1:0] rama_lo; - wire [3:0] rama; - wire [3:0] audio; // wire mob_n; @@ -189,17 +196,19 @@ module centipede( wire [7:0] switch_out; wire flip; + wire cntrlsel; wire coin_ctr_r_drive, coin_ctr_c_drive, coin_ctr_l_drive; wire [7:0] playerin_out; wire [7:0] pokey_out; + wire [7:0] pokey2_out; reg [11:0] h_counter; reg [7:0] v_counter; wire v_counter_reset; initial h_counter = 0; - always @(posedge s_12mhz or posedge reset) + always @(posedge s_12mhz) if (reset) h_counter <= 0; else @@ -239,7 +248,7 @@ module centipede( assign v_counter_reset = reset | ~vreset == 0; - always @(posedge s_12mhz or posedge reset) + always @(posedge s_12mhz) if (reset) v_counter <= 0; else if (s_256h_n_en) @@ -254,77 +263,127 @@ module centipede( assign s_4v = v_counter[2]; assign s_8v = v_counter[3]; assign s_16v = v_counter[4]; - assign s_16v_en = s_256h_n_en & v_counter[4:0] == 5'b01111; + assign s_16v_en = s_256h_n_en & v_counter[4:0] == 5'b01111; assign s_32v = v_counter[5]; assign s_64v = v_counter[6]; assign s_128v = v_counter[7]; + assign mob_n = ~((s_256h_n & s_256hd) | (s_256h2d_n & s_256hd)) | milli; + + assign blank_clk = ~s_12mhz & (h_counter[3:0] == 4'b1111); + + always @(posedge s_12mhz) + if (reset) + begin + s_256h2d <= 1'b0; + s_256hd <= 1'b0; + vblankd <= 1'b0; + end + else if (h_counter[3:0] == 4'b1111) + begin + s_256h2d <= s_256hd; + s_256hd <= s_256h; + vblankd <= vblank; + end + + assign s_256h2d_n = ~s_256h2d; + assign s_256hd_n = ~s_256hd; + assign vblankd_n = ~vblankd; assign vprom_addr = {vblank, s_128v, s_64v, s_32v, s_8v, s_4v, s_2v, s_1v}; -P4 P4( - .clk(s_12mhz), - .addr(vprom_addr), - .data(vprom_out) - ); + dpram #( + .addr_width_g(8), + .data_width_g(4)) + P4( + .clk_a_i(s_12mhz), + .clk_b_i(s_12mhz), + .we_i(1'b0), + .addr_a_i(vprom_addr), + .data_a_o(vprom_out), + .data_a_i(), + .addr_b_i(dl_addr[7:0]), + .data_b_o(), + .data_b_i(dl_data[3:0]), + .we_b_i(dl_we && dl_addr[14:8] == 7'b1010000) + ); -always @(posedge s_12mhz or posedge reset) + always @(posedge s_12mhz) if (reset) vprom_reg <= 0; - else if (s_256h_n_en) - vprom_reg <= vprom_out; + else if (s_256h_n_en) + vprom_reg <= vprom_out; -assign vsync = vprom_reg[0]; -assign vreset = vprom_reg[2]; -assign hs_set = reset | ~s_256h_n; + assign vsync = vprom_reg[0]; + assign vreset = vprom_reg[2]; + assign hs_set = reset | ~s_256h_n; -always @(posedge s_12mhz or posedge hs_set) - if (hs_set) - hs <= 1; - else if (s_32h_en) - hs <= s_64h; + always @(posedge s_12mhz or posedge hs_set) + if (hs_set) + hs <= 1; + else if (s_32h_en) + hs <= s_64h; -assign hsync_reset = reset | hs; + assign hsync_reset = reset | hs; -always @(posedge s_12mhz or posedge hsync_reset) - if (hsync_reset) - hsync <= 0; - else if (s_8h_en) - hsync <= s_32h; + always @(posedge s_12mhz or posedge hsync_reset) + if (hsync_reset) + hsync <= 0; + else if (s_8h_en) + hsync <= s_32h; -always @(posedge s_12mhz) - if (reset) + always @(posedge s_12mhz) + if (reset) coloren <= 0; else if (s_6mhz_en) coloren <= s_256hd; -assign s_6_12 = ~(s_6mhz & s_12mhz); -reg xxx1; + assign s_6_12 = ~(s_6mhz & s_12mhz); + reg xxx1; -always @(posedge s_12mhz)//s_6_12) - if (reset) - xxx1 <= 0; - else if (s_6mhz_en) - xxx1 <= coloren; + always @(posedge s_12mhz)//s_6_12) + if (reset) + xxx1 <= 0; + else if (s_6mhz_en) + xxx1 <= coloren; -assign vblank = vprom_reg[3]; -assign hblank = ~(xxx1 | coloren); + reg hblank1_n; + always @(posedge s_12mhz) + if (reset) + hblank1_n <= 0; + else if (s_6mhz_n_en) + hblank1_n <= s_256hd; -PROG PROG ( - .clk(s_12mhz), - .addr(ab[12:0]), - .data(rom_out[7:0]) - ); - -spram #( - .addr_width_g(10), - .data_width_g(8)) -ram( - .address(ab[9:0]), - .clock(s_12mhz), - .wren(~write_n & ~ram0_n), - .data(db_out[7:0]), - .q(ram_out[7:0]) - ); + + assign vblank = vprom_reg[3]; + //assign hblank = ~(xxx1 | coloren); + assign hblank = ~hblank1_n; + + dpram #( + .addr_width_g(14), + .data_width_g(8)) + PROG( + .clk_a_i(s_12mhz), + .clk_b_i(s_12mhz), + .we_i(1'b0), + .addr_a_i(ab[13:0]), + .data_a_o(rom_out[7:0]), + .data_a_i(), + .addr_b_i(dl_addr[13:0]), + .data_b_o(), + .data_b_i(dl_data), + .we_b_i(dl_we && !dl_addr[14]) + ); + + spram #( + .addr_width_g(10), + .data_width_g(8)) + ram( + .address(ab[9:0]), + .clock(s_12mhz), + .wren(~write_n & ~ram0_n), + .data(db_out[7:0]), + .q(ram_out[7:0]) + ); wire irq_n; @@ -339,7 +398,7 @@ ram( assign irq_n = irq; - always @(posedge s_12mhz or posedge reset) + always @(posedge s_12mhz) if (reset) phi0a <= 1'b0; else if (s_1h_en) @@ -366,33 +425,30 @@ ram( end assign mpu_clk = s_6mhz; - assign mpu_reset_n = ~mpu_reset; - -assign phi2 = ~phi0; -T65 T65( - .Mode("00"), - .Res_n(mpu_reset_n), - .Enable(phi0_en), - .Clk(s_12mhz), - .Rdy(1'b1), - .Abort_n(1'b1), - .IRQ_n(irq_n), - .NMI_n(1'b1), - .SO_n(1'b1), - .R_W_n(rw_n), - .A(ab), - .DI(db_in[7:0]), - .DO(db_out[7:0]) - ); + assign mpu_reset_n = ~mpu_reset; + assign phi2 = ~phi0; + T65 T65( + .Mode("00"), + .Res_n(mpu_reset_n), + .Enable(phi0_en), + .Clk(s_12mhz), + .Rdy(1'b1), + .Abort_n(1'b1), + .IRQ_n(irq_n), + .NMI_n(1'b1), + .SO_n(1'b1), + .R_W_n(rw_n), + .A(ab), + .DI(db_in[7:0]), + .DO(db_out[7:0]) + ); // Address Decoder assign write_n = ~(phi2 & ~rw_n); assign brw_n = ~rw_n; - assign rom_n = brw_n | ~ab[13]; - assign adecode = (ab[13:10] == 4'b0000) ? 10'b1111111110 : (ab[13:10] == 4'b0001) ? 10'b1111111101 : @@ -406,74 +462,283 @@ T65 T65( (ab[13:10] == 4'b1001) ? 10'b0111111111 : 10'b1111111111; -// assign write2_n = ~(s_6mhz & ~write_n); - reg write2_n; - always @(posedge s_12mhz) - if (reset) - write2_n <= 0; - else if (s_6mhz_en) - write2_n <= write_n; - - assign steerclr_n = adecode[9] | write2_n; - assign watchdog_n = adecode[8] | write2_n; - assign out0_n = adecode[7] | write2_n; - assign irqres_n = (adecode[6] | write2_n) & mpu_reset_n; + wire write2_n = ~(s_6mhz & ~write_n); - assign coloram_n = (adecode[5] | ab[9])/* | pac_n*/; + // For millipede + wire mos_n = ab[14:12] != 3'b000; + wire io_n = ab[14:12] != 3'b010; + wire inputs_n = {io_n, ab[11:10]} != 3'b000; + wire outputs_n = {io_n, ab[11:10]} != 3'b001; - assign pokey_n = adecode[4]; - assign pokey2_n = adecode[3]; + always @(*) begin + if (milli) begin + rom_n = brw_n | ~ab[14]; - assign in0_n = adecode[3] | ab[1]; - assign in1_n = adecode[3] | ~ab[1]; + steerclr_n = 1;//adecode[9] | write2_n; + + in0_n = {inputs_n, ab[5:4]} != 3'b000; + in1_n = {inputs_n, ab[5:4]} != 3'b001; + ea_read_n = {inputs_n, ab[5:4]} != 3'b011; - assign swrd_n = adecode[2]; - assign pf_n = adecode[1]; - assign ram0_n = adecode[0]; + swrd_n = 1;//adecode[2]; + pf_n = ab[14:12] != 3'b001; // _scram + ram0_n = {mos_n, ab[11:10]} != 3'b000; + pokey_n = {mos_n, ab[11:10]} != 3'b001; + pokey2_n = {mos_n, ab[11:10]} != 3'b010; + + coloram_n = {outputs_n | write_n, ab[9:7]} != 4'b0001; + out0_n = {outputs_n | write_n, ab[9:7]} != 4'b0010; + irqres_n = {outputs_n | write_n, ab[9:7]} != 4'b0100 & mpu_reset_n; + watchdog_n = {outputs_n | write_n, ab[9:7]} != 4'b0101; + ea_ctrl_n = {outputs_n | write_n, ab[9:7]} != 4'b0110; + ea_addr_n = {outputs_n | write_n, ab[9:7]} != 4'b0111; - assign {ea_read_n, ea_ctrl_n, ea_addr_n} = - ({~ab[9]|adecode[5], ab[8:7]} == 3'b000) ? 3'b110 : - ({~ab[9]|adecode[5], ab[8:7]} == 3'b001) ? 3'b101 : - ({~ab[9]|adecode[5], ab[8:7]} == 3'b010) ? 3'b011 : - 3'b111; - assign pframrd_n = pf_n | brw_n; + pframrd_n = pf_n | brw_n; - assign {pfwr3_n, pfwr2_n, pfwr1_n, pfwr0_n} = + {pfwr3_n, pfwr2_n, pfwr1_n, pfwr0_n} = ({pf_n, write_n, ab[5:4]} == 4'b0000) ? 4'b1110 : ({pf_n, write_n, ab[5:4]} == 4'b0001) ? 4'b1101 : ({pf_n, write_n, ab[5:4]} == 4'b0010) ? 4'b1011 : ({pf_n, write_n, ab[5:4]} == 4'b0011) ? 4'b0111 : 4'b1111; - assign {pfrd3_n, pfrd2_n, pfrd1_n, pfrd0_n} = + {pfrd3_n, pfrd2_n, pfrd1_n, pfrd0_n} = (ab[5:4] == 2'b00) ? 4'b1110 : (ab[5:4] == 2'b01) ? 4'b1101 : (ab[5:4] == 2'b10) ? 4'b1011 : (ab[5:4] == 2'b11) ? 4'b0111 : 4'b1111; + end else begin + rom_n = brw_n | ~ab[13]; + + steerclr_n = adecode[9] | write2_n; + watchdog_n = adecode[8] | write2_n; + out0_n = adecode[7] | write2_n; + irqres_n = (adecode[6] | write2_n) & mpu_reset_n; + + coloram_n = (adecode[5] | ab[9])/* | pac_n*/; + + pokey_n = adecode[4]; + pokey2_n = 1;// adecode[3]; + + in0_n = adecode[3] | ab[1]; + in1_n = adecode[3] | ~ab[1]; + + swrd_n = adecode[2]; + pf_n = adecode[1]; + ram0_n = adecode[0]; + + {ea_read_n, ea_ctrl_n, ea_addr_n} = + ({~ab[9]|adecode[5], ab[8:7]} == 3'b000) ? 3'b110 : + ({~ab[9]|adecode[5], ab[8:7]} == 3'b001) ? 3'b101 : + ({~ab[9]|adecode[5], ab[8:7]} == 3'b010) ? 3'b011 : + 3'b111; + pframrd_n = pf_n | brw_n; + + {pfwr3_n, pfwr2_n, pfwr1_n, pfwr0_n} = + ({pf_n, write_n, ab[5:4]} == 4'b0000) ? 4'b1110 : + ({pf_n, write_n, ab[5:4]} == 4'b0001) ? 4'b1101 : + ({pf_n, write_n, ab[5:4]} == 4'b0010) ? 4'b1011 : + ({pf_n, write_n, ab[5:4]} == 4'b0011) ? 4'b0111 : + 4'b1111; + + {pfrd3_n, pfrd2_n, pfrd1_n, pfrd0_n} = + (ab[5:4] == 2'b00) ? 4'b1110 : + (ab[5:4] == 2'b01) ? 4'b1101 : + (ab[5:4] == 2'b10) ? 4'b1011 : + (ab[5:4] == 2'b11) ? 4'b0111 : + 4'b1111; + end + end // - assign mob_n = ~((s_256h_n & s_256hd) | (s_256h2d_n & s_256hd)); + assign db_in = + ~rom_n ? rom_out : + ~ram0_n ? ram_out : + ~coloram_n ? coloram_out : + ~pframrd_n ? pf_out[7:0] : + ~ea_read_n ? hs_out : + ~in0_n ? playerin_out : + ~in1_n ? joystick_out : + ~swrd_n ? switch_out : + ~pokey_n ? pokey_out : + ~pokey2_n ? pokey2_out : + 8'b0; + // + // High Score Memory Circuitry - assign blank_clk = ~s_12mhz & (h_counter[3:0] == 4'b1111); + wire hs_addr_en = ~ea_addr_n & ~write2_n; + wire hs_ctrl_en = ~ea_ctrl_n & ~write2_n; - always @(posedge blank_clk or posedge reset) + always @(posedge s_12mhz) begin + if (hs_addr_en) begin + hs_addr <= ab[5:0]; + hs_data <= db_out[7:0]; + end + if (hs_ctrl_en) hs_ctrl <= db_out[3:0]; + end + + dpram #( + .addr_width_g(6), + .data_width_g(8)) + hs_ram( + .clk_a_i(s_12mhz), + .clk_b_i(s_12mhz), + .we_i(hs_ctrl[1] & ~hs_ctrl[2]), + .addr_a_i(hs_addr), + .data_a_o(hs_out), + .data_a_i(hs_data), + .addr_b_i(hsram_addr), + .data_b_o(hsram_dout), + .data_b_i(hsram_din), + .we_b_i(hsram_we) + ); + + // Joystick Circuitry + wire js1_right, js1_left, js1_down, js1_up; + wire js2_right, js2_left, js2_down, js2_up; + + assign js1_right = joystick_i[7]; + assign js1_left = joystick_i[6]; + assign js1_down = joystick_i[5]; + assign js1_up = joystick_i[4]; + assign js2_right = joystick_i[3]; + assign js2_left = joystick_i[2]; + assign js2_down = joystick_i[1]; + assign js2_up = joystick_i[0]; + + wire [7:0] joystick_out_centi = ab[0] ? + { js1_right, js1_left, js1_down, js1_up, js2_right, js2_left, js2_down, js2_up } : + { dir2, 3'b0, trb }; + + wire [7:0] joystick_out_milli = { + ab[0] ? { self_test, 1'b0, cocktail, 1'b1 } : { coin_r, coin_l, coin_c, slam }, + cntrlsel ? { js2_down, js2_up, js2_right, js2_left } : { js1_up, js1_down, js1_left, js1_right } }; + + assign joystick_out = milli ? joystick_out_milli : joystick_out_centi; + + // Option Input Circuitry + + assign switch_out = ab[0] ? + sw2_i : + sw1_i; + + // Player Input Circuitry + wire coin_r, coin_c, coin_l, self_test; + wire cocktail, slam, start1, start2, fire2, fire1; + + assign coin_r = coin_ctr_r_drive ? coin_ctr_r_drive : playerinput_i[9]; + assign coin_c = coin_ctr_c_drive ? coin_ctr_c_drive : playerinput_i[8]; + assign coin_l = coin_ctr_l_drive ? coin_ctr_l_drive : playerinput_i[7]; + assign self_test = playerinput_i[6]; + assign cocktail = playerinput_i[5]; + assign slam = playerinput_i[4]; + assign start2 = playerinput_i[3]; + assign start1 = playerinput_i[2]; + assign fire2 = playerinput_i[1]; + assign fire1 = playerinput_i[0]; + + wire [7:0] playerin_out0; + wire [7:0] playerin_out1; + + assign playerin_out1 = milli ? + { dir2, 1'b0, start2, fire2, sw1_i[7:4] } : + { coin_r, coin_c, coin_l, slam, fire2, fire1, start2, start1 }; + + assign playerin_out0 = milli ? + { dir1, vblank, start1, fire1, sw1_i[3:0] } : + { dir1, vblank, self_test, cocktail, tra }; + + assign playerin_out = ab[0] ? playerin_out1 : playerin_out0; + + // Coin Counter Output + reg [7:0] cc_latch; + + always @(posedge s_12mhz) if (reset) - begin - s_256h2d <= 1'b0; - s_256hd <= 1'b0; - vblankd <= 1'b0; - end - else - begin - s_256h2d <= s_256hd; - s_256hd <= s_256h; - vblankd <= vblank; - end + cc_latch <= 0; + else if (s_6mhz_en) + if (~out0_n) + cc_latch[ ab[2:0] ] <= db_out[7]; - assign s_256h2d_n = ~s_256h2d; - assign s_256hd_n = ~s_256hd; - assign vblankd_n = ~vblankd; + assign flip = milli ? cc_latch[6] : cc_latch[7]; + assign cntrlsel = milli ? cc_latch[6] : 1'b0; + assign led_o[4] = milli ? 1'b0 : cc_latch[6]; + assign led_o[3] = milli ? 1'b0 : cc_latch[5]; + assign led_o[2] = cc_latch[4]; + assign led_o[1] = cc_latch[3]; + assign coin_ctr_r_drive = cc_latch[2]; + assign coin_ctr_c_drive = cc_latch[1]; + assign coin_ctr_l_drive = cc_latch[1]; + + // Mini-Trak Ball inputs + wire [3:0] tb_mux; + wire s_1_horiz_dir, s_1_horiz_ck, s_1_vert_dir, s_1_vert_ck; + wire s_2_horiz_dir, s_2_horiz_ck, s_2_vert_dir, s_2_vert_ck; + wire tb_h_dir, tb_h_ck, tb_v_dir, tb_v_ck; + reg tb_h_reg, tb_v_reg; + reg [3:0] tb_h_ctr, tb_v_ctr; + wire tb_h_ctr_clr, tb_v_ctr_clr; + + assign s_1_horiz_dir = trakball_i[7]; + assign s_2_horiz_dir = trakball_i[6]; + assign s_1_horiz_ck = trakball_i[5]; + assign s_2_horiz_ck = trakball_i[4]; + assign s_1_vert_dir = trakball_i[3]; + assign s_2_vert_dir = trakball_i[2]; + assign s_1_vert_ck = trakball_i[1]; + assign s_2_vert_ck = trakball_i[0]; + + assign tb_mux = flip ? + { s_1_horiz_dir, s_1_horiz_ck, s_1_vert_dir, s_1_vert_ck } : + { s_2_horiz_dir, s_2_horiz_ck, s_2_vert_dir, s_2_vert_ck }; + + assign tb_h_dir = tb_mux[3]; + assign tb_h_ck = tb_mux[2]; + assign tb_v_dir = tb_mux[1]; + assign tb_v_ck = tb_mux[0]; +/* + // H + always @(posedge tb_h_ck or posedge reset) + if (reset) + tb_h_reg <= 0; + else + tb_h_reg <= tb_h_dir; + + assign tb_h_ctr_clr = reset | ~steerclr_n; + + always @(posedge tb_h_ck or posedge tb_h_ctr_clr) + if (tb_h_ctr_clr) + tb_h_ctr <= 0; + else + if (tb_h_reg) + tb_h_ctr <= tb_h_ctr + 4'd1; + else + tb_h_ctr <= tb_h_ctr - 4'd1; + + // V + always @(posedge tb_v_ck or posedge reset) + if (reset) + tb_v_reg <= 0; + else + tb_v_reg <= tb_v_dir; + + assign tb_v_ctr_clr = reset | ~steerclr_n; + + always @(posedge tb_v_ck or posedge tb_v_ctr_clr) + if (tb_v_ctr_clr) + tb_v_ctr <= 0; + else + if (tb_v_reg) + tb_v_ctr <= tb_v_ctr + 4'd1; + else + tb_v_ctr <= tb_v_ctr - 4'd1; +*/ + assign tra = tb_h_ctr; + assign trb = tb_v_ctr; + assign dir1 = tb_h_reg; + assign dir2 = tb_v_reg; + // motion objects (vertical) @@ -520,12 +785,15 @@ T65 T65( // for debug only assign match_true = (~match_n & s_256h_n) && pfd != 0; + wire pic7 = milli ? !s_256h & pic[7] : pic[7]; - assign mga = { match_mux[3] ^ (pic[7] & s_256h_n), - match_mux[2] ^ pic[7], - match_mux[1] ^ pic[7], - match_mux[0] ^ pic[7] }; - + assign mga = { match_mux[3] ^ (pic7 & s_256h_n), + match_mux[2] ^ pic7, + match_mux[1] ^ pic7, + match_mux[0] ^ pic7 }; + + wire horrot = milli ? (!s_256h & pic[6]) : pic[6]; + wire mga10 = s_256h ? pic[6] : pic[0]; //--- // motion objects (horizontal) @@ -548,7 +816,7 @@ T65 T65( else /* posedge s_4h */ if (s_4h_en) - pfd_hold <= pfd[29:16]; + pfd_hold <= pfd[31:16]; // always @(posedge s_4h_n) // if (reset) @@ -562,7 +830,9 @@ T65 T65( /* posedge s_4h_n */ if (s_4h_n_en) pfd_hold2 <= pfd_hold; - + + reg [1:0] y_reg; + assign y[1] = // C7 (area == 2'b00) ? (s_256hd ? 1'b0 : gry[1]) : (area == 2'b01) ? (s_256hd ? 1'b0 : pfd_hold2[25]) : @@ -577,13 +847,16 @@ T65 T65( (area == 2'b11) ? (s_256hd ? 1'b0 : pfd_hold2[28]) : 1'b0; + assign mocbx[0] = (area == 2'b00) ? (s_256hd ? 1'b0 : mocb[0]) : pfd_hold2[30]; + assign mocbx[1] = (area == 2'b00) ? (s_256hd ? 1'b0 : mocb[1]) : pfd_hold2[31]; + assign line_ram_ctr_load = ~(pload_n | s_256h); assign line_ram_ctr_clr = ~(pload_n | ~(s_256h & s_256hd_n)); - always @(posedge s_6mhz) // A5-B5 + always @(posedge s_12mhz) // A5-B5 if (reset) line_ram_ctr <= 0; - else /*if (s_6mhz_en)*/ begin + else if (s_6mhz_en) begin if (line_ram_ctr_clr) line_ram_ctr <= 0; else if (line_ram_ctr_load) @@ -595,25 +868,26 @@ T65 T65( assign line_ram_addr = line_ram_ctr; always @(posedge s_12mhz) - if (~s_6mhz) line_ram[line_ram_addr] <= y; + if (~s_6mhz) line_ram[line_ram_addr] <= {mocbx, y}; - always @(posedge s_12mhz) - if (reset) + always @(negedge s_12mhz) + if (reset) begin mr <= 0; - else - mr <= line_ram[line_ram_addr]; + mocb_o <= 0; + end else + {mocb_o, mr} <= line_ram[line_ram_addr]; + reg [1:0] mocb, mocb_o; + wire [1:0] mocbx; - always @(posedge s_6mhz_n) - if (reset) - gry <= 0; - else - if (~mob_n) + always @(posedge s_12mhz, negedge mob_n) + if (~mob_n) gry <= 2'b00; - else/* if (s_6mhz_n_en)*/ + else if (s_6mhz_n_en) begin gry <= mr; - + mocb <= mocb_o; + end // playfield multiplexer // The playfield multiplexer receives playfield data from the pf memory @@ -634,26 +908,48 @@ T65 T65( // else // pic <= pf[7:0]; always @(posedge s_12mhz) - if (reset) - pic <= 0; - else if (s_4h_en) - pic <= pf[7:0]; - -F7 F7( - .clk(s_12mhz), - .addr(pf_rom0_addr), - .data(pf_rom0_out) - ); - -HJ7 HJ7( - .clk(s_12mhz), - .addr(pf_rom1_addr), - .data(pf_rom1_out) - ); + if (reset) + pic <= 0; + else if (s_4h_en) + pic <= pf[7:0]; + else if (s_4h_n_en) + picD <= pic; + + dpram #( + .addr_width_g(11), + .data_width_g(8)) + F7( + .clk_a_i(s_12mhz), + .clk_b_i(s_12mhz), + .we_i(1'b0), + .addr_a_i(pf_rom0_addr), + .data_a_o(pf_rom0_out), + .data_a_i(), + .addr_b_i(dl_addr[10:0]), + .data_b_o(), + .data_b_i(dl_data), + .we_b_i(dl_we && dl_addr[14:11] == 4'b1000) + ); + + dpram #( + .addr_width_g(11), + .data_width_g(8)) + HJ7( + .clk_a_i(s_12mhz), + .clk_b_i(s_12mhz), + .we_i(1'b0), + .addr_a_i(pf_rom1_addr), + .data_a_o(pf_rom1_out), + .data_a_i(), + .addr_b_i(dl_addr[10:0]), + .data_b_o(), + .data_b_i(dl_data), + .we_b_i(dl_we && dl_addr[14:11] == 4'b1001) + ); // a guess, based on millipede schematics wire pf_romx_haddr; - assign pf_romx_haddr = s_256h_n & pic[0]; + assign pf_romx_haddr = milli ? mga10 : s_256h_n & pic[0]; assign pf_rom1_addr = { pf_romx_haddr, s_256h, pic[5:1], mga }; assign pf_rom0_addr = { pf_romx_haddr, s_256h, pic[5:1], mga }; assign pf_rom0_out_rev = { pf_rom0_out[0], pf_rom0_out[1], pf_rom0_out[2], pf_rom0_out[3], @@ -662,8 +958,8 @@ HJ7 HJ7( assign pf_rom1_out_rev = { pf_rom1_out[0], pf_rom1_out[1], pf_rom1_out[2], pf_rom1_out[3], pf_rom1_out[4], pf_rom1_out[5], pf_rom1_out[6], pf_rom1_out[7] }; - assign pf_mux0 = match_n ? 8'b0 : (pic[6] ? pf_rom0_out_rev : pf_rom0_out); - assign pf_mux1 = match_n ? 8'b0 : (pic[6] ? pf_rom1_out_rev : pf_rom1_out); + assign pf_mux0 = match_n ? 8'b0 : (horrot ? pf_rom0_out_rev : pf_rom0_out); + assign pf_mux1 = match_n ? 8'b0 : (horrot ? pf_rom1_out_rev : pf_rom1_out); always @(posedge s_12mhz) if (reset) @@ -689,19 +985,6 @@ HJ7 HJ7( else if (s_6mhz_n_en) area <= { pf_shift1[7], pf_shift0[7] }; - // - assign db_in = - ~rom_n ? rom_out : - ~ram0_n ? ram_out : - ~coloram_n ? { 4'b0, coloram_out } : - ~pframrd_n ? pf_out[7:0] : - ~ea_read_n ? hs_out : - ~in0_n ? playerin_out : - ~in1_n ? joystick_out : - ~swrd_n ? switch_out : - ~pokey_n ? pokey_out : - 8'b0; - // we ignore the cpu, as pf ram is now dp and cpu has it's own port // assign pf_sel = mob_n ? { s_8v, s_128h } : 2'b00; @@ -732,209 +1015,27 @@ HJ7 HJ7( assign pfa = { pfa7654, pfa3210 }; wire pf_ce; - reg pf_ce_d; wire [3:0] pf_ce4_n; assign pf_ce = ~(s_1h & s_2h & s_4h & s_6mhz); - always @(posedge s_12mhz) - if (reset) - pf_ce_d <= 0; - else - pf_ce_d <= pf_ce; - -// assign pf_ce4_n = { pf_ce_d, pf_ce_d, pf_ce_d, pf_ce_d }; assign pf_ce4_n = 4'b0; - + pf_ram pf_ram( - .clk_a(s_12mhz), - .clk_b(s_12mhz), - .reset(reset), - // - .addr_a({ab[9:6], ab[3:0]}), - .din_a(db_out[7:0]), - .dout_a(pf_out), - .ce_a({pfrd3_n, pfrd2_n, pfrd1_n, pfrd0_n}), - .we_a({pfwr3_n, pfwr2_n, pfwr1_n, pfwr0_n}), - // - .addr_b(pfa), - .dout_b(pfd), - .ce_b(pf_ce4_n) - ); - - // High Score Memory Circuitry + .clk_a(s_12mhz), + .clk_b(s_12mhz), + .reset(reset), + // + .addr_a({ab[9:6], ab[3:0]}), + .din_a(db_out[7:0]), + .dout_a(pf_out), + .ce_a({pfrd3_n, pfrd2_n, pfrd1_n, pfrd0_n}), + .we_a({pfwr3_n, pfwr2_n, pfwr1_n, pfwr0_n}), + // + .addr_b(pfa), + .dout_b(pfd), + .ce_b(pf_ce4_n) + ); - assign hs_addr_clk = ~(~ea_addr_n & ~write2_n); - assign hs_ctrl_clk = ~(~ea_ctrl_n & ~write2_n); - always @(posedge hs_addr_clk) - hs_addr <= ab[5:0]; - - always @(posedge hs_ctrl_clk) - hs_ctrl <= db_out[3:0]; -/* -spram #( - .addr_width_g(6), - .data_width_g(8)) -hs_ram( - .address(hs_addr), - .clock(hs_ctrl[0] & ~hs_ctrl[3]), - .wren(~hs_ctrl[1] & hs_ctrl[2]), - .data(hs_data), - .q(hs_out) - ); */ -assign hs_out = 8'b0; - always @(posedge hs_addr_clk) - hs_data <= db_out[7:0]; - - // Joystick Circuitry - wire js1_right, js1_left, js1_down, js1_up; - wire js2_right, js2_left, js2_down, js2_up; - - assign js1_right = joystick_i[7]; - assign js1_left = joystick_i[6]; - assign js1_down = joystick_i[5]; - assign js1_up = joystick_i[4]; - assign js2_right = joystick_i[3]; - assign js2_left = joystick_i[2]; - assign js2_down = joystick_i[1]; - assign js2_up = joystick_i[0]; - - assign joystick_out = ab[0] ? - { js1_right, js1_left, js1_down, js1_up, js2_right, js2_left, js2_down, js2_up } : - { dir2, 3'b0, trb }; - - // Option Input Circuitry - - assign switch_out = ab[0] ? - sw2_i : - sw1_i; - - // Player Input Circuitry - wire coin_r, coin_c, coin_l, self_test; - wire cocktail, slam, start1, start2, fire2, fire1; - - assign coin_r = coin_ctr_r_drive ? coin_ctr_r_drive : playerinput_i[9]; - assign coin_c = coin_ctr_c_drive ? coin_ctr_c_drive : playerinput_i[8]; - assign coin_l = coin_ctr_l_drive ? coin_ctr_l_drive : playerinput_i[7]; - assign self_test = playerinput_i[6]; - assign cocktail = playerinput_i[5]; - assign slam = playerinput_i[4]; - assign start1 = playerinput_i[3]; - assign start2 = playerinput_i[2]; - assign fire2 = playerinput_i[1]; - assign fire1 = playerinput_i[0]; - - wire [7:0] playerin_out0; - wire [7:0] playerin_out1; - - assign playerin_out1 = { coin_r, coin_c, coin_l, slam, fire2, fire1, start1, start2 }; - assign playerin_out0 = { dir1, vblank, self_test, cocktail, tra }; - - assign playerin_out = ab[0] ? playerin_out1 : playerin_out0; - - // Coin Counter Output - reg [7:0] cc_latch; - - always @(posedge s_12mhz or posedge reset) - if (reset) - cc_latch <= 0; - else if (s_6mhz_en) - if (~out0_n) - cc_latch[ ab[2:0] ] <= db_out[7]; - - assign flip = cc_latch[7]; - assign led_o[4] = cc_latch[6]; - assign led_o[3] = cc_latch[5]; - assign led_o[2] = cc_latch[4]; - assign led_o[1] = cc_latch[3]; - assign coin_ctr_r_drive = cc_latch[2]; - assign coin_ctr_c_drive = cc_latch[1]; - assign coin_ctr_l_drive = cc_latch[1]; - - // Mini-Trak Ball inputs - wire [3:0] tb_mux; - wire s_1_horiz_dir, s_1_horiz_ck, s_1_vert_dir, s_1_vert_ck; - wire s_2_horiz_dir, s_2_horiz_ck, s_2_vert_dir, s_2_vert_ck; - wire tb_h_dir, tb_h_ck, tb_v_dir, tb_v_ck; - reg tb_h_reg, tb_v_reg; - reg [3:0] tb_h_ctr, tb_v_ctr; - wire tb_h_ctr_clr, tb_v_ctr_clr; - - assign s_1_horiz_dir = trakball_i[7]; - assign s_2_horiz_dir = trakball_i[6]; - assign s_1_horiz_ck = trakball_i[5]; - assign s_2_horiz_ck = trakball_i[4]; - assign s_1_vert_dir = trakball_i[3]; - assign s_2_vert_dir = trakball_i[2]; - assign s_1_vert_ck = trakball_i[1]; - assign s_2_vert_ck = trakball_i[0]; - - assign tb_mux = flip ? - { s_1_horiz_dir, s_1_horiz_ck, s_1_vert_dir, s_1_vert_ck } : - { s_2_horiz_dir, s_2_horiz_ck, s_2_vert_dir, s_2_vert_ck }; - - assign tb_h_dir = tb_mux[3]; - assign tb_h_ck = tb_mux[2]; - assign tb_v_dir = tb_mux[1]; - assign tb_v_ck = tb_mux[0]; - - // H - always @(posedge tb_h_ck or posedge reset) - if (reset) - tb_h_reg <= 0; - else - tb_h_reg <= tb_h_dir; - - assign tb_h_ctr_clr = reset | ~steerclr_n; - - always @(posedge tb_h_ck or posedge tb_h_ctr_clr) - if (tb_h_ctr_clr) - tb_h_ctr <= 0; - else - if (tb_h_reg) - tb_h_ctr <= tb_h_ctr + 4'd1; - else - tb_h_ctr <= tb_h_ctr - 4'd1; - - // V - always @(posedge tb_v_ck or posedge reset) - if (reset) - tb_v_reg <= 0; - else - tb_v_reg <= tb_v_dir; - - assign tb_v_ctr_clr = reset | ~steerclr_n; - - always @(posedge tb_v_ck or posedge tb_v_ctr_clr) - if (tb_v_ctr_clr) - tb_v_ctr <= 0; - else - if (tb_v_reg) - tb_v_ctr <= tb_v_ctr + 4'd1; - else - tb_v_ctr <= tb_v_ctr - 4'd1; - - assign tra = tb_h_ctr; - assign trb = tb_v_ctr; - assign dir1 = tb_h_reg; - assign dir2 = tb_v_reg; - - - // Audio output circuitry - - -POKEY POKEY( - .Din(db_out[7:0]), - .Dout(pokey_out), - .A(ab[3:0]), - .P(8'b0), - .phi2(phi2), - .readHighWriteLow(rw_n), - .cs0Bar(pokey_n), - .audio(audio), - .clk(clk_100mhz) - ); - - // Video output circuitry // The video output circuit receives motion object, playfield, address and data inputs @@ -955,7 +1056,7 @@ POKEY POKEY( wire gry0_or_1; assign gry0_or_1 = gry[1] | gry[0]; - assign rama_sel = { coloram_n, gry0_or_1 }; + //assign rama_sel = { coloram_n, gry0_or_1 }; // assign rama = // (rama_sel == 2'b00) ? { ab[3:0] } : @@ -964,42 +1065,50 @@ POKEY POKEY( // (rama_sel == 2'b11) ? { {gry0_or_1, 1'b1}, gry[1:0] } : // 4'b0; - assign rama = gry0_or_1 ? - { {gry0_or_1, 1'b1}, gry[1:0] } : - { {gry0_or_1, 1'b1}, area[1:0] }; + wire [3:0] rama_centi = gry0_or_1 ? + { {gry0_or_1, 1'b1}, gry[1:0] } : + { {gry0_or_1, 1'b1}, area[1:0] }; - -dpram #( - .addr_width_g(4), - .data_width_g(4)) -color_ram( - .clk_a_i(s_12mhz), - .clk_b_i(s_12mhz), - .we_i(~coloram_w_n), - .addr_a_i(ab[3:0]), - .data_a_o(coloram_out), - .data_a_i(db_out[3:0]), - .addr_b_i(rama), - .data_b_o(coloram_rgbi) - ); + wire rama_hi_sel = (gry0_or_1 & s_256h & s_256h2d); + wire [4:0] rama_milli = {rama_hi_sel, rama_hi_sel ? {mocb, gry} : {picD[7:6], area}}; - assign rgb_o = - rgbi == 4'b0000 ? 9'b111_111_111 : - rgbi == 4'b0001 ? 9'b111_111_011 : - rgbi == 4'b0010 ? 9'b111_011_111 : - rgbi == 4'b0011 ? 9'b111_011_011 : - rgbi == 4'b0100 ? 9'b011_111_111 : - rgbi == 4'b0101 ? 9'b011_111_011 : - rgbi == 4'b0110 ? 9'b011_011_111 : - rgbi == 4'b0111 ? 9'b011_011_011 : - rgbi == 4'b1000 ? 9'b111_111_111 : - rgbi == 4'b1001 ? 9'b111_111_000 : - rgbi == 4'b1010 ? 9'b111_000_111 : - rgbi == 4'b1011 ? 9'b111_000_000 : - rgbi == 4'b1100 ? 9'b000_111_111 : - rgbi == 4'b1101 ? 9'b000_111_000 : - rgbi == 4'b1110 ? 9'b000_000_111 : - rgbi == 4'b1111 ? 9'b000_000_000 : + wire [4:0] rama = milli ? rama_milli : {1'b0, rama_centi}; + wire [4:0] cram_a = milli ? ab[4:0] : {1'b0, ab[3:0]}; + + dpram #( + .addr_width_g(5), + .data_width_g(8)) + color_ram( + .clk_a_i(s_12mhz), + .clk_b_i(s_12mhz), + .we_i(~coloram_w_n), + .addr_a_i(cram_a), + .data_a_o(coloram_out), + .data_a_i(milli ? db_out : {db_out[3:0], db_out[3:0]}), + .addr_b_i(rama), + .data_b_o(coloram_rgbi) + ); + + assign rgb_o = milli ? rgb_o_milli : rgb_o_centi; + + wire [8:0] rgb_o_milli = ~{ rgbi[2:0], rgbi[4:3], 1'b1, rgbi[7:5] }; + wire [8:0] rgb_o_centi = + rgbi[3:0] == 4'b0000 ? 9'b111_111_111 : + rgbi[3:0] == 4'b0001 ? 9'b111_111_011 : + rgbi[3:0] == 4'b0010 ? 9'b111_011_111 : + rgbi[3:0] == 4'b0011 ? 9'b111_011_011 : + rgbi[3:0] == 4'b0100 ? 9'b011_111_111 : + rgbi[3:0] == 4'b0101 ? 9'b011_111_011 : + rgbi[3:0] == 4'b0110 ? 9'b011_011_111 : + rgbi[3:0] == 4'b0111 ? 9'b011_011_011 : + rgbi[3:0] == 4'b1000 ? 9'b111_111_111 : + rgbi[3:0] == 4'b1001 ? 9'b111_111_000 : + rgbi[3:0] == 4'b1010 ? 9'b111_000_111 : + rgbi[3:0] == 4'b1011 ? 9'b111_000_000 : + rgbi[3:0] == 4'b1100 ? 9'b000_111_111 : + rgbi[3:0] == 4'b1101 ? 9'b000_111_000 : + rgbi[3:0] == 4'b1110 ? 9'b000_000_111 : + rgbi[3:0] == 4'b1111 ? 9'b000_000_000 : 9'd0; @@ -1008,6 +1117,38 @@ color_ram( assign vsync_o = vsync; assign audio_o = audio; assign hblank_o = hblank; - assign vblank_o = vblank; + assign vblank_o = vblankd; + + // Audio output circuitry + + wire [3:0] pokey_audio; + POKEY POKEY( + .Din(db_out[7:0]), + .Dout(pokey_out), + .A(ab[3:0]), + .P(8'b0), + .phi2(phi2), + .readHighWriteLow(rw_n), + .cs0Bar(pokey_n), + .audio(pokey_audio), + .clk(clk_100mhz) + ); + + POKEY POKEY2( + .Din(db_out[7:0]), + .Dout(pokey2_out), + .A(ab[3:0]), + .P(8'b0), + .phi2(phi2), + .readHighWriteLow(rw_n), + .cs0Bar(pokey2_n), + .audio(pokey2_audio), + .clk(clk_100mhz) + ); + wire [3:0] pokey2_audio; + wire [4:0] pokey_mux = pokey_audio + pokey2_audio; + + assign audio = milli ? (pokey_mux[4] ? 4'hf : pokey_mux[3:0]) : pokey_audio; + endmodule diff --git a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/dpram.vhd b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/dpram.vhd index d867b5d2..e42e9194 100644 --- a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/dpram.vhd +++ b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/dpram.vhd @@ -18,7 +18,9 @@ entity dpram is data_a_i : in std_logic_vector(data_width_g-1 downto 0); data_a_o : out std_logic_vector(data_width_g-1 downto 0); clk_b_i : in std_logic; + we_b_i : in std_logic := '0'; addr_b_i : in std_logic_vector(addr_width_g-1 downto 0); + data_b_i : in std_logic_vector(data_width_g-1 downto 0); data_b_o : out std_logic_vector(data_width_g-1 downto 0) ); end entity; @@ -52,6 +54,9 @@ begin begin if rising_edge(clk_b_i) then read_addr_v := unsigned(addr_b_i); + if we_b_i = '1' then + ram_q(to_integer(read_addr_v)) <= data_b_i; + end if; data_b_o <= ram_q(to_integer(read_addr_v)); end if; end process mem_b; diff --git a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/pf_ram.v b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/pf_ram.v index aac899ac..c774f7bb 100644 --- a/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/pf_ram.v +++ b/Arcade_MiST/Atari Centipede Hardware/Centipede_MiST/rtl/pf_ram.v @@ -27,12 +27,12 @@ dpram #( .addr_width_g(8), .data_width_g(8)) ram0( - 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