13
tests/opt/bug1525.ys
Normal file
13
tests/opt/bug1525.ys
Normal file
@@ -0,0 +1,13 @@
|
||||
read_verilog << EOF
|
||||
module top(...);
|
||||
input A1, A2, B, S;
|
||||
output O;
|
||||
|
||||
assign O = S ? (A1 & B) : (A2 & B);
|
||||
|
||||
endmodule
|
||||
EOF
|
||||
|
||||
simplemap
|
||||
opt_share
|
||||
dump
|
||||
Reference in New Issue
Block a user