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synced 2026-03-09 20:18:22 +00:00
Tron: update to latest with interlaced TV out
This commit is contained in:
Gyorgy Szombathelyi
@@ -41,7 +41,7 @@
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# ========================
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set_global_assignment -name PROJECT_OUTPUT_DIRECTORY output_files
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set_global_assignment -name NUM_PARALLEL_PROCESSORS ALL
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set_global_assignment -name LAST_QUARTUS_VERSION 13.1
|
||||
set_global_assignment -name LAST_QUARTUS_VERSION "13.1 SP4.26"
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set_global_assignment -name PRE_FLOW_SCRIPT_FILE "quartus_sh:rtl/build_id.tcl"
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# Pin & Location Assignments
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@@ -181,17 +181,15 @@ set_global_assignment -name PARTITION_NETLIST_TYPE SOURCE -section_id Top
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set_global_assignment -name PARTITION_FITTER_PRESERVATION_LEVEL PLACEMENT_AND_ROUTING -section_id Top
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set_global_assignment -name PARTITION_COLOR 16764057 -section_id Top
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||||
set_global_assignment -name SYSTEMVERILOG_FILE rtl/Tron_MiST.sv
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set_global_assignment -name VHDL_FILE rtl/satans_hollow.vhd
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set_global_assignment -name VHDL_FILE rtl/satans_hollow_sound_board.vhd
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set_global_assignment -name VHDL_FILE rtl/spinner.vhd
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||||
set_global_assignment -name VHDL_FILE rtl/YM2149_linmix_sep.vhd
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||||
set_global_assignment -name VHDL_FILE rtl/ctc_counter.vhd
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||||
set_global_assignment -name VHDL_FILE rtl/ctc_controler.vhd
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set_global_assignment -name VHDL_FILE rtl/gen_ram.vhd
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set_global_assignment -name VHDL_FILE rtl/cmos_ram.vhd
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||||
set_global_assignment -name VHDL_FILE rtl/rom/tron_sp_bits_4.vhd
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||||
set_global_assignment -name VHDL_FILE rtl/rom/tron_sp_bits_3.vhd
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||||
set_global_assignment -name VHDL_FILE rtl/rom/tron_sp_bits_2.vhd
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||||
set_global_assignment -name VHDL_FILE rtl/rom/tron_sp_bits_1.vhd
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||||
set_global_assignment -name VHDL_FILE rtl/tron.vhd
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||||
set_global_assignment -name VHDL_FILE rtl/tron_sound_board.vhd
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||||
set_global_assignment -name VHDL_FILE rtl/rom/tron_sp_bits.vhd
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||||
set_global_assignment -name VHDL_FILE rtl/rom/tron_bg_bits_2.vhd
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||||
set_global_assignment -name VHDL_FILE rtl/rom/tron_bg_bits_1.vhd
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set_global_assignment -name VHDL_FILE rtl/rom/midssio_82s123.vhd
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@@ -79,7 +79,7 @@ wire [7:0] joystick_1;
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wire scandoublerD;
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wire ypbpr;
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wire [15:0] audio_l, audio_r;
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wire hs, vs;
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wire hs, vs, cs;
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wire blankn;
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wire [2:0] g, r, b;
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wire [15:0] rom_addr;
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@@ -166,7 +166,19 @@ always @(posedge clk_sys) begin
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reset <= status[0] | buttons[1] | ~rom_loaded;
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end
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satans_hollow satans_hollow(
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wire [6:0] spin_angle;
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spinner spinner (
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.clock_40(clk_sys),
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.reset(reset),
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||||
.btn_acc(btn_f),
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||||
.btn_left(btn_g),
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||||
.btn_right(btn_t),
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.ctc_zc_to_2(vs),
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||||
.spin_angle(spin_angle)
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);
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tron tron (
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||||
.clock_40(clk_sys),
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||||
.reset(reset),
|
||||
.video_r(r),
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||||
@@ -175,6 +187,8 @@ satans_hollow satans_hollow(
|
||||
.video_blankn(blankn),
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||||
.video_hs(hs),
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||||
.video_vs(vs),
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||||
.video_csync(cs),
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||||
.tv15Khz_mode(scandoublerD),
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||||
.separate_audio(1'b0),
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||||
.audio_out_l(audio_l),
|
||||
.audio_out_r(audio_r),
|
||||
@@ -182,26 +196,26 @@ satans_hollow satans_hollow(
|
||||
.coin2(1'b0),
|
||||
.start2(btn_two_players),
|
||||
.start1(btn_one_player),
|
||||
|
||||
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||||
.left(m_left),
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||||
.right(m_right),
|
||||
.up(m_up),
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||||
.down(m_down),
|
||||
.fire(m_fire),
|
||||
|
||||
.angle(spin_angle),
|
||||
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||||
.left_c(0),
|
||||
.right_c(0),
|
||||
.up_c(0),
|
||||
.down_c(0),
|
||||
.fire_c(0),
|
||||
.angle_c(spin_angle),
|
||||
|
||||
.buttonf(btn_f),
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||||
.buttong(btn_g),
|
||||
.buttont(btn_t),
|
||||
.cont(status[7]),
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||||
.cocktail(0),
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||||
.coin_meters(1),
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||||
.service(status[6]),
|
||||
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||||
.cpu_rom_addr ( rom_addr ),
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||||
.cpu_rom_do ( rom_addr[0] ? rom_do[15:8] : rom_do[7:0] ),
|
||||
.cpu_rom_rd ( rom_rd ),
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||||
@@ -210,6 +224,11 @@ satans_hollow satans_hollow(
|
||||
.snd_rom_rd ( snd_rd )
|
||||
);
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wire vs_out;
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wire hs_out;
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||||
assign VGA_VS = scandoublerD | vs_out;
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assign VGA_HS = scandoublerD ? cs : hs_out;
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||||
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||||
mist_video #(.COLOR_DEPTH(3), .SD_HCNT_WIDTH(10)) mist_video(
|
||||
.clk_sys ( clk_sys ),
|
||||
.SPI_SCK ( SPI_SCK ),
|
||||
@@ -223,12 +242,13 @@ mist_video #(.COLOR_DEPTH(3), .SD_HCNT_WIDTH(10)) mist_video(
|
||||
.VGA_R ( VGA_R ),
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||||
.VGA_G ( VGA_G ),
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||||
.VGA_B ( VGA_B ),
|
||||
.VGA_VS ( VGA_VS ),
|
||||
.VGA_HS ( VGA_HS ),
|
||||
.VGA_VS ( vs_out ),
|
||||
.VGA_HS ( hs_out ),
|
||||
.rotate ( {1'b1,status[2]} ),
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||||
.ce_divider ( 1 ),
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||||
.blend ( status[5] ),
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||||
.scandoubler_disable(1),//scandoublerD ),
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||||
.no_csync ( 1'b1 ),
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||||
.scanlines ( status[4:3] ),
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||||
.ypbpr ( ypbpr )
|
||||
);
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||||
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||||
2071
Arcade_MiST/Midway MCR 2/Tron_MiST/rtl/rom/tron_sp_bits.vhd
Normal file
2071
Arcade_MiST/Midway MCR 2/Tron_MiST/rtl/rom/tron_sp_bits.vhd
Normal file
File diff suppressed because it is too large
Load Diff
@@ -1,534 +0,0 @@
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||||
library ieee;
|
||||
use ieee.std_logic_1164.all,ieee.numeric_std.all;
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||||
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||||
entity tron_sp_bits_1 is
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||||
port (
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||||
clk : in std_logic;
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||||
addr : in std_logic_vector(12 downto 0);
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||||
data : out std_logic_vector(7 downto 0)
|
||||
);
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||||
end entity;
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||||
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||||
architecture prom of tron_sp_bits_1 is
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||||
type rom is array(0 to 8191) of std_logic_vector(7 downto 0);
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||||
signal rom_data: rom := (
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"22",X"22",X"00",X"00",X"22",X"22",X"00",
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X"00",X"00",X"77",X"00",X"00",X"00",X"77",X"00",X"00",X"00",X"77",X"22",X"00",X"00",X"77",X"22",
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X"00",X"66",X"77",X"00",X"00",X"66",X"77",X"00",X"00",X"66",X"77",X"00",X"00",X"00",X"77",X"00",
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X"00",X"00",X"77",X"00",X"00",X"00",X"77",X"00",X"00",X"00",X"77",X"00",X"00",X"00",X"66",X"00",
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X"00",X"02",X"66",X"00",X"00",X"00",X"22",X"00",X"00",X"00",X"22",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"02",X"00",X"00",X"00",X"02",X"00",X"00",X"00",
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X"00",X"00",X"00",X"62",X"00",X"00",X"00",X"66",X"00",X"00",X"00",X"22",X"00",X"00",X"00",X"22",
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X"00",X"22",X"77",X"00",X"00",X"22",X"77",X"00",X"00",X"66",X"66",X"00",X"00",X"66",X"27",X"00",
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X"72",X"66",X"22",X"77",X"72",X"66",X"22",X"67",X"00",X"22",X"77",X"22",X"00",X"22",X"77",X"26",
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X"20",X"66",X"77",X"66",X"20",X"66",X"77",X"66",X"00",X"77",X"77",X"00",X"00",X"77",X"77",X"00",
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X"00",X"66",X"22",X"66",X"00",X"66",X"22",X"26",X"00",X"22",X"77",X"22",X"00",X"22",X"77",X"22",
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X"00",X"00",X"77",X"77",X"00",X"00",X"77",X"77",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"02",X"00",X"00",X"00",X"02",X"00",X"00",X"00",
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X"00",X"00",X"00",X"66",X"00",X"00",X"00",X"66",X"00",X"20",X"00",X"22",X"00",X"00",X"00",X"22",
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X"00",X"22",X"77",X"00",X"00",X"22",X"77",X"00",X"00",X"66",X"66",X"00",X"00",X"66",X"27",X"00",
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X"72",X"66",X"22",X"77",X"72",X"66",X"22",X"67",X"00",X"22",X"77",X"22",X"00",X"22",X"77",X"26",
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X"20",X"66",X"77",X"66",X"20",X"66",X"77",X"66",X"00",X"77",X"77",X"00",X"00",X"77",X"77",X"00",
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X"00",X"66",X"22",X"66",X"00",X"66",X"22",X"26",X"00",X"22",X"77",X"22",X"00",X"22",X"77",X"22",
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X"00",X"00",X"77",X"77",X"00",X"00",X"77",X"77",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"CC",X"00",X"00",X"00",X"CC",X"00",X"00",X"00",X"00",X"CC",X"00",X"00",X"00",X"CC",X"00",X"00",
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X"00",X"77",X"00",X"00",X"00",X"77",X"CC",X"00",X"00",X"22",X"77",X"77",X"00",X"22",X"77",X"77",
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X"CC",X"77",X"22",X"22",X"CC",X"77",X"22",X"72",X"CC",X"77",X"22",X"22",X"CC",X"77",X"22",X"77",
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X"67",X"77",X"22",X"77",X"67",X"77",X"22",X"77",X"CC",X"22",X"27",X"77",X"CC",X"22",X"77",X"77",
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X"00",X"22",X"27",X"22",X"00",X"22",X"27",X"22",X"00",X"22",X"77",X"77",X"00",X"22",X"77",X"77",
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X"00",X"77",X"22",X"CC",X"00",X"77",X"22",X"00",X"CC",X"77",X"22",X"77",X"CC",X"77",X"22",X"77",
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X"CC",X"77",X"77",X"22",X"CC",X"77",X"77",X"22",X"00",X"22",X"CC",X"77",X"00",X"22",X"CC",X"77",
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X"00",X"77",X"CC",X"CC",X"00",X"77",X"CC",X"CC",X"00",X"CC",X"CC",X"00",X"00",X"CC",X"CC",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"BB",X"00",X"00",X"00",X"BB",X"00",X"00",X"00",X"BB",X"00",X"00",X"00",X"BB",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00");
|
||||
begin
|
||||
process(clk)
|
||||
begin
|
||||
if rising_edge(clk) then
|
||||
data <= rom_data(to_integer(unsigned(addr)));
|
||||
end if;
|
||||
end process;
|
||||
end architecture;
|
||||
@@ -1,534 +0,0 @@
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all,ieee.numeric_std.all;
|
||||
|
||||
entity tron_sp_bits_2 is
|
||||
port (
|
||||
clk : in std_logic;
|
||||
addr : in std_logic_vector(12 downto 0);
|
||||
data : out std_logic_vector(7 downto 0)
|
||||
);
|
||||
end entity;
|
||||
|
||||
architecture prom of tron_sp_bits_2 is
|
||||
type rom is array(0 to 8191) of std_logic_vector(7 downto 0);
|
||||
signal rom_data: rom := (
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"77",X"00",X"00",X"00",X"77",X"00",
|
||||
X"00",X"77",X"22",X"00",X"00",X"77",X"22",X"00",X"00",X"22",X"77",X"00",X"00",X"22",X"77",X"00",
|
||||
X"00",X"77",X"77",X"00",X"00",X"77",X"77",X"00",X"00",X"77",X"77",X"00",X"00",X"00",X"22",X"00",
|
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00");
|
||||
begin
|
||||
process(clk)
|
||||
begin
|
||||
if rising_edge(clk) then
|
||||
data <= rom_data(to_integer(unsigned(addr)));
|
||||
end if;
|
||||
end process;
|
||||
end architecture;
|
||||
@@ -1,534 +0,0 @@
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all,ieee.numeric_std.all;
|
||||
|
||||
entity tron_sp_bits_3 is
|
||||
port (
|
||||
clk : in std_logic;
|
||||
addr : in std_logic_vector(12 downto 0);
|
||||
data : out std_logic_vector(7 downto 0)
|
||||
);
|
||||
end entity;
|
||||
|
||||
architecture prom of tron_sp_bits_3 is
|
||||
type rom is array(0 to 8191) of std_logic_vector(7 downto 0);
|
||||
signal rom_data: rom := (
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"02",X"00",X"00",
|
||||
X"00",X"00",X"22",X"00",X"00",X"00",X"22",X"00",X"00",X"66",X"00",X"00",X"00",X"66",X"00",X"00",
|
||||
X"00",X"22",X"00",X"00",X"00",X"22",X"00",X"00",X"00",X"77",X"77",X"00",X"00",X"77",X"77",X"00",
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|
||||
X"00",X"22",X"77",X"00",X"00",X"77",X"66",X"00",X"00",X"77",X"66",X"00",X"00",X"00",X"60",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"77",X"00",X"00",X"00",X"77",X"77",X"77",X"00",X"22",X"77",X"77",X"00",X"22",
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X"22",X"77",X"00",X"00",X"22",X"77",X"00",X"00",X"00",X"00",X"77",X"00",X"00",X"00",X"77",X"00",
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X"00",X"66",X"22",X"00",X"00",X"66",X"22",X"00",X"77",X"66",X"00",X"00",X"77",X"66",X"00",X"00",
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X"77",X"66",X"00",X"00",X"77",X"66",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"22",X"62",X"66",X"00",X"22",X"22",X"66",X"00",X"22",X"22",X"22",X"66",X"22",X"22",X"22",X"66",
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X"00",X"77",X"77",X"22",X"00",X"72",X"77",X"22",X"00",X"22",X"66",X"00",X"00",X"22",X"66",X"00",
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X"00",X"66",X"22",X"00",X"00",X"66",X"22",X"00",X"77",X"66",X"00",X"00",X"77",X"66",X"00",X"00",
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X"00",X"22",X"77",X"C0",X"00",X"22",X"77",X"C0",X"CC",X"22",X"77",X"C0",X"CC",X"22",X"77",X"C0",
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X"77",X"22",X"22",X"00",X"77",X"22",X"22",X"00",X"22",X"22",X"22",X"C0",X"22",X"72",X"77",X"C0",
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X"77",X"77",X"72",X"77",X"77",X"77",X"22",X"77",X"77",X"22",X"22",X"CC",X"77",X"22",X"22",X"CC",
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X"22",X"22",X"22",X"00",X"22",X"22",X"22",X"00",X"77",X"22",X"22",X"CC",X"77",X"72",X"22",X"CC",
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X"00",X"77",X"22",X"77",X"00",X"77",X"22",X"77",X"CC",X"CC",X"77",X"CC",X"CC",X"CC",X"77",X"CC",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00");
|
||||
begin
|
||||
process(clk)
|
||||
begin
|
||||
if rising_edge(clk) then
|
||||
data <= rom_data(to_integer(unsigned(addr)));
|
||||
end if;
|
||||
end process;
|
||||
end architecture;
|
||||
@@ -1,534 +0,0 @@
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all,ieee.numeric_std.all;
|
||||
|
||||
entity tron_sp_bits_4 is
|
||||
port (
|
||||
clk : in std_logic;
|
||||
addr : in std_logic_vector(12 downto 0);
|
||||
data : out std_logic_vector(7 downto 0)
|
||||
);
|
||||
end entity;
|
||||
|
||||
architecture prom of tron_sp_bits_4 is
|
||||
type rom is array(0 to 8191) of std_logic_vector(7 downto 0);
|
||||
signal rom_data: rom := (
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"22",X"00",X"00",X"00",X"22",X"00",X"00",
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||||
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X"22",X"22",X"00",X"00",X"22",X"22",X"00",X"00",X"00",X"22",X"00",X"00",X"00",X"22",X"00",X"00",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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X"77",X"22",X"22",X"00",X"77",X"22",X"22",X"00",X"77",X"22",X"77",X"00",X"77",X"22",X"77",X"00",
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X"22",X"22",X"00",X"00",X"22",X"22",X"00",X"00",X"00",X"22",X"00",X"00",X"00",X"22",X"00",X"00",
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X"CC",X"77",X"22",X"CC",X"CC",X"77",X"22",X"CC",X"77",X"CC",X"77",X"00",X"77",X"CC",X"77",X"00",
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X"6C",X"C7",X"05",X"2C",X"6C",X"7C",X"25",X"CC",X"6C",X"C7",X"25",X"2C",X"AC",X"C7",X"25",X"55",
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"40",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"60",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"66",X"60",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"55",X"00",X"55",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"55",X"05",X"05",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"04",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"40",X"40",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"F0",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"05",X"00",X"0E",X"00",X"05",X"00",X"E0",X"0A",X"00",X"7F",X"09",X"00",X"00",X"F0",X"20",
|
||||
X"0A",X"0F",X"0F",X"0B",X"00",X"00",X"00",X"A0",X"AB",X"00",X"0B",X"00",X"F0",X"F0",X"F0",X"00",
|
||||
X"0A",X"09",X"09",X"00",X"90",X"20",X"90",X"00",X"0E",X"0B",X"00",X"B0",X"00",X"00",X"00",X"A5",
|
||||
X"0E",X"00",X"0B",X"00",X"0A",X"00",X"2E",X"A0",X"00",X"0B",X"00",X"00",X"00",X"09",X"00",X"A7",
|
||||
X"00",X"90",X"00",X"00",X"00",X"0E",X"00",X"00",X"00",X"A0",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"E0",X"00",X"00",X"00",X"95",X"00",X"00",X"7E",X"09",X"00",X"00",X"90",X"05",X"00",X"00",
|
||||
X"09",X"00",X"00",X"00",X"B0",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"50",X"00",X"00",X"00",X"0A",X"00",X"00",X"00",
|
||||
X"07",X"00",X"00",X"00",X"20",X"02",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"2A",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"07",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"07",X"00",X"00",X"00",X"07",X"00",X"07",X"00",
|
||||
X"07",X"00",X"00",X"00",X"07",X"00",X"00",X"00",X"44",X"44",X"00",X"40",X"44",X"40",X"00",X"44",
|
||||
X"44",X"00",X"00",X"44",X"44",X"00",X"00",X"40",X"44",X"00",X"00",X"00",X"07",X"00",X"00",X"00",
|
||||
X"07",X"00",X"07",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"07",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"77",X"00",X"77",X"00",X"55",X"00",X"55",X"00",
|
||||
X"CC",X"00",X"5C",X"00",X"CC",X"00",X"05",X"00",X"C5",X"00",X"00",X"00",X"50",X"00",X"00",X"00",
|
||||
X"50",X"00",X"00",X"00",X"50",X"00",X"00",X"00",X"50",X"00",X"00",X"00",X"50",X"00",X"00",X"00",
|
||||
X"50",X"00",X"00",X"00",X"50",X"00",X"00",X"00",X"50",X"55",X"00",X"00",X"00",X"CC",X"00",X"00",
|
||||
X"55",X"55",X"55",X"00",X"00",X"00",X"00",X"00",X"50",X"50",X"00",X"00",X"50",X"50",X"50",X"00",
|
||||
X"50",X"00",X"C5",X"00",X"55",X"50",X"55",X"55",X"00",X"00",X"00",X"00",X"00",X"55",X"55",X"00",
|
||||
X"00",X"CC",X"00",X"00",X"00",X"CC",X"00",X"00",X"00",X"57",X"00",X"00",X"00",X"05",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"75",X"55",X"55",X"00",X"75",X"CC",X"5C",X"00",
|
||||
X"75",X"CC",X"5C",X"00",X"75",X"CC",X"5C",X"00",X"75",X"55",X"55",X"00",X"75",X"00",X"00",X"00",
|
||||
X"75",X"00",X"00",X"00",X"75",X"00",X"05",X"00",X"75",X"00",X"5C",X"00",X"00",X"00",X"5C",X"00",
|
||||
X"00",X"00",X"55",X"00",X"00",X"00",X"55",X"00",X"00",X"00",X"55",X"50",X"00",X"00",X"00",X"75",
|
||||
X"00",X"00",X"00",X"75",X"00",X"00",X"55",X"50",X"00",X"00",X"55",X"00",X"00",X"00",X"55",X"00",
|
||||
X"00",X"00",X"5C",X"00",X"75",X"00",X"5C",X"00",X"75",X"00",X"05",X"00",X"75",X"00",X"00",X"00",
|
||||
X"75",X"00",X"00",X"00",X"75",X"55",X"55",X"00",X"75",X"CC",X"5C",X"00",X"75",X"CC",X"5C",X"00",
|
||||
X"75",X"CC",X"5C",X"00",X"75",X"55",X"55",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00");
|
||||
begin
|
||||
process(clk)
|
||||
begin
|
||||
if rising_edge(clk) then
|
||||
data <= rom_data(to_integer(unsigned(addr)));
|
||||
end if;
|
||||
end process;
|
||||
end architecture;
|
||||
46
Arcade_MiST/Midway MCR 2/Tron_MiST/rtl/spinner.vhd
Normal file
46
Arcade_MiST/Midway MCR 2/Tron_MiST/rtl/spinner.vhd
Normal file
@@ -0,0 +1,46 @@
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all;
|
||||
use ieee.std_logic_unsigned.all;
|
||||
use ieee.numeric_std.all;
|
||||
|
||||
entity spinner is
|
||||
port(
|
||||
clock_40 : in std_logic;
|
||||
reset : in std_logic;
|
||||
btn_left : in std_logic;
|
||||
btn_right : in std_logic;
|
||||
btn_acc : in std_logic; -- speed up button
|
||||
ctc_zc_to_2 : in std_logic;
|
||||
spin_angle : out std_logic_vector(6 downto 0)
|
||||
);
|
||||
end spinner;
|
||||
|
||||
architecture rtl of spinner is
|
||||
|
||||
signal ctc_zc_to_2_r : std_logic;
|
||||
signal spin_count : std_logic_vector(9 downto 0);
|
||||
|
||||
begin
|
||||
|
||||
spin_angle <= spin_count(9 downto 3);
|
||||
|
||||
process (clock_40, reset)
|
||||
begin
|
||||
if reset = '1' then
|
||||
spin_count <= (others => '0');
|
||||
elsif rising_edge(clock_40) then
|
||||
ctc_zc_to_2_r <= ctc_zc_to_2;
|
||||
|
||||
if ctc_zc_to_2_r ='0' and ctc_zc_to_2 = '1' then
|
||||
if btn_acc = '0' then -- space -- speed up
|
||||
if btn_left = '1' then spin_count <= spin_count - 40; end if; -- left
|
||||
if btn_right = '1' then spin_count <= spin_count + 40; end if; -- right
|
||||
else
|
||||
if btn_left = '1' then spin_count <= spin_count - 55; end if;
|
||||
if btn_right = '1' then spin_count <= spin_count + 55; end if;
|
||||
end if;
|
||||
end if;
|
||||
end if;
|
||||
end process;
|
||||
|
||||
end rtl;
|
||||
@@ -3,10 +3,15 @@
|
||||
-- http://darfpga.blogspot.fr
|
||||
---------------------------------------------------------------------------------
|
||||
--
|
||||
-- release 01 : improve ssio read input (fix mirror addressing)
|
||||
-- improve memory access (fix mirror addressing)
|
||||
-- release rev 03 : add TV 15kHz mode
|
||||
-- (22/11/2019) use merged sprite 8bits roms (make it easier to externalize)
|
||||
--
|
||||
-- release 00 : initial release
|
||||
-- release rev 02 : slight improvement in bg and sp memory access (no big change)
|
||||
--
|
||||
-- release rev 01 : improve ssio read input (fix mirror addressing)
|
||||
-- improve memory access (fix mirror addressing)
|
||||
--
|
||||
-- release rev 00 : initial release
|
||||
--
|
||||
---------------------------------------------------------------------------------
|
||||
-- gen_ram.vhd & io_ps2_keyboard
|
||||
@@ -29,13 +34,13 @@
|
||||
---------------------------------------------------------------------------------
|
||||
|
||||
-- Features :
|
||||
-- Video : 31Khz/60Hz
|
||||
-- Video : VGA 31Khz/60Hz and TV 15kHz
|
||||
-- Coctail mode : NO
|
||||
-- Sound : OK
|
||||
|
||||
-- Use with MAME roms from tron.zip
|
||||
--
|
||||
-- Use make_tron_hollow_proms.bat to build vhd file from binaries
|
||||
-- Use make_tron_proms.bat to build vhd file from binaries
|
||||
-- (CRC list included)
|
||||
|
||||
-- Tron (midway mcr) Hardware caracteristics :
|
||||
@@ -58,7 +63,7 @@
|
||||
|
||||
-- Sprites line buffer rams : 1 scan line delay flip/flop 2x256x8bits
|
||||
--
|
||||
-- SOUND : see tron_hollow_sound_board.vhd
|
||||
-- SOUND : see tron_sound_board.vhd
|
||||
|
||||
---------------------------------------------------------------------------------
|
||||
-- Schematics remarks :
|
||||
@@ -127,25 +132,24 @@
|
||||
--
|
||||
---------------------------------------------------------------------------------
|
||||
|
||||
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all;
|
||||
use ieee.std_logic_unsigned.all;
|
||||
use ieee.numeric_std.all;
|
||||
|
||||
entity satans_hollow is
|
||||
entity tron is
|
||||
port(
|
||||
clock_40 : in std_logic;
|
||||
reset : in std_logic;
|
||||
--tv15Khz_mode : in std_logic;
|
||||
tv15Khz_mode : in std_logic;
|
||||
video_r : out std_logic_vector(2 downto 0);
|
||||
video_g : out std_logic_vector(2 downto 0);
|
||||
video_b : out std_logic_vector(2 downto 0);
|
||||
video_clk : out std_logic;
|
||||
--video_csync : out std_logic;
|
||||
video_csync : out std_logic;
|
||||
video_blankn : out std_logic;
|
||||
video_vs : out std_logic;
|
||||
video_hs : out std_logic;
|
||||
video_vs : out std_logic;
|
||||
|
||||
separate_audio : in std_logic;
|
||||
audio_out_l : out std_logic_vector(15 downto 0);
|
||||
@@ -161,33 +165,33 @@ port(
|
||||
up : in std_logic;
|
||||
down : in std_logic;
|
||||
fire : in std_logic;
|
||||
buttonf : in std_logic;
|
||||
buttong : in std_logic;
|
||||
buttont : in std_logic;
|
||||
angle : in std_logic_vector(6 downto 0);
|
||||
|
||||
left_c : in std_logic;
|
||||
right_c : in std_logic;
|
||||
up_c : in std_logic;
|
||||
down_c : in std_logic;
|
||||
fire_c : in std_logic;
|
||||
|
||||
angle_c : in std_logic_vector(6 downto 0);
|
||||
|
||||
coin_meters : in std_logic;
|
||||
cocktail : in std_logic;
|
||||
cont : in std_logic;
|
||||
service : in std_logic;
|
||||
cpu_rom_addr : out std_logic_vector(15 downto 0);
|
||||
cpu_rom_do : in std_logic_vector(7 downto 0);
|
||||
cpu_rom_rd : out std_logic;
|
||||
|
||||
snd_rom_addr : out std_logic_vector(13 downto 0);
|
||||
snd_rom_do : in std_logic_vector(7 downto 0);
|
||||
snd_rom_rd : out std_logic
|
||||
cpu_rom_addr : out std_logic_vector(15 downto 0);
|
||||
cpu_rom_do : in std_logic_vector(7 downto 0);
|
||||
cpu_rom_rd : out std_logic;
|
||||
|
||||
snd_rom_addr : out std_logic_vector(13 downto 0);
|
||||
snd_rom_do : in std_logic_vector(7 downto 0);
|
||||
snd_rom_rd : out std_logic;
|
||||
|
||||
dbg_cpu_addr : out std_logic_vector(15 downto 0)
|
||||
);
|
||||
end satans_hollow;
|
||||
end tron;
|
||||
|
||||
architecture struct of satans_hollow is
|
||||
architecture struct of tron is
|
||||
|
||||
signal reset_n : std_logic;
|
||||
signal clock_vid : std_logic;
|
||||
@@ -198,10 +202,11 @@ architecture struct of satans_hollow is
|
||||
signal vcnt : std_logic_vector(9 downto 0) := (others=>'0'); -- vertical counter
|
||||
signal vflip : std_logic_vector(9 downto 0) := (others=>'0'); -- vertical counter flip
|
||||
|
||||
signal frame : std_logic_vector(9 downto 0) := (others=>'0'); -- frame counter dbg
|
||||
signal hs_cnt, vs_cnt :std_logic_vector(9 downto 0) ;
|
||||
signal hsync0, hsync1, hsync2, hsync3, hsync4 : std_logic;
|
||||
signal top_frame : std_logic := '0';
|
||||
|
||||
signal pix_ena : std_logic;
|
||||
signal pix_ena_r : std_logic;
|
||||
signal cpu_ena : std_logic;
|
||||
|
||||
signal cpu_addr : std_logic_vector(15 downto 0);
|
||||
@@ -238,14 +243,15 @@ architecture struct of satans_hollow is
|
||||
signal ctc_counter_3_do : std_logic_vector(7 downto 0);
|
||||
signal ctc_counter_3_int : std_logic;
|
||||
|
||||
-- signal cpu_rom_do : std_logic_vector( 7 downto 0);
|
||||
|
||||
signal wram_we : std_logic;
|
||||
signal wram_do : std_logic_vector( 7 downto 0);
|
||||
|
||||
signal bg_ram_addr: std_logic_vector(10 downto 0);
|
||||
signal bg_ram_we : std_logic;
|
||||
signal bg_ram_cpu_access : std_logic;
|
||||
signal bg_ram_do : std_logic_vector(7 downto 0);
|
||||
signal bg_ram_do_r: std_logic_vector(7 downto 0); -- registred data for cpu
|
||||
signal bg_ram_do_r: std_logic_vector(7 downto 0); -- registred ram data for cpu
|
||||
|
||||
signal bg_code : std_logic_vector(7 downto 0);
|
||||
signal bg_code_r : std_logic_vector(7 downto 0);
|
||||
@@ -258,8 +264,8 @@ architecture struct of satans_hollow is
|
||||
|
||||
signal sp_ram_cache_addr : std_logic_vector(8 downto 0);
|
||||
signal sp_ram_cache_we : std_logic;
|
||||
signal sp_ram_cache_cpu_access : std_logic;
|
||||
signal sp_ram_cache_do : std_logic_vector(7 downto 0);
|
||||
signal sp_ram_cache_do_r : std_logic_vector(7 downto 0);-- registred ram data for cpu
|
||||
|
||||
signal move_buf : std_logic;
|
||||
signal sp_ram_addr : std_logic_vector(8 downto 0);
|
||||
@@ -278,15 +284,12 @@ architecture struct of satans_hollow is
|
||||
signal sp_on_line_r : std_logic;
|
||||
signal sp_byte_cnt : std_logic_vector( 1 downto 0);
|
||||
signal sp_code_line : std_logic_vector(12 downto 0);
|
||||
signal sp_code_line_mux: std_logic_vector(14 downto 0);
|
||||
signal sp_hflip : std_logic_vector( 1 downto 0);
|
||||
signal sp_vflip : std_logic_vector( 4 downto 0);
|
||||
|
||||
signal sp_graphx1_do : std_logic_vector( 7 downto 0);
|
||||
signal sp_graphx2_do : std_logic_vector( 7 downto 0);
|
||||
signal sp_graphx3_do : std_logic_vector( 7 downto 0);
|
||||
signal sp_graphx4_do : std_logic_vector( 7 downto 0);
|
||||
signal sp_graphx_do : std_logic_vector( 7 downto 0);
|
||||
signal sp_mux_roms : std_logic_vector( 1 downto 0);
|
||||
signal sp_graphx_mux : std_logic_vector( 7 downto 0);
|
||||
signal sp_graphx_flip : std_logic_vector( 7 downto 0);
|
||||
|
||||
signal sp_buffer_ram1_addr : std_logic_vector(7 downto 0);
|
||||
@@ -301,54 +304,37 @@ architecture struct of satans_hollow is
|
||||
signal sp_buffer_ram2_do : std_logic_vector(7 downto 0);
|
||||
signal sp_buffer_ram2_do_r : std_logic_vector(7 downto 0);
|
||||
|
||||
signal sp_vid_a : std_logic_vector(3 downto 0);
|
||||
signal sp_buffer_sel : std_logic;
|
||||
|
||||
signal sp_vid : std_logic_vector(3 downto 0);
|
||||
|
||||
signal palette_addr : std_logic_vector(5 downto 0);
|
||||
signal palette_we : std_logic;
|
||||
signal palette_do : std_logic_vector(8 downto 0);
|
||||
|
||||
signal ssio_iowe : std_logic;
|
||||
signal ssio_do : std_logic_vector(7 downto 0);
|
||||
signal ssio_iowe : std_logic;
|
||||
signal ssio_do : std_logic_vector(7 downto 0);
|
||||
|
||||
signal input_0 : std_logic_vector(7 downto 0);
|
||||
signal input_1 : std_logic_vector(7 downto 0);
|
||||
signal input_2 : std_logic_vector(7 downto 0);
|
||||
signal input_3 : std_logic_vector(7 downto 0);
|
||||
signal input_4 : std_logic_vector(7 downto 0);
|
||||
|
||||
signal vga_s_r : std_logic;
|
||||
signal spin_count : std_logic_vector(9 downto 0);
|
||||
signal vga_vs : std_logic;
|
||||
signal angle : std_logic_vector(6 downto 0);
|
||||
signal angle_c : std_logic_vector(6 downto 0);
|
||||
|
||||
begin
|
||||
|
||||
clock_vid <= clock_40;
|
||||
clock_vidn <= not clock_40;
|
||||
reset_n <= not reset;
|
||||
video_vs <= vga_vs;
|
||||
|
||||
process (clock_40)
|
||||
-- debug
|
||||
process (reset, clock_vid)
|
||||
begin
|
||||
if rising_edge(clock_40) then
|
||||
vga_s_r <= vga_vs;
|
||||
|
||||
if vga_s_r ='0' and vga_vs = '1' then
|
||||
if buttont = '0' then -- 't' -- speed up spinner
|
||||
if buttonf = '1' then spin_count <= spin_count - 30; end if; -- 'f'
|
||||
if buttong = '1' then spin_count <= spin_count + 30; end if; -- 'g'
|
||||
else
|
||||
if buttonf = '1' then spin_count <= spin_count - 40; end if;
|
||||
if buttong = '1' then spin_count <= spin_count + 40; end if;
|
||||
end if;
|
||||
end if;
|
||||
|
||||
end if;
|
||||
if rising_edge(clock_vid) and cpu_ena ='1' and cpu_mreq_n ='0' then
|
||||
dbg_cpu_addr<= "0" & angle & "00" & cocktail & cont & "000" & service; --cpu_addr;
|
||||
end if;
|
||||
end process;
|
||||
|
||||
angle <= spin_count(9 downto 3);
|
||||
angle_c <= spin_count(9 downto 3);
|
||||
-- make enables clock from clock_vid
|
||||
process (clock_vid, reset)
|
||||
begin
|
||||
@@ -366,10 +352,11 @@ begin
|
||||
end process;
|
||||
--
|
||||
cpu_ena <= '1' when clock_cnt = "1111" else '0'; -- (2.5MHz)
|
||||
pix_ena <= clock_cnt(0); -- (20MHz)
|
||||
pix_ena <= '1' when (clock_cnt(1 downto 0) = "11" and tv15Khz_mode = '1') or -- (10MHz)
|
||||
(clock_cnt(0) = '1' and tv15Khz_mode = '0') else '0'; -- (20MHz)
|
||||
|
||||
-----------------------------------
|
||||
-- Video scanner 635x525 @20Mhz --
|
||||
-- Video scanner 634x525 @20Mhz --
|
||||
-- display 512x480 --
|
||||
-----------------------------------
|
||||
process (reset, clock_vid)
|
||||
@@ -377,31 +364,106 @@ begin
|
||||
if reset='1' then
|
||||
hcnt <= (others=>'0');
|
||||
vcnt <= (others=>'0');
|
||||
frame <= (others=>'0');
|
||||
top_frame <= '0';
|
||||
else
|
||||
if rising_edge(clock_vid) then
|
||||
if pix_ena = '1' then
|
||||
|
||||
hcnt <= hcnt + 1;
|
||||
if hcnt = 634 then
|
||||
if hcnt = 633 then
|
||||
hcnt <= (others=>'0');
|
||||
vcnt <= vcnt + 1;
|
||||
if vcnt = 524 then
|
||||
if (vcnt = 524 and tv15Khz_mode = '0') or (vcnt = 263 and tv15Khz_mode = '1') then
|
||||
vcnt <= (others=>'0');
|
||||
frame <= frame + 1;
|
||||
top_frame <= not top_frame;
|
||||
end if;
|
||||
end if;
|
||||
|
||||
if vcnt = 490-1 then vga_vs <= '0'; end if; -- front porch 10
|
||||
if vcnt = 492-1 then vga_vs <= '1'; end if; -- sync pulse 2
|
||||
-- back porch 33
|
||||
if tv15Khz_mode = '0' then
|
||||
-- progessive mode
|
||||
|
||||
if vcnt = 490-1 then video_vs <= '0'; end if; -- front porch 10
|
||||
if vcnt = 492-1 then video_vs <= '1'; end if; -- sync pulse 2
|
||||
-- back porch 33
|
||||
|
||||
if hcnt = 512+40 then video_hs <= '0'; end if; -- front porch 16/25*20 = 13
|
||||
if hcnt = 512+90+9 then video_hs <= '1'; end if; -- sync pulse 96/25*20 = 77
|
||||
-- back porch 48/25*20 = 38
|
||||
video_blankn <= '0';
|
||||
if hcnt = 512+13+9+6 then video_hs <= '0'; end if; -- front porch 16/25*20 = 13
|
||||
if hcnt = 512+90+9+6 then video_hs <= '1'; end if; -- sync pulse 96/25*20 = 77
|
||||
-- back porch 48/25*20 = 38
|
||||
video_blankn <= '0';
|
||||
if hcnt >= 2+16-1 and hcnt < 514+16-1 and
|
||||
vcnt >= 2 and vcnt < 481 then video_blankn <= '1';end if;
|
||||
|
||||
else -- interlaced mode
|
||||
|
||||
if hcnt = 530+22 then
|
||||
hs_cnt <= (others => '0');
|
||||
if (vcnt = 240) then
|
||||
vs_cnt <= (others => '0');
|
||||
else
|
||||
vs_cnt <= vs_cnt +1;
|
||||
end if;
|
||||
|
||||
if vcnt = 240 then video_vs <= '0'; end if;
|
||||
if vcnt = 242 then video_vs <= '1'; end if;
|
||||
|
||||
else
|
||||
hs_cnt <= hs_cnt + 1;
|
||||
end if;
|
||||
|
||||
video_blankn <= '0';
|
||||
if hcnt >= 2+16 and hcnt < 514+16 and
|
||||
vcnt >= 2 and vcnt < 481 then video_blankn <= '1';end if;
|
||||
vcnt >= 1 and vcnt < 241 then video_blankn <= '1';end if;
|
||||
|
||||
|
||||
if hs_cnt = 0 then hsync0 <= '0';
|
||||
elsif hs_cnt = 47 then hsync0 <= '1';
|
||||
end if;
|
||||
|
||||
if hs_cnt = 0 then hsync1 <= '0';
|
||||
elsif hs_cnt = 23 then hsync1 <= '1';
|
||||
elsif hs_cnt = 317+ 0 then hsync1 <= '0';
|
||||
elsif hs_cnt = 317+23 then hsync1 <= '1';
|
||||
end if;
|
||||
|
||||
if hs_cnt = 0 then hsync2 <= '0';
|
||||
elsif hs_cnt = 317-47 then hsync2 <= '1';
|
||||
elsif hs_cnt = 317 then hsync2 <= '0';
|
||||
elsif hs_cnt = 634-47 then hsync2 <= '1';
|
||||
end if;
|
||||
|
||||
|
||||
if hs_cnt = 0 then hsync3 <= '0';
|
||||
elsif hs_cnt = 23 then hsync3 <= '1';
|
||||
elsif hs_cnt = 317 then hsync3 <= '0';
|
||||
elsif hs_cnt = 634-47 then hsync3 <= '1';
|
||||
end if;
|
||||
|
||||
if hs_cnt = 0 then hsync4 <= '0';
|
||||
elsif hs_cnt = 317-47 then hsync4 <= '1';
|
||||
elsif hs_cnt = 317 then hsync4 <= '0';
|
||||
elsif hs_cnt = 317+23 then hsync4 <= '1';
|
||||
end if;
|
||||
|
||||
|
||||
if vs_cnt = 1 then video_csync <= hsync1;
|
||||
elsif vs_cnt = 2 then video_csync <= hsync1;
|
||||
elsif vs_cnt = 3 then video_csync <= hsync1;
|
||||
elsif vs_cnt = 4 and top_frame = '1' then video_csync <= hsync3;
|
||||
elsif vs_cnt = 4 and top_frame = '0' then video_csync <= hsync1;
|
||||
elsif vs_cnt = 5 then video_csync <= hsync2;
|
||||
elsif vs_cnt = 6 then video_csync <= hsync2;
|
||||
elsif vs_cnt = 7 and top_frame = '1' then video_csync <= hsync4;
|
||||
elsif vs_cnt = 7 and top_frame = '0' then video_csync <= hsync2;
|
||||
elsif vs_cnt = 8 then video_csync <= hsync1;
|
||||
elsif vs_cnt = 9 then video_csync <= hsync1;
|
||||
elsif vs_cnt = 10 then video_csync <= hsync1;
|
||||
elsif vs_cnt = 11 then video_csync <= hsync0;
|
||||
else video_csync <= hsync0;
|
||||
end if;
|
||||
|
||||
|
||||
end if;
|
||||
|
||||
end if;
|
||||
end if;
|
||||
end if;
|
||||
@@ -420,22 +482,22 @@ input_4 <= '1' & angle_c;
|
||||
------------------------------------------
|
||||
-- cpu data input with address decoding --
|
||||
------------------------------------------
|
||||
cpu_di <= cpu_rom_do when cpu_mreq_n = '0' and cpu_addr(15 downto 12) < X"C" else -- 0000-BFFF
|
||||
wram_do when cpu_mreq_n = '0' and (cpu_addr and X"E000") = x"C000" else -- C000-C7FF + mirroring 1800
|
||||
sp_ram_cache_do when cpu_mreq_n = '0' and (cpu_addr and x"E800") = x"E000" else -- sprite ram E000-E1FF + mirroring 1600
|
||||
bg_ram_do_r when cpu_mreq_n = '0' and (cpu_addr and x"E800") = x"E800" else -- video ram E800-EFFF + mirroring 1000
|
||||
ctc_controler_do when cpu_ioreq_n = '0' and cpu_m1_n = '0' else -- ctc ctrl (interrupt vector)
|
||||
ssio_do when cpu_ioreq_n = '0' and cpu_addr(7 downto 5) = "000" else -- 0x00-0x1F
|
||||
ctc_counter_3_do when cpu_ioreq_n = '0' and cpu_addr(7 downto 0) = X"F3" else
|
||||
ctc_counter_2_do when cpu_ioreq_n = '0' and cpu_addr(7 downto 0) = X"F2" else
|
||||
ctc_counter_1_do when cpu_ioreq_n = '0' and cpu_addr(7 downto 0) = X"F1" else
|
||||
ctc_counter_0_do when cpu_ioreq_n = '0' and cpu_addr(7 downto 0) = X"F0" else
|
||||
X"FF";
|
||||
cpu_di <= cpu_rom_do when cpu_mreq_n = '0' and cpu_addr(15 downto 12) < X"C" else -- 0000-BFFF
|
||||
wram_do when cpu_mreq_n = '0' and (cpu_addr and X"E000") = x"C000" else -- C000-C7FF + mirroring 1800
|
||||
sp_ram_cache_do_r when cpu_mreq_n = '0' and (cpu_addr and x"E800") = x"E000" else -- sprite ram E000-E1FF + mirroring 1600
|
||||
bg_ram_do_r when cpu_mreq_n = '0' and (cpu_addr and x"E800") = x"E800" else -- video ram E800-EFFF + mirroring 1000
|
||||
ctc_controler_do when cpu_ioreq_n = '0' and cpu_m1_n = '0' else -- ctc ctrl (interrupt vector)
|
||||
ssio_do when cpu_ioreq_n = '0' and cpu_addr(7 downto 5) = "000" else -- 0x00-0x1F
|
||||
ctc_counter_3_do when cpu_ioreq_n = '0' and cpu_addr(7 downto 0) = X"F3" else
|
||||
ctc_counter_2_do when cpu_ioreq_n = '0' and cpu_addr(7 downto 0) = X"F2" else
|
||||
ctc_counter_1_do when cpu_ioreq_n = '0' and cpu_addr(7 downto 0) = X"F1" else
|
||||
ctc_counter_0_do when cpu_ioreq_n = '0' and cpu_addr(7 downto 0) = X"F0" else
|
||||
X"FF";
|
||||
|
||||
------------------------------------------------------------------------
|
||||
-- Misc registers : ctc write enable / interrupt acknowledge
|
||||
------------------------------------------------------------------------
|
||||
ctc_counter_3_trg <= '1' when vcnt = 493 else '0';
|
||||
ctc_counter_3_trg <= '1' when (vcnt = 246 and tv15Khz_mode = '1') or (vcnt = 493 and tv15Khz_mode = '0')else '0';
|
||||
ctc_counter_3_we <= '1' when cpu_wr_n = '0' and cpu_ioreq_n = '0' and cpu_addr(7 downto 0) = X"F3" else '0';
|
||||
ctc_counter_2_we <= '1' when cpu_wr_n = '0' and cpu_ioreq_n = '0' and cpu_addr(7 downto 0) = X"F2" else '0';
|
||||
ctc_counter_1_we <= '1' when cpu_wr_n = '0' and cpu_ioreq_n = '0' and cpu_addr(7 downto 0) = X"F1" else '0';
|
||||
@@ -446,19 +508,18 @@ ctc_int_ack <= '1' when cpu_ioreq_n = '0' and cpu_m1_n = '0' else '0';
|
||||
------------------------------------------
|
||||
-- write enable / ram access from CPU --
|
||||
------------------------------------------
|
||||
wram_we <= '1' when cpu_mreq_n = '0' and cpu_wr_n = '0' and (cpu_addr and x"E000") = x"C000" else '0';
|
||||
sp_ram_cache_we <= '1' when cpu_mreq_n = '0' and cpu_wr_n = '0' and (cpu_addr and x"E800") = x"E000" else '0';
|
||||
sp_ram_cache_cpu_access <= '1' when cpu_mreq_n = '0' and (cpu_wr_n = '0' or cpu_rd_n = '0') and (cpu_addr and x"E800") = x"E000" else '0';
|
||||
bg_ram_cpu_access <= '1' when cpu_mreq_n = '0' and (cpu_wr_n = '0' or cpu_rd_n = '0') and (cpu_addr and x"E800") = x"E800" and hcnt(0) = '0' else '0';
|
||||
bg_ram_we <= '1' when bg_ram_cpu_access = '1' and cpu_wr_n = '0' else '0';
|
||||
wram_we <= '1' when cpu_mreq_n = '0' and cpu_wr_n = '0' and (cpu_addr and x"E000") = x"C000" else '0';
|
||||
sp_ram_cache_we <= '1' when cpu_mreq_n = '0' and cpu_wr_n = '0' and (cpu_addr and x"E800") = x"E000" and hcnt(0) = '0' else '0';
|
||||
bg_ram_we <= '1' when cpu_mreq_n = '0' and cpu_wr_n = '0' and (cpu_addr and x"E800") = x"E800" and hcnt(0) = '0' else '0';
|
||||
|
||||
ssio_iowe <= '1' when cpu_wr_n = '0' and cpu_ioreq_n = '0' else '0';
|
||||
|
||||
----------------------
|
||||
--- sprite machine ---
|
||||
----------------------
|
||||
--vflip <= 480-vcnt; -- apply mirror flip
|
||||
vflip <= vcnt; -- do not apply mirror flip
|
||||
vflip <= vcnt(8 downto 0) & top_frame when tv15Khz_mode = '1' else vcnt; -- do not apply mirror flip
|
||||
|
||||
sp_buffer_sel <= vflip(1) when tv15Khz_mode = '1' else vflip(0);
|
||||
|
||||
process (clock_vid)
|
||||
begin
|
||||
@@ -508,20 +569,18 @@ begin
|
||||
sp_buffer_ram2_do_r <= sp_buffer_ram2_do;
|
||||
end if;
|
||||
|
||||
sp_on_line_r <= sp_on_line;
|
||||
|
||||
pix_ena_r <= pix_ena;
|
||||
|
||||
sp_vid <= sp_vid_a;
|
||||
|
||||
end if;
|
||||
|
||||
end if;
|
||||
end process;
|
||||
|
||||
sp_ram_cache_addr <= cpu_addr(8 downto 0) when sp_ram_cache_cpu_access = '1' else sp_ram_addr;
|
||||
-- sp_ram_cache can be read/write by cpu when hcnt(0) = 0;
|
||||
-- sp_ram_cache can be read by sprite machine when hcnt(0) = 1;
|
||||
|
||||
move_buf <= '1' when vcnt(8 downto 1) = 250 else '0'; -- line 500-501
|
||||
sp_ram_cache_addr <= cpu_addr(8 downto 0) when hcnt(0) = '0' else sp_ram_addr;
|
||||
|
||||
|
||||
move_buf <= '1' when (vcnt(8 downto 1) = 250 and tv15Khz_mode = '0') or (vcnt(7 downto 1) = 125 and tv15Khz_mode = '1') else '0'; -- line 500-501
|
||||
sp_ram_addr <= vcnt(0) & hcnt(8 downto 1) when move_buf = '1' else sp_cnt & sp_input_phase(1 downto 0);
|
||||
sp_ram_we <= hcnt(0) when move_buf = '1' else '0';
|
||||
|
||||
@@ -532,35 +591,35 @@ sp_vflip <= (others => sp_code(7));
|
||||
|
||||
sp_code_line <= sp_code(5 downto 0) & (sp_line xor sp_vflip) & (sp_byte_cnt xor sp_hflip); -- sprite graphics roms addr
|
||||
|
||||
sp_graphx_mux <= sp_graphx1_do when (sp_hflip(0) = '0' and sp_mux_roms = "01") or
|
||||
sp_code_line_mux <= "00" & sp_code_line when (sp_hflip(0) = '0' and sp_mux_roms = "01") or
|
||||
(sp_hflip(0) = '1' and sp_mux_roms = "00") else
|
||||
sp_graphx2_do when (sp_hflip(0) = '0' and sp_mux_roms = "10") or
|
||||
"01" & sp_code_line when (sp_hflip(0) = '0' and sp_mux_roms = "10") or
|
||||
(sp_hflip(0) = '1' and sp_mux_roms = "11") else
|
||||
sp_graphx3_do when (sp_hflip(0) = '0' and sp_mux_roms = "11") or
|
||||
"10" & sp_code_line when (sp_hflip(0) = '0' and sp_mux_roms = "11") or
|
||||
(sp_hflip(0) = '1' and sp_mux_roms = "10") else
|
||||
sp_graphx4_do when (sp_hflip(0) = '0' and sp_mux_roms = "00") or
|
||||
"11" & sp_code_line when (sp_hflip(0) = '0' and sp_mux_roms = "00") or
|
||||
(sp_hflip(0) = '1' and sp_mux_roms = "01") ;
|
||||
|
||||
sp_graphx_flip <= sp_graphx_mux when sp_hflip(0) = '0' else
|
||||
sp_graphx_mux(3 downto 0) & sp_graphx_mux(7 downto 4);
|
||||
sp_graphx_flip <= sp_graphx_do when sp_hflip(0) = '0' else
|
||||
sp_graphx_do(3 downto 0) & sp_graphx_do(7 downto 4);
|
||||
|
||||
sp_buffer_ram1_di <= sp_buffer_ram1_do or sp_graphx_flip when vflip(0) = '1' else "00000000";
|
||||
sp_buffer_ram1_addr <= sp_hcnt(8 downto 1) when vflip(0) = '1' else hcnt(8 downto 1) - X"04";
|
||||
sp_buffer_ram1_we <= not sp_hcnt(0) and sp_on_line and pix_ena when vflip(0) = '1' else hcnt(0);
|
||||
sp_buffer_ram1_di <= sp_buffer_ram1_do or sp_graphx_flip when sp_buffer_sel = '1' else "00000000";
|
||||
sp_buffer_ram1_addr <= sp_hcnt(8 downto 1) when sp_buffer_sel = '1' else hcnt(8 downto 1) - X"04";
|
||||
sp_buffer_ram1_we <= not sp_hcnt(0) and sp_on_line and pix_ena when sp_buffer_sel = '1' else hcnt(0);
|
||||
|
||||
sp_buffer_ram2_di <= sp_buffer_ram2_do or sp_graphx_flip when vflip(0) = '0' else "00000000";
|
||||
sp_buffer_ram2_addr <= sp_hcnt(8 downto 1) when vflip(0) = '0' else hcnt(8 downto 1) - X"04";
|
||||
sp_buffer_ram2_we <= not sp_hcnt(0) and sp_on_line and pix_ena when vflip(0) = '0' else hcnt(0);
|
||||
sp_buffer_ram2_di <= sp_buffer_ram2_do or sp_graphx_flip when sp_buffer_sel = '0' else "00000000";
|
||||
sp_buffer_ram2_addr <= sp_hcnt(8 downto 1) when sp_buffer_sel = '0' else hcnt(8 downto 1) - X"04";
|
||||
sp_buffer_ram2_we <= not sp_hcnt(0) and sp_on_line and pix_ena when sp_buffer_sel = '0' else hcnt(0);
|
||||
|
||||
sp_vid_a <= sp_buffer_ram1_do_r(7 downto 4) when (vflip(0) = '0') and (hcnt(0) = '1') else
|
||||
sp_buffer_ram1_do_r(3 downto 0) when (vflip(0) = '0') and (hcnt(0) = '0') else
|
||||
sp_buffer_ram2_do_r(7 downto 4) when (vflip(0) = '1') and (hcnt(0) = '1') else
|
||||
sp_buffer_ram2_do_r(3 downto 0) when (vflip(0) = '1') and (hcnt(0) = '0');
|
||||
sp_vid <= sp_buffer_ram1_do_r(7 downto 4) when (sp_buffer_sel = '0') and (hcnt(0) = '1') else
|
||||
sp_buffer_ram1_do_r(3 downto 0) when (sp_buffer_sel = '0') and (hcnt(0) = '0') else
|
||||
sp_buffer_ram2_do_r(7 downto 4) when (sp_buffer_sel = '1') and (hcnt(0) = '1') else
|
||||
sp_buffer_ram2_do_r(3 downto 0) when (sp_buffer_sel = '1') and (hcnt(0) = '0');
|
||||
|
||||
--------------------
|
||||
--- char machine ---
|
||||
--------------------
|
||||
bg_ram_addr <= cpu_addr(10 downto 0) when bg_ram_cpu_access = '1' else vflip(8 downto 4) & hcnt(8 downto 4) & hcnt(1);
|
||||
bg_ram_addr <= cpu_addr(10 downto 0) when hcnt(0) = '0' else vflip(8 downto 4) & hcnt(8 downto 4) & hcnt(1);
|
||||
|
||||
bg_code_line <= bg_attr(0) & bg_code_r & (vflip(3 downto 1) xor (bg_attr(2) & bg_attr(2) & bg_attr(2) ) ) & (hcnt(3) xor bg_attr(1));
|
||||
|
||||
@@ -568,10 +627,14 @@ process (clock_vid)
|
||||
begin
|
||||
if rising_edge(clock_vid) then
|
||||
|
||||
if hcnt(0) = '0' then bg_ram_do_r <= bg_ram_do; end if;
|
||||
-- catch ram data for cpu
|
||||
if hcnt(0) = '0' then
|
||||
bg_ram_do_r <= bg_ram_do;
|
||||
sp_ram_cache_do_r <= sp_ram_cache_do;
|
||||
end if;
|
||||
|
||||
if pix_ena = '1' then
|
||||
|
||||
|
||||
if hcnt(0) = '1' then
|
||||
case hcnt(3 downto 1) is
|
||||
when "110" => bg_code <= bg_ram_do;
|
||||
@@ -725,9 +788,17 @@ port map(
|
||||
|
||||
);
|
||||
|
||||
-- cpu program ROM 0x0000-0xBFFF
|
||||
cpu_rom_addr <= cpu_addr(15 downto 0);
|
||||
cpu_rom_rd <= '1' when cpu_mreq_n = '0' and cpu_rd_n = '0' and cpu_addr(15 downto 12) < X"C" else '0';
|
||||
|
||||
--rom_cpu : entity work.tron_cpu
|
||||
--port map(
|
||||
-- clk => clock_vidn,
|
||||
-- addr => cpu_addr(15 downto 0),
|
||||
-- data => cpu_rom_do
|
||||
--);
|
||||
|
||||
-- working RAM 0xC000-0xC7FF + mirroring adresses
|
||||
wram : entity work.cmos_ram
|
||||
generic map( dWidth => 8, aWidth => 11)
|
||||
@@ -810,40 +881,48 @@ port map(
|
||||
data => bg_graphx2_do
|
||||
);
|
||||
|
||||
--sprite graphics ROM 1E
|
||||
sprite_graphics_1 : entity work.tron_sp_bits_1
|
||||
----sprite graphics ROM 1E
|
||||
--sprite_graphics_1 : entity work.tron_sp_bits_1
|
||||
--port map(
|
||||
-- clk => clock_vidn,
|
||||
-- addr => sp_code_line,
|
||||
-- data => sp_graphx1_do
|
||||
--);
|
||||
--
|
||||
---- sprite graphics ROM 1D
|
||||
--sprite_graphics_2 : entity work.tron_sp_bits_2
|
||||
--port map(
|
||||
-- clk => clock_vidn,
|
||||
-- addr => sp_code_line,
|
||||
-- data => sp_graphx2_do
|
||||
--);
|
||||
--
|
||||
---- sprite graphics ROM 1B
|
||||
--sprite_graphics_3 : entity work.tron_sp_bits_3
|
||||
--port map(
|
||||
-- clk => clock_vidn,
|
||||
-- addr => sp_code_line,
|
||||
-- data => sp_graphx3_do
|
||||
--);
|
||||
--
|
||||
---- sprite graphics ROM 1A
|
||||
--sprite_graphics_4 : entity work.tron_sp_bits_4
|
||||
--port map(
|
||||
-- clk => clock_vidn,
|
||||
-- addr => sp_code_line,
|
||||
-- data => sp_graphx4_do
|
||||
--);
|
||||
|
||||
-- sprite graphics ROM 1E/1D/1B/1A
|
||||
sprite_graphics : entity work.tron_sp_bits
|
||||
port map(
|
||||
clk => clock_vidn,
|
||||
addr => sp_code_line,
|
||||
data => sp_graphx1_do
|
||||
addr => sp_code_line_mux,
|
||||
data => sp_graphx_do
|
||||
);
|
||||
|
||||
-- sprite graphics ROM 1D
|
||||
sprite_graphics_2 : entity work.tron_sp_bits_2
|
||||
port map(
|
||||
clk => clock_vidn,
|
||||
addr => sp_code_line,
|
||||
data => sp_graphx2_do
|
||||
);
|
||||
|
||||
-- sprite graphics ROM 1B
|
||||
sprite_graphics_3 : entity work.tron_sp_bits_3
|
||||
port map(
|
||||
clk => clock_vidn,
|
||||
addr => sp_code_line,
|
||||
data => sp_graphx3_do
|
||||
);
|
||||
|
||||
-- sprite graphics ROM 1A
|
||||
sprite_graphics_4 : entity work.tron_sp_bits_4
|
||||
port map(
|
||||
clk => clock_vidn,
|
||||
addr => sp_code_line,
|
||||
data => sp_graphx4_do
|
||||
);
|
||||
|
||||
--satans_hollow_sound_board
|
||||
sound_board : entity work.satans_hollow_sound_board
|
||||
--tron_sound_board
|
||||
sound_board : entity work.tron_sound_board
|
||||
port map(
|
||||
clock_40 => clock_40,
|
||||
reset => reset,
|
||||
@@ -859,13 +938,15 @@ port map(
|
||||
input_2 => input_2,
|
||||
input_3 => input_3,
|
||||
input_4 => input_4,
|
||||
|
||||
|
||||
separate_audio => separate_audio,
|
||||
audio_out_l => audio_out_l,
|
||||
audio_out_r => audio_out_r,
|
||||
|
||||
cpu_rom_addr => snd_rom_addr,
|
||||
cpu_rom_do => snd_rom_do,
|
||||
cpu_rom_rd => snd_rom_rd,
|
||||
|
||||
dbg_cpu_addr => open --dbg_cpu_addr
|
||||
);
|
||||
|
||||
@@ -52,7 +52,7 @@ use ieee.std_logic_1164.all;
|
||||
use ieee.std_logic_unsigned.all;
|
||||
use ieee.numeric_std.all;
|
||||
|
||||
entity satans_hollow_sound_board is
|
||||
entity tron_sound_board is
|
||||
port(
|
||||
clock_40 : in std_logic;
|
||||
reset : in std_logic;
|
||||
@@ -67,19 +67,22 @@ port(
|
||||
input_1 : in std_logic_vector(7 downto 0);
|
||||
input_2 : in std_logic_vector(7 downto 0);
|
||||
input_3 : in std_logic_vector(7 downto 0);
|
||||
input_4 : in std_logic_vector(7 downto 0);
|
||||
input_4 : in std_logic_vector(7 downto 0);
|
||||
|
||||
separate_audio : in std_logic;
|
||||
|
||||
audio_out_l : out std_logic_vector(15 downto 0);
|
||||
audio_out_r : out std_logic_vector(15 downto 0);
|
||||
|
||||
cpu_rom_addr : out std_logic_vector(13 downto 0);
|
||||
cpu_rom_do : in std_logic_vector(7 downto 0);
|
||||
cpu_rom_rd : out std_logic;
|
||||
|
||||
dbg_cpu_addr : out std_logic_vector(15 downto 0)
|
||||
);
|
||||
end satans_hollow_sound_board;
|
||||
end tron_sound_board;
|
||||
|
||||
architecture struct of satans_hollow_sound_board is
|
||||
architecture struct of tron_sound_board is
|
||||
|
||||
signal reset_n : std_logic;
|
||||
signal clock_snd : std_logic;
|
||||
@@ -100,7 +103,8 @@ architecture struct of satans_hollow_sound_board is
|
||||
signal cpu_ioreq_n : std_logic;
|
||||
signal cpu_irq_n : std_logic;
|
||||
signal cpu_m1_n : std_logic;
|
||||
|
||||
|
||||
-- signal cpu_rom_do : std_logic_vector( 7 downto 0);
|
||||
|
||||
signal wram_we : std_logic;
|
||||
signal wram_do : std_logic_vector( 7 downto 0);
|
||||
@@ -226,6 +230,9 @@ cpu_di <= cpu_rom_do when cpu_mreq_n = '0' and cpu_addr(15 downto 14) = "00" el
|
||||
|
||||
------------------------------------------
|
||||
-- write enable to working ram from CPU --
|
||||
-- clear interrupt, cs for AY3-8910 --
|
||||
-- ssio output to main cpu (read input) --
|
||||
-- ssio status to main cpu --
|
||||
------------------------------------------
|
||||
wram_we <= '1' when cpu_mreq_n = '0' and cpu_wr_n = '0' and cpu_addr(15 downto 12) = X"8" else '0'; -- 0x8000-0x83FF
|
||||
clr_int <= '1' when cpu_mreq_n = '0' and cpu_rd_n = '0' and cpu_addr(15 downto 12) = X"E" else '0'; -- 0xE000-0xEFFF
|
||||
@@ -239,13 +246,13 @@ ay2_bdir <= not (not ay2_cs or cpu_addr(0) );
|
||||
ay2_bc1 <= not (not ay2_cs or cpu_addr(1) );
|
||||
|
||||
ssio_do <= input_0 when main_cpu_addr(2 downto 0) = "000" else -- Input 0 -- players, coins, ...
|
||||
input_1 when main_cpu_addr(2 downto 0) = "001" else -- Input 1
|
||||
input_1 when main_cpu_addr(2 downto 0) = "001" else -- Input 1
|
||||
input_2 when main_cpu_addr(2 downto 0) = "010" else -- Input 2
|
||||
input_3 when main_cpu_addr(2 downto 0) = "011" else -- Input 3 -- sw1 dip
|
||||
input_4 when main_cpu_addr(2 downto 0) = "100" else -- Input 4
|
||||
ssio_status when main_cpu_addr(2 downto 0) = "111" else -- ssio status
|
||||
x"FF";
|
||||
|
||||
input_3 when main_cpu_addr(2 downto 0) = "011" else -- Input 3 -- sw1 dip
|
||||
input_4 when main_cpu_addr(2 downto 0) = "100" else -- Input 4
|
||||
ssio_status when main_cpu_addr(2 downto 0) = "111" else -- ssio status
|
||||
x"FF";
|
||||
|
||||
process (clock_snd)
|
||||
begin
|
||||
if rising_edge(clock_snd) then
|
||||
@@ -431,9 +438,17 @@ port map(
|
||||
DO => cpu_do
|
||||
);
|
||||
|
||||
-- cpu program ROM 0x0000-0x3FFF
|
||||
cpu_rom_addr <= cpu_addr(13 downto 0);
|
||||
cpu_rom_rd <= '1' when cpu_mreq_n = '0' and cpu_rd_n = '0' and cpu_addr(15 downto 14) = "00" else '0'; -- 0x0000-0x2FFF
|
||||
|
||||
--rom_cpu : entity work.tron_sound_cpu
|
||||
--port map(
|
||||
-- clk => clock_sndn,
|
||||
-- addr => cpu_addr(13 downto 0),
|
||||
-- data => cpu_rom_do
|
||||
--);
|
||||
|
||||
-- working RAM 0x8000-0x83FF
|
||||
wram : entity work.gen_ram
|
||||
generic map( dWidth => 8, aWidth => 10)
|
||||
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