mirror of
https://github.com/Gehstock/Mist_FPGA.git
synced 2026-05-06 00:04:10 +00:00
Marcel
GitHub
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@@ -0,0 +1,85 @@
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|
||||
<part crc="58b2f47c" name="gg1_9.4l"/>
|
||||
|
||||
<!-- namco mcus -->
|
||||
<part crc="c2f57ef8" name="51xx.bin"/>
|
||||
<part crc="ee7357e0" name="54xx.bin"/>
|
||||
</rom>
|
||||
<rom index="2"/>
|
||||
<rom index="3" md5="none">
|
||||
<part>
|
||||
11 2A 88 00 00 FF 00 02 00 02 00 01 00 FF 00 00
|
||||
00 00 8A 20 2D 00 18 00
|
||||
00 00 83 ED 06 00 24 00
|
||||
</part>
|
||||
</rom>
|
||||
<rom index="4"/>
|
||||
<nvram index="4" size="51"/>
|
||||
|
||||
<mratimestamp>20210730103520</mratimestamp>
|
||||
</misterromdescription>
|
||||
87
Arcade_MiST/Galaga Hardware/Galaga_MiST/meta/Gatsbee.mra
Normal file
87
Arcade_MiST/Galaga Hardware/Galaga_MiST/meta/Gatsbee.mra
Normal file
@@ -0,0 +1,87 @@
|
||||
<misterromdescription>
|
||||
<name>Gatsbee</name>
|
||||
<region/>
|
||||
<year>1984</year>
|
||||
<bootleg>yes</bootleg>
|
||||
<alternative>Galaga</alternative>
|
||||
<series>Galaxian</series>
|
||||
<manufacturer>hack (Uchida)</manufacturer>
|
||||
<category>Shooter - Gallery</category>
|
||||
|
||||
<setname>gatsbee</setname>
|
||||
<parent>galaga</parent>
|
||||
<mameversion>0220</mameversion>
|
||||
<rbf>galaga</rbf>
|
||||
<about/>
|
||||
|
||||
<resolution>15kHz</resolution>
|
||||
<rotation>vertical (cw)</rotation>
|
||||
<flip>yes</flip>
|
||||
|
||||
<players>2 (alternating)</players>
|
||||
<joystick>4-way horizontal</joystick>
|
||||
<special_controls/>
|
||||
<num_buttons>1</num_buttons>
|
||||
<button_names/>
|
||||
|
||||
<switches base="8" default="08,68" page_id="1" page_name="Switches">
|
||||
<!-- DIP Switch 6K -->
|
||||
<dip bits="0,1" name="Difficulty" ids="Easy(Rank A),Hardest(Rank D),Hard(Rank C),Medium(Rank B)"/>
|
||||
<dip bits="3" name="Demo Sounds" ids="Off,On"/>
|
||||
<dip bits="4" name="Freeze" ids="Off,On"/>
|
||||
<dip bits="5" name="Rack Test" ids="Off,On"/>
|
||||
<dip bits="7" name="Cabinet" ids="Upright,Cocktail"/>
|
||||
|
||||
<!-- DIP Switch 6J -->
|
||||
<dip bits="8,10" name="Coinage" ids="1 Coin/1 Cr.,2 Coins/1 Cr.,1 Coin/3 Cr.,4 Coins/1 Cr.,1 Coin/2 Cr.,3 Coins/1 Cr.,2 Coins/3 Cr.,Free Play"/>
|
||||
<dip bits="11,13" name="Bonus" ids="30k 80k,20k 80k every 80k,30k 120k every 120k,20k 60k every 60k,20k 60k,20k 70k every 70k,30k 100k every 100k,Nothing"/>
|
||||
<dip bits="14,15" name="Lives" ids="5,3,4,2"/>
|
||||
|
||||
<!-- Service switches -->
|
||||
<dip bits="16" name="Self-test mode" ids="Off,On"/>
|
||||
<dip bits="17" name="Service trigger" ids="Off,On"/>
|
||||
</switches>
|
||||
|
||||
<rom index="1"/>
|
||||
<rom index="0" md5="9d301ad0f2ac3803b6473cbec81638f3" type="merged" zip="galaga.zip|namco51.zip|namco54.zip">
|
||||
<!-- main cpu -->
|
||||
<part crc="9fb8e28b" name="1.4b"/>
|
||||
<part crc="bf6cb840" name="2.4c"/>
|
||||
<part crc="3604e2dd" name="3.4d"/>
|
||||
<part crc="bf9f613b" name="4.4e"/>
|
||||
|
||||
<!-- cpu 2 -->
|
||||
<part crc="3102fccd" name="gg1-5.3f"/>
|
||||
|
||||
<!-- cpu 3 -->
|
||||
<part crc="8995088d" name="gg1-7.2c"/>
|
||||
|
||||
<!-- cpu 4 - not used -->
|
||||
<!--
|
||||
<part crc="001b70bc" name="gallag.6"/>
|
||||
-->
|
||||
|
||||
<!-- gfx2 -->
|
||||
<part crc="22e339d5" name="9.6a"/>
|
||||
<part crc="60dcf940" name="10.7a"/>
|
||||
|
||||
<!-- gfx1 -->
|
||||
<part crc="b324f650" name="8.5r"/>
|
||||
|
||||
<!-- namco mcus -->
|
||||
<part crc="c2f57ef8" name="51xx.bin"/>
|
||||
<part crc="ee7357e0" name="54xx.bin"/>
|
||||
</rom>
|
||||
<rom index="2"/>
|
||||
<rom index="3" md5="none">
|
||||
<part>
|
||||
00 32 00 00 00 FF 00 02 00 02 00 01 00 FF 00 00
|
||||
00 00 8A 20 2D 00 0E 00
|
||||
00 00 83 ED 06 00 24 00
|
||||
</part>
|
||||
</rom>
|
||||
<rom index="4"/>
|
||||
<nvram index="4" size="51"/>
|
||||
|
||||
<mratimestamp>20210730104830</mratimestamp>
|
||||
</misterromdescription>
|
||||
75
Arcade_MiST/Galaga Hardware/Galaga_MiST/rtl/dpram.vhd
Normal file
75
Arcade_MiST/Galaga Hardware/Galaga_MiST/rtl/dpram.vhd
Normal file
@@ -0,0 +1,75 @@
|
||||
LIBRARY ieee;
|
||||
USE ieee.std_logic_1164.all;
|
||||
|
||||
LIBRARY altera_mf;
|
||||
USE altera_mf.altera_mf_components.all;
|
||||
|
||||
entity dpram is
|
||||
generic (
|
||||
addr_width_g : integer := 8;
|
||||
data_width_g : integer := 8
|
||||
);
|
||||
PORT
|
||||
(
|
||||
address_a : IN STD_LOGIC_VECTOR (addr_width_g-1 DOWNTO 0);
|
||||
address_b : IN STD_LOGIC_VECTOR (addr_width_g-1 DOWNTO 0);
|
||||
clock_a : IN STD_LOGIC := '1';
|
||||
clock_b : IN STD_LOGIC ;
|
||||
data_a : IN STD_LOGIC_VECTOR (data_width_g-1 DOWNTO 0);
|
||||
data_b : IN STD_LOGIC_VECTOR (data_width_g-1 DOWNTO 0) := (others => '0');
|
||||
enable_a : IN STD_LOGIC := '1';
|
||||
enable_b : IN STD_LOGIC := '1';
|
||||
wren_a : IN STD_LOGIC := '0';
|
||||
wren_b : IN STD_LOGIC := '0';
|
||||
q_a : OUT STD_LOGIC_VECTOR (data_width_g-1 DOWNTO 0);
|
||||
q_b : OUT STD_LOGIC_VECTOR (data_width_g-1 DOWNTO 0)
|
||||
);
|
||||
END dpram;
|
||||
|
||||
|
||||
ARCHITECTURE SYN OF dpram IS
|
||||
BEGIN
|
||||
altsyncram_component : altsyncram
|
||||
GENERIC MAP (
|
||||
address_reg_b => "CLOCK1",
|
||||
clock_enable_input_a => "NORMAL",
|
||||
clock_enable_input_b => "NORMAL",
|
||||
clock_enable_output_a => "BYPASS",
|
||||
clock_enable_output_b => "BYPASS",
|
||||
indata_reg_b => "CLOCK1",
|
||||
intended_device_family => "Cyclone V",
|
||||
lpm_type => "altsyncram",
|
||||
numwords_a => 2**addr_width_g,
|
||||
numwords_b => 2**addr_width_g,
|
||||
operation_mode => "BIDIR_DUAL_PORT",
|
||||
outdata_aclr_a => "NONE",
|
||||
outdata_aclr_b => "NONE",
|
||||
outdata_reg_a => "UNREGISTERED",
|
||||
outdata_reg_b => "UNREGISTERED",
|
||||
power_up_uninitialized => "FALSE",
|
||||
read_during_write_mode_port_a => "NEW_DATA_NO_NBE_READ",
|
||||
read_during_write_mode_port_b => "NEW_DATA_NO_NBE_READ",
|
||||
widthad_a => addr_width_g,
|
||||
widthad_b => addr_width_g,
|
||||
width_a => data_width_g,
|
||||
width_b => data_width_g,
|
||||
width_byteena_a => 1,
|
||||
width_byteena_b => 1,
|
||||
wrcontrol_wraddress_reg_b => "CLOCK1"
|
||||
)
|
||||
PORT MAP (
|
||||
address_a => address_a,
|
||||
address_b => address_b,
|
||||
clock0 => clock_a,
|
||||
clock1 => clock_b,
|
||||
clocken0 => enable_a,
|
||||
clocken1 => enable_b,
|
||||
data_a => data_a,
|
||||
data_b => data_b,
|
||||
wren_a => wren_a,
|
||||
wren_b => wren_b,
|
||||
q_a => q_a,
|
||||
q_b => q_b
|
||||
);
|
||||
|
||||
END SYN;
|
||||
File diff suppressed because it is too large
Load Diff
@@ -20,14 +20,28 @@ module galaga_mist
|
||||
`include "rtl\build_id.v"
|
||||
|
||||
localparam CONF_STR = {
|
||||
"Galaga;;",
|
||||
"GALAGA;;",
|
||||
"O2,Rotate Controls,Off,On;",
|
||||
"O34,Scanlines,Off,25%,50%,75%;",
|
||||
"O5,Blend,Off,On;",
|
||||
"T6,Reset;",
|
||||
"O6,Flip screen,Off,On;",
|
||||
"O7,Self-test mode,Off,On;",
|
||||
"T1,Service trigger,Off,On;",
|
||||
"DIP;",
|
||||
"T0,Reset;",
|
||||
"V,v1.21.",`BUILD_DATE
|
||||
};
|
||||
|
||||
wire rotate = status[2];
|
||||
wire [1:0] scanlines = status[4:3];
|
||||
wire blend = status[5];
|
||||
wire flip = status[6];
|
||||
wire selftest = status[7];
|
||||
wire service = status[1];
|
||||
|
||||
wire [7:0] dipa = ~status[15:8];
|
||||
wire [7:0] dipb = ~status[23:16];
|
||||
|
||||
assign LED = 1;
|
||||
assign AUDIO_R = AUDIO_L;
|
||||
|
||||
@@ -40,63 +54,14 @@ pll pll(
|
||||
wire [31:0] status;
|
||||
wire [1:0] buttons;
|
||||
wire [1:0] switches;
|
||||
wire [9:0] kbjoy;
|
||||
wire [7:0] joystick_0;
|
||||
wire [7:0] joystick_1;
|
||||
wire scandoublerD;
|
||||
wire ypbpr;
|
||||
wire [10:0] ps2_key;
|
||||
wire [9:0] audio;
|
||||
wire hs, vs;
|
||||
wire blankn = ~(hb | vb);
|
||||
wire hb, vb;
|
||||
wire [2:0] r,g;
|
||||
wire [1:0] b;
|
||||
|
||||
galaga galaga(
|
||||
.clock_18(clk_18),
|
||||
.reset(status[0] | status[6] | buttons[1]),
|
||||
.video_r(r),
|
||||
.video_g(g),
|
||||
.video_b(b),
|
||||
.video_hb(hb),
|
||||
.video_vb(vb),
|
||||
.video_hs(hs),
|
||||
.video_vs(vs),
|
||||
.audio(audio),
|
||||
.coin(btn_coin),
|
||||
.start1(btn_one_player),
|
||||
.left1(m_left),
|
||||
.right1(m_right),
|
||||
.fire1(m_fire),
|
||||
.start2(btn_two_players),
|
||||
.left2(m_left),
|
||||
.right2(m_right),
|
||||
.fire2(m_fire)
|
||||
);
|
||||
|
||||
mist_video #(.COLOR_DEPTH(3), .SD_HCNT_WIDTH(10)) mist_video(
|
||||
.clk_sys(clk_18),
|
||||
.SPI_SCK(SPI_SCK),
|
||||
.SPI_SS3(SPI_SS3),
|
||||
.SPI_DI(SPI_DI),
|
||||
.R(blankn ? r : 0),
|
||||
.G(blankn ? g : 0),
|
||||
.B(blankn ? {b[0], b} : 0),
|
||||
.HSync(hs),
|
||||
.VSync(vs),
|
||||
.VGA_R(VGA_R),
|
||||
.VGA_G(VGA_G),
|
||||
.VGA_B(VGA_B),
|
||||
.VGA_VS(VGA_VS),
|
||||
.VGA_HS(VGA_HS),
|
||||
.ce_divider(1'b1),
|
||||
.blend(status[5]),
|
||||
.rotate({1'b1,status[2]}),
|
||||
.scanlines(scandoublerD ? 2'b00 : status[4:3]),
|
||||
.scandoubler_disable(scandoublerD),
|
||||
.ypbpr(ypbpr)
|
||||
);
|
||||
wire no_csync;
|
||||
wire key_strobe;
|
||||
wire key_pressed;
|
||||
wire [7:0] key_code;
|
||||
|
||||
user_io #(
|
||||
.STRLEN(($size(CONF_STR)>>3)))
|
||||
@@ -110,6 +75,7 @@ user_io(
|
||||
.buttons (buttons ),
|
||||
.switches (switches ),
|
||||
.scandoubler_disable (scandoublerD ),
|
||||
.no_csync (no_csync ),
|
||||
.ypbpr (ypbpr ),
|
||||
.key_strobe (key_strobe ),
|
||||
.key_pressed (key_pressed ),
|
||||
@@ -119,8 +85,106 @@ user_io(
|
||||
.status (status )
|
||||
);
|
||||
|
||||
wire ioctl_downl;
|
||||
wire [7:0] ioctl_index;
|
||||
wire ioctl_wr;
|
||||
wire [24:0] ioctl_addr;
|
||||
wire [7:0] ioctl_dout;
|
||||
|
||||
data_io data_io(
|
||||
.clk_sys ( clk_18 ),
|
||||
.SPI_SCK ( SPI_SCK ),
|
||||
.SPI_SS2 ( SPI_SS2 ),
|
||||
.SPI_DI ( SPI_DI ),
|
||||
.ioctl_download( ioctl_downl ),
|
||||
.ioctl_index ( ioctl_index ),
|
||||
.ioctl_wr ( ioctl_wr ),
|
||||
.ioctl_addr ( ioctl_addr ),
|
||||
.ioctl_dout ( ioctl_dout )
|
||||
);
|
||||
|
||||
wire [15:0] audio;
|
||||
wire hs, vs;
|
||||
wire blankn = ~(hb | vb);
|
||||
wire hb, vb;
|
||||
wire [2:0] r,g;
|
||||
wire [1:0] b;
|
||||
reg service_trg;
|
||||
reg reset;
|
||||
|
||||
always @(posedge clk_18) begin
|
||||
reg serviceD;
|
||||
reg [19:0] service_cnt = 0;
|
||||
|
||||
serviceD <= service;
|
||||
if (~serviceD & service) service_cnt <= 24'hFFFFF;
|
||||
else if (|service_cnt) service_cnt <= service_cnt - 1'd1;
|
||||
|
||||
service_trg <= |service_cnt;
|
||||
|
||||
reset <= status[0] | buttons[1] | ioctl_downl;
|
||||
end
|
||||
|
||||
galaga galaga(
|
||||
.clock_18(clk_18),
|
||||
.reset(reset),
|
||||
.flip_screen(flip),
|
||||
.video_r(r),
|
||||
.video_g(g),
|
||||
.video_b(b),
|
||||
.blank_h(hb),
|
||||
.blank_v(vb),
|
||||
.video_hs(hs),
|
||||
.video_vs(vs),
|
||||
.audio(audio),
|
||||
.coin1(m_coin1),
|
||||
.start1(m_one_player),
|
||||
.left1(m_left),
|
||||
.right1(m_right),
|
||||
.fire1(m_fireA),
|
||||
.start2(m_two_players),
|
||||
.left2(m_left2),
|
||||
.right2(m_right2),
|
||||
.fire2(m_fire2A),
|
||||
|
||||
.dip_switch_a(dipa),
|
||||
.dip_switch_b(dipb),
|
||||
|
||||
.service(service_trg),
|
||||
.self_test(selftest),
|
||||
.pause(1'b0),
|
||||
|
||||
.dn_addr(ioctl_addr),
|
||||
.dn_data(ioctl_dout),
|
||||
.dn_wr(ioctl_wr)
|
||||
);
|
||||
|
||||
mist_video #(.COLOR_DEPTH(3), .SD_HCNT_WIDTH(10)) mist_video(
|
||||
.clk_sys(clk_18),
|
||||
.SPI_SCK(SPI_SCK),
|
||||
.SPI_SS3(SPI_SS3),
|
||||
.SPI_DI(SPI_DI),
|
||||
.R(blankn ? r : 0),
|
||||
.G(blankn ? g : 0),
|
||||
.B(blankn ? {b, b[1]} : 0),
|
||||
.HSync(hs),
|
||||
.VSync(vs),
|
||||
.VGA_R(VGA_R),
|
||||
.VGA_G(VGA_G),
|
||||
.VGA_B(VGA_B),
|
||||
.VGA_VS(VGA_VS),
|
||||
.VGA_HS(VGA_HS),
|
||||
.ce_divider(1'b1),
|
||||
.no_csync(no_csync),
|
||||
.blend(blend),
|
||||
.rotate({~flip,rotate}),
|
||||
.scanlines(scanlines),
|
||||
.scandoubler_disable(scandoublerD),
|
||||
.ypbpr(ypbpr)
|
||||
);
|
||||
|
||||
dac #(
|
||||
.C_bits(10))
|
||||
.C_bits(16))
|
||||
dac(
|
||||
.clk_i(clk_18),
|
||||
.res_n_i(1),
|
||||
@@ -128,44 +192,25 @@ dac(
|
||||
.dac_o(AUDIO_L)
|
||||
);
|
||||
|
||||
// Rotated Normal
|
||||
wire m_up = ~status[2] ? btn_left | joystick_0[1] | joystick_1[1] : btn_up | joystick_0[3] | joystick_1[3];
|
||||
wire m_down = ~status[2] ? btn_right | joystick_0[0] | joystick_1[0] : btn_down | joystick_0[2] | joystick_1[2];
|
||||
wire m_left = ~status[2] ? btn_down | joystick_0[2] | joystick_1[2] : btn_left | joystick_0[1] | joystick_1[1];
|
||||
wire m_right = ~status[2] ? btn_up | joystick_0[3] | joystick_1[3] : btn_right | joystick_0[0] | joystick_1[0];
|
||||
|
||||
wire m_fire = btn_fire1 | joystick_0[4] | joystick_1[4];
|
||||
wire m_bomb = btn_fire2 | joystick_0[5] | joystick_1[5];
|
||||
wire m_up, m_down, m_left, m_right, m_fireA, m_fireB, m_fireC, m_fireD, m_fireE, m_fireF;
|
||||
wire m_up2, m_down2, m_left2, m_right2, m_fire2A, m_fire2B, m_fire2C, m_fire2D, m_fire2E, m_fire2F;
|
||||
wire m_tilt, m_coin1, m_coin2, m_coin3, m_coin4, m_one_player, m_two_players, m_three_players, m_four_players;
|
||||
|
||||
reg btn_one_player = 0;
|
||||
reg btn_two_players = 0;
|
||||
reg btn_left = 0;
|
||||
reg btn_right = 0;
|
||||
reg btn_down = 0;
|
||||
reg btn_up = 0;
|
||||
reg btn_fire1 = 0;
|
||||
reg btn_fire2 = 0;
|
||||
reg btn_fire3 = 0;
|
||||
reg btn_coin = 0;
|
||||
wire key_pressed;
|
||||
wire [7:0] key_code;
|
||||
wire key_strobe;
|
||||
|
||||
always @(posedge clk_18) begin
|
||||
if(key_strobe) begin
|
||||
case(key_code)
|
||||
'h75: btn_up <= key_pressed; // up
|
||||
'h72: btn_down <= key_pressed; // down
|
||||
'h6B: btn_left <= key_pressed; // left
|
||||
'h74: btn_right <= key_pressed; // right
|
||||
'h76: btn_coin <= key_pressed; // ESC
|
||||
'h05: btn_one_player <= key_pressed; // F1
|
||||
'h06: btn_two_players <= key_pressed; // F2
|
||||
'h14: btn_fire3 <= key_pressed; // ctrl
|
||||
'h11: btn_fire2 <= key_pressed; // alt
|
||||
'h29: btn_fire1 <= key_pressed; // Space
|
||||
endcase
|
||||
end
|
||||
end
|
||||
arcade_inputs inputs (
|
||||
.clk ( clk_18 ),
|
||||
.key_strobe ( key_strobe ),
|
||||
.key_pressed ( key_pressed ),
|
||||
.key_code ( key_code ),
|
||||
.joystick_0 ( joystick_0 ),
|
||||
.joystick_1 ( joystick_1 ),
|
||||
.rotate ( rotate ),
|
||||
.orientation ( {~flip, 1'b1} ),
|
||||
.joyswap ( 1'b0 ),
|
||||
.oneplayer ( 1'b1 ),
|
||||
.controls ( {m_tilt, m_coin4, m_coin3, m_coin2, m_coin1, m_four_players, m_three_players, m_two_players, m_one_player} ),
|
||||
.player1 ( {m_fireF, m_fireE, m_fireD, m_fireC, m_fireB, m_fireA, m_up, m_down, m_left, m_right} ),
|
||||
.player2 ( {m_fire2F, m_fire2E, m_fire2D, m_fire2C, m_fire2B, m_fire2A, m_up2, m_down2, m_left2, m_right2} )
|
||||
);
|
||||
|
||||
endmodule
|
||||
@@ -3,33 +3,39 @@
|
||||
-- http://darfpga.blogspot.fr
|
||||
---------------------------------------------------------------------------------
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all,ieee.numeric_std.ALL;
|
||||
use ieee.std_logic_1164.all,
|
||||
ieee.std_logic_1164.all,
|
||||
ieee.std_logic_unsigned.all,
|
||||
ieee.numeric_std.all;
|
||||
|
||||
|
||||
entity gen_video is
|
||||
port(
|
||||
clk : in std_logic;
|
||||
enable : in std_logic;
|
||||
hcnt : out std_logic_vector(8 downto 0);
|
||||
vcnt : out std_logic_vector(8 downto 0);
|
||||
hsync : out std_logic;
|
||||
vsync : out std_logic;
|
||||
csync : out std_logic; -- composite sync for TV
|
||||
hblank : out std_logic;
|
||||
vblank : out std_logic
|
||||
clk : in std_logic;
|
||||
enable : in std_logic;
|
||||
hcnt : out std_logic_vector(8 downto 0);
|
||||
vcnt : out std_logic_vector(8 downto 0);
|
||||
hsync : out std_logic;
|
||||
vsync : out std_logic;
|
||||
csync : out std_logic; -- composite sync for TV
|
||||
hblank : out std_logic;
|
||||
vblank : out std_logic;
|
||||
h_offset: in signed(3 downto 0);
|
||||
v_offset: in signed(3 downto 0)
|
||||
);
|
||||
end gen_video;
|
||||
|
||||
architecture struct of gen_video is
|
||||
signal hclkReg : unsigned (1 DOWNTO 0);
|
||||
--signal hblank : std_logic;
|
||||
--signal vblank : std_logic;
|
||||
signal hcntReg : unsigned (8 DOWNTO 0) := to_unsigned(000,9);
|
||||
signal vcntReg : unsigned (8 DOWNTO 0) := to_unsigned(015,9);
|
||||
|
||||
signal hsync0 : std_logic;
|
||||
signal hsync1 : std_logic;
|
||||
signal hsync2 : std_logic;
|
||||
signal hsync1 : std_logic;
|
||||
signal hsync2 : std_logic;
|
||||
|
||||
signal hsync_base : integer;
|
||||
signal vsync_base : integer;
|
||||
begin
|
||||
|
||||
hcnt <= std_logic_vector(hcntReg);
|
||||
@@ -44,72 +50,71 @@ hsync <= hsync0;
|
||||
-- Compteur vertical : 263-000+1=264 lignes (33 tiles)
|
||||
-- 000 à 015 : 16 lignes debut de trame (2 tiles)
|
||||
-- 016 à 239 : 224 lignes centrales (28 tiles affichées)
|
||||
-- 240 à 263 : 24 lignes fin de trame (3 tiles
|
||||
-- 240 à 263 : 24 lignes fin de trame (3 tiles)
|
||||
|
||||
-- Synchro horizontale : hcnt=[176 à 204] (29 pixels)
|
||||
-- Synchro verticale : vcnt=[260 à 003] ( 8 lignes)
|
||||
|
||||
process(clk, enable)
|
||||
process(clk)
|
||||
begin
|
||||
if rising_edge(clk) then
|
||||
if enable = '1' then -- clk & ena at 6MHz
|
||||
|
||||
if rising_edge(clk) and enable = '1' then -- clk & ena at 6MHz
|
||||
if hcntReg = 511 then
|
||||
hcntReg <= to_unsigned (128,9);
|
||||
else
|
||||
hcntReg <= hcntReg + 1;
|
||||
end if;
|
||||
|
||||
if hcntReg = 511 then
|
||||
hcntReg <= to_unsigned (128,9);
|
||||
else
|
||||
hcntReg <= hcntReg + 1;
|
||||
end if;
|
||||
if hcntReg = 191 then
|
||||
if vcntReg = 263 then
|
||||
vcntReg <= to_unsigned(0,9);
|
||||
else
|
||||
vcntReg <= vcntReg + 1;
|
||||
end if;
|
||||
end if;
|
||||
|
||||
if hcntReg = 191 then
|
||||
if vcntReg = 263 then
|
||||
vcntReg <= to_unsigned(0,9);
|
||||
else
|
||||
vcntReg <= vcntReg + 1;
|
||||
end if;
|
||||
end if;
|
||||
hsync_base <= 175 + to_integer(resize(h_offset, 9));
|
||||
if hcntReg = (hsync_base+ 0-8+8) then hsync0 <= '0'; -- 1
|
||||
elsif hcntReg = (hsync_base+29-8+8) then hsync0 <= '1';
|
||||
end if;
|
||||
|
||||
if hcntReg = (175+ 0-8+8) then hsync0 <= '0'; -- 1
|
||||
elsif hcntReg = (175+29-8+8) then hsync0 <= '1';
|
||||
end if;
|
||||
if hcntReg = (hsync_base-8+8) then hsync1 <= '0';
|
||||
elsif hcntReg = (hsync_base+13-8+8) then hsync1 <= '1'; -- 11
|
||||
elsif hcntReg = (hsync_base +192-8+8) then hsync1 <= '0';
|
||||
elsif hcntReg = (hsync_base+13+192-8+8) then hsync1 <= '1'; -- 11
|
||||
end if;
|
||||
|
||||
if hcntReg = (175-8+8) then hsync1 <= '0';
|
||||
elsif hcntReg = (175+13-8+8) then hsync1 <= '1'; -- 11
|
||||
elsif hcntReg = (175 +192-8+8) then hsync1 <= '0';
|
||||
elsif hcntReg = (175+13+192-8+8) then hsync1 <= '1'; -- 11
|
||||
end if;
|
||||
if hcntReg = (hsync_base-8+8) then hsync2 <= '0';
|
||||
elsif hcntReg = (hsync_base-28-8+8) then hsync2 <= '1';
|
||||
end if;
|
||||
|
||||
if hcntReg = (175-8+8) then hsync2 <= '0';
|
||||
elsif hcntReg = (175-28-8+8) then hsync2 <= '1';
|
||||
end if;
|
||||
vsync_base <= 250+to_integer(resize(v_offset, 9));
|
||||
if vcntReg = (vsync_base+ 2-1+2) mod 264 then csync <= hsync1;
|
||||
elsif vcntReg = (vsync_base+ 3-1+2) mod 264 then csync <= hsync1;
|
||||
elsif vcntReg = (vsync_base+ 4-1+2) mod 264 then csync <= hsync1; -- and hsync2;
|
||||
elsif vcntReg = (vsync_base+ 5-1+2) mod 264 then csync <= hsync2; -- not(hsync1);
|
||||
elsif vcntReg = (vsync_base+ 6-1+2) mod 264 then csync <= hsync2; -- not(hsync1);
|
||||
elsif vcntReg = (vsync_base+ 7-1+2) mod 264 then csync <= hsync2; -- not(hsync1) or not(hsync2);
|
||||
elsif vcntReg = (vsync_base+ 8-1+2) mod 264 then csync <= hsync1;
|
||||
elsif vcntReg = (vsync_base+ 9-1+2) mod 264 then csync <= hsync1;
|
||||
elsif vcntReg = (vsync_base+10-1+2) mod 264 then csync <= hsync1;
|
||||
else csync <= hsync0;
|
||||
end if;
|
||||
|
||||
if vcntReg = 252-1 then csync <= hsync1;
|
||||
elsif vcntReg = 253-1 then csync <= hsync1;
|
||||
elsif vcntReg = 254-1 then csync <= hsync1; -- and hsync2;
|
||||
elsif vcntReg = 255-1 then csync <= hsync2; -- not(hsync1);
|
||||
elsif vcntReg = 256-1 then csync <= hsync2; -- not(hsync1);
|
||||
elsif vcntReg = 257-1 then csync <= hsync2; -- not(hsync1) or not(hsync2);
|
||||
elsif vcntReg = 258-1 then csync <= hsync1;
|
||||
elsif vcntReg = 259-1 then csync <= hsync1;
|
||||
elsif vcntReg = 260-1 then csync <= hsync1;
|
||||
else csync <= hsync0;
|
||||
end if;
|
||||
if vcntReg = (vsync_base+10) mod 264 then vsync <= '1';
|
||||
elsif vcntReg = (vsync_base+17) mod 264 then vsync <= '0';
|
||||
end if;
|
||||
|
||||
if vcntReg = 260 then vsync <= '0';
|
||||
elsif vcntReg = 003 then vsync <= '1';
|
||||
end if;
|
||||
|
||||
if hcntReg = (127+16+8) then hblank <= '1';
|
||||
elsif hcntReg = (255-17+8+1) then hblank <= '0';
|
||||
end if;
|
||||
|
||||
if vcntReg = (240+1-1) then vblank <= '1';
|
||||
elsif vcntReg = (015+1) then vblank <= '0';
|
||||
end if;
|
||||
|
||||
-- blankn <= not (hblank or vblank);
|
||||
|
||||
end if;
|
||||
if hcntReg = (127+16+9) then hblank <= '1';
|
||||
elsif hcntReg = (255-17+9+1) then hblank <= '0';
|
||||
end if;
|
||||
|
||||
if vcntReg = (240+1-1) then vblank <= '1';
|
||||
elsif vcntReg = (015+1) then vblank <= '0';
|
||||
end if;
|
||||
end if;
|
||||
end if;
|
||||
end process;
|
||||
|
||||
end architecture;
|
||||
end architecture;
|
||||
|
||||
@@ -4,13 +4,13 @@
|
||||
---------------------------------------------------------------------------------
|
||||
--
|
||||
-- Version 0.3 -- 28/02/2017 --
|
||||
-- fixed instruction JMP (0xC0..0xFF) let r_pa be incremented when r_pc = 0x3F
|
||||
-- fixed instruction JMP (0xC0..0xFF) let r_pa be incremented when r_pc = 0x3F
|
||||
--
|
||||
-- Version 0.2 -- 26/02/2017 --
|
||||
-- corrected r_stf for tstR instruction (0x24)
|
||||
-- corrected r_stf for tbit instruction (0x38-0x3B)
|
||||
--
|
||||
-- Version 0.1 -- 25/02/2017 --
|
||||
-- Version 0.1 -- 25/02/2017 --
|
||||
-- outO instruction write to ol,oh depending on r_cf
|
||||
---------------------------------------------------------------------------------
|
||||
-- Educational use only
|
||||
@@ -19,7 +19,7 @@
|
||||
-- Use at your own risk
|
||||
---------------------------------------------------------------------------------
|
||||
|
||||
-- Todo : Timer, Serial
|
||||
-- Todo : Timer, Serial
|
||||
|
||||
-- Features :
|
||||
|
||||
@@ -57,10 +57,10 @@ port(
|
||||
sc_out_n : out std_logic;
|
||||
so_n : out std_logic;
|
||||
to_n : out std_logic;
|
||||
|
||||
|
||||
rom_addr : out std_logic_vector(10 downto 0);
|
||||
rom_data : in std_logic_vector( 7 downto 0)
|
||||
|
||||
|
||||
);
|
||||
end mb88;
|
||||
|
||||
@@ -68,36 +68,39 @@ architecture struct of mb88 is
|
||||
|
||||
signal reset : std_logic;
|
||||
signal clock_n : std_logic;
|
||||
|
||||
signal ram_addr : std_logic_vector(6 downto 0);
|
||||
|
||||
signal ram_addr : std_logic_vector(6 downto 0);
|
||||
signal ram_we : std_logic;
|
||||
signal ram_di : std_logic_vector(3 downto 0);
|
||||
signal ram_do : std_logic_vector(3 downto 0);
|
||||
|
||||
signal r_pc : std_logic_vector(5 downto 0) := (others=>'0');
|
||||
signal r_pa : std_logic_vector(4 downto 0) := (others=>'0');
|
||||
signal r_si : std_logic_vector(1 downto 0) := (others=>'0');
|
||||
signal r_a : std_logic_vector(3 downto 0) := (others=>'0');
|
||||
signal r_x : std_logic_vector(3 downto 0) := (others=>'0');
|
||||
signal r_y : std_logic_vector(3 downto 0) := (others=>'0');
|
||||
signal r_stf : std_logic := '1';
|
||||
signal r_zf : std_logic := '0';
|
||||
signal r_cf : std_logic := '0';
|
||||
signal r_vf : std_logic := '0';
|
||||
signal r_sf : std_logic := '0';
|
||||
signal r_nf : std_logic := '0';
|
||||
|
||||
signal r_pio : std_logic_vector(7 downto 0) := (others=>'0');
|
||||
signal r_th : std_logic_vector(3 downto 0) := (others=>'0');
|
||||
signal r_tl : std_logic_vector(3 downto 0) := (others=>'0');
|
||||
signal r_tp : std_logic_vector(5 downto 0) := (others=>'0');
|
||||
signal r_ctr : std_logic_vector(5 downto 0) := (others=>'0');
|
||||
signal r_pc : std_logic_vector(5 downto 0) := (others=>'0');
|
||||
signal r_pa : std_logic_vector(4 downto 0) := (others=>'0');
|
||||
signal r_si : std_logic_vector(1 downto 0) := (others=>'0');
|
||||
signal r_a : std_logic_vector(3 downto 0) := (others=>'0');
|
||||
signal r_x : std_logic_vector(3 downto 0) := (others=>'0');
|
||||
signal r_y : std_logic_vector(3 downto 0) := (others=>'0');
|
||||
signal r_stf : std_logic := '1';
|
||||
signal r_zf : std_logic := '0';
|
||||
signal r_cf : std_logic := '0';
|
||||
signal r_vf : std_logic := '0';
|
||||
signal r_sf : std_logic := '0';
|
||||
signal r_nf : std_logic := '0';
|
||||
|
||||
signal r_sb : std_logic_vector(3 downto 0) := (others=>'0');
|
||||
signal r_sbcnt : std_logic_vector(3 downto 0) := (others=>'0');
|
||||
signal r_pio : std_logic_vector(7 downto 0) := (others=>'0');
|
||||
signal r_th : std_logic_vector(3 downto 0) := (others=>'0');
|
||||
signal r_tl : std_logic_vector(3 downto 0) := (others=>'0');
|
||||
signal r_tp : std_logic_vector(5 downto 0) := (others=>'0');
|
||||
signal r_ctr : std_logic_vector(5 downto 0) := (others=>'0');
|
||||
|
||||
signal interrupt_pending : std_logic := '0';
|
||||
signal irq_n_r : std_logic := '0';
|
||||
signal r_sb : std_logic_vector(3 downto 0) := (others=>'0');
|
||||
signal r_sbcnt : std_logic_vector(3 downto 0) := (others=>'0');
|
||||
|
||||
signal interrupt_pending : std_logic := '0';
|
||||
signal timer_interrupt_pending : std_logic := '0';
|
||||
signal irq_n_r : std_logic := '0';
|
||||
|
||||
signal tc_n_r : std_logic := '0';
|
||||
|
||||
subtype stack_size is integer range 0 to 3;
|
||||
type stack_def is array(stack_size) of std_logic_vector(15 downto 0);
|
||||
@@ -107,8 +110,8 @@ architecture struct of mb88 is
|
||||
type ram_def is array(ram_size) of std_logic_vector(3 downto 0);
|
||||
signal ram : ram_def := (others=>(others=>'0'));
|
||||
|
||||
signal single_byte_op : std_logic := '1';
|
||||
signal op_code : std_logic_vector(7 downto 0) := X"00";
|
||||
signal single_byte_op : std_logic := '1';
|
||||
signal op_code : std_logic_vector(7 downto 0) := X"00";
|
||||
|
||||
signal a_p1 : std_logic_vector(3 downto 0);
|
||||
signal a_p1_z : std_logic;
|
||||
@@ -183,12 +186,12 @@ architecture struct of mb88 is
|
||||
signal m_set_bit : std_logic_vector(3 downto 0);
|
||||
signal m_clr_bit : std_logic_vector(3 downto 0);
|
||||
signal m_tst_bit : std_logic;
|
||||
|
||||
|
||||
signal mem : std_logic_vector(3 downto 0);
|
||||
signal mem_z : std_logic;
|
||||
signal imm_x7_z : std_logic;
|
||||
signal imm_xF_z : std_logic;
|
||||
|
||||
|
||||
begin
|
||||
|
||||
clock_n <= not clock;
|
||||
@@ -201,7 +204,7 @@ ram_addr <= X"0" & rom_data(2 downto 0) when ((rom_data >= X"50") and (rom_data
|
||||
ram_we <= '1' when(( (rom_data = X"1D") or (rom_data = X"1A") or
|
||||
(rom_data = X"0A") or (rom_data = X"0B") or
|
||||
(rom_data = X"2A") or
|
||||
(rom_data = X"19") or (rom_data = X"09") or
|
||||
(rom_data = X"19") or (rom_data = X"09") or
|
||||
((rom_data >= X"30") and (rom_data <= X"37") ) or
|
||||
((rom_data >= X"50") and (rom_data <= X"57") )
|
||||
) and (single_byte_op = '1')and ena = '1')
|
||||
@@ -209,20 +212,20 @@ ram_we <= '1' when(( (rom_data = X"1D") or (rom_data = X"1A") or
|
||||
|
||||
with rom_data select
|
||||
ram_di <= r_a when X"1D", r_a when X"1A",
|
||||
r_a when X"0A", r_a when X"0B",
|
||||
r_a when X"0A", r_a when X"0B",
|
||||
r_sb when X"2A",
|
||||
m_m1 when X"19", m_p1 when X"09",
|
||||
m_set_bit when X"30", m_clr_bit when X"34",
|
||||
m_set_bit when X"31", m_clr_bit when X"35",
|
||||
m_set_bit when X"30", m_clr_bit when X"34",
|
||||
m_set_bit when X"31", m_clr_bit when X"35",
|
||||
m_set_bit when X"32", m_clr_bit when X"36",
|
||||
m_set_bit when X"33", m_clr_bit when X"37",
|
||||
r_a when X"50", r_y when X"54",
|
||||
r_a when X"51", r_y when X"55",
|
||||
r_a when X"52", r_y when X"56",
|
||||
r_a when X"53", r_y when X"57",
|
||||
r_a when X"50", r_y when X"54",
|
||||
r_a when X"51", r_y when X"55",
|
||||
r_a when X"52", r_y when X"56",
|
||||
r_a when X"53", r_y when X"57",
|
||||
X"A" when others;
|
||||
|
||||
|
||||
|
||||
a_p1 <= r_a + X"1";
|
||||
a_p1_z <= '1' when a_p1 = X"0" else '0';
|
||||
a_p1_c <= '1' when a_p1 = X"0" else '0';
|
||||
@@ -247,39 +250,39 @@ m_m1 <= ram_do - X"1";
|
||||
--m_m1_z <= '1' when m_m1 = X"0" else '0';
|
||||
--m_m1_c <= '1' when m_m1 = X"F" else '0';
|
||||
|
||||
with rom_data(2 downto 0) select
|
||||
with rom_data(2 downto 0) select
|
||||
m_set_bit <= ram_do or X"1" when "000",
|
||||
ram_do or X"2" when "001",
|
||||
ram_do or X"4" when "010",
|
||||
ram_do or X"8" when others;
|
||||
|
||||
with rom_data(2 downto 0) select
|
||||
with rom_data(2 downto 0) select
|
||||
m_clr_bit <= ram_do and not X"1" when "000",
|
||||
ram_do and not X"2" when "001",
|
||||
ram_do and not X"4" when "010",
|
||||
ram_do and not X"8" when others;
|
||||
|
||||
|
||||
m_tst_bit <= ram_do(to_integer(unsigned(rom_data(1 downto 0))));
|
||||
|
||||
rola <= r_a(2 downto 0) & r_cf;
|
||||
rola_z <= '1' when rola = X"0" else '0';
|
||||
rola_z <= '1' when rola = X"0" else '0';
|
||||
|
||||
rora <= r_cf & r_a(3 downto 1);
|
||||
rora_z <= '1' when rora = X"0" else '0';
|
||||
rora_z <= '1' when rora = X"0" else '0';
|
||||
|
||||
nega <= not(r_a) + X"1";
|
||||
nega_z <= '1' when nega = X"0" else '0';
|
||||
nega_z <= '1' when nega = X"0" else '0';
|
||||
|
||||
adc <= ('0'&ram_do) + ('0'&r_a) + ("0000"&r_cf);
|
||||
adc_z <= '1' when adc(3 downto 0) = X"0" else '0';
|
||||
adc_z <= '1' when adc(3 downto 0) = X"0" else '0';
|
||||
adc_c <= '1' when adc(4) = '1' else '0';
|
||||
|
||||
sbc <= ('0'&ram_do) - ('0'&r_a) - ("0000"&r_cf);
|
||||
sbc_z <= '1' when sbc(3 downto 0) = X"0" else '0';
|
||||
sbc_z <= '1' when sbc(3 downto 0) = X"0" else '0';
|
||||
sbc_c <= '1' when sbc(4) = '1' else '0';
|
||||
|
||||
cma <= ('0'&ram_do) - ('0'&r_a);
|
||||
cma_z <= '1' when cma(3 downto 0) = X"0" else '0';
|
||||
cma_z <= '1' when cma(3 downto 0) = X"0" else '0';
|
||||
cma_c <= '1' when cma(4) = '1' else '0';
|
||||
|
||||
a_pim <= ('0'&rom_data(3 downto 0)) + ('0'&r_a);
|
||||
@@ -295,25 +298,25 @@ im_ma_z <= '1' when im_ma(3 downto 0) = X"0" else '0';
|
||||
im_ma_c <= '1' when im_ma(4) = '1' else '0';
|
||||
|
||||
a_and_m <= r_a and ram_do;
|
||||
a_and_m_z <= '1' when a_and_m = X"0" else '0';
|
||||
|
||||
a_and_m_z <= '1' when a_and_m = X"0" else '0';
|
||||
|
||||
a_or_m <= r_a or ram_do;
|
||||
a_or_m_z <= '1' when a_or_m = X"0" else '0';
|
||||
a_or_m_z <= '1' when a_or_m = X"0" else '0';
|
||||
|
||||
a_xor_m <= r_a xor ram_do;
|
||||
a_xor_m_z <= '1' when a_xor_m = X"0" else '0';
|
||||
|
||||
do_da <= '1' when (r_a > X"9") or (r_cf = '1') else '0';
|
||||
|
||||
daa <= r_a + X"6";
|
||||
daa <= r_a + X"6";
|
||||
daa_z <= '1' when daa = X"0" else '0';
|
||||
daa_c <= '1' when r_a > X"9" else '0';
|
||||
|
||||
das <= r_a + X"A";
|
||||
das <= r_a + X"A";
|
||||
das_z <= '1' when das = X"0" else '0';
|
||||
das_c <= '1' when r_a > X"5" else '0';
|
||||
|
||||
dca <= r_a + X"F";
|
||||
dca <= r_a + X"F";
|
||||
dca_z <= '1' when dca = X"0" else '0';
|
||||
dca_c <= '1' when dca = X"F" else '0';
|
||||
|
||||
@@ -333,9 +336,9 @@ sel_bit_y <= "0001" when "00",
|
||||
"0010" when "01",
|
||||
"0100" when "10",
|
||||
"1000" when others;
|
||||
|
||||
imm_x7_z <= '1' when rom_data(2 downto 0) = "000" else '0';
|
||||
imm_xF_z <= '1' when rom_data(3 downto 0) = "0000" else '0';
|
||||
|
||||
imm_x7_z <= '1' when rom_data(2 downto 0) = "000" else '0';
|
||||
imm_xF_z <= '1' when rom_data(3 downto 0) = "0000" else '0';
|
||||
|
||||
process (clock_n) -- register data before memory value update at middle cycle
|
||||
begin
|
||||
@@ -347,34 +350,33 @@ begin
|
||||
if m_m1 = X"0" then m_m1_z <= '1'; else m_m1_z <= '0'; end if;
|
||||
if m_m1 = X"F" then m_m1_c <= '1'; else m_m1_c <= '0'; end if;
|
||||
end if;
|
||||
end process;
|
||||
end process;
|
||||
|
||||
process (clock)
|
||||
begin
|
||||
if rising_edge(clock) then
|
||||
-- mem <= ram_do;
|
||||
-- if ram_do = X"0" then mem_z <= '1'; else mem_z <= '0'; end if;
|
||||
|
||||
irq_n_r <= irq_n;
|
||||
r_nf <= not irq_n;
|
||||
if irq_n = '0' and irq_n_r = '1' and r_pio(2) = '1' then
|
||||
interrupt_pending <= '1';
|
||||
if irq_n = '0' and irq_n_r = '1' and r_pio(2) = '1' then
|
||||
interrupt_pending <= '1';
|
||||
end if;
|
||||
|
||||
|
||||
if reset = '1' then
|
||||
r_pc <= (others=>'0');
|
||||
r_pa <= (others=>'0');
|
||||
r_si <= (others=>'0');
|
||||
r_a <= (others=>'0');
|
||||
r_x <= (others=>'0');
|
||||
r_a <= (others=>'0');
|
||||
r_x <= (others=>'0');
|
||||
r_y <= (others=>'0');
|
||||
r_stf <= '1';
|
||||
r_zf <= '0';
|
||||
r_cf <= '0';
|
||||
r_vf <= '0';
|
||||
r_sf <= '0';
|
||||
r_nf <= '0';
|
||||
r_pio <= (others=>'0');
|
||||
r_stf <= '1';
|
||||
r_zf <= '0';
|
||||
r_cf <= '0';
|
||||
r_vf <= '0';
|
||||
r_sf <= '0';
|
||||
r_nf <= '0';
|
||||
r_pio <= (others=>'0');
|
||||
r_th <= (others=>'0');
|
||||
r_tl <= (others=>'0');
|
||||
r_tp <= (others=>'0');
|
||||
@@ -382,28 +384,49 @@ begin
|
||||
r_sb <= (others=>'0');
|
||||
r_sbcnt <= (others=>'0');
|
||||
interrupt_pending <= '0';
|
||||
timer_interrupt_pending <= '0';
|
||||
stack <= (others=>(others=>'0'));
|
||||
single_byte_op <= '1';
|
||||
else
|
||||
if ena = '1' then
|
||||
|
||||
tc_n_r <= tc_n;
|
||||
if (tc_n = '0' and tc_n_r = '1' and r_pio(6) = '1') or
|
||||
(ena = '1' and r_pio(7) = '1')
|
||||
then
|
||||
r_tl <= r_tl + 1;
|
||||
if r_tl = X"F" then
|
||||
r_th <= r_th + 1;
|
||||
if r_th = X"F" then
|
||||
if r_pio(1) = '1' then
|
||||
timer_interrupt_pending <= '1';
|
||||
end if;
|
||||
r_vf <= '1';
|
||||
end if;
|
||||
end if;
|
||||
end if;
|
||||
|
||||
if ena = '1' then
|
||||
|
||||
op_code <= rom_data;
|
||||
single_byte_op <= '1';
|
||||
|
||||
if r_pc = "111111" then
|
||||
if r_pc = "111111" then
|
||||
r_pc <= "000000";
|
||||
r_pa <= r_pa + "0001";
|
||||
else
|
||||
else
|
||||
r_pc <= r_pc + "000001";
|
||||
end if;
|
||||
|
||||
|
||||
if single_byte_op = '1' then
|
||||
if interrupt_pending = '1' then
|
||||
if interrupt_pending = '1' or timer_interrupt_pending = '1' then
|
||||
stack(to_integer(unsigned(r_si)))(13 downto 0) <= (r_cf & r_zf & r_stf & r_pa & r_pc);
|
||||
r_pc <= "000010";
|
||||
r_pa <= "00000";
|
||||
r_si <= r_si + "01";
|
||||
interrupt_pending <= '0';
|
||||
if interrupt_pending = '1' then
|
||||
interrupt_pending <= '0';
|
||||
elsif timer_interrupt_pending = '1' then
|
||||
timer_interrupt_pending <= '0';
|
||||
end if;
|
||||
else -- no irq
|
||||
case rom_data is
|
||||
when X"00" => r_stf <='1'; -- nop
|
||||
@@ -419,24 +442,24 @@ begin
|
||||
when X"04" => r_stf <='1'; r_y <= r_a; -- tay Y <- A
|
||||
when X"05" => r_stf <='1'; r_th <= r_a; -- tath TH <- A
|
||||
when X"06" => r_stf <='1'; r_tl <= r_a; -- tatl TL <- A
|
||||
when X"07" => r_stf <='1'; r_sb <= r_a; -- tas SB <- A
|
||||
when X"07" => r_stf <='1'; r_sb <= r_a; -- tas SB <- A
|
||||
when X"08" => r_stf <= not y_p1_c; r_y <= y_p1; r_zf <= y_p1_z; -- icy Y <- Y+1
|
||||
when X"09" => r_stf <= not m_p1_c; r_zf <= m_p1_z; -- icm M[X,Y] <- M[X,Y]+1
|
||||
when X"09" => r_stf <= not m_p1_c; r_zf <= m_p1_z; -- icm M[X,Y] <- M[X,Y]+1
|
||||
when X"0A" => r_stf <= not y_p1_c; r_y <= y_p1; r_zf <= y_p1_z; -- stic M[X,Y] <- A; Y <- Y+1
|
||||
when X"0B" => r_stf <='1'; r_a <= mem; r_zf <= mem_z; -- x A <- M[X,Y]; M[X,Y] <- A
|
||||
when X"0C" => r_stf <= not r_a(3); r_a <= rola; r_zf <= rola_z; r_cf <= r_a(3); -- rol
|
||||
when X"0D" => r_stf <='1'; r_a <= mem; r_zf <= mem_z; -- l A <- M[X,Y];
|
||||
when X"0E" => r_stf <= not adc_c; r_a <= adc(3 downto 0); r_zf <= adc_z; r_cf <= adc_c; -- adc A <- M[X,Y]+A+CF;
|
||||
when X"0F" => r_stf <= not a_and_m_z; r_a <= a_and_m; r_zf <= a_and_m_z; -- and A <- A & M[X,Y];
|
||||
when X"10" =>
|
||||
if do_da = '1' then r_stf <= not daa_c; r_a <= daa; r_cf <= daa_c; -- daa A <- A + 6 ; si A>9 or CF
|
||||
when X"0C" => r_stf <= not r_a(3); r_a <= rola; r_zf <= rola_z; r_cf <= r_a(3); -- rol
|
||||
when X"0D" => r_stf <='1'; r_a <= mem; r_zf <= mem_z; -- l A <- M[X,Y];
|
||||
when X"0E" => r_stf <= not adc_c; r_a <= adc(3 downto 0); r_zf <= adc_z; r_cf <= adc_c; -- adc A <- M[X,Y]+A+CF;
|
||||
when X"0F" => r_stf <= not a_and_m_z; r_a <= a_and_m; r_zf <= a_and_m_z; -- and A <- A & M[X,Y];
|
||||
when X"10" =>
|
||||
if do_da = '1' then r_stf <= not daa_c; r_a <= daa; r_cf <= daa_c; -- daa A <- A + 6 ; si A>9 or CF
|
||||
else r_stf <= '1'; r_cf <= '0'; end if;
|
||||
when X"11" =>
|
||||
if do_da = '1' then r_stf <= not das_c; r_a <= das; r_cf <= das_c; -- das A <- A + 10; si A>9 or CF
|
||||
when X"11" =>
|
||||
if do_da = '1' then r_stf <= not das_c; r_a <= das; r_cf <= das_c; -- das A <- A + 10; si A>9 or CF
|
||||
else r_stf <= '1'; r_cf <= '0'; end if;
|
||||
when X"12" => r_stf <='1'; r_a <= k_port_in; r_zf <= k_port_in_z; -- inK A <- K
|
||||
when X"13" => r_stf <='1'; -- inR A <- R(Y)
|
||||
if r_y = X"0" then r_a <= r0_port_in; r_zf <= r0_port_in_z; end if;
|
||||
when X"12" => r_stf <='1'; r_a <= k_port_in; r_zf <= k_port_in_z; -- inK A <- K
|
||||
when X"13" => r_stf <='1'; -- inR A <- R(Y)
|
||||
if r_y = X"0" then r_a <= r0_port_in; r_zf <= r0_port_in_z; end if;
|
||||
if r_y = X"1" then r_a <= r1_port_in; r_zf <= r1_port_in_z; end if;
|
||||
if r_y = X"2" then r_a <= r2_port_in; r_zf <= r2_port_in_z; end if;
|
||||
if r_y = X"3" then r_a <= r3_port_in; r_zf <= r3_port_in_z; end if;
|
||||
@@ -444,25 +467,25 @@ begin
|
||||
when X"15" => r_stf <='1'; r_a <= r_th; r_zf <= th_z; -- ttha A <- TH
|
||||
when X"16" => r_stf <='1'; r_a <= r_tl; r_zf <= tl_z; -- ttla A <- TH
|
||||
when X"17" => r_stf <='1'; r_a <= r_sb; r_zf <= sb_z; -- tsa A <- SB
|
||||
when X"18" => r_stf <= not y_m1_c; r_y <= y_m1; -- dcy Y <- Y-1
|
||||
when X"18" => r_stf <= not y_m1_c; r_y <= y_m1; -- dcy Y <- Y-1
|
||||
when X"19" => r_stf <= not m_m1_c; r_zf <= m_m1_z; -- dcm M[X,Y] <- M[X,Y]-1
|
||||
when X"1A" => r_stf <= not y_m1_c; r_y <= y_m1; r_zf <= y_m1_z; -- stdc M[X,Y] <- A; Y <- Y-1
|
||||
when X"1B" => r_stf <='1'; r_a <= r_x; r_x <= r_a; r_zf <= x_z; -- xx A <- X, X <- A
|
||||
when X"1C" => r_stf <= not r_a(0); r_a <= rora; r_zf <= rora_z; r_cf <= r_a(0); -- ror
|
||||
when X"1D" => r_stf <='1'; -- st M[X,Y] <- A
|
||||
when X"1E" => r_stf <= not sbc_c; r_a <= sbc(3 downto 0); r_zf <= sbc_z; r_cf <= sbc_c; -- sbc A <- M[X,Y]-A-CF;
|
||||
when X"1F" => r_stf <= not a_or_m_z; r_a <= a_or_m; r_zf <= a_or_m_z; -- or A <- A | M[X,Y];
|
||||
when X"1C" => r_stf <= not r_a(0); r_a <= rora; r_zf <= rora_z; r_cf <= r_a(0); -- ror
|
||||
when X"1D" => r_stf <='1'; -- st M[X,Y] <- A
|
||||
when X"1E" => r_stf <= not sbc_c; r_a <= sbc(3 downto 0); r_zf <= sbc_z; r_cf <= sbc_c; -- sbc A <- M[X,Y]-A-CF;
|
||||
when X"1F" => r_stf <= not a_or_m_z; r_a <= a_or_m; r_zf <= a_or_m_z; -- or A <- A | M[X,Y];
|
||||
when X"20" => r_stf <='1'; -- setR
|
||||
if r_y(3 downto 2) = "00" then r0_port_out <= (r0_port_in or sel_bit_y ); end if;
|
||||
if r_y(3 downto 2) = "01" then r1_port_out <= (r1_port_in or sel_bit_y ); end if;
|
||||
if r_y(3 downto 2) = "10" then r2_port_out <= (r2_port_in or sel_bit_y ); end if;
|
||||
if r_y(3 downto 2) = "11" then r3_port_out <= (r3_port_in or sel_bit_y ); end if;
|
||||
if r_y(3 downto 2) = "00" then r0_port_out <= (r0_port_in or sel_bit_y ); end if;
|
||||
if r_y(3 downto 2) = "01" then r1_port_out <= (r1_port_in or sel_bit_y ); end if;
|
||||
if r_y(3 downto 2) = "10" then r2_port_out <= (r2_port_in or sel_bit_y ); end if;
|
||||
if r_y(3 downto 2) = "11" then r3_port_out <= (r3_port_in or sel_bit_y ); end if;
|
||||
when X"21" => r_stf <='1'; r_cf <= '1'; -- setCF
|
||||
when X"22" => r_stf <='1'; -- clrR
|
||||
if r_y(3 downto 2) = "00" then r0_port_out <= (r0_port_in and not sel_bit_y ); end if;
|
||||
if r_y(3 downto 2) = "01" then r1_port_out <= (r1_port_in and not sel_bit_y ); end if;
|
||||
if r_y(3 downto 2) = "10" then r2_port_out <= (r2_port_in and not sel_bit_y ); end if;
|
||||
if r_y(3 downto 2) = "11" then r3_port_out <= (r3_port_in and not sel_bit_y ); end if;
|
||||
if r_y(3 downto 2) = "00" then r0_port_out <= (r0_port_in and not sel_bit_y ); end if;
|
||||
if r_y(3 downto 2) = "01" then r1_port_out <= (r1_port_in and not sel_bit_y ); end if;
|
||||
if r_y(3 downto 2) = "10" then r2_port_out <= (r2_port_in and not sel_bit_y ); end if;
|
||||
if r_y(3 downto 2) = "11" then r3_port_out <= (r3_port_in and not sel_bit_y ); end if;
|
||||
when X"23" => r_stf <='1'; r_cf <= '0'; -- clrCF
|
||||
when X"24" => -- tstR
|
||||
if r_y(3 downto 2) = "00" then r_stf <= not r0_port_in(to_integer(unsigned(r_y(1 downto 0)))); end if;
|
||||
@@ -476,17 +499,17 @@ begin
|
||||
when X"29" => r_stf <= not r_zf; -- tstz (ZF)
|
||||
when X"2A" => r_stf <= '1'; r_zf <= sb_z; -- sts M[X,Y] <- SB
|
||||
when X"2B" => r_stf <= '1'; r_sb <= mem; r_zf <= mem_z; -- ls SB <- M[X,Y]
|
||||
when X"2C" => r_stf <= '1'; -- rts
|
||||
when X"2C" => r_stf <= '1'; -- rts
|
||||
r_pa <= stack(to_integer(unsigned(r_si-"01")))(10 downto 6);
|
||||
r_pc <= stack(to_integer(unsigned(r_si-"01")))( 5 downto 0);
|
||||
r_si <= r_si - "01";
|
||||
when X"2D" => r_stf <= not nega_z; r_a <= nega; -- negA A <- -A
|
||||
when X"2E" => r_stf <= not cma_z; r_zf <= cma_z; r_cf <= cma_c; -- c M[X,Y]-A ?=
|
||||
when X"2F" => r_stf <= not a_xor_m_z; r_a <= a_xor_m; r_zf <= a_xor_m_z;-- eor A <- A xor M[X,Y];
|
||||
when X"30" | X"31" | X"32" | X"33" => r_stf <='1'; -- sbit M[X,Y](op&3) <- 1
|
||||
when X"2F" => r_stf <= not a_xor_m_z; r_a <= a_xor_m; r_zf <= a_xor_m_z;-- eor A <- A xor M[X,Y];
|
||||
when X"30" | X"31" | X"32" | X"33" => r_stf <='1'; -- sbit M[X,Y](op&3) <- 1
|
||||
when X"34" | X"35" | X"36" | X"37" => r_stf <='1'; -- rbit M[X,Y](op&3) <- 0
|
||||
when X"38" | X"39" | X"3A" | X"3B" => r_stf <= not m_tst_bit; -- tbit M[X,Y](op&3) == 1
|
||||
when X"3C" => -- rti
|
||||
when X"3C" => -- rti
|
||||
r_pa <= stack(to_integer(unsigned(r_si-"01")))(10 downto 6);
|
||||
r_pc <= stack(to_integer(unsigned(r_si-"01")))( 5 downto 0);
|
||||
r_stf <= stack(to_integer(unsigned(r_si-"01")))(11);
|
||||
@@ -494,7 +517,7 @@ begin
|
||||
r_cf <= stack(to_integer(unsigned(r_si-"01")))(13);
|
||||
r_si <= r_si - "01";
|
||||
when X"3D" => single_byte_op <= '0'; -- jpa
|
||||
when X"3E" => single_byte_op <= '0'; -- en
|
||||
when X"3E" => single_byte_op <= '0'; -- en
|
||||
when X"3F" => single_byte_op <= '0'; -- dis
|
||||
when X"40" => r_stf <= '1'; r0_port_out <= (r0_port_in or X"1"); -- setd RO(op&3) <- 1
|
||||
when X"41" => r_stf <= '1'; r0_port_out <= (r0_port_in or X"2"); -- setd RO(op&3) <- 1
|
||||
@@ -505,39 +528,39 @@ begin
|
||||
when X"46" => r_stf <= '1'; r0_port_out <= (r0_port_in and not X"4"); -- setd RO(op&3) <- 0
|
||||
when X"47" => r_stf <= '1'; r0_port_out <= (r0_port_in and not X"8"); -- setd RO(op&3) <- 0
|
||||
when X"48" | X"49" | X"4A" | X"4B" => -- tstd R2(op&3) ?=
|
||||
r_stf <= not r2_port_in(to_integer(unsigned(rom_data(1 downto 0))));
|
||||
when X"4C" | X"4D" | X"4E" | X"4F" => -- tba A(op&3) ?=
|
||||
r_stf <= not r_a(to_integer(unsigned(rom_data(1 downto 0))));
|
||||
r_stf <= not r2_port_in(to_integer(unsigned(rom_data(1 downto 0))));
|
||||
when X"4C" | X"4D" | X"4E" | X"4F" => -- tba A(op&3) ?=
|
||||
r_stf <= not r_a(to_integer(unsigned(rom_data(1 downto 0))));
|
||||
when X"50" | X"51" | X"52" | X"53" => -- xd A <-> M[0,op&3]
|
||||
r_stf <= '1'; r_a <= mem; r_zf <= mem_z;
|
||||
r_stf <= '1'; r_a <= mem; r_zf <= mem_z;
|
||||
when X"54" | X"55" | X"56" | X"57" => -- xyd Y <-> M[0,op&3]
|
||||
r_stf <= '1'; r_y <= mem; r_zf <= mem_z;
|
||||
r_stf <= '1'; r_y <= mem; r_zf <= mem_z;
|
||||
when X"58" | X"59" | X"5A" | X"5B" | X"5C" | X"5D" | X"5E" | X"5F" => -- lxi imm (op&7)
|
||||
r_stf <='1'; r_x <= '0' & rom_data(2 downto 0); r_zf <= imm_x7_z;
|
||||
when X"60" | X"61" | X"62" | X"63" | X"64" | X"65" | X"66" | X"67" => -- call addr
|
||||
single_byte_op <= '0';
|
||||
when X"68" | X"69" | X"6A" | X"6B" | X"6C" | X"6D" | X"6E" | X"6F" => -- jpl addr
|
||||
single_byte_op <= '0';
|
||||
when X"70" | X"71" | X"72" | X"73" | X"74" | X"75" | X"76" | X"77" |
|
||||
when X"60" | X"61" | X"62" | X"63" | X"64" | X"65" | X"66" | X"67" => -- call addr
|
||||
single_byte_op <= '0';
|
||||
when X"68" | X"69" | X"6A" | X"6B" | X"6C" | X"6D" | X"6E" | X"6F" => -- jpl addr
|
||||
single_byte_op <= '0';
|
||||
when X"70" | X"71" | X"72" | X"73" | X"74" | X"75" | X"76" | X"77" |
|
||||
X"78" | X"79" | X"7A" | X"7B" | X"7C" | X"7D" | X"7E" | X"7F" => -- ai A <- A+imm (op&F)
|
||||
r_stf <= not a_pim_c; r_a <= a_pim(3 downto 0); r_zf <= a_pim_z; r_cf <= a_pim_c;
|
||||
when X"80" | X"81" | X"82" | X"83" | X"84" | X"85" | X"86" | X"87" |
|
||||
r_stf <= not a_pim_c; r_a <= a_pim(3 downto 0); r_zf <= a_pim_z; r_cf <= a_pim_c;
|
||||
when X"80" | X"81" | X"82" | X"83" | X"84" | X"85" | X"86" | X"87" |
|
||||
X"88" | X"89" | X"8A" | X"8B" | X"8C" | X"8D" | X"8E" | X"8F" => -- lyi Y <- imm (op&F)
|
||||
r_stf <='1'; r_y <= rom_data(3 downto 0); r_zf <= imm_xF_z;
|
||||
when X"90" | X"91" | X"92" | X"93" | X"94" | X"95" | X"96" | X"97" |
|
||||
r_stf <='1'; r_y <= rom_data(3 downto 0); r_zf <= imm_xF_z;
|
||||
when X"90" | X"91" | X"92" | X"93" | X"94" | X"95" | X"96" | X"97" |
|
||||
X"98" | X"99" | X"9A" | X"9B" | X"9C" | X"9D" | X"9E" | X"9F" => -- li A <- imm (op&F)
|
||||
r_stf <='1'; r_a <= rom_data(3 downto 0); r_zf <= imm_xF_z;
|
||||
when X"A0" | X"A1" | X"A2" | X"A3" | X"A4" | X"A5" | X"A6" | X"A7" |
|
||||
r_stf <='1'; r_a <= rom_data(3 downto 0); r_zf <= imm_xF_z;
|
||||
when X"A0" | X"A1" | X"A2" | X"A3" | X"A4" | X"A5" | X"A6" | X"A7" |
|
||||
X"A8" | X"A9" | X"AA" | X"AB" | X"AC" | X"AD" | X"AE" | X"AF" => -- cyi imm - Y ?=
|
||||
r_stf <= not im_my_z; r_zf <= im_my_z; r_cf <= im_my_c;
|
||||
when X"B0" | X"B1" | X"B2" | X"B3" | X"B4" | X"B5" | X"B6" | X"B7" |
|
||||
r_stf <= not im_my_z; r_zf <= im_my_z; r_cf <= im_my_c;
|
||||
when X"B0" | X"B1" | X"B2" | X"B3" | X"B4" | X"B5" | X"B6" | X"B7" |
|
||||
X"B8" | X"B9" | X"BA" | X"BB" | X"BC" | X"BD" | X"BE" | X"BF" => -- ci imm - A ?=
|
||||
r_stf <= not im_ma_z; r_zf <= im_ma_z; r_cf <= im_ma_c;
|
||||
r_stf <= not im_ma_z; r_zf <= im_ma_z; r_cf <= im_ma_c;
|
||||
when others => r_stf <='1'; -- jmp addr if ST (op_code C0..FF)
|
||||
if r_stf = '1' then r_pc <= rom_data(5 downto 0); end if; -- (let r_pa be incremented when r_pc = 0x3F)
|
||||
end case;
|
||||
end if ;
|
||||
else -- 2 bytes op_code, rom_data = 2nd byte
|
||||
end if ;
|
||||
else -- 2 bytes op_code, rom_data = 2nd byte
|
||||
case op_code is
|
||||
when X"3D" => r_stf <='1'; r_pa <= rom_data(4 downto 0); r_pc <= r_a & "00"; -- jpa PA <- data&0x1f; PC <- A*4
|
||||
when X"3E" => r_stf <='1'; r_pio <= r_pio or rom_data; -- en PIO <- PIO or imm data
|
||||
@@ -548,7 +571,7 @@ begin
|
||||
stack(to_integer(unsigned(r_si)))(10 downto 0) <= (r_pa & r_pc) + '1';
|
||||
r_pc <= rom_data(5 downto 0);
|
||||
r_pa <= op_code(2 downto 0) & rom_data(7 downto 6);
|
||||
r_si <= r_si + "01";
|
||||
r_si <= r_si + "01";
|
||||
end if;
|
||||
when X"68" | X"69" | X"6A" | X"6B" | X"6C" | X"6D" | X"6E" | X"6F" => -- jpl if ST
|
||||
r_stf <= '1';
|
||||
@@ -559,7 +582,7 @@ begin
|
||||
when others => r_stf <='1';
|
||||
end case;
|
||||
end if;
|
||||
|
||||
|
||||
end if;
|
||||
end if;
|
||||
end if;
|
||||
@@ -574,7 +597,7 @@ begin
|
||||
end if;
|
||||
end if;
|
||||
end process;
|
||||
|
||||
|
||||
ram_do <= ram(to_integer(unsigned(ram_addr)));
|
||||
|
||||
end struct;
|
||||
end struct;
|
||||
|
||||
@@ -1,278 +0,0 @@
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all,ieee.numeric_std.all;
|
||||
|
||||
entity bg_graphx is
|
||||
port (
|
||||
clk : in std_logic;
|
||||
addr : in std_logic_vector(11 downto 0);
|
||||
data : out std_logic_vector(7 downto 0)
|
||||
);
|
||||
end entity;
|
||||
|
||||
architecture prom of bg_graphx is
|
||||
type rom is array(0 to 4095) of std_logic_vector(7 downto 0);
|
||||
signal rom_data: rom := (
|
||||
X"88",X"CC",X"22",X"22",X"66",X"CC",X"88",X"00",X"33",X"77",X"CC",X"88",X"88",X"77",X"33",X"00",
|
||||
X"22",X"22",X"EE",X"EE",X"22",X"22",X"00",X"00",X"00",X"00",X"FF",X"FF",X"44",X"00",X"00",X"00",
|
||||
X"22",X"22",X"AA",X"AA",X"EE",X"EE",X"66",X"00",X"66",X"FF",X"BB",X"99",X"99",X"CC",X"44",X"00",
|
||||
X"CC",X"EE",X"22",X"22",X"22",X"66",X"44",X"00",X"88",X"DD",X"FF",X"BB",X"99",X"88",X"00",X"00",
|
||||
X"88",X"EE",X"EE",X"88",X"88",X"88",X"88",X"00",X"00",X"FF",X"FF",X"CC",X"66",X"33",X"11",X"00",
|
||||
X"CC",X"EE",X"22",X"22",X"22",X"66",X"44",X"00",X"11",X"BB",X"AA",X"AA",X"AA",X"EE",X"EE",X"00",
|
||||
X"CC",X"EE",X"22",X"22",X"22",X"EE",X"CC",X"00",X"00",X"99",X"99",X"99",X"DD",X"77",X"33",X"00",
|
||||
X"00",X"00",X"00",X"EE",X"EE",X"00",X"00",X"00",X"CC",X"EE",X"BB",X"99",X"88",X"CC",X"CC",X"00",
|
||||
X"CC",X"EE",X"AA",X"AA",X"22",X"22",X"CC",X"00",X"00",X"66",X"99",X"99",X"BB",X"FF",X"66",X"00",
|
||||
X"88",X"CC",X"66",X"22",X"22",X"22",X"00",X"00",X"77",X"FF",X"99",X"99",X"99",X"FF",X"66",X"00",
|
||||
X"EE",X"EE",X"88",X"88",X"88",X"EE",X"EE",X"00",X"33",X"77",X"CC",X"88",X"CC",X"77",X"33",X"00",
|
||||
X"CC",X"EE",X"22",X"22",X"22",X"EE",X"EE",X"00",X"66",X"FF",X"99",X"99",X"99",X"FF",X"FF",X"00",
|
||||
X"44",X"66",X"22",X"22",X"66",X"CC",X"88",X"00",X"44",X"CC",X"88",X"88",X"CC",X"77",X"33",X"00",
|
||||
X"88",X"CC",X"66",X"22",X"22",X"EE",X"EE",X"00",X"33",X"77",X"CC",X"88",X"88",X"FF",X"FF",X"00",
|
||||
X"22",X"22",X"22",X"22",X"EE",X"EE",X"00",X"00",X"88",X"99",X"99",X"99",X"FF",X"FF",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"EE",X"EE",X"00",X"88",X"99",X"99",X"99",X"99",X"FF",X"FF",X"00",
|
||||
X"EE",X"EE",X"22",X"22",X"66",X"CC",X"88",X"00",X"99",X"99",X"99",X"88",X"CC",X"77",X"33",X"00",
|
||||
X"EE",X"EE",X"00",X"00",X"00",X"EE",X"EE",X"00",X"FF",X"FF",X"11",X"11",X"11",X"FF",X"FF",X"00",
|
||||
X"22",X"22",X"EE",X"EE",X"22",X"22",X"00",X"00",X"88",X"88",X"FF",X"FF",X"88",X"88",X"00",X"00",
|
||||
X"CC",X"EE",X"22",X"22",X"22",X"66",X"44",X"00",X"FF",X"FF",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"22",X"66",X"EE",X"CC",X"88",X"EE",X"EE",X"00",X"88",X"CC",X"66",X"33",X"11",X"FF",X"FF",X"00",
|
||||
X"22",X"22",X"22",X"22",X"EE",X"EE",X"00",X"00",X"00",X"00",X"00",X"00",X"FF",X"FF",X"00",X"00",
|
||||
X"EE",X"EE",X"00",X"88",X"00",X"EE",X"EE",X"00",X"FF",X"FF",X"77",X"33",X"77",X"FF",X"FF",X"00",
|
||||
X"EE",X"EE",X"CC",X"88",X"00",X"EE",X"EE",X"00",X"FF",X"FF",X"11",X"33",X"77",X"FF",X"FF",X"00",
|
||||
X"CC",X"EE",X"22",X"22",X"22",X"EE",X"CC",X"00",X"77",X"FF",X"88",X"88",X"88",X"FF",X"77",X"00",
|
||||
X"00",X"88",X"88",X"88",X"88",X"EE",X"EE",X"00",X"77",X"FF",X"88",X"88",X"88",X"FF",X"FF",X"00",
|
||||
X"AA",X"CC",X"EE",X"AA",X"22",X"EE",X"CC",X"00",X"77",X"FF",X"88",X"88",X"88",X"FF",X"77",X"00",
|
||||
X"22",X"66",X"EE",X"CC",X"88",X"EE",X"EE",X"00",X"77",X"FF",X"99",X"88",X"88",X"FF",X"FF",X"00",
|
||||
X"CC",X"EE",X"22",X"22",X"22",X"66",X"44",X"00",X"00",X"55",X"DD",X"99",X"99",X"FF",X"66",X"00",
|
||||
X"00",X"00",X"EE",X"EE",X"00",X"00",X"00",X"00",X"88",X"88",X"FF",X"FF",X"88",X"88",X"00",X"00",
|
||||
X"CC",X"EE",X"22",X"22",X"22",X"EE",X"CC",X"00",X"FF",X"FF",X"00",X"00",X"00",X"FF",X"FF",X"00",
|
||||
X"00",X"88",X"CC",X"EE",X"CC",X"88",X"00",X"00",X"FF",X"FF",X"11",X"00",X"11",X"FF",X"FF",X"00",
|
||||
X"EE",X"EE",X"CC",X"88",X"CC",X"EE",X"EE",X"00",X"FF",X"FF",X"11",X"33",X"11",X"FF",X"FF",X"00",
|
||||
X"66",X"EE",X"CC",X"88",X"CC",X"EE",X"66",X"00",X"CC",X"EE",X"77",X"33",X"77",X"EE",X"CC",X"00",
|
||||
X"00",X"00",X"EE",X"EE",X"00",X"00",X"00",X"00",X"EE",X"FF",X"11",X"11",X"FF",X"EE",X"00",X"00",
|
||||
X"22",X"22",X"22",X"AA",X"EE",X"EE",X"66",X"00",X"CC",X"EE",X"FF",X"BB",X"99",X"88",X"88",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"11",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"FF",X"88",X"88",X"88",X"88",X"88",X"88",X"88",X"FF",
|
||||
X"FF",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"FF",X"88",X"88",X"88",X"88",X"88",X"88",X"88",
|
||||
X"44",X"AA",X"44",X"00",X"88",X"44",X"22",X"00",X"88",X"44",X"22",X"11",X"44",X"AA",X"44",X"00",
|
||||
X"00",X"00",X"00",X"00",X"66",X"66",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"FF",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"FF",
|
||||
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"98",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"98",X"98",X"00",X"00",X"00",X"00",X"00",X"00",X"02",X"02",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"40",X"40",X"40",X"20",X"20",X"20",X"20",X"10",X"19",X"19",X"19",X"15",X"15",X"15",X"15",X"13",
|
||||
X"81",X"81",X"81",X"81",X"81",X"41",X"41",X"41",X"22",X"22",X"22",X"22",X"22",X"22",X"22",X"22",
|
||||
X"41",X"41",X"41",X"81",X"81",X"81",X"81",X"81",X"22",X"22",X"22",X"22",X"22",X"22",X"22",X"22",
|
||||
X"10",X"20",X"20",X"20",X"20",X"40",X"40",X"40",X"13",X"15",X"15",X"15",X"15",X"19",X"19",X"19",
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X"00",X"00",X"00",X"00",X"00",X"00",X"98",X"98",X"00",X"00",X"00",X"00",X"00",X"00",X"02",X"02",
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X"A8",X"98",X"54",X"54",X"00",X"00",X"00",X"00",X"02",X"02",X"02",X"00",X"00",X"00",X"00",X"00",
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X"40",X"40",X"40",X"40",X"40",X"20",X"20",X"20",X"19",X"19",X"19",X"19",X"15",X"15",X"15",X"15",
|
||||
X"81",X"81",X"81",X"81",X"81",X"81",X"81",X"81",X"22",X"22",X"22",X"22",X"22",X"22",X"22",X"11",
|
||||
X"81",X"81",X"81",X"81",X"81",X"81",X"81",X"81",X"11",X"22",X"22",X"22",X"22",X"22",X"22",X"22",
|
||||
X"20",X"20",X"20",X"40",X"40",X"40",X"40",X"40",X"15",X"15",X"15",X"15",X"19",X"19",X"19",X"19",
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||||
X"00",X"00",X"00",X"00",X"54",X"54",X"98",X"A8",X"00",X"00",X"00",X"00",X"00",X"02",X"02",X"02",
|
||||
X"A8",X"A8",X"98",X"54",X"54",X"44",X"00",X"00",X"04",X"04",X"04",X"02",X"02",X"00",X"00",X"00",
|
||||
X"40",X"40",X"40",X"40",X"40",X"20",X"20",X"20",X"19",X"19",X"19",X"19",X"19",X"19",X"15",X"15",
|
||||
X"81",X"81",X"81",X"81",X"81",X"81",X"81",X"81",X"22",X"22",X"22",X"22",X"22",X"22",X"22",X"22",
|
||||
X"81",X"81",X"81",X"81",X"81",X"81",X"81",X"81",X"22",X"22",X"22",X"22",X"22",X"22",X"22",X"22",
|
||||
X"20",X"20",X"20",X"40",X"40",X"40",X"40",X"40",X"15",X"15",X"19",X"19",X"19",X"19",X"19",X"19",
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X"00",X"00",X"44",X"54",X"54",X"98",X"A8",X"A8",X"00",X"00",X"00",X"02",X"02",X"04",X"04",X"04",
|
||||
X"20",X"20",X"20",X"20",X"10",X"10",X"10",X"00",X"04",X"04",X"02",X"02",X"02",X"02",X"00",X"00",
|
||||
X"40",X"40",X"40",X"40",X"40",X"40",X"40",X"40",X"19",X"19",X"19",X"19",X"19",X"15",X"15",X"15",
|
||||
X"81",X"81",X"81",X"81",X"81",X"81",X"81",X"81",X"22",X"22",X"22",X"22",X"22",X"22",X"22",X"22",
|
||||
X"81",X"81",X"81",X"81",X"81",X"81",X"81",X"81",X"22",X"22",X"22",X"22",X"22",X"22",X"22",X"22",
|
||||
X"40",X"40",X"40",X"40",X"40",X"40",X"40",X"40",X"15",X"15",X"15",X"19",X"19",X"19",X"19",X"19",
|
||||
X"00",X"10",X"10",X"10",X"20",X"20",X"20",X"20",X"00",X"00",X"02",X"02",X"02",X"02",X"04",X"04");
|
||||
begin
|
||||
process(clk)
|
||||
begin
|
||||
if rising_edge(clk) then
|
||||
data <= rom_data(to_integer(unsigned(addr)));
|
||||
end if;
|
||||
end process;
|
||||
end architecture;
|
||||
@@ -1,86 +0,0 @@
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all,ieee.numeric_std.all;
|
||||
|
||||
entity cs54xx_prog is
|
||||
port (
|
||||
clk : in std_logic;
|
||||
addr : in std_logic_vector(9 downto 0);
|
||||
data : out std_logic_vector(7 downto 0)
|
||||
);
|
||||
end entity;
|
||||
|
||||
architecture prom of cs54xx_prog is
|
||||
type rom is array(0 to 1023) of std_logic_vector(7 downto 0);
|
||||
signal rom_data: rom := (
|
||||
X"C6",X"C6",X"52",X"12",X"3D",X"06",X"58",X"80",X"90",X"1B",X"0A",X"CA",X"1B",X"71",X"B8",X"C9",
|
||||
X"3E",X"04",X"59",X"84",X"0D",X"1C",X"18",X"0D",X"1C",X"1A",X"0D",X"1C",X"1A",X"0D",X"1C",X"1A",
|
||||
X"0D",X"1C",X"1D",X"1C",X"83",X"2F",X"71",X"08",X"0A",X"0D",X"80",X"38",X"F8",X"23",X"01",X"88",
|
||||
X"20",X"08",X"0D",X"21",X"0E",X"1A",X"68",X"41",X"88",X"22",X"23",X"90",X"01",X"89",X"0D",X"0E",
|
||||
X"1A",X"0D",X"7F",X"68",X"90",X"58",X"19",X"68",X"90",X"59",X"86",X"19",X"68",X"90",X"08",X"19",
|
||||
X"68",X"90",X"08",X"19",X"0D",X"B1",X"D8",X"DF",X"B2",X"FF",X"90",X"85",X"1D",X"92",X"E6",X"5B",
|
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X"81",X"0D",X"59",X"85",X"1D",X"91",X"23",X"0C",X"04",X"5B",X"0D",X"B0",X"F5",X"50",X"08",X"0D",
|
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X"B0",X"F8",X"88",X"59",X"D3",X"50",X"08",X"0D",X"59",X"87",X"1A",X"50",X"1D",X"68",X"90",X"85",
|
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X"0D",X"7F",X"68",X"90",X"0D",X"23",X"1C",X"23",X"0E",X"1C",X"1D",X"91",X"88",X"1D",X"68",X"66",
|
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X"89",X"59",X"93",X"0F",X"B1",X"D8",X"8E",X"09",X"8A",X"0D",X"8E",X"38",X"DE",X"90",X"21",X"01",
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X"38",X"E5",X"89",X"20",X"E7",X"89",X"22",X"8D",X"0D",X"7F",X"68",X"FC",X"58",X"19",X"68",X"FC",
|
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X"59",X"8B",X"19",X"68",X"FC",X"08",X"19",X"68",X"FC",X"08",X"19",X"0D",X"B1",X"68",X"C0",X"C9",
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X"B2",X"68",X"EC",X"90",X"8A",X"1D",X"92",X"68",X"D0",X"5B",X"89",X"0D",X"59",X"8A",X"1D",X"91",
|
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X"23",X"0C",X"78",X"04",X"5B",X"0D",X"B0",X"68",X"E3",X"50",X"08",X"0D",X"B0",X"68",X"E6",X"59",
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X"0D",X"23",X"1C",X"23",X"0E",X"1C",X"1D",X"91",X"8D",X"1D",X"68",X"D0",X"5A",X"8F",X"0D",X"8B",
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X"59",X"80",X"38",X"E1",X"5A",X"86",X"0D",X"23",X"8A",X"0E",X"1D",X"87",X"0D",X"8B",X"0E",X"1D",
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X"19",X"68",X"12",X"8F",X"59",X"19",X"0D",X"B0",X"69",X"47",X"5A",X"0D",X"1C",X"23",X"0E",X"1C",
|
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X"1D",X"7F",X"68",X"12",X"91",X"59",X"1D",X"5A",X"84",X"0D",X"8D",X"1D",X"7F",X"D7",X"85",X"0D",
|
||||
X"8E",X"1D",X"8C",X"90",X"1D",X"68",X"12",X"85",X"0D",X"8E",X"1D",X"B0",X"E3",X"8F",X"1D",X"59",
|
||||
X"1D",X"68",X"12",X"90",X"8C",X"1D",X"68",X"12",X"1B",X"53",X"54",X"80",X"13",X"5A",X"8F",X"1D",
|
||||
X"54",X"53",X"1B",X"52",X"3E",X"04",X"3C",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
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X"FC",X"00",X"00",X"00",X"69",X"C0",X"00",X"00",X"69",X"DC",X"00",X"00",X"6A",X"55",X"00",X"00",
|
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X"6A",X"5D",X"00",X"00",X"69",X"F9",X"00",X"00",X"6A",X"40",X"00",X"00",X"69",X"68",X"00",X"00",
|
||||
X"FC",X"00",X"00",X"00",X"FC",X"00",X"00",X"00",X"FC",X"00",X"00",X"00",X"FC",X"00",X"00",X"00",
|
||||
X"FC",X"00",X"00",X"00",X"FC",X"00",X"00",X"00",X"FC",X"00",X"00",X"00",X"52",X"3E",X"04",X"3C",
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X"88",X"0D",X"59",X"8A",X"1D",X"8D",X"93",X"0A",X"5B",X"0D",X"51",X"08",X"0D",X"59",X"8C",X"1A",
|
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X"51",X"1D",X"53",X"1B",X"52",X"54",X"3E",X"04",X"3C",X"1B",X"53",X"54",X"5A",X"81",X"0D",X"8C",
|
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X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
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|
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X"54",X"8F",X"55",X"3F",X"04",X"25",X"E8",X"E5",X"25",X"E8",X"80",X"13",X"55",X"1A",X"12",X"1A",
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|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00");
|
||||
begin
|
||||
process(clk)
|
||||
begin
|
||||
if rising_edge(clk) then
|
||||
data <= rom_data(to_integer(unsigned(addr)));
|
||||
end if;
|
||||
end process;
|
||||
end architecture;
|
||||
File diff suppressed because it is too large
Load Diff
@@ -1,278 +0,0 @@
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all,ieee.numeric_std.all;
|
||||
|
||||
entity galaga_cpu2 is
|
||||
port (
|
||||
clk : in std_logic;
|
||||
addr : in std_logic_vector(11 downto 0);
|
||||
data : out std_logic_vector(7 downto 0)
|
||||
);
|
||||
end entity;
|
||||
|
||||
architecture prom of galaga_cpu2 is
|
||||
type rom is array(0 to 4095) of std_logic_vector(7 downto 0);
|
||||
signal rom_data: rom := (
|
||||
X"31",X"00",X"91",X"C3",X"7C",X"05",X"FF",X"FF",X"87",X"30",X"05",X"24",X"C3",X"10",X"00",X"FF",
|
||||
X"85",X"6F",X"D0",X"24",X"C9",X"FF",X"FF",X"FF",X"77",X"23",X"10",X"FC",X"C9",X"23",X"06",X"16",
|
||||
X"23",X"00",X"19",X"F7",X"4B",X"00",X"23",X"F0",X"02",X"F0",X"5E",X"00",X"23",X"F0",X"24",X"FB",
|
||||
X"23",X"00",X"FF",X"FF",X"E9",X"FF",X"FF",X"FF",X"C3",X"13",X"05",X"BE",X"05",X"BF",X"05",X"D3",
|
||||
X"08",X"BE",X"05",X"F5",X"06",X"EE",X"05",X"BE",X"05",X"CA",X"0E",X"23",X"F0",X"26",X"23",X"14",
|
||||
X"13",X"FE",X"0D",X"0B",X"0A",X"08",X"06",X"04",X"03",X"01",X"23",X"FF",X"FF",X"FF",X"44",X"E4",
|
||||
X"18",X"FB",X"44",X"00",X"FF",X"FF",X"C9",X"23",X"08",X"08",X"23",X"03",X"1B",X"23",X"08",X"0F",
|
||||
X"23",X"16",X"15",X"F7",X"84",X"00",X"23",X"16",X"03",X"F0",X"97",X"00",X"23",X"16",X"19",X"FB",
|
||||
X"23",X"00",X"FF",X"FF",X"23",X"16",X"01",X"FE",X"0D",X"0C",X"0A",X"08",X"06",X"04",X"03",X"01",
|
||||
X"23",X"FC",X"30",X"23",X"00",X"FF",X"FF",X"44",X"27",X"0E",X"FB",X"44",X"00",X"FF",X"FF",X"33",
|
||||
X"06",X"18",X"23",X"00",X"18",X"F7",X"B6",X"00",X"23",X"F0",X"08",X"F0",X"CC",X"00",X"23",X"F0",
|
||||
X"20",X"FB",X"23",X"00",X"FF",X"FF",X"23",X"F0",X"20",X"23",X"10",X"0D",X"FE",X"1A",X"18",X"15",
|
||||
X"10",X"0C",X"08",X"05",X"03",X"23",X"FE",X"30",X"23",X"00",X"FF",X"FF",X"33",X"E0",X"10",X"FB",
|
||||
X"44",X"00",X"FF",X"FF",X"23",X"03",X"18",X"33",X"04",X"10",X"23",X"08",X"0A",X"44",X"16",X"12",
|
||||
X"F7",X"60",X"01",X"44",X"16",X"03",X"F0",X"73",X"01",X"44",X"16",X"1D",X"FB",X"23",X"00",X"FF",
|
||||
X"FF",X"12",X"18",X"17",X"12",X"00",X"80",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"14",X"06",X"14",X"0C",X"14",X"08",X"14",X"0A",X"1C",X"00",X"1C",X"12",X"1E",X"00",X"1E",X"12",
|
||||
X"1C",X"02",X"1C",X"10",X"1E",X"02",X"1E",X"10",X"1C",X"04",X"1C",X"0E",X"1E",X"04",X"1E",X"0E",
|
||||
X"1C",X"06",X"1C",X"0C",X"1E",X"06",X"1E",X"0C",X"1C",X"08",X"1C",X"0A",X"1E",X"08",X"1E",X"0A",
|
||||
X"16",X"06",X"16",X"0C",X"16",X"08",X"16",X"0A",X"18",X"00",X"18",X"12",X"1A",X"00",X"1A",X"12",
|
||||
X"18",X"02",X"18",X"10",X"1A",X"02",X"1A",X"10",X"18",X"04",X"18",X"0E",X"1A",X"04",X"1A",X"0E",
|
||||
X"18",X"06",X"18",X"0C",X"1A",X"06",X"1A",X"0C",X"18",X"08",X"18",X"0A",X"1A",X"08",X"1A",X"0A",
|
||||
X"44",X"16",X"06",X"FE",X"0C",X"0B",X"0A",X"08",X"06",X"04",X"02",X"01",X"23",X"FE",X"30",X"23",
|
||||
X"00",X"FF",X"FF",X"66",X"20",X"14",X"FB",X"44",X"00",X"FF",X"FF",X"23",X"06",X"18",X"23",X"00",
|
||||
X"18",X"F7",X"92",X"01",X"44",X"F0",X"08",X"F0",X"A8",X"01",X"44",X"F0",X"20",X"FB",X"23",X"00",
|
||||
X"FF",X"FF",X"44",X"F0",X"26",X"23",X"10",X"0B",X"FE",X"22",X"20",X"1E",X"1B",X"18",X"15",X"12",
|
||||
X"10",X"23",X"FE",X"30",X"23",X"00",X"FF",X"FF",X"66",X"E0",X"10",X"FB",X"44",X"00",X"FF",X"FF",
|
||||
X"23",X"03",X"20",X"23",X"08",X"0F",X"23",X"16",X"12",X"F7",X"CA",X"01",X"23",X"16",X"03",X"F0",
|
||||
X"E0",X"01",X"23",X"16",X"1D",X"FB",X"23",X"00",X"FF",X"FF",X"23",X"16",X"01",X"FE",X"0D",X"0C",
|
||||
X"0B",X"09",X"07",X"05",X"03",X"02",X"23",X"02",X"20",X"23",X"FC",X"12",X"23",X"00",X"FF",X"FF",
|
||||
X"44",X"20",X"14",X"FB",X"44",X"00",X"FF",X"FF",X"23",X"00",X"10",X"23",X"01",X"40",X"22",X"0C",
|
||||
X"37",X"23",X"00",X"FF",X"FF",X"23",X"02",X"3A",X"23",X"10",X"09",X"23",X"00",X"18",X"23",X"20",
|
||||
X"10",X"23",X"00",X"18",X"23",X"20",X"0D",X"23",X"00",X"FF",X"FF",X"23",X"00",X"10",X"23",X"01",
|
||||
X"30",X"00",X"40",X"08",X"23",X"FF",X"30",X"23",X"00",X"FF",X"FF",X"23",X"00",X"30",X"23",X"05",
|
||||
X"80",X"23",X"05",X"4C",X"23",X"04",X"01",X"23",X"00",X"50",X"FF",X"23",X"00",X"28",X"23",X"06",
|
||||
X"1D",X"23",X"00",X"11",X"00",X"40",X"08",X"23",X"00",X"11",X"23",X"FA",X"1D",X"23",X"00",X"50",
|
||||
X"FF",X"23",X"00",X"21",X"00",X"20",X"10",X"23",X"F8",X"20",X"23",X"FF",X"20",X"23",X"F8",X"1B",
|
||||
X"23",X"E8",X"0B",X"23",X"00",X"21",X"00",X"20",X"08",X"23",X"00",X"42",X"FF",X"23",X"00",X"08",
|
||||
X"00",X"20",X"08",X"23",X"F0",X"20",X"23",X"10",X"20",X"23",X"F0",X"40",X"23",X"10",X"20",X"23",
|
||||
X"F0",X"20",X"00",X"20",X"08",X"23",X"00",X"30",X"FF",X"23",X"10",X"0C",X"23",X"00",X"20",X"23",
|
||||
X"E8",X"10",X"23",X"F4",X"10",X"23",X"E8",X"10",X"23",X"F4",X"32",X"23",X"E8",X"10",X"23",X"F4",
|
||||
X"32",X"23",X"E8",X"10",X"23",X"F4",X"10",X"23",X"E8",X"0E",X"23",X"02",X"30",X"FF",X"23",X"F1",
|
||||
X"08",X"23",X"00",X"10",X"23",X"05",X"3C",X"23",X"07",X"42",X"23",X"0A",X"40",X"23",X"10",X"2D",
|
||||
X"23",X"20",X"19",X"00",X"FC",X"14",X"23",X"02",X"4A",X"FF",X"23",X"04",X"20",X"23",X"00",X"16",
|
||||
X"23",X"F0",X"30",X"23",X"00",X"12",X"23",X"10",X"30",X"23",X"00",X"12",X"23",X"10",X"30",X"23",
|
||||
X"00",X"16",X"23",X"04",X"20",X"23",X"00",X"10",X"FF",X"23",X"00",X"15",X"00",X"20",X"08",X"23",
|
||||
X"00",X"11",X"00",X"E0",X"08",X"23",X"00",X"18",X"00",X"20",X"08",X"23",X"00",X"13",X"00",X"E0",
|
||||
X"08",X"23",X"00",X"1F",X"00",X"20",X"08",X"23",X"00",X"30",X"FF",X"23",X"02",X"0E",X"23",X"00",
|
||||
X"34",X"23",X"12",X"19",X"23",X"00",X"20",X"23",X"E0",X"0E",X"23",X"00",X"12",X"23",X"20",X"0E",
|
||||
X"23",X"00",X"0C",X"23",X"E0",X"0E",X"23",X"1B",X"08",X"23",X"00",X"10",X"FF",X"23",X"00",X"0D",
|
||||
X"00",X"C0",X"04",X"23",X"00",X"21",X"00",X"40",X"06",X"23",X"00",X"51",X"00",X"C0",X"06",X"23",
|
||||
X"00",X"73",X"FF",X"23",X"08",X"20",X"23",X"00",X"16",X"23",X"E0",X"0C",X"23",X"02",X"0B",X"23",
|
||||
X"11",X"0C",X"23",X"02",X"0B",X"23",X"E0",X"0C",X"23",X"00",X"16",X"23",X"08",X"20",X"FF",X"12",
|
||||
X"18",X"1E",X"12",X"00",X"34",X"12",X"FB",X"26",X"12",X"00",X"02",X"FC",X"2E",X"12",X"FA",X"3C",
|
||||
X"FA",X"9E",X"03",X"12",X"F8",X"10",X"12",X"FA",X"5C",X"12",X"00",X"23",X"F8",X"F9",X"EF",X"7C",
|
||||
X"03",X"F6",X"AB",X"12",X"01",X"28",X"12",X"0A",X"18",X"FD",X"52",X"03",X"F6",X"B0",X"23",X"08",
|
||||
X"1E",X"23",X"00",X"19",X"23",X"F8",X"16",X"23",X"00",X"02",X"FC",X"30",X"23",X"F7",X"26",X"FA",
|
||||
X"9E",X"03",X"23",X"F0",X"0A",X"23",X"F5",X"31",X"23",X"00",X"10",X"FD",X"6C",X"03",X"12",X"F8",
|
||||
X"10",X"12",X"00",X"40",X"FB",X"12",X"00",X"FF",X"FF",X"12",X"18",X"1D",X"12",X"00",X"28",X"12",
|
||||
X"FA",X"02",X"F3",X"3F",X"3B",X"36",X"32",X"28",X"26",X"24",X"22",X"12",X"04",X"30",X"12",X"FC",
|
||||
X"30",X"12",X"00",X"18",X"F8",X"F9",X"FA",X"0C",X"04",X"EF",X"D7",X"03",X"F6",X"B0",X"12",X"01",
|
||||
X"28",X"12",X"0A",X"15",X"FD",X"AC",X"03",X"F6",X"C0",X"23",X"08",X"10",X"23",X"00",X"23",X"23",
|
||||
X"F8",X"0F",X"23",X"00",X"48",X"F8",X"F9",X"FA",X"0C",X"04",X"F6",X"B0",X"23",X"08",X"20",X"23",
|
||||
X"00",X"08",X"23",X"F8",X"02",X"F3",X"34",X"31",X"2D",X"29",X"22",X"26",X"1F",X"18",X"23",X"08",
|
||||
X"18",X"23",X"F8",X"18",X"23",X"00",X"10",X"F8",X"F9",X"FD",X"CC",X"03",X"FB",X"12",X"00",X"FF",
|
||||
X"FF",X"12",X"18",X"14",X"12",X"03",X"2A",X"12",X"10",X"40",X"12",X"01",X"20",X"12",X"FE",X"71",
|
||||
X"F9",X"F1",X"FA",X"0C",X"04",X"EF",X"30",X"04",X"F6",X"AB",X"12",X"02",X"20",X"FD",X"14",X"04",
|
||||
X"F6",X"B0",X"23",X"04",X"1A",X"23",X"03",X"1D",X"23",X"1A",X"25",X"23",X"03",X"10",X"23",X"FD",
|
||||
X"48",X"FD",X"20",X"04",X"12",X"18",X"14",X"12",X"03",X"2A",X"12",X"10",X"40",X"12",X"01",X"20",
|
||||
X"12",X"FE",X"78",X"FF",X"12",X"18",X"14",X"F4",X"12",X"00",X"04",X"FC",X"48",X"00",X"FC",X"FF",
|
||||
X"23",X"00",X"30",X"F8",X"F9",X"FA",X"0C",X"04",X"FD",X"25",X"04",X"12",X"18",X"14",X"FB",X"12",
|
||||
X"00",X"FF",X"FF",X"12",X"18",X"1E",X"12",X"00",X"08",X"F2",X"99",X"04",X"00",X"00",X"0A",X"F2",
|
||||
X"99",X"04",X"00",X"00",X"0A",X"12",X"00",X"2C",X"12",X"FB",X"26",X"12",X"00",X"02",X"FC",X"2E",
|
||||
X"12",X"FA",X"3C",X"FA",X"9E",X"03",X"FD",X"63",X"03",X"12",X"00",X"2C",X"12",X"FB",X"26",X"12",
|
||||
X"00",X"02",X"FC",X"2E",X"12",X"FA",X"18",X"12",X"00",X"10",X"FF",X"12",X"18",X"13",X"F2",X"C6",
|
||||
X"04",X"00",X"00",X"08",X"F2",X"CF",X"04",X"00",X"00",X"08",X"12",X"18",X"0B",X"12",X"00",X"34",
|
||||
X"12",X"FB",X"26",X"FD",X"58",X"03",X"12",X"00",X"10",X"12",X"18",X"0B",X"FD",X"D8",X"04",X"12",
|
||||
X"00",X"08",X"12",X"18",X"0B",X"12",X"00",X"06",X"12",X"00",X"22",X"12",X"FB",X"26",X"12",X"00",
|
||||
X"02",X"FC",X"2E",X"12",X"FA",X"18",X"12",X"00",X"20",X"FF",X"12",X"18",X"1E",X"12",X"00",X"14",
|
||||
X"F2",X"02",X"05",X"12",X"00",X"08",X"F2",X"02",X"05",X"12",X"00",X"18",X"12",X"FB",X"26",X"FD",
|
||||
X"58",X"03",X"12",X"E2",X"01",X"F3",X"08",X"07",X"06",X"05",X"04",X"03",X"02",X"01",X"F5",X"23",
|
||||
X"00",X"48",X"FF",X"AF",X"32",X"21",X"68",X"3A",X"04",X"68",X"E6",X"02",X"CA",X"75",X"05",X"3A",
|
||||
X"A0",X"92",X"3C",X"32",X"A0",X"92",X"2A",X"A1",X"92",X"E6",X"1F",X"3D",X"28",X"08",X"3C",X"20",
|
||||
X"06",X"7C",X"F6",X"01",X"67",X"2C",X"24",X"22",X"A1",X"92",X"3A",X"C7",X"99",X"5F",X"3A",X"A7",
|
||||
X"92",X"BB",X"CB",X"10",X"3A",X"15",X"90",X"A0",X"E6",X"01",X"32",X"AA",X"92",X"0E",X"00",X"21",
|
||||
X"20",X"90",X"79",X"85",X"6F",X"7E",X"A7",X"20",X"03",X"0C",X"18",X"F3",X"47",X"21",X"3B",X"00",
|
||||
X"79",X"CB",X"27",X"85",X"6F",X"5E",X"23",X"56",X"EB",X"C5",X"CD",X"34",X"00",X"C1",X"78",X"81",
|
||||
X"4F",X"E6",X"F8",X"28",X"DA",X"3E",X"01",X"32",X"21",X"68",X"FB",X"C9",X"11",X"00",X"91",X"1A",
|
||||
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|
||||
X"10",X"1C",X"16",X"01",X"1A",X"5F",X"16",X"98",X"1A",X"CB",X"41",X"28",X"04",X"C6",X"0E",X"ED",
|
||||
X"44",X"CB",X"3F",X"DD",X"77",X"03",X"3A",X"AA",X"92",X"A7",X"CA",X"86",X"0B",X"32",X"B3",X"9A",
|
||||
X"18",X"04",X"DD",X"36",X"01",X"9C",X"23",X"DD",X"75",X"08",X"DD",X"74",X"09",X"DD",X"34",X"0D",
|
||||
X"C3",X"FA",X"0D",X"DD",X"7E",X"10",X"E6",X"38",X"FE",X"38",X"CA",X"41",X"0B",X"23",X"23",X"23",
|
||||
X"C3",X"0E",X"09",X"23",X"7E",X"DD",X"CB",X"13",X"7E",X"28",X"04",X"C6",X"80",X"ED",X"44",X"0E",
|
||||
X"00",X"CB",X"27",X"CB",X"11",X"CB",X"27",X"CB",X"11",X"DD",X"77",X"04",X"DD",X"71",X"05",X"DD",
|
||||
X"36",X"0E",X"1E",X"3A",X"C8",X"92",X"DD",X"77",X"0F",X"C3",X"86",X"0B",X"3A",X"AA",X"92",X"4F",
|
||||
X"3A",X"1D",X"90",X"3D",X"A1",X"18",X"C3",X"4F",X"E6",X"0F",X"DD",X"77",X"0A",X"79",X"07",X"07",
|
||||
X"07",X"07",X"E6",X"0F",X"23",X"DD",X"77",X"0B",X"7E",X"23",X"DD",X"CB",X"13",X"7E",X"28",X"02",
|
||||
X"ED",X"44",X"DD",X"77",X"0C",X"7E",X"23",X"DD",X"77",X"0D",X"DD",X"75",X"08",X"DD",X"74",X"09",
|
||||
X"DD",X"CB",X"13",X"76",X"28",X"22",X"DD",X"7E",X"01",X"DD",X"96",X"06",X"28",X"08",X"F2",X"13",
|
||||
X"0C",X"ED",X"44",X"3D",X"20",X"12",X"DD",X"7E",X"03",X"DD",X"96",X"07",X"CA",X"07",X"0E",X"F2",
|
||||
X"24",X"0C",X"ED",X"44",X"3D",X"CA",X"07",X"0E",X"DD",X"CB",X"13",X"6E",X"28",X"13",X"DD",X"7E",
|
||||
X"01",X"DD",X"96",X"06",X"28",X"03",X"3C",X"20",X"08",X"DD",X"36",X"0D",X"01",X"DD",X"CB",X"13",
|
||||
X"AE",X"DD",X"46",X"0C",X"DD",X"7E",X"04",X"5F",X"80",X"DD",X"77",X"04",X"DD",X"56",X"05",X"2E",
|
||||
X"01",X"CB",X"78",X"28",X"02",X"2E",X"FF",X"1F",X"A8",X"7A",X"F2",X"5E",X"0C",X"85",X"DD",X"77",
|
||||
X"05",X"7B",X"4A",X"CB",X"41",X"28",X"01",X"2F",X"C6",X"15",X"30",X"04",X"06",X"06",X"18",X"0C",
|
||||
X"CB",X"3F",X"47",X"CB",X"38",X"80",X"07",X"07",X"07",X"E6",X"07",X"47",X"26",X"8B",X"DD",X"6E",
|
||||
X"10",X"7E",X"E6",X"F8",X"B0",X"77",X"26",X"9B",X"79",X"CB",X"09",X"A9",X"3C",X"CB",X"09",X"17",
|
||||
X"E6",X"03",X"77",X"3A",X"A0",X"92",X"E6",X"01",X"28",X"05",X"DD",X"7E",X"0A",X"18",X"03",X"DD",
|
||||
X"7E",X"0B",X"A7",X"CA",X"FE",X"0C",X"E5",X"DD",X"E5",X"E1",X"47",X"7A",X"E6",X"03",X"57",X"CB",
|
||||
X"03",X"CB",X"12",X"D5",X"AA",X"0F",X"38",X"02",X"2C",X"2C",X"14",X"CB",X"52",X"78",X"28",X"02",
|
||||
X"ED",X"44",X"4F",X"CB",X"29",X"30",X"04",X"7E",X"C6",X"80",X"77",X"2C",X"7E",X"89",X"77",X"2D",
|
||||
X"EB",X"7B",X"EE",X"02",X"5F",X"E1",X"CB",X"3D",X"30",X"04",X"7D",X"EE",X"7F",X"6F",X"78",X"44",
|
||||
X"26",X"00",X"CD",X"96",X"0E",X"78",X"EE",X"02",X"3D",X"CB",X"57",X"28",X"08",X"44",X"4D",X"21",
|
||||
X"00",X"00",X"A7",X"ED",X"42",X"EB",X"7B",X"86",X"77",X"2C",X"7A",X"8E",X"77",X"E1",X"3A",X"15",
|
||||
X"92",X"4F",X"26",X"93",X"DD",X"56",X"03",X"3E",X"7F",X"DD",X"BE",X"02",X"7A",X"17",X"CB",X"41",
|
||||
X"28",X"03",X"C6",X"0D",X"2F",X"DD",X"CB",X"13",X"76",X"28",X"03",X"DD",X"86",X"11",X"77",X"2C",
|
||||
X"DD",X"46",X"01",X"3E",X"7F",X"DD",X"BE",X"00",X"CB",X"13",X"78",X"CB",X"41",X"20",X"04",X"C6",
|
||||
X"4F",X"2F",X"1D",X"CB",X"1B",X"17",X"CB",X"13",X"DD",X"CB",X"13",X"76",X"28",X"0D",X"DD",X"86",
|
||||
X"12",X"57",X"1F",X"DD",X"AE",X"12",X"07",X"7A",X"30",X"01",X"1C",X"77",X"26",X"9B",X"CB",X"0E",
|
||||
X"CB",X"0B",X"CB",X"16",X"DD",X"35",X"0E",X"C2",X"FA",X"0D",X"DD",X"CB",X"0F",X"3E",X"D2",X"F4",
|
||||
X"0D",X"DD",X"7E",X"01",X"FE",X"4C",X"DA",X"F4",X"0D",X"3A",X"15",X"90",X"A7",X"CA",X"F4",X"0D",
|
||||
X"3A",X"AD",X"92",X"A7",X"C2",X"F4",X"0D",X"EB",X"21",X"68",X"88",X"06",X"08",X"7E",X"FE",X"80",
|
||||
X"28",X"06",X"2C",X"2C",X"10",X"F7",X"18",X"6C",X"36",X"06",X"26",X"9B",X"36",X"01",X"E5",X"26",
|
||||
X"93",X"54",X"1D",X"1A",X"4F",X"77",X"1C",X"2C",X"1A",X"47",X"77",X"26",X"9B",X"54",X"1A",X"CB",
|
||||
X"0E",X"0F",X"CB",X"16",X"07",X"CB",X"18",X"3A",X"62",X"93",X"91",X"F5",X"30",X"02",X"ED",X"44",
|
||||
X"67",X"3A",X"15",X"92",X"A7",X"3E",X"95",X"28",X"02",X"3E",X"1C",X"90",X"30",X"02",X"ED",X"44",
|
||||
X"CD",X"A9",X"0E",X"44",X"4D",X"CB",X"3C",X"CB",X"1D",X"CB",X"3C",X"CB",X"1D",X"09",X"CB",X"3C",
|
||||
X"CB",X"1D",X"CB",X"3C",X"CB",X"1D",X"7C",X"A7",X"20",X"05",X"7D",X"FE",X"60",X"38",X"02",X"3E",
|
||||
X"60",X"47",X"F1",X"CB",X"18",X"E1",X"7D",X"C6",X"08",X"E6",X"0F",X"21",X"B0",X"92",X"85",X"6F",
|
||||
X"70",X"23",X"36",X"00",X"3A",X"E2",X"92",X"DD",X"77",X"0E",X"21",X"89",X"92",X"35",X"C8",X"11",
|
||||
X"14",X"00",X"DD",X"19",X"C3",X"E4",X"08",X"AF",X"DD",X"CB",X"13",X"86",X"DD",X"77",X"00",X"DD",
|
||||
X"77",X"02",X"26",X"88",X"DD",X"6E",X"10",X"36",X"02",X"26",X"8B",X"2C",X"7E",X"2D",X"3C",X"E6",
|
||||
X"07",X"FE",X"05",X"38",X"14",X"3A",X"2E",X"98",X"4F",X"E6",X"F8",X"C6",X"06",X"77",X"2C",X"79",
|
||||
X"E6",X"07",X"77",X"2D",X"3E",X"01",X"32",X"2D",X"98",X"DD",X"7E",X"06",X"DD",X"77",X"01",X"DD",
|
||||
X"7E",X"07",X"DD",X"77",X"03",X"C3",X"FE",X"0C",X"26",X"88",X"DD",X"6E",X"10",X"36",X"80",X"26",
|
||||
X"93",X"36",X"00",X"DD",X"36",X"13",X"00",X"C3",X"FA",X"0D",X"C5",X"D5",X"7B",X"95",X"06",X"00",
|
||||
X"30",X"04",X"CB",X"C0",X"ED",X"44",X"4F",X"7A",X"94",X"30",X"0A",X"57",X"78",X"EE",X"01",X"F6",
|
||||
X"02",X"47",X"7A",X"ED",X"44",X"B9",X"F5",X"17",X"A8",X"1F",X"3F",X"CB",X"10",X"F1",X"30",X"03",
|
||||
X"51",X"4F",X"7A",X"61",X"2E",X"00",X"CD",X"A9",X"0E",X"7C",X"A8",X"E6",X"01",X"28",X"03",X"7D",
|
||||
X"2F",X"6F",X"60",X"D1",X"C1",X"C9",X"D5",X"EB",X"21",X"00",X"00",X"CB",X"3F",X"30",X"01",X"19",
|
||||
X"CB",X"23",X"CB",X"12",X"A7",X"20",X"F4",X"D1",X"C9",X"C5",X"4F",X"AF",X"06",X"11",X"8F",X"38",
|
||||
X"0B",X"B9",X"38",X"01",X"91",X"3F",X"ED",X"6A",X"10",X"F4",X"C1",X"C9",X"91",X"37",X"C3",X"B6",
|
||||
X"0E",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"3A",X"06",X"68",X"E6",X"02",X"C0",
|
||||
X"21",X"FF",X"10",X"7E",X"2E",X"DF",X"4E",X"7E",X"A9",X"CB",X"67",X"20",X"01",X"C7",X"11",X"F7",
|
||||
X"89",X"21",X"F6",X"89",X"01",X"13",X"00",X"ED",X"B8",X"DD",X"21",X"D5",X"0F",X"1E",X"E0",X"01",
|
||||
X"04",X"05",X"DD",X"7E",X"00",X"DD",X"23",X"6F",X"26",X"10",X"7E",X"7B",X"81",X"5F",X"7E",X"12",
|
||||
X"10",X"F0",X"06",X"05",X"21",X"E4",X"89",X"7E",X"2C",X"B6",X"2C",X"2F",X"A6",X"2C",X"A6",X"2C",
|
||||
X"E6",X"0F",X"20",X"04",X"10",X"F1",X"18",X"40",X"05",X"28",X"4F",X"05",X"CB",X"20",X"CB",X"20",
|
||||
X"0F",X"38",X"03",X"04",X"18",X"FA",X"3A",X"E0",X"89",X"CB",X"3F",X"5F",X"CB",X"11",X"C6",X"E1",
|
||||
X"6F",X"26",X"89",X"7E",X"CB",X"41",X"28",X"04",X"07",X"07",X"07",X"07",X"E6",X"F0",X"B0",X"CB",
|
||||
X"41",X"28",X"04",X"07",X"07",X"07",X"07",X"77",X"3A",X"E0",X"89",X"A7",X"20",X"02",X"3E",X"02",
|
||||
X"3D",X"32",X"E0",X"89",X"7B",X"A7",X"28",X"09",X"2A",X"E2",X"89",X"7E",X"32",X"E1",X"89",X"18",
|
||||
X"42",X"2A",X"E2",X"89",X"3A",X"E1",X"89",X"77",X"18",X"39",X"4F",X"21",X"E0",X"89",X"CB",X"41",
|
||||
X"20",X"2D",X"7E",X"CB",X"3F",X"28",X"13",X"CB",X"59",X"20",X"0C",X"7E",X"FE",X"05",X"30",X"03",
|
||||
X"34",X"18",X"D5",X"36",X"05",X"18",X"D1",X"35",X"18",X"CE",X"2A",X"E2",X"89",X"CB",X"59",X"20",
|
||||
X"03",X"2B",X"18",X"01",X"23",X"22",X"E2",X"89",X"3E",X"01",X"32",X"E0",X"89",X"18",X"B9",X"36",
|
||||
X"05",X"18",X"B5",X"21",X"CA",X"83",X"11",X"E1",X"89",X"06",X"03",X"1A",X"1C",X"CD",X"C6",X"0F",
|
||||
X"10",X"F9",X"21",X"CA",X"87",X"3A",X"E0",X"89",X"06",X"06",X"A7",X"4F",X"28",X"02",X"0E",X"01",
|
||||
X"71",X"2C",X"3D",X"10",X"F5",X"C9",X"4F",X"E6",X"0F",X"77",X"2C",X"79",X"07",X"07",X"07",X"07",
|
||||
X"E6",X"0F",X"77",X"2C",X"C9",X"FD",X"FB",X"F7",X"EF",X"FE",X"23",X"00",X"1B",X"23",X"F0",X"40",
|
||||
X"23",X"00",X"09",X"23",X"05",X"11",X"23",X"00",X"10",X"23",X"10",X"40",X"23",X"04",X"30",X"FF",
|
||||
X"23",X"02",X"35",X"23",X"08",X"10",X"23",X"10",X"3C",X"23",X"00",X"FF",X"FF",X"AC",X"FF",X"FF");
|
||||
begin
|
||||
process(clk)
|
||||
begin
|
||||
if rising_edge(clk) then
|
||||
data <= rom_data(to_integer(unsigned(addr)));
|
||||
end if;
|
||||
end process;
|
||||
end architecture;
|
||||
@@ -1,278 +0,0 @@
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all,ieee.numeric_std.all;
|
||||
|
||||
entity galaga_cpu3 is
|
||||
port (
|
||||
clk : in std_logic;
|
||||
addr : in std_logic_vector(11 downto 0);
|
||||
data : out std_logic_vector(7 downto 0)
|
||||
);
|
||||
end entity;
|
||||
|
||||
architecture prom of galaga_cpu3 is
|
||||
type rom is array(0 to 4095) of std_logic_vector(7 downto 0);
|
||||
signal rom_data: rom := (
|
||||
X"31",X"00",X"9B",X"C3",X"7B",X"00",X"FF",X"FF",X"87",X"30",X"05",X"24",X"18",X"02",X"FF",X"FF",
|
||||
X"85",X"6F",X"D0",X"24",X"C9",X"FF",X"FF",X"FF",X"77",X"23",X"10",X"FC",X"C9",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"F5",X"C5",X"D5",X"E5",X"3E",X"01",X"32",X"22",X"68",X"AF",
|
||||
X"32",X"22",X"68",X"CD",X"B1",X"00",X"E1",X"D1",X"C1",X"F1",X"C9",X"3E",X"01",X"32",X"22",X"68",
|
||||
X"11",X"01",X"91",X"1A",X"A7",X"20",X"FC",X"67",X"6F",X"01",X"10",X"00",X"86",X"23",X"10",X"FC",
|
||||
X"0D",X"20",X"F9",X"FE",X"FF",X"28",X"02",X"3E",X"21",X"12",X"1A",X"A7",X"20",X"FC",X"AF",X"32",
|
||||
X"22",X"68",X"21",X"00",X"9A",X"36",X"00",X"11",X"01",X"9A",X"01",X"FF",X"00",X"ED",X"B0",X"18",
|
||||
X"FE",X"3A",X"B8",X"9A",X"A7",X"C2",X"A1",X"06",X"21",X"60",X"9A",X"36",X"00",X"11",X"61",X"9A",
|
||||
X"01",X"0F",X"00",X"ED",X"B0",X"3A",X"B7",X"9A",X"A7",X"C2",X"42",X"03",X"3A",X"79",X"9A",X"A7",
|
||||
X"28",X"09",X"21",X"A8",X"9A",X"86",X"77",X"AF",X"32",X"79",X"9A",X"3A",X"A0",X"9A",X"A7",X"28",
|
||||
X"6F",X"3A",X"11",X"92",X"21",X"80",X"9A",X"BE",X"28",X"20",X"32",X"80",X"9A",X"3C",X"28",X"0C",
|
||||
X"21",X"EA",X"06",X"22",X"82",X"9A",X"AF",X"32",X"00",X"9A",X"18",X"09",X"21",X"FA",X"06",X"22",
|
||||
X"82",X"9A",X"32",X"00",X"9A",X"32",X"81",X"9A",X"18",X"12",X"21",X"00",X"9A",X"34",X"7E",X"FE",
|
||||
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X"78",X"01",X"75",X"01",X"71",X"01",X"60",X"01",X"78",X"01",X"75",X"01",X"71",X"01",X"60",X"01",
|
||||
X"78",X"01",X"75",X"01",X"71",X"01",X"60",X"01",X"0C",X"01",X"78",X"01",X"7A",X"01",X"75",X"01",
|
||||
X"78",X"01",X"73",X"01",X"75",X"01",X"61",X"01",X"7A",X"01",X"76",X"01",X"73",X"01",X"61",X"01",
|
||||
X"7A",X"01",X"76",X"01",X"73",X"01",X"61",X"01",X"7A",X"01",X"76",X"01",X"73",X"01",X"61",X"01",
|
||||
X"7A",X"01",X"76",X"01",X"73",X"01",X"61",X"01",X"79",X"01",X"76",X"01",X"73",X"01",X"61",X"01",
|
||||
X"79",X"01",X"76",X"01",X"73",X"01",X"61",X"01",X"0C",X"01",X"79",X"01",X"61",X"01",X"78",X"01",
|
||||
X"79",X"01",X"75",X"01",X"78",X"01",X"FF",X"02",X"02",X"05",X"60",X"01",X"60",X"01",X"60",X"01",
|
||||
X"FF",X"02",X"04",X"05",X"61",X"02",X"78",X"02",X"78",X"02",X"61",X"02",X"78",X"02",X"78",X"02",
|
||||
X"61",X"02",X"78",X"02",X"78",X"02",X"61",X"02",X"78",X"02",X"78",X"02",X"61",X"02",X"78",X"02",
|
||||
X"7A",X"02",X"75",X"02",X"63",X"02",X"7A",X"02",X"7A",X"02",X"63",X"02",X"7A",X"02",X"7A",X"02",
|
||||
X"63",X"02",X"7A",X"02",X"79",X"02",X"63",X"02",X"79",X"02",X"79",X"02",X"63",X"02",X"79",X"02",
|
||||
X"76",X"02",X"73",X"02",X"FF",X"02",X"02",X"05",X"78",X"01",X"78",X"01",X"78",X"01",X"FF",X"02",
|
||||
X"10",X"05",X"85",X"06",X"85",X"06",X"85",X"06",X"85",X"06",X"85",X"04",X"85",X"04",X"86",X"06",
|
||||
X"86",X"06",X"86",X"06",X"86",X"06",X"86",X"04",X"86",X"04",X"FF",X"02",X"04",X"05",X"81",X"01",
|
||||
X"81",X"01",X"81",X"01",X"FF",X"02",X"00",X"07",X"65",X"01",X"0C",X"01",X"61",X"01",X"0C",X"01",
|
||||
X"63",X"01",X"FF",X"02",X"00",X"05",X"7A",X"05",X"0C",X"01",X"7A",X"01",X"0C",X"01",X"7A",X"03",
|
||||
X"0C",X"01",X"78",X"07",X"0C",X"01",X"78",X"07",X"0C",X"01",X"78",X"03",X"0C",X"01",X"7B",X"05",
|
||||
X"0C",X"01",X"7B",X"01",X"0C",X"01",X"7B",X"03",X"0C",X"01",X"7A",X"07",X"0C",X"01",X"7A",X"07",
|
||||
X"0C",X"01",X"7A",X"03",X"0C",X"01",X"7B",X"01",X"0C",X"01",X"7B",X"01",X"0C",X"03",X"7B",X"01",
|
||||
X"0C",X"01",X"7B",X"03",X"0C",X"01",X"61",X"01",X"0C",X"01",X"61",X"01",X"0C",X"03",X"61",X"01",
|
||||
X"0C",X"01",X"61",X"03",X"0C",X"01",X"61",X"03",X"0C",X"01",X"61",X"03",X"0C",X"01",X"63",X"01",
|
||||
X"0C",X"01",X"63",X"01",X"0C",X"03",X"63",X"01",X"0C",X"01",X"63",X"03",X"0C",X"01",X"63",X"03",
|
||||
X"0C",X"01",X"63",X"03",X"0C",X"01",X"FF",X"02",X"00",X"03",X"86",X"02",X"8A",X"02",X"71",X"02",
|
||||
X"76",X"02",X"86",X"02",X"8A",X"02",X"71",X"02",X"76",X"02",X"86",X"02",X"8A",X"02",X"71",X"02",
|
||||
X"76",X"02",X"86",X"02",X"8A",X"02",X"71",X"02",X"76",X"02",X"86",X"02",X"8A",X"02",X"71",X"02",
|
||||
X"76",X"02",X"86",X"02",X"8A",X"02",X"71",X"02",X"76",X"02",X"86",X"02",X"8A",X"02",X"71",X"02",
|
||||
X"76",X"02",X"86",X"02",X"8A",X"02",X"71",X"02",X"76",X"02",X"77",X"01",X"0C",X"01",X"77",X"01",
|
||||
X"0C",X"03",X"77",X"01",X"0C",X"01",X"77",X"03",X"0C",X"01",X"69",X"01",X"0C",X"01",X"69",X"01",
|
||||
X"0C",X"03",X"69",X"01",X"0C",X"01",X"69",X"03",X"0C",X"01",X"69",X"03",X"0C",X"01",X"69",X"03",
|
||||
X"0C",X"01",X"8B",X"02",X"73",X"02",X"76",X"02",X"7B",X"02",X"7B",X"02",X"76",X"02",X"73",X"02",
|
||||
X"8B",X"02",X"FF",X"00",X"00",X"02",X"86",X"08",X"81",X"08",X"86",X"08",X"81",X"08",X"86",X"08",
|
||||
X"81",X"08",X"86",X"08",X"81",X"08",X"82",X"01",X"0C",X"01",X"82",X"01",X"0C",X"03",X"82",X"01",
|
||||
X"0C",X"01",X"82",X"03",X"0C",X"01",X"84",X"01",X"0C",X"01",X"84",X"01",X"0C",X"03",X"84",X"01",
|
||||
X"0C",X"01",X"84",X"03",X"0C",X"01",X"84",X"03",X"0C",X"01",X"84",X"03",X"0C",X"01",X"7B",X"08",
|
||||
X"76",X"04",X"8B",X"04",X"FF",X"00",X"0C",X"05",X"75",X"0C",X"71",X"0C",X"8A",X"0C",X"86",X"0C",
|
||||
X"0C",X"09",X"75",X"03",X"71",X"09",X"8A",X"03",X"86",X"04",X"8A",X"04",X"71",X"04",X"89",X"04",
|
||||
X"70",X"04",X"73",X"04",X"8B",X"0C",X"73",X"0C",X"76",X"0C",X"78",X"0C",X"0C",X"09",X"79",X"03",
|
||||
X"76",X"09",X"72",X"03",X"8B",X"04",X"89",X"04",X"86",X"04",X"72",X"04",X"89",X"04",X"76",X"04",
|
||||
X"FF",X"00",X"0C",X"05",X"71",X"0C",X"8A",X"0C",X"86",X"0C",X"85",X"0C",X"0C",X"09",X"81",X"03",
|
||||
X"8A",X"09",X"86",X"03",X"85",X"04",X"86",X"04",X"8A",X"04",X"86",X"04",X"89",X"04",X"8B",X"04",
|
||||
X"88",X"0C",X"8B",X"0C",X"73",X"0C",X"76",X"0C",X"0C",X"09",X"76",X"03",X"72",X"09",X"8B",X"03",
|
||||
X"8A",X"04",X"86",X"04",X"82",X"04",X"8B",X"04",X"89",X"04",X"82",X"04",X"FF",X"00",X"00",X"03",
|
||||
X"75",X"18",X"75",X"18",X"75",X"18",X"71",X"0C",X"75",X"0C",X"73",X"18",X"73",X"18",X"72",X"18",
|
||||
X"76",X"0C",X"78",X"0C",X"FF",X"FB",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",
|
||||
X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF",X"FF");
|
||||
begin
|
||||
process(clk)
|
||||
begin
|
||||
if rising_edge(clk) then
|
||||
data <= rom_data(to_integer(unsigned(addr)));
|
||||
end if;
|
||||
end process;
|
||||
end architecture;
|
||||
@@ -1,534 +0,0 @@
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all,ieee.numeric_std.all;
|
||||
|
||||
entity sp_graphx is
|
||||
port (
|
||||
clk : in std_logic;
|
||||
addr : in std_logic_vector(12 downto 0);
|
||||
data : out std_logic_vector(7 downto 0)
|
||||
);
|
||||
end entity;
|
||||
|
||||
architecture prom of sp_graphx is
|
||||
type rom is array(0 to 8191) of std_logic_vector(7 downto 0);
|
||||
signal rom_data: rom := (
|
||||
X"88",X"CC",X"EE",X"FF",X"BB",X"99",X"18",X"19",X"11",X"1D",X"3F",X"BF",X"FF",X"DF",X"CF",X"E7",
|
||||
X"00",X"06",X"8E",X"BF",X"FF",X"7F",X"7E",X"FD",X"22",X"66",X"EE",X"EE",X"AA",X"22",X"02",X"02",
|
||||
X"11",X"01",X"01",X"00",X"00",X"00",X"00",X"00",X"77",X"33",X"33",X"33",X"33",X"11",X"11",X"11",
|
||||
X"DD",X"89",X"89",X"88",X"88",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"11",X"11",X"33",X"33",X"22",X"02",X"00",X"00",X"00",X"00",X"8B",X"8B",X"EF",X"77",X"E7",X"EB",
|
||||
X"00",X"00",X"44",X"CF",X"CF",X"DF",X"FF",X"7F",X"00",X"00",X"00",X"11",X"33",X"EE",X"EE",X"44",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"AB",X"3B",X"33",X"77",X"77",X"22",X"22",X"22",
|
||||
X"FE",X"EE",X"AA",X"02",X"00",X"00",X"00",X"00",X"04",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"01",X"02",X"00",X"00",X"00",X"44",X"CC",X"CC",X"CD",X"EF",X"77",X"77",X"DF",
|
||||
X"00",X"00",X"00",X"2A",X"EE",X"EF",X"CF",X"FF",X"00",X"00",X"00",X"00",X"00",X"00",X"11",X"FF",
|
||||
X"01",X"00",X"00",X"00",X"00",X"11",X"11",X"00",X"C7",X"77",X"FF",X"FF",X"CC",X"88",X"00",X"00",
|
||||
X"FF",X"FF",X"EA",X"04",X"00",X"00",X"00",X"00",X"EE",X"04",X"08",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"01",X"00",X"00",X"01",X"11",X"33",X"77",X"3B",X"33",X"77",X"FB",X"23",
|
||||
X"00",X"00",X"00",X"0C",X"9D",X"EE",X"EF",X"FF",X"00",X"00",X"00",X"88",X"00",X"00",X"08",X"08",
|
||||
X"00",X"00",X"00",X"00",X"11",X"22",X"00",X"00",X"23",X"77",X"EE",X"CC",X"00",X"00",X"00",X"00",
|
||||
X"7F",X"FF",X"62",X"44",X"09",X"00",X"00",X"00",X"FF",X"EE",X"44",X"08",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"11",X"13",X"15",X"33",X"77",X"7B",X"77",
|
||||
X"CC",X"88",X"88",X"88",X"8E",X"BF",X"FF",X"FF",X"00",X"00",X"00",X"00",X"00",X"88",X"00",X"08",
|
||||
X"00",X"00",X"11",X"33",X"66",X"00",X"00",X"00",X"EF",X"EF",X"FF",X"DC",X"01",X"00",X"00",X"00",
|
||||
X"EF",X"7F",X"FF",X"99",X"00",X"01",X"00",X"00",X"08",X"00",X"FF",X"EE",X"08",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"01",X"00",X"10",X"7F",X"33",X"77",
|
||||
X"11",X"77",X"EE",X"66",X"EF",X"CF",X"FF",X"7F",X"88",X"00",X"00",X"00",X"08",X"08",X"CC",X"88",
|
||||
X"11",X"FF",X"11",X"00",X"00",X"00",X"00",X"00",X"EF",X"FF",X"88",X"13",X"00",X"00",X"00",X"00",
|
||||
X"2F",X"FF",X"F7",X"D9",X"00",X"13",X"00",X"00",X"0C",X"0C",X"00",X"CC",X"FF",X"CC",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"11",X"00",X"00",X"00",X"00",X"17",X"00",X"11",X"FF",
|
||||
X"00",X"3F",X"00",X"11",X"FB",X"F7",X"FF",X"9F",X"00",X"FF",X"EE",X"CC",X"88",X"8E",X"0E",X"CC",
|
||||
X"FF",X"11",X"00",X"00",X"00",X"00",X"00",X"00",X"FF",X"FF",X"11",X"00",X"17",X"00",X"00",X"00",
|
||||
X"3F",X"9F",X"FF",X"F7",X"FB",X"11",X"00",X"3F",X"FF",X"CC",X"0E",X"8E",X"88",X"CC",X"EE",X"FF",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"11",X"00",X"00",X"00",X"00",X"17",X"00",X"11",X"FF",
|
||||
X"00",X"3F",X"00",X"11",X"FB",X"F7",X"FF",X"9F",X"00",X"FF",X"EE",X"CC",X"88",X"8E",X"0E",X"CC",
|
||||
X"FF",X"11",X"00",X"00",X"00",X"00",X"00",X"00",X"FF",X"FF",X"11",X"00",X"17",X"00",X"00",X"00",
|
||||
X"3F",X"9F",X"FF",X"F7",X"FB",X"11",X"00",X"3F",X"FF",X"CC",X"0E",X"8E",X"88",X"CC",X"EE",X"FF",
|
||||
X"30",X"70",X"43",X"43",X"52",X"61",X"21",X"30",X"00",X"80",X"80",X"80",X"80",X"81",X"C1",X"F3",
|
||||
X"00",X"00",X"00",X"00",X"00",X"04",X"14",X"FE",X"60",X"F0",X"96",X"96",X"D2",X"B4",X"A4",X"E0",
|
||||
X"70",X"10",X"00",X"00",X"00",X"00",X"00",X"00",X"F3",X"F3",X"73",X"30",X"43",X"C3",X"10",X"10",
|
||||
X"FE",X"FE",X"F6",X"E0",X"96",X"96",X"40",X"40",X"F0",X"C0",X"00",X"00",X"00",X"80",X"00",X"00",
|
||||
X"00",X"00",X"00",X"10",X"10",X"30",X"70",X"30",X"00",X"30",X"70",X"E0",X"80",X"81",X"A3",X"F3",
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|
||||
X"00",X"00",X"00",X"00",X"00",X"30",X"70",X"F0",X"00",X"00",X"34",X"30",X"00",X"E0",X"F0",X"F8",
|
||||
X"00",X"70",X"F0",X"C4",X"FF",X"77",X"30",X"B3",X"00",X"80",X"80",X"00",X"00",X"8B",X"F0",X"C3",
|
||||
X"F1",X"D3",X"3D",X"70",X"70",X"30",X"00",X"00",X"FE",X"7E",X"FC",X"FC",X"F0",X"E0",X"00",X"00",
|
||||
X"FC",X"B1",X"91",X"91",X"32",X"F0",X"68",X"00",X"C0",X"CC",X"88",X"88",X"E0",X"E0",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"30",X"70",X"F0",X"F1",X"00",X"00",X"12",X"10",X"E0",X"F0",X"F8",X"FC",
|
||||
X"00",X"00",X"F0",X"F0",X"77",X"33",X"91",X"B0",X"00",X"00",X"C0",X"C0",X"00",X"88",X"CC",X"C3",
|
||||
X"1F",X"F1",X"F0",X"70",X"30",X"00",X"00",X"00",X"7E",X"FC",X"F8",X"F0",X"E0",X"10",X"12",X"00",
|
||||
X"FF",X"B0",X"91",X"33",X"77",X"F0",X"F0",X"00",X"F0",X"C3",X"CC",X"88",X"00",X"C0",X"C0",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00");
|
||||
begin
|
||||
process(clk)
|
||||
begin
|
||||
if rising_edge(clk) then
|
||||
data <= rom_data(to_integer(unsigned(addr)));
|
||||
end if;
|
||||
end process;
|
||||
end architecture;
|
||||
120
Arcade_MiST/Galaga Hardware/Galaga_MiST/rtl/sound_lpf.vhd
Normal file
120
Arcade_MiST/Galaga Hardware/Galaga_MiST/rtl/sound_lpf.vhd
Normal file
@@ -0,0 +1,120 @@
|
||||
---------------------------------------------------------------------------------
|
||||
-- Implementation of audio LPF filters
|
||||
-- derived from Burnin' Rubber / Bump'n'Jump sources
|
||||
---------------------------------------------------------------------------------
|
||||
--
|
||||
-- ----------o------------
|
||||
-- u4^ | | |
|
||||
-- | --- C4 | | R5 |
|
||||
-- | --- | | |
|
||||
-- | | C3 | |
|
||||
-- --| R1 |----o----||---o------|\ |
|
||||
-- ^ | ------> u3 | \__o---
|
||||
-- | | | / ^
|
||||
-- |uin | | R2 --|/ |
|
||||
-- | | | | | uout
|
||||
-- | | | |
|
||||
-- ------------o--------------o----------
|
||||
--
|
||||
-- i1 = (sin+u3)/R1
|
||||
-- i2 = -u3/R2
|
||||
-- i3 = (u4-u3)/R5
|
||||
-- i4 = i2-i1-i3
|
||||
--
|
||||
-- u3(t+dt) = u3(t) + i3(t)*dt/C3;
|
||||
-- u4(t+dt) = u4(t) + i4(t)*dt/C4;
|
||||
-- uout = u4-u3
|
||||
--
|
||||
-- (i3(t)*dt/C3)*scale = du3*scale = ((u4-u3)/R5*dt/C3)*scale
|
||||
-- (i4(t)*dt/C4)*scale = du4*scale = (-u3/R2 -(uin+u3)/R1 -(u4-u3)/R5)*dt/C4*scale
|
||||
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all,
|
||||
ieee.std_logic_1164.all,
|
||||
ieee.std_logic_unsigned.all,
|
||||
ieee.numeric_std.all;
|
||||
|
||||
entity lpf is
|
||||
port(
|
||||
clock : in std_logic;
|
||||
reset : in std_logic;
|
||||
|
||||
div : in integer;
|
||||
audio_in : in std_logic_vector(9 downto 0);
|
||||
|
||||
gain_in : in integer;
|
||||
r1 : in integer;
|
||||
r2 : in integer;
|
||||
dt_over_c3 : in integer;
|
||||
dt_over_c4 : in integer;
|
||||
r5 : in integer;
|
||||
|
||||
audio_out : out std_logic_vector(15 downto 0)
|
||||
);
|
||||
end lpf;
|
||||
|
||||
architecture rtl of lpf is
|
||||
signal clock_div : std_logic_vector(9 downto 0) := (others =>'0');
|
||||
signal uin : integer;
|
||||
signal u3 : integer;
|
||||
signal u4 : integer;
|
||||
signal du3 : integer;
|
||||
signal du4 : integer;
|
||||
signal uout : integer;
|
||||
signal uout_ltd : integer;
|
||||
|
||||
-- integer scale for fixed point
|
||||
constant scale : integer := 8192;
|
||||
|
||||
begin
|
||||
|
||||
uin <= to_integer(unsigned(audio_in)-256)*gain_in;
|
||||
|
||||
process (clock, reset)
|
||||
begin
|
||||
if reset = '1' then
|
||||
clock_div <= (others => '0');
|
||||
else
|
||||
if rising_edge(clock) then
|
||||
-- divide main clock for downsampling
|
||||
if clock_div = div-1 then
|
||||
clock_div <= "0000000000";
|
||||
else
|
||||
clock_div <= clock_div + '1';
|
||||
end if;
|
||||
|
||||
if clock_div = "0000000000" then
|
||||
du3 <= scale*dt_over_c3/r5*(u4-u3);
|
||||
du4 <= (scale*dt_over_c4/r2 + scale*dt_over_c4/r1 - scale*dt_over_c4/r5)*u3
|
||||
+ scale*dt_over_c4/r5*u4
|
||||
+ scale*dt_over_c4/r1*uin;
|
||||
end if;
|
||||
|
||||
if clock_div = "0000000001" then
|
||||
u3 <= u3 + du3/scale;
|
||||
u4 <= u4 - du4/scale;
|
||||
end if;
|
||||
|
||||
if clock_div = "0000000010" then
|
||||
uout <= u4 - u3;
|
||||
end if;
|
||||
|
||||
-- clamp
|
||||
if clock_div = "0000000011" then
|
||||
if uout > 255 then
|
||||
uout_ltd <= 255;
|
||||
elsif uout < -255 then
|
||||
uout_ltd <= -255;
|
||||
else
|
||||
uout_ltd <= uout;
|
||||
end if;
|
||||
end if;
|
||||
|
||||
if clock_div = "0000000100" then
|
||||
audio_out <= std_logic_vector(to_unsigned(uout_ltd+256,9)) & "0000000";
|
||||
end if;
|
||||
end if;
|
||||
end if;
|
||||
end process;
|
||||
|
||||
end architecture;
|
||||
@@ -37,24 +37,24 @@ architecture struct of sound_machine is
|
||||
signal snd_ram_1_we : std_logic;
|
||||
signal snd_ram_0_do : std_logic_vector(3 downto 0);
|
||||
signal snd_ram_1_do : std_logic_vector(3 downto 0);
|
||||
|
||||
|
||||
signal snd_seq_addr : std_logic_vector(7 downto 0);
|
||||
signal snd_seq_do : std_logic_vector(7 downto 0);
|
||||
|
||||
signal snd_samples_addr : std_logic_vector(7 downto 0);
|
||||
signal snd_samples_do : std_logic_vector(7 downto 0);
|
||||
|
||||
|
||||
signal sum : std_logic_vector(4 downto 0) := (others => '0');
|
||||
signal sum_r : std_logic_vector(4 downto 0) := (others => '0');
|
||||
signal sum_3_rr : std_logic := '0';
|
||||
|
||||
|
||||
signal samples_ch0 : std_logic_vector(3 downto 0);
|
||||
signal samples_ch1 : std_logic_vector(3 downto 0);
|
||||
signal samples_ch2 : std_logic_vector(3 downto 0);
|
||||
signal volume_ch0 : std_logic_vector(3 downto 0);
|
||||
signal volume_ch1 : std_logic_vector(3 downto 0);
|
||||
signal volume_ch2 : std_logic_vector(3 downto 0);
|
||||
|
||||
|
||||
begin
|
||||
|
||||
clock_18n <= not clock_18;
|
||||
@@ -69,38 +69,39 @@ snd_ram_1_we <= ram_1_we;
|
||||
|
||||
sum <= ('0' & snd_ram_0_do) + ('0' & snd_ram_1_do) + ("0000" & sum_r(4));
|
||||
|
||||
process (clock_18, ena)
|
||||
process (clock_18)
|
||||
begin
|
||||
if rising_edge(clock_18) and ena = '1' then
|
||||
if snd_seq_do(3) = '0' then
|
||||
sum_r <= (others => '0');
|
||||
sum_3_rr <= '0';
|
||||
elsif snd_seq_do(0) = '0' then
|
||||
sum_r <= sum;
|
||||
sum_3_rr <= sum_r(3);
|
||||
end if ;
|
||||
if rising_edge(clock_18) then
|
||||
if ena = '1' then
|
||||
if snd_seq_do(3) = '0' then
|
||||
sum_r <= (others => '0');
|
||||
sum_3_rr <= '0';
|
||||
elsif snd_seq_do(0) = '0' then
|
||||
sum_r <= sum;
|
||||
sum_3_rr <= sum_r(3);
|
||||
end if;
|
||||
|
||||
snd_samples_addr <= snd_ram_0_do(2 downto 0) & sum_r(3 downto 0) & sum_3_rr;
|
||||
|
||||
if snd_seq_do(2) = '0' then
|
||||
if hcnt(5 downto 2) = X"5" then
|
||||
samples_ch0 <= snd_samples_do(3 downto 0);
|
||||
volume_ch0 <= snd_ram_1_do;
|
||||
end if;
|
||||
if hcnt(5 downto 2) = X"A" then
|
||||
samples_ch1 <= snd_samples_do(3 downto 0);
|
||||
volume_ch1 <= snd_ram_1_do;
|
||||
end if;
|
||||
if hcnt(5 downto 2) = X"F" then
|
||||
samples_ch2 <= snd_samples_do(3 downto 0);
|
||||
volume_ch2 <= snd_ram_1_do;
|
||||
snd_samples_addr <= snd_ram_0_do(2 downto 0) & sum_r(3 downto 0) & sum_3_rr;
|
||||
|
||||
if snd_seq_do(2) = '0' then
|
||||
if hcnt(5 downto 2) = X"5" then
|
||||
samples_ch0 <= snd_samples_do(3 downto 0);
|
||||
volume_ch0 <= snd_ram_1_do;
|
||||
end if;
|
||||
if hcnt(5 downto 2) = X"A" then
|
||||
samples_ch1 <= snd_samples_do(3 downto 0);
|
||||
volume_ch1 <= snd_ram_1_do;
|
||||
end if;
|
||||
if hcnt(5 downto 2) = X"F" then
|
||||
samples_ch2 <= snd_samples_do(3 downto 0);
|
||||
volume_ch2 <= snd_ram_1_do;
|
||||
end if;
|
||||
end if;
|
||||
|
||||
audio <= ("00" & samples_ch0) * volume_ch0 +
|
||||
("00" & samples_ch1) * volume_ch1 +
|
||||
("00" & samples_ch2) * volume_ch2;
|
||||
end if;
|
||||
|
||||
audio <= ("00" & samples_ch0) * volume_ch0 +
|
||||
("00" & samples_ch1) * volume_ch1 +
|
||||
("00" & samples_ch2) * volume_ch2;
|
||||
|
||||
end if;
|
||||
end process;
|
||||
|
||||
|
||||
@@ -167,6 +167,7 @@ data_io #(.ROM_DIRECT_UPLOAD(1'b1)) data_io(
|
||||
.SPI_SS4 ( SPI_SS4 ),
|
||||
.SPI_DI ( SPI_DI ),
|
||||
.SPI_DO ( SPI_DO ),
|
||||
.clkref_n ( ~clkref ),
|
||||
.ioctl_download( ioctl_downl ),
|
||||
.ioctl_index ( ioctl_index ),
|
||||
.ioctl_wr ( ioctl_wr ),
|
||||
|
||||
@@ -166,7 +166,7 @@ assign SDRAM_nWE = sd_cmd[0];
|
||||
|
||||
reg [24:1] addr_latch[2];
|
||||
reg [24:1] addr_latch_next[2];
|
||||
reg [17:1] addr_last[2];
|
||||
reg [17:1] addr_last[2:1];
|
||||
reg [19:2] addr_last2[4];
|
||||
reg [15:0] din_latch[2];
|
||||
reg [1:0] oe_latch;
|
||||
|
||||
@@ -347,18 +347,19 @@ set_global_assignment -name USE_SIGNALTAP_FILE output_files/sdram.stp
|
||||
set_global_assignment -name SDC_FILE vectrex_MiST.out.sdc
|
||||
set_global_assignment -name SYSTEMVERILOG_FILE rtl/vectrex_mist.sv
|
||||
set_global_assignment -name SYSTEMVERILOG_FILE rtl/sdram.sv
|
||||
set_global_assignment -name VERILOG_FILE rtl/pll.v
|
||||
set_global_assignment -name VHDL_FILE rtl/vectrex.vhd
|
||||
set_global_assignment -name VHDL_FILE rtl/vectrex_exec_prom.vhd
|
||||
set_global_assignment -name VHDL_FILE rtl/m6522a.vhd
|
||||
set_global_assignment -name VHDL_FILE rtl/gen_ram.vhd
|
||||
set_global_assignment -name VHDL_FILE rtl/cpu09l_128a.vhd
|
||||
set_global_assignment -name VERILOG_FILE rtl/pll.v
|
||||
set_global_assignment -name VERILOG_FILE rtl/mc6809is.v
|
||||
set_global_assignment -name VERILOG_FILE rtl/mc6809.v
|
||||
set_global_assignment -name VHDL_FILE rtl/sp0256.vhd
|
||||
set_global_assignment -name VHDL_FILE rtl/sp0256_al2_decoded.vhd
|
||||
set_global_assignment -name VHDL_FILE rtl/vectrex_speakjet.vhd
|
||||
set_global_assignment -name SYSTEMVERILOG_FILE rtl/YM2149.sv
|
||||
set_global_assignment -name SIGNALTAP_FILE output_files/sdram.stp
|
||||
set_global_assignment -name VERILOG_FILE rtl/mc6809.v
|
||||
set_global_assignment -name VHDL_FILE ../../common/Sound/ym2149/YM2149.vhd
|
||||
set_global_assignment -name VHDL_FILE ../../common/Sound/ym2149/vol_table_array.vhd
|
||||
set_global_assignment -name VERILOG_FILE ../../common/CPU/MC6809/mc6809is.v
|
||||
set_global_assignment -name VHDL_FILE ../../common/CPU/MC6809/cpu09l_128a.vhd
|
||||
set_global_assignment -name QIP_FILE ../../common/mist/mist.qip
|
||||
set_global_assignment -name SIGNALTAP_FILE output_files/sdram.stp
|
||||
set_instance_assignment -name PARTITION_HIERARCHY root_partition -to | -section_id Top
|
||||
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