mirror of
https://github.com/Gehstock/Mist_FPGA.git
synced 2026-03-10 12:28:26 +00:00
Add Missile Command Code
This commit is contained in:
Marcel
31
Arcade_MiST/Atari MissileCommand/MissileC.qpf
Normal file
31
Arcade_MiST/Atari MissileCommand/MissileC.qpf
Normal file
@@ -0,0 +1,31 @@
|
||||
# -------------------------------------------------------------------------- #
|
||||
#
|
||||
# Copyright (C) 1991-2014 Altera Corporation
|
||||
# Your use of Altera Corporation's design tools, logic functions
|
||||
# and other software and tools, and its AMPP partner logic
|
||||
# functions, and any output files from any of the foregoing
|
||||
# (including device programming or simulation files), and any
|
||||
# associated documentation or information are expressly subject
|
||||
# to the terms and conditions of the Altera Program License
|
||||
# Subscription Agreement, Altera MegaCore Function License
|
||||
# Agreement, or other applicable license agreement, including,
|
||||
# without limitation, that your use is for the sole purpose of
|
||||
# programming logic devices manufactured by Altera and sold by
|
||||
# Altera or its authorized distributors. Please refer to the
|
||||
# applicable agreement for further details.
|
||||
#
|
||||
# -------------------------------------------------------------------------- #
|
||||
#
|
||||
# Quartus II 64-Bit
|
||||
# Version 13.1.4 Build 182 03/12/2014 SJ Full Version
|
||||
# Date created = 12:19:24 October 16, 2022
|
||||
#
|
||||
# -------------------------------------------------------------------------- #
|
||||
|
||||
QUARTUS_VERSION = "13.1"
|
||||
DATE = "12:19:24 October 16, 2022"
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||||
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||||
# Revisions
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||||
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||||
PROJECT_REVISION = "MissileC"
|
||||
PROJECT_REVISION = "MissileComand_MiST"
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||||
243
Arcade_MiST/Atari MissileCommand/MissileC.qsf
Normal file
243
Arcade_MiST/Atari MissileCommand/MissileC.qsf
Normal file
@@ -0,0 +1,243 @@
|
||||
# -------------------------------------------------------------------------- #
|
||||
#
|
||||
# Copyright (C) 1991-2014 Altera Corporation
|
||||
# Your use of Altera Corporation's design tools, logic functions
|
||||
# and other software and tools, and its AMPP partner logic
|
||||
# functions, and any output files from any of the foregoing
|
||||
# (including device programming or simulation files), and any
|
||||
# associated documentation or information are expressly subject
|
||||
# to the terms and conditions of the Altera Program License
|
||||
# Subscription Agreement, Altera MegaCore Function License
|
||||
# Agreement, or other applicable license agreement, including,
|
||||
# without limitation, that your use is for the sole purpose of
|
||||
# programming logic devices manufactured by Altera and sold by
|
||||
# Altera or its authorized distributors. Please refer to the
|
||||
# applicable agreement for further details.
|
||||
#
|
||||
# -------------------------------------------------------------------------- #
|
||||
#
|
||||
# Quartus II 64-Bit
|
||||
# Version 13.1.4 Build 182 03/12/2014 SJ Full Version
|
||||
# Date created = 12:22:53 October 16, 2022
|
||||
#
|
||||
# -------------------------------------------------------------------------- #
|
||||
#
|
||||
# Notes:
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||||
#
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||||
# 1) The default values for assignments are stored in the file:
|
||||
# MissileC_assignment_defaults.qdf
|
||||
# If this file doesn't exist, see file:
|
||||
# assignment_defaults.qdf
|
||||
#
|
||||
# 2) Altera recommends that you do not modify this file. This
|
||||
# file is updated automatically by the Quartus II software
|
||||
# and any changes you make may be lost or overwritten.
|
||||
#
|
||||
# -------------------------------------------------------------------------- #
|
||||
|
||||
|
||||
|
||||
# Project-Wide Assignments
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||||
# ========================
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||||
set_global_assignment -name ORIGINAL_QUARTUS_VERSION "12.1 SP1"
|
||||
set_global_assignment -name PROJECT_CREATION_TIME_DATE "09:07:52 FEBRUARY 01, 2013"
|
||||
set_global_assignment -name LAST_QUARTUS_VERSION 13.1
|
||||
set_global_assignment -name PROJECT_OUTPUT_DIRECTORY output_files
|
||||
set_global_assignment -name SMART_RECOMPILE ON
|
||||
set_global_assignment -name PRE_FLOW_SCRIPT_FILE "quartus_sh:rtl/build_id.tcl"
|
||||
set_global_assignment -name SYSTEMVERILOG_FILE rtl/MissileCommand_MiST.sv
|
||||
set_global_assignment -name VERILOG_FILE rtl/missile.v
|
||||
set_global_assignment -name VERILOG_FILE rtl/micro.v
|
||||
set_global_assignment -name VERILOG_FILE rtl/trackball.v
|
||||
set_global_assignment -name VERILOG_FILE rtl/dpram.v
|
||||
set_global_assignment -name VERILOG_FILE rtl/sync.v
|
||||
set_global_assignment -name VERILOG_FILE rtl/dpvram.v
|
||||
set_global_assignment -name VERILOG_FILE rtl/spram.v
|
||||
set_global_assignment -name VERILOG_FILE rtl/ls42.v
|
||||
set_global_assignment -name VERILOG_FILE rtl/pll_mist.v
|
||||
set_global_assignment -name QIP_FILE "D:/GitHub/Mist_FPGA/common/Sound/Pokey/Pokey.qip"
|
||||
set_global_assignment -name QIP_FILE "D:/GitHub/Mist_FPGA/common/mist/mist.qip"
|
||||
set_global_assignment -name QIP_FILE "D:/GitHub/Mist_FPGA/common/CPU/bc6502/BC6502.qip"
|
||||
set_global_assignment -name QIP_FILE "D:/GitHub/Mist_FPGA/common/CPU/T80/T80.qip"
|
||||
set_global_assignment -name VHDL_FILE rtl/rom/L6.vhd
|
||||
set_global_assignment -name VHDL_FILE rtl/rom/rom1.vhd
|
||||
set_global_assignment -name VHDL_FILE rtl/rom/rom2.vhd
|
||||
set_global_assignment -name VHDL_FILE rtl/rom/rom3.vhd
|
||||
|
||||
# Pin & Location Assignments
|
||||
# ==========================
|
||||
set_location_assignment PIN_7 -to LED
|
||||
set_location_assignment PIN_54 -to CLOCK_27
|
||||
set_location_assignment PIN_144 -to VGA_R[5]
|
||||
set_location_assignment PIN_143 -to VGA_R[4]
|
||||
set_location_assignment PIN_142 -to VGA_R[3]
|
||||
set_location_assignment PIN_141 -to VGA_R[2]
|
||||
set_location_assignment PIN_137 -to VGA_R[1]
|
||||
set_location_assignment PIN_135 -to VGA_R[0]
|
||||
set_location_assignment PIN_133 -to VGA_B[5]
|
||||
set_location_assignment PIN_132 -to VGA_B[4]
|
||||
set_location_assignment PIN_125 -to VGA_B[3]
|
||||
set_location_assignment PIN_121 -to VGA_B[2]
|
||||
set_location_assignment PIN_120 -to VGA_B[1]
|
||||
set_location_assignment PIN_115 -to VGA_B[0]
|
||||
set_location_assignment PIN_114 -to VGA_G[5]
|
||||
set_location_assignment PIN_113 -to VGA_G[4]
|
||||
set_location_assignment PIN_112 -to VGA_G[3]
|
||||
set_location_assignment PIN_111 -to VGA_G[2]
|
||||
set_location_assignment PIN_110 -to VGA_G[1]
|
||||
set_location_assignment PIN_106 -to VGA_G[0]
|
||||
set_location_assignment PIN_136 -to VGA_VS
|
||||
set_location_assignment PIN_119 -to VGA_HS
|
||||
set_location_assignment PIN_65 -to AUDIO_L
|
||||
set_location_assignment PIN_80 -to AUDIO_R
|
||||
set_location_assignment PIN_105 -to SPI_DO
|
||||
set_location_assignment PIN_88 -to SPI_DI
|
||||
set_location_assignment PIN_126 -to SPI_SCK
|
||||
set_location_assignment PIN_127 -to SPI_SS2
|
||||
set_location_assignment PIN_91 -to SPI_SS3
|
||||
set_location_assignment PIN_90 -to SPI_SS4
|
||||
set_location_assignment PIN_13 -to CONF_DATA0
|
||||
set_location_assignment PIN_49 -to SDRAM_A[0]
|
||||
set_location_assignment PIN_44 -to SDRAM_A[1]
|
||||
set_location_assignment PIN_42 -to SDRAM_A[2]
|
||||
set_location_assignment PIN_39 -to SDRAM_A[3]
|
||||
set_location_assignment PIN_4 -to SDRAM_A[4]
|
||||
set_location_assignment PIN_6 -to SDRAM_A[5]
|
||||
set_location_assignment PIN_8 -to SDRAM_A[6]
|
||||
set_location_assignment PIN_10 -to SDRAM_A[7]
|
||||
set_location_assignment PIN_11 -to SDRAM_A[8]
|
||||
set_location_assignment PIN_28 -to SDRAM_A[9]
|
||||
set_location_assignment PIN_50 -to SDRAM_A[10]
|
||||
set_location_assignment PIN_30 -to SDRAM_A[11]
|
||||
set_location_assignment PIN_32 -to SDRAM_A[12]
|
||||
set_location_assignment PIN_83 -to SDRAM_DQ[0]
|
||||
set_location_assignment PIN_79 -to SDRAM_DQ[1]
|
||||
set_location_assignment PIN_77 -to SDRAM_DQ[2]
|
||||
set_location_assignment PIN_76 -to SDRAM_DQ[3]
|
||||
set_location_assignment PIN_72 -to SDRAM_DQ[4]
|
||||
set_location_assignment PIN_71 -to SDRAM_DQ[5]
|
||||
set_location_assignment PIN_69 -to SDRAM_DQ[6]
|
||||
set_location_assignment PIN_68 -to SDRAM_DQ[7]
|
||||
set_location_assignment PIN_86 -to SDRAM_DQ[8]
|
||||
set_location_assignment PIN_87 -to SDRAM_DQ[9]
|
||||
set_location_assignment PIN_98 -to SDRAM_DQ[10]
|
||||
set_location_assignment PIN_99 -to SDRAM_DQ[11]
|
||||
set_location_assignment PIN_100 -to SDRAM_DQ[12]
|
||||
set_location_assignment PIN_101 -to SDRAM_DQ[13]
|
||||
set_location_assignment PIN_103 -to SDRAM_DQ[14]
|
||||
set_location_assignment PIN_104 -to SDRAM_DQ[15]
|
||||
set_location_assignment PIN_58 -to SDRAM_BA[0]
|
||||
set_location_assignment PIN_51 -to SDRAM_BA[1]
|
||||
set_location_assignment PIN_85 -to SDRAM_DQMH
|
||||
set_location_assignment PIN_67 -to SDRAM_DQML
|
||||
set_location_assignment PIN_60 -to SDRAM_nRAS
|
||||
set_location_assignment PIN_64 -to SDRAM_nCAS
|
||||
set_location_assignment PIN_66 -to SDRAM_nWE
|
||||
set_location_assignment PIN_59 -to SDRAM_nCS
|
||||
set_location_assignment PIN_33 -to SDRAM_CKE
|
||||
set_location_assignment PIN_43 -to SDRAM_CLK
|
||||
set_location_assignment PLL_1 -to "pll:pll|altpll:altpll_component"
|
||||
|
||||
# Classic Timing Assignments
|
||||
# ==========================
|
||||
set_global_assignment -name MIN_CORE_JUNCTION_TEMP 0
|
||||
set_global_assignment -name MAX_CORE_JUNCTION_TEMP 85
|
||||
set_global_assignment -name TIMEQUEST_DO_CCPP_REMOVAL ON
|
||||
set_global_assignment -name TIMEQUEST_MULTICORNER_ANALYSIS ON
|
||||
|
||||
# Analysis & Synthesis Assignments
|
||||
# ================================
|
||||
set_global_assignment -name FAMILY "Cyclone III"
|
||||
set_global_assignment -name DEVICE_FILTER_PIN_COUNT 144
|
||||
set_global_assignment -name DEVICE_FILTER_SPEED_GRADE 8
|
||||
set_global_assignment -name VHDL_INPUT_VERSION VHDL_2008
|
||||
set_global_assignment -name VHDL_SHOW_LMF_MAPPING_MESSAGES OFF
|
||||
set_global_assignment -name VERILOG_INPUT_VERSION SYSTEMVERILOG_2005
|
||||
set_global_assignment -name VERILOG_SHOW_LMF_MAPPING_MESSAGES OFF
|
||||
set_global_assignment -name TOP_LEVEL_ENTITY MissileCommand_MiST
|
||||
|
||||
# Fitter Assignments
|
||||
# ==================
|
||||
set_global_assignment -name DEVICE EP3C25E144C8
|
||||
set_global_assignment -name CYCLONEIII_CONFIGURATION_SCHEME "PASSIVE SERIAL"
|
||||
set_global_assignment -name CRC_ERROR_OPEN_DRAIN OFF
|
||||
set_global_assignment -name FORCE_CONFIGURATION_VCCIO ON
|
||||
set_global_assignment -name STRATIX_DEVICE_IO_STANDARD "3.3-V LVTTL"
|
||||
set_global_assignment -name CYCLONEII_RESERVE_NCEO_AFTER_CONFIGURATION "USE AS REGULAR IO"
|
||||
set_global_assignment -name RESERVE_DATA0_AFTER_CONFIGURATION "USE AS REGULAR IO"
|
||||
set_global_assignment -name RESERVE_DATA1_AFTER_CONFIGURATION "USE AS REGULAR IO"
|
||||
set_global_assignment -name RESERVE_FLASH_NCE_AFTER_CONFIGURATION "USE AS REGULAR IO"
|
||||
set_global_assignment -name RESERVE_DCLK_AFTER_CONFIGURATION "USE AS REGULAR IO"
|
||||
|
||||
# Assembler Assignments
|
||||
# =====================
|
||||
set_global_assignment -name USE_CONFIGURATION_DEVICE OFF
|
||||
set_global_assignment -name GENERATE_RBF_FILE ON
|
||||
|
||||
# Power Estimation Assignments
|
||||
# ============================
|
||||
set_global_assignment -name POWER_PRESET_COOLING_SOLUTION "23 MM HEAT SINK WITH 200 LFPM AIRFLOW"
|
||||
set_global_assignment -name POWER_BOARD_THERMAL_MODEL "NONE (CONSERVATIVE)"
|
||||
|
||||
# Advanced I/O Timing Assignments
|
||||
# ===============================
|
||||
set_global_assignment -name OUTPUT_IO_TIMING_NEAR_END_VMEAS "HALF VCCIO" -rise
|
||||
set_global_assignment -name OUTPUT_IO_TIMING_NEAR_END_VMEAS "HALF VCCIO" -fall
|
||||
set_global_assignment -name OUTPUT_IO_TIMING_FAR_END_VMEAS "HALF SIGNAL SWING" -rise
|
||||
set_global_assignment -name OUTPUT_IO_TIMING_FAR_END_VMEAS "HALF SIGNAL SWING" -fall
|
||||
|
||||
# ---------------------------------
|
||||
# start ENTITY(MissileCommand_MiST)
|
||||
|
||||
# Pin & Location Assignments
|
||||
# ==========================
|
||||
set_instance_assignment -name FAST_OUTPUT_REGISTER ON -to SDRAM_DQ[*]
|
||||
set_instance_assignment -name FAST_OUTPUT_REGISTER ON -to SDRAM_A[*]
|
||||
set_instance_assignment -name FAST_OUTPUT_REGISTER ON -to SDRAM_BA[0]
|
||||
set_instance_assignment -name FAST_OUTPUT_REGISTER ON -to SDRAM_BA[1]
|
||||
set_instance_assignment -name FAST_OUTPUT_REGISTER ON -to SDRAM_DQMH
|
||||
set_instance_assignment -name FAST_OUTPUT_REGISTER ON -to SDRAM_DQML
|
||||
set_instance_assignment -name FAST_OUTPUT_REGISTER ON -to SDRAM_nRAS
|
||||
set_instance_assignment -name FAST_OUTPUT_REGISTER ON -to SDRAM_nCAS
|
||||
set_instance_assignment -name FAST_OUTPUT_REGISTER ON -to SDRAM_nWE
|
||||
set_instance_assignment -name FAST_OUTPUT_REGISTER ON -to SDRAM_nCS
|
||||
set_instance_assignment -name FAST_OUTPUT_ENABLE_REGISTER ON -to SDRAM_DQ[*]
|
||||
set_instance_assignment -name FAST_INPUT_REGISTER ON -to SDRAM_DQ[*]
|
||||
|
||||
# Fitter Assignments
|
||||
# ==================
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to SDRAM_A[*]
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to SDRAM_DQ[*]
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to SDRAM_BA[*]
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to SDRAM_DQML
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to SDRAM_DQMH
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to SDRAM_nRAS
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to SDRAM_nCAS
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to SDRAM_nWE
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to SDRAM_nCS
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to SDRAM_CKE
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to SDRAM_CLK
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to VGA_R[*]
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to VGA_G[*]
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to VGA_B[*]
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to VGA_HS
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW "MAXIMUM CURRENT" -to VGA_VS
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW 4MA -to AUDIO_L
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW 4MA -to AUDIO_R
|
||||
set_instance_assignment -name CURRENT_STRENGTH_NEW 4MA -to SPI_DO
|
||||
|
||||
# start DESIGN_PARTITION(Top)
|
||||
# ---------------------------
|
||||
|
||||
# Incremental Compilation Assignments
|
||||
# ===================================
|
||||
set_global_assignment -name PARTITION_NETLIST_TYPE SOURCE -section_id Top
|
||||
set_global_assignment -name PARTITION_FITTER_PRESERVATION_LEVEL PLACEMENT_AND_ROUTING -section_id Top
|
||||
set_global_assignment -name PARTITION_COLOR 16764057 -section_id Top
|
||||
|
||||
# end DESIGN_PARTITION(Top)
|
||||
# -------------------------
|
||||
|
||||
# end ENTITY(MissileCommand_MiST)
|
||||
# -------------------------------
|
||||
set_instance_assignment -name PARTITION_HIERARCHY root_partition -to | -section_id Top
|
||||
BIN
Arcade_MiST/Atari MissileCommand/MissileC.rbf
Normal file
BIN
Arcade_MiST/Atari MissileCommand/MissileC.rbf
Normal file
Binary file not shown.
55
Arcade_MiST/Atari MissileCommand/README.MD
Normal file
55
Arcade_MiST/Atari MissileCommand/README.MD
Normal file
@@ -0,0 +1,55 @@
|
||||
# Missile Command by Atari for [MiSTer](https://github.com/MiSTer-devel/Main_MiSTer/wiki)
|
||||
|
||||
An FPGA implementation of the __Missile Command__ arcade hardware by __Atari__ for the MiSTer platform.
|
||||
|
||||
## Credits, acknowledgements, and thanks
|
||||
- [__JimmyStones__](https://github.com/JimmyStones): Core design and implementation
|
||||
- [__JaguarLV__](https://github.com/JaguarLV): Collaboration and code sharing when we were both stuck trying to get this core working!
|
||||
- [__Andy McFadden__](https://6502disassembly.com/va-missile-command/): Missile Command disassembly project
|
||||
- [__Jotego__](https://github.com/jotego): [jtframe_resync](https://github.com/jotego/jtframe/blob/master/hdl/video/jtframe_resync.v) for analog video H/V re-positioning
|
||||
- [__Bird Computer__](https://github.com/robfinch/Cores/blob/master/bc6502/bc6502.v): 6502 CPU in Verilog
|
||||
- [__MiSTer Walrus__](https://twitter.com/WalrusFPGA) and [__ThePulseRifle__](https://twitter.com/thepulserifle): Alpha testing action
|
||||
|
||||
## FPGA implementation
|
||||
- Created using original schematics, information from the MAME project, and insight from the excellent disassembly by Andy McFadden (https://6502disassembly.com/va-missile-command/).
|
||||
- Logic has been simplified, and re-engineered where necessary to interact reliably with FPGA block RAM.
|
||||
|
||||
## Controls
|
||||
This core supports multiple control methods:
|
||||
### Mouse/Trackball
|
||||
- Use a combination of the 'Mouse/Trackball Speed' OSD option and the 'Trackball Speed' DIP switch to achieve a comfortable speed for your device
|
||||
- Use the 'Button order' OSD option to change the layout of the mouse/trackball buttons to suit your device'
|
||||
### Digital joypad/stick
|
||||
- Set the 'Joystick mode' OSD option to Digital to use a pad or digital stick
|
||||
- Use the 'Joystick speed' OSD option to achieve a comfortable speed for your device
|
||||
### Analog stick
|
||||
- Set 'Joystick mode' OSD option to Analog to use an analog stick
|
||||
- Use the 'Joystick speed' OSD option to achieve a comfortable speed for your device
|
||||
|
||||
|
||||
## Hiscore save/load
|
||||
To save your hiscores manually, press the 'Save Settings' option in the OSD. Hiscores will be automatically loaded when the core is started.
|
||||
|
||||
To enable automatic saving of hiscores, turn on the 'Autosave Hiscores' option and press the 'Save Settings' option in the OSD. Hiscores will then be automatically saved (if they have changed) any time the OSD is opened.
|
||||
|
||||
Hiscore data is stored in /media/fat/config/nvram/ as ```<mra filename>.nvm```
|
||||
|
||||
## Known issues
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||||
- Cocktail mode is not currently supported
|
||||
|
||||
## Installation
|
||||
Place `*.rbf` into the "_Arcade/cores" folder on your SD card. Then, place `*.mra` into the "_Arcade" folder and ROM files from MAME into "games/mame".
|
||||
|
||||
### ****ATTENTION****
|
||||
ROMs are not included. In order to use this arcade core, you must provide the correct ROMs.
|
||||
|
||||
To simplify the process, .mra files are provided in the releases folder that specify the required ROMs along with their checksums. The ROM's .zip filename refers to the corresponding file in the M.A.M.E. project.
|
||||
|
||||
Please refer to https://github.com/MiSTer-devel/Main_MiSTer/wiki/Arcade-Roms-and-MRA-files for information on how to setup and use the environment.
|
||||
|
||||
Quick reference for folders and file placement:
|
||||
|
||||
/_Arcade/<game name>.mra
|
||||
/_Arcade/cores/<game rbf>.rbf
|
||||
/games/mame/<mame rom>.zip
|
||||
/games/hbmame/<hbmame rom>.zip
|
||||
15
Arcade_MiST/Atari MissileCommand/clean.bat
Normal file
15
Arcade_MiST/Atari MissileCommand/clean.bat
Normal file
@@ -0,0 +1,15 @@
|
||||
@echo off
|
||||
del /s *.bak
|
||||
del /s *.orig
|
||||
del /s *.rej
|
||||
rmdir /s /q db
|
||||
rmdir /s /q incremental_db
|
||||
rmdir /s /q output_files
|
||||
rmdir /s /q simulation
|
||||
rmdir /s /q greybox_tmp
|
||||
del PLLJ_PLLSPE_INFO.txt
|
||||
del *.qws
|
||||
del *.ppf
|
||||
del *.qip
|
||||
del *.ddb
|
||||
pause
|
||||
@@ -0,0 +1,21 @@
|
||||
<misterromdescription>
|
||||
<name>Missile Command (rev 1)</name>
|
||||
<mameversion>0240</mameversion>
|
||||
<setname>missile1</setname>
|
||||
<year>1980</year>
|
||||
<manufacturer>Atari Games</manufacturer>
|
||||
<rbf>MissileC</rbf>
|
||||
<rom index="0" zip="missile.zip|missile1.zip" md5="none">
|
||||
<part crc="41cbb8f2" name="35820-01.h1"/>
|
||||
<part crc="728702c8" name="35821-01.jk1"/>
|
||||
<part crc="28f0999f" name="35822-01.kl1"/>
|
||||
<part crc="bcc93c94" name="35823-01.ln1"/>
|
||||
<part crc="0ca089c8" name="35824-01.np1"/>
|
||||
<part crc="428cf0d5" name="35825-01.r1"/>
|
||||
<part crc="86a22140" name="035826-01.l6"/>
|
||||
</rom>
|
||||
<rom index="4"></rom>
|
||||
|
||||
<nvram index="4" size="48"></nvram>
|
||||
|
||||
</misterromdescription>
|
||||
@@ -0,0 +1,21 @@
|
||||
<misterromdescription>
|
||||
<name>Missile Command (rev 2)</name>
|
||||
<mameversion>0240</mameversion>
|
||||
<setname>missile2</setname>
|
||||
<year>1980</year>
|
||||
<manufacturer>Atari Games</manufacturer>
|
||||
<rbf>MissileC</rbf>
|
||||
<rom index="0" zip="missile.zip|missile2.zip" md5="none">
|
||||
<part crc="7a62ce6a" name="035820-02.h1"/>
|
||||
<part crc="df3bd57f" name="035821-02.jk1"/>
|
||||
<part crc="a1cd384a" name="035822-02.kl1"/>
|
||||
<part crc="82e552bb" name="035823-02.ln1"/>
|
||||
<part crc="606e42e0" name="035824-02.np1"/>
|
||||
<part crc="f752eaeb" name="035825-02.r1"/>
|
||||
<part crc="86a22140" name="035826-01.l6"/>
|
||||
</rom>
|
||||
<rom index="4"></rom>
|
||||
|
||||
<nvram index="4" size="48"></nvram>
|
||||
|
||||
</misterromdescription>
|
||||
@@ -0,0 +1,21 @@
|
||||
<misterromdescription>
|
||||
<name>Missile Command (rev 3)</name>
|
||||
<mameversion>0240</mameversion>
|
||||
<setname>missile</setname>
|
||||
<year>1980</year>
|
||||
<manufacturer>Atari Games</manufacturer>
|
||||
<rbf>MissileC</rbf>
|
||||
<rom index="0" zip="missile.zip" md5="none">
|
||||
<part crc="7a62ce6a" name="035820-02.h1"/>
|
||||
<part crc="df3bd57f" name="035821-02.jk1"/>
|
||||
<part crc="1a2f599a" name="035822-03e.kl1"/>
|
||||
<part crc="82e552bb" name="035823-02.ln1"/>
|
||||
<part crc="606e42e0" name="035824-02.np1"/>
|
||||
<part crc="f752eaeb" name="035825-02.r1"/>
|
||||
<part crc="86a22140" name="035826-01.l6"/>
|
||||
</rom>
|
||||
<rom index="4"></rom>
|
||||
|
||||
<nvram index="4" size="48"></nvram>
|
||||
|
||||
</misterromdescription>
|
||||
246
Arcade_MiST/Atari MissileCommand/rtl/MissileCommand_MiST.sv
Normal file
246
Arcade_MiST/Atari MissileCommand/rtl/MissileCommand_MiST.sv
Normal file
@@ -0,0 +1,246 @@
|
||||
module MissileCommand_MiST(
|
||||
output LED,
|
||||
output [5:0] VGA_R,
|
||||
output [5:0] VGA_G,
|
||||
output [5:0] VGA_B,
|
||||
output VGA_HS,
|
||||
output VGA_VS,
|
||||
output AUDIO_L,
|
||||
output AUDIO_R,
|
||||
input SPI_SCK,
|
||||
output SPI_DO,
|
||||
input SPI_DI,
|
||||
input SPI_SS2,
|
||||
input SPI_SS3,
|
||||
input CONF_DATA0,
|
||||
input CLOCK_27,
|
||||
output SDRAM_CKE
|
||||
);
|
||||
|
||||
`include "rtl/build_id.v"
|
||||
|
||||
localparam CONF_STR = {
|
||||
"MissileC;rom;",
|
||||
"O1,Pause,Off,On;",
|
||||
|
||||
"O45,Coinage ,1C_1C,2C_1C,Free_Play,1C_2C;",
|
||||
"O6,Service,Off,On;",
|
||||
"O78,Language ,English,French,German,Spanish;",
|
||||
"O9A,Cities ,6,4,5,7;",
|
||||
"OB,Bonus Credit for 4 Coins,On,Off;",
|
||||
|
||||
"OC,Trackbal Size,Mini,Large;",
|
||||
"ODE,Bonus City,None,8000,20000,18000,15000,14000,12000,10000;",
|
||||
"OF,Cabinet,Upright,Cocktail;",
|
||||
|
||||
"OGH,Mouse/trackball speed,25%,50%,100%,200%;",
|
||||
"OIJ,Button order,LMR,LRM,MRL;",
|
||||
"O3,Joystick mode,Digital,Analog;",
|
||||
"O2,Joystick speed,Low,High;",
|
||||
|
||||
"T0,Reset;",
|
||||
"V,v1.0.",`BUILD_DATE
|
||||
};
|
||||
|
||||
wire pause = status[1];
|
||||
//wire blend = status[3];
|
||||
wire service = status[6];
|
||||
wire [1:0] coinage = status[5:4];
|
||||
wire [1:0] language = status[8:7];
|
||||
wire [1:0] cities = status[10:9];
|
||||
wire bonus = status[11];
|
||||
wire size = status[12];
|
||||
wire [2:0] bonuscity = status[15:13];
|
||||
wire cabinet = status[16];
|
||||
assign LED = ~ioctl_downl;
|
||||
assign AUDIO_R = AUDIO_L;
|
||||
assign SDRAM_CKE = 0;
|
||||
|
||||
wire clk_sys, clk_core;
|
||||
wire pll_locked;
|
||||
pll_mist pll(
|
||||
.inclk0(CLOCK_27),
|
||||
.areset(0),
|
||||
.c0(clk_sys),//20
|
||||
.c1(clk_core),//10
|
||||
.locked(pll_locked)
|
||||
);
|
||||
|
||||
reg clk_vid = 1'b0;
|
||||
always @(posedge clk_core) clk_vid <= !clk_vid;
|
||||
|
||||
wire ioctl_downl;
|
||||
wire [7:0] ioctl_index;
|
||||
wire ioctl_wr;
|
||||
wire [24:0] ioctl_addr;
|
||||
wire [7:0] ioctl_dout;
|
||||
|
||||
data_io data_io(
|
||||
.clk_sys ( clk_sys ),
|
||||
.SPI_SCK ( SPI_SCK ),
|
||||
.SPI_SS2 ( SPI_SS2 ),
|
||||
.SPI_DI ( SPI_DI ),
|
||||
.ioctl_download( ioctl_downl ),
|
||||
.ioctl_index ( ioctl_index ),
|
||||
.ioctl_wr ( ioctl_wr ),
|
||||
.ioctl_addr ( ioctl_addr ),
|
||||
.ioctl_dout ( ioctl_dout )
|
||||
);
|
||||
|
||||
wire [63:0] status;
|
||||
wire [1:0] buttons;
|
||||
wire [1:0] switches;
|
||||
wire [31:0] joystick_0;
|
||||
wire [31:0] joystick_1;
|
||||
wire [31:0] joystick_analog_0;
|
||||
wire [31:0] joystick_analog_1;
|
||||
wire scandoublerD;
|
||||
wire ypbpr;
|
||||
wire no_csync;
|
||||
wire key_pressed;
|
||||
wire [7:0] key_code;
|
||||
wire key_strobe;
|
||||
|
||||
user_io #(
|
||||
.STRLEN(($size(CONF_STR)>>3)))
|
||||
user_io(
|
||||
.clk_sys (clk_sys ),
|
||||
.conf_str (CONF_STR ),
|
||||
.SPI_CLK (SPI_SCK ),
|
||||
.SPI_SS_IO (CONF_DATA0 ),
|
||||
.SPI_MISO (SPI_DO ),
|
||||
.SPI_MOSI (SPI_DI ),
|
||||
.buttons (buttons ),
|
||||
.switches (switches ),
|
||||
.scandoubler_disable (scandoublerD),
|
||||
.ypbpr (ypbpr ),
|
||||
.no_csync (no_csync ),
|
||||
.key_strobe (key_strobe ),
|
||||
.key_pressed (key_pressed ),
|
||||
.key_code (key_code ),
|
||||
.joystick_0 (joystick_0 ),
|
||||
.joystick_1 (joystick_1 ),
|
||||
.joystick_analog_0(joystick_analog_0),
|
||||
.joystick_analog_1(joystick_analog_1),
|
||||
.status (status )
|
||||
);
|
||||
|
||||
wire [5:0] audio;
|
||||
wire hs, vs, hb, vb;
|
||||
wire blankn = ~(hb | vb);
|
||||
wire g, r, b;
|
||||
|
||||
missile missile_inst(
|
||||
.clk_10M (clk_core),
|
||||
.ce_5M (clk_vid),
|
||||
.reset (status[0] | buttons[1]),
|
||||
.pause (pause),
|
||||
.vtb_dir1 (vtb_dir1),
|
||||
.vtb_clk1 (vtb_clk1),
|
||||
.htb_dir1 (htb_dir1),
|
||||
.htb_clk1 (htb_clk1),
|
||||
|
||||
|
||||
.coin (m_coin1),
|
||||
.p1_start (m_one_player),
|
||||
.p2_start (m_two_players),
|
||||
|
||||
.p1_fire_l (m_fireA),
|
||||
.p1_fire_c (m_fireB),
|
||||
.p1_fire_r (m_fireC),
|
||||
|
||||
.p2_fire_l (m_fire2A),
|
||||
.p2_fire_c (m_fire2B),
|
||||
.p2_fire_r (m_fire2C),
|
||||
|
||||
.in2 ({1'b0,language,1'b0,2'b00,coinage}),
|
||||
.switches ({cabinet,bonuscity,bonuscity,bonuscity,size,bonus,cities,cities}),
|
||||
.self_test (service),
|
||||
.slam (m_tilt),
|
||||
.flip (flip),
|
||||
|
||||
.r (r),
|
||||
.g (g),
|
||||
.b (b),
|
||||
.h_sync (hs),
|
||||
.v_sync (vs),
|
||||
.h_blank (hb),
|
||||
.v_blank (vb),
|
||||
.audio_o (audio),
|
||||
.dn_addr (ioctl_addr[15:0]),
|
||||
.dn_data (ioctl_dout),
|
||||
.dn_wr (ioctl_wr && ioctl_index == 0)
|
||||
);
|
||||
|
||||
//Trackball
|
||||
wire TB_horiz, TB_vert;
|
||||
wire flip;
|
||||
wire vtb_dir1;
|
||||
wire vtb_clk1;
|
||||
wire htb_dir1;
|
||||
wire htb_clk1;
|
||||
wire [24:0] ps2_mouse;
|
||||
trackball trackball
|
||||
(
|
||||
.clk(clk_core),
|
||||
.flip(flip),
|
||||
.joystick({m_up, m_down, m_left, m_right}),
|
||||
.joystick_mode(status[3]),
|
||||
.joystick_analog(joystick_analog_0 !=0 ? joystick_analog_0 : joystick_analog_1),
|
||||
.joystick_sensitivity(status[13]),
|
||||
.mouse_speed(status[15:14]),
|
||||
.ps2_mouse(ps2_mouse),
|
||||
.v_dir(vtb_dir1),
|
||||
.v_clk(vtb_clk1),
|
||||
.h_dir(htb_dir1),
|
||||
.h_clk(htb_clk1)
|
||||
);
|
||||
|
||||
|
||||
mist_video #(.COLOR_DEPTH(1), .SD_HCNT_WIDTH(10)) mist_video(
|
||||
.clk_sys ( clk_sys ),
|
||||
.SPI_SCK ( SPI_SCK ),
|
||||
.SPI_SS3 ( SPI_SS3 ),
|
||||
.SPI_DI ( SPI_DI ),
|
||||
.R ( blankn ? r : 0 ),
|
||||
.G ( blankn ? g : 0 ),
|
||||
.B ( blankn ? b : 0 ),
|
||||
.HSync ( hs ),
|
||||
.VSync ( vs ),
|
||||
.VGA_R ( VGA_R ),
|
||||
.VGA_G ( VGA_G ),
|
||||
.VGA_B ( VGA_B ),
|
||||
.VGA_VS ( VGA_VS ),
|
||||
.VGA_HS ( VGA_HS ),
|
||||
.scandoubler_disable(scandoublerD ),
|
||||
.ypbpr ( ypbpr )
|
||||
);
|
||||
|
||||
dac #(
|
||||
.C_bits(6))
|
||||
dac_l(
|
||||
.clk_i(clk_sys),
|
||||
.res_n_i(1),
|
||||
.dac_i(audio),
|
||||
.dac_o(AUDIO_L)
|
||||
);
|
||||
|
||||
wire m_up, m_down, m_left, m_right, m_fireA, m_fireB, m_fireC, m_fireD, m_fireE, m_fireF;
|
||||
wire m_up2, m_down2, m_left2, m_right2, m_fire2A, m_fire2B, m_fire2C, m_fire2D, m_fire2E, m_fire2F;
|
||||
wire m_tilt, m_coin1, m_coin2, m_coin3, m_coin4, m_one_player, m_two_players, m_three_players, m_four_players;
|
||||
|
||||
arcade_inputs inputs (
|
||||
.clk ( clk_sys ),
|
||||
.key_strobe ( key_strobe ),
|
||||
.key_pressed ( key_pressed ),
|
||||
.key_code ( key_code ),
|
||||
.joystick_0 ( joystick_0 ),
|
||||
.joystick_1 ( joystick_1 ),
|
||||
.joyswap ( 1'b0 ),
|
||||
.oneplayer ( 1'b1 ),
|
||||
.controls ( {m_tilt, m_coin4, m_coin3, m_coin2, m_coin1, m_four_players, m_three_players, m_two_players, m_one_player} ),
|
||||
.player1 ( {m_fireF, m_fireE, m_fireD, m_fireC, m_fireB, m_fireA, m_up, m_down, m_left, m_right} ),
|
||||
.player2 ( {m_fire2F, m_fire2E, m_fire2D, m_fire2C, m_fire2B, m_fire2A, m_up2, m_down2, m_left2, m_right2} )
|
||||
);
|
||||
|
||||
endmodule
|
||||
35
Arcade_MiST/Atari MissileCommand/rtl/build_id.tcl
Normal file
35
Arcade_MiST/Atari MissileCommand/rtl/build_id.tcl
Normal file
@@ -0,0 +1,35 @@
|
||||
# ================================================================================
|
||||
#
|
||||
# Build ID Verilog Module Script
|
||||
# Jeff Wiencrot - 8/1/2011
|
||||
#
|
||||
# Generates a Verilog module that contains a timestamp,
|
||||
# from the current build. These values are available from the build_date, build_time,
|
||||
# physical_address, and host_name output ports of the build_id module in the build_id.v
|
||||
# Verilog source file.
|
||||
#
|
||||
# ================================================================================
|
||||
|
||||
proc generateBuildID_Verilog {} {
|
||||
|
||||
# Get the timestamp (see: http://www.altera.com/support/examples/tcl/tcl-date-time-stamp.html)
|
||||
set buildDate [ clock format [ clock seconds ] -format %y%m%d ]
|
||||
set buildTime [ clock format [ clock seconds ] -format %H%M%S ]
|
||||
|
||||
# Create a Verilog file for output
|
||||
set outputFileName "rtl/build_id.v"
|
||||
set outputFile [open $outputFileName "w"]
|
||||
|
||||
# Output the Verilog source
|
||||
puts $outputFile "`define BUILD_DATE \"$buildDate\""
|
||||
puts $outputFile "`define BUILD_TIME \"$buildTime\""
|
||||
close $outputFile
|
||||
|
||||
# Send confirmation message to the Messages window
|
||||
post_message "Generated build identification Verilog module: [pwd]/$outputFileName"
|
||||
post_message "Date: $buildDate"
|
||||
post_message "Time: $buildTime"
|
||||
}
|
||||
|
||||
# Comment out this line to prevent the process from automatically executing when the file is sourced:
|
||||
generateBuildID_Verilog
|
||||
65
Arcade_MiST/Atari MissileCommand/rtl/dpram.v
Normal file
65
Arcade_MiST/Atari MissileCommand/rtl/dpram.v
Normal file
@@ -0,0 +1,65 @@
|
||||
/*============================================================================
|
||||
Generic dual-port RAM module with single clock input
|
||||
|
||||
Copyright (C) 2022 - Jim Gregory - https://github.com/JimmyStones/
|
||||
|
||||
This program is free software; you can redistribute it and/or modify it
|
||||
under the terms of the GNU General Public License as published by the Free
|
||||
Software Foundation; either version 3 of the License, or (at your option)
|
||||
any later version.
|
||||
|
||||
This program is distributed in the hope that it will be useful,
|
||||
but WITHOUT ANY WARRANTY; without even the implied warranty of
|
||||
MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
|
||||
GNU General Public License for more details.
|
||||
|
||||
You should have received a copy of the GNU General Public License along
|
||||
with this program. If not, see <http://www.gnu.org/licenses/>.
|
||||
===========================================================================*/
|
||||
|
||||
`timescale 1 ps / 1 ps
|
||||
`default_nettype none
|
||||
|
||||
module dpram #(
|
||||
parameter address_width = 10,
|
||||
parameter data_width = 8
|
||||
) (
|
||||
input wire clock,
|
||||
|
||||
input wire enable_a,
|
||||
input wire wren_a,
|
||||
input wire [address_width-1:0] address_a,
|
||||
input wire [data_width-1:0] data_a,
|
||||
output reg [data_width-1:0] q_a,
|
||||
|
||||
input wire enable_b,
|
||||
input wire wren_b,
|
||||
input wire [address_width-1:0] address_b,
|
||||
input wire [data_width-1:0] data_b,
|
||||
output reg [data_width-1:0] q_b
|
||||
);
|
||||
|
||||
localparam ramLength = (2**address_width);
|
||||
reg [data_width-1:0] mem [ramLength-1:0];
|
||||
|
||||
always @(posedge clock) begin
|
||||
if(enable_a)
|
||||
begin
|
||||
q_a <= mem[address_a];
|
||||
if(wren_a) begin
|
||||
q_a <= data_a;
|
||||
mem[address_a] <= data_a;
|
||||
end
|
||||
end
|
||||
|
||||
if(enable_b)
|
||||
begin
|
||||
q_b <= mem[address_b];
|
||||
if(wren_b) begin
|
||||
q_b <= data_b;
|
||||
mem[address_b] <= data_b;
|
||||
end
|
||||
end
|
||||
end
|
||||
|
||||
endmodule
|
||||
55
Arcade_MiST/Atari MissileCommand/rtl/dpvram.v
Normal file
55
Arcade_MiST/Atari MissileCommand/rtl/dpvram.v
Normal file
@@ -0,0 +1,55 @@
|
||||
/*============================================================================
|
||||
Dual-port RAM module with bit-level write enable and read-only second port
|
||||
|
||||
Copyright (C) 2022 - Jim Gregory - https://github.com/JimmyStones/
|
||||
|
||||
This program is free software; you can redistribute it and/or modify it
|
||||
under the terms of the GNU General Public License as published by the Free
|
||||
Software Foundation; either version 3 of the License, or (at your option)
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`timescale 1 ps / 1 ps
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`default_nettype none
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||||
module dpvram #(
|
||||
parameter address_width = 10,
|
||||
parameter data_width = 8
|
||||
) (
|
||||
input wire clock_a,
|
||||
input wire [data_width-1:0] wren_a,
|
||||
input wire [address_width-1:0] address_a,
|
||||
input wire [data_width-1:0] data_a,
|
||||
output reg [data_width-1:0] q_a,
|
||||
|
||||
input wire clock_b,
|
||||
input wire [address_width-1:0] address_b,
|
||||
output reg [data_width-1:0] q_b
|
||||
);
|
||||
|
||||
localparam ramLength = (2**address_width);
|
||||
reg [data_width-1:0] mem [ramLength-1:0];
|
||||
|
||||
integer i;
|
||||
always @(posedge clock_a)
|
||||
begin
|
||||
q_a <= mem[address_a];
|
||||
for(i=0;i<data_width;i=i+1)
|
||||
begin
|
||||
if(!wren_a[i]) mem[address_a][i] <= data_a[i];
|
||||
end
|
||||
end
|
||||
|
||||
always @(negedge clock_b) begin
|
||||
q_b <= mem[address_b];
|
||||
end
|
||||
|
||||
endmodule
|
||||
40
Arcade_MiST/Atari MissileCommand/rtl/ls42.v
Normal file
40
Arcade_MiST/Atari MissileCommand/rtl/ls42.v
Normal file
@@ -0,0 +1,40 @@
|
||||
/*============================================================================
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||||
74LS42 - BCD to decimal decoder
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Copyright (C) 2022 - Jim Gregory - https://github.com/JimmyStones/
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`timescale 1 ps / 1 ps
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||||
`default_nettype none
|
||||
|
||||
module ls42
|
||||
(
|
||||
input wire a, b, c, d,
|
||||
output wire [9:0] o
|
||||
);
|
||||
|
||||
assign o[0] = ~(~a && ~b && ~c && ~d);
|
||||
assign o[1] = ~(a && ~b && ~c && ~d);
|
||||
assign o[2] = ~(~a && b && ~c && ~d);
|
||||
assign o[3] = ~(a && b && ~c && ~d);
|
||||
assign o[4] = ~(~a && ~b && c && ~d);
|
||||
assign o[5] = ~(a && ~b && c && ~d);
|
||||
assign o[6] = ~(~a && b && c && ~d);
|
||||
assign o[7] = ~(a && b && c && ~d);
|
||||
assign o[8] = ~(~a && ~b && ~c && d);
|
||||
assign o[9] = ~(a && ~b && ~c && d);
|
||||
|
||||
endmodule
|
||||
119
Arcade_MiST/Atari MissileCommand/rtl/micro.v
Normal file
119
Arcade_MiST/Atari MissileCommand/rtl/micro.v
Normal file
@@ -0,0 +1,119 @@
|
||||
/*============================================================================
|
||||
Missile Command for MiSTer FPGA - Microprocessor circuit
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Copyright (C) 2022 - Jim Gregory - https://github.com/JimmyStones/
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`timescale 1 ps / 1 ps
|
||||
`default_nettype none
|
||||
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||||
module micro
|
||||
(
|
||||
input clk_10M,
|
||||
input wire s_phi_x,
|
||||
input wire s_phi_extend,
|
||||
input wire reset/*verilator public_flat*/,
|
||||
input wire pause,
|
||||
input wire flip,
|
||||
input wire s_INTACK_n,
|
||||
input wire [8:0] hcnt,
|
||||
input wire [7:0] vcnt,
|
||||
input wire [7:0] s_db_in,
|
||||
output wire s_phi_0/*verilator public_flat*/,
|
||||
output wire s_phi_2,
|
||||
output reg s_irq_n,
|
||||
output wire s_READWRITE,
|
||||
output wire s_WRITE_n,
|
||||
output wire s_br_w_n,
|
||||
output wire s_16FLIP,
|
||||
output wire [15:0] s_addr/*verilator public_flat*/,
|
||||
output wire [7:0] s_db_out,
|
||||
output wire sync/*verilator public_flat*/
|
||||
);
|
||||
|
||||
//// TODO - Watchdog
|
||||
|
||||
// L3 - 74S86 - XOR
|
||||
assign s_16FLIP = ~vcnt_adjust[4];
|
||||
// C4 - 74S32 - OR
|
||||
assign s_phi_0 = (s_phi_x | s_phi_extend);
|
||||
|
||||
reg irq_pending;
|
||||
wire [7:0] vcnt_adjust = vcnt - 8'd10;
|
||||
always @(posedge clk_10M)
|
||||
begin
|
||||
reg s_INTACK_n_last;
|
||||
reg s_16FLIP_last;
|
||||
s_INTACK_n_last <= s_INTACK_n;
|
||||
s_16FLIP_last <= s_16FLIP;
|
||||
|
||||
if(reset)
|
||||
irq_pending <= 1'b1;
|
||||
else if (!s_INTACK_n & s_INTACK_n_last)
|
||||
irq_pending <= 1'b1;
|
||||
else if(s_16FLIP && !s_16FLIP_last)
|
||||
irq_pending <= vcnt_adjust[5];
|
||||
end
|
||||
|
||||
wire sync_phi0 = (sync && s_phi_0);
|
||||
|
||||
// F7, E7
|
||||
always @(posedge clk_10M)
|
||||
begin
|
||||
reg sync_phi0_last;
|
||||
sync_phi0_last <= sync_phi0;
|
||||
if(reset)
|
||||
s_irq_n <= 1'b1;
|
||||
else
|
||||
if(sync_phi0 && !sync_phi0_last) s_irq_n <= irq_pending;
|
||||
end
|
||||
|
||||
// D3 - 7414 - NOT
|
||||
wire s_D3_1 = ~s_phi_0;
|
||||
wire s_D3_3 = s_READWRITE;
|
||||
|
||||
// C3 - 7432 - OR
|
||||
wire s_C3 = s_D3_1 | s_D3_3;
|
||||
|
||||
// C4 - 7432 - OR
|
||||
wire s_C4 = ~hcnt[0] | s_C3;
|
||||
|
||||
assign s_WRITE_n = s_C4;
|
||||
assign s_br_w_n = s_D3_3;
|
||||
|
||||
bc6502 bc6502
|
||||
(
|
||||
.reset(reset),
|
||||
.clk(s_phi_0),
|
||||
.nmi(1'b0),
|
||||
.irq(~s_irq_n),
|
||||
.rdy(~pause),
|
||||
.so(1'b0),
|
||||
.di(s_db_in),
|
||||
.dout(s_db_out),
|
||||
.rw(s_READWRITE),
|
||||
.ma(s_addr),
|
||||
.rw_nxt(),
|
||||
.ma_nxt(),
|
||||
.sync(sync),
|
||||
.state(),
|
||||
.flags()
|
||||
);
|
||||
|
||||
assign s_phi_2 = ~s_phi_0;
|
||||
|
||||
|
||||
endmodule
|
||||
648
Arcade_MiST/Atari MissileCommand/rtl/missile.v
Normal file
648
Arcade_MiST/Atari MissileCommand/rtl/missile.v
Normal file
@@ -0,0 +1,648 @@
|
||||
/*============================================================================
|
||||
Missile Command for MiSTer FPGA - Main core
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Copyright (C) 2022 - Jim Gregory - https://github.com/JimmyStones/
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`timescale 1 ps / 1 ps
|
||||
`default_nettype none
|
||||
|
||||
module missile(
|
||||
input clk_10M,
|
||||
input ce_5M,
|
||||
input reset,
|
||||
input pause,
|
||||
|
||||
input vtb_dir1,
|
||||
input vtb_clk1,
|
||||
input htb_dir1,
|
||||
input htb_clk1,
|
||||
|
||||
input vtb_dir2,
|
||||
input vtb_clk2,
|
||||
input htb_dir2,
|
||||
input htb_clk2,
|
||||
|
||||
input coin,
|
||||
input p1_start,
|
||||
input p2_start,
|
||||
|
||||
input p1_fire_l,
|
||||
input p1_fire_c,
|
||||
input p1_fire_r,
|
||||
input p2_fire_l,
|
||||
input p2_fire_c,
|
||||
input p2_fire_r,
|
||||
|
||||
input [7:0] in2,
|
||||
input [7:0] switches,
|
||||
|
||||
input self_test,
|
||||
input slam,
|
||||
|
||||
output flip,
|
||||
|
||||
output r,
|
||||
output g,
|
||||
output b,
|
||||
|
||||
output h_sync/*verilator public_flat*/,
|
||||
output v_sync/*verilator public_flat*/,
|
||||
output h_blank/*verilator public_flat*/,
|
||||
output v_blank/*verilator public_flat*/,
|
||||
|
||||
output [5:0] audio_o,
|
||||
|
||||
input [15:0] dn_addr,
|
||||
input [7:0] dn_data,
|
||||
input dn_wr,
|
||||
|
||||
|
||||
input [13:0] hs_address,
|
||||
input [7:0] hs_data_in,
|
||||
output [7:0] hs_data_out,
|
||||
input hs_write,
|
||||
input hs_access
|
||||
);
|
||||
|
||||
|
||||
|
||||
//// SHARED SIGNALS
|
||||
|
||||
wire [8:0] hcnt;
|
||||
wire [7:0] vcnt;
|
||||
wire sync;
|
||||
wire s_phi_0;
|
||||
wire s_phi_2;
|
||||
wire s_phi_x;
|
||||
reg s_phi_extend = 1'b0;
|
||||
wire s_3INH;
|
||||
wire s_irq_n;
|
||||
wire s_READWRITE;
|
||||
wire s_WRITE_n;
|
||||
wire s_br_w_n;
|
||||
wire [15:0] s_addr /* synthesis preserve */;
|
||||
wire [7:0] s_pgrom0_out/* synthesis preserve */;
|
||||
wire [7:0] s_pgrom1_out/* synthesis preserve */;
|
||||
wire [7:0] s_pgrom2_out/* synthesis preserve */;
|
||||
wire [7:0] s_db_in/* synthesis preserve */;
|
||||
wire [7:0] s_db_out/* synthesis preserve */;
|
||||
wire [7:0] s_pokey_out/* synthesis preserve */;
|
||||
wire s_16FLIP;
|
||||
wire s_INTACK_n;
|
||||
reg s_MADSEL = 1'b0;
|
||||
reg s_MADSELDEL = 1'b0;
|
||||
reg s_MUSHROOM = 1'b0;
|
||||
wire [2:0] s_PROGSEL_n;
|
||||
wire s_RAM_n;
|
||||
wire s_POKEY_n;
|
||||
wire s_NIO_n;
|
||||
wire s_WDOG_n;
|
||||
wire s_COLRAM_n;
|
||||
wire s_OUT_n;
|
||||
|
||||
////////////////////////
|
||||
///// SYNC CIRCUIT /////
|
||||
////////////////////////
|
||||
|
||||
sync sync_circuit(
|
||||
.clk_10M(clk_10M),
|
||||
.ce_5M(ce_5M),
|
||||
.reset(reset),
|
||||
.flip(s_FLIP),
|
||||
.h_blank(h_blank),
|
||||
.h_sync(h_sync),
|
||||
.v_blank(v_blank),
|
||||
.v_sync(v_sync),
|
||||
.s_phi_x(s_phi_x),
|
||||
.s_3INH(s_3INH),
|
||||
.hcnt(hcnt),
|
||||
.vcnt(vcnt)
|
||||
);
|
||||
|
||||
|
||||
//////////////////////////////////
|
||||
///// MICROPROCESSOR CIRCUIT /////
|
||||
//////////////////////////////////
|
||||
|
||||
micro mp(
|
||||
.clk_10M(clk_10M),
|
||||
.s_phi_x(s_phi_x),
|
||||
.s_phi_extend(s_phi_extend),
|
||||
.reset(reset),
|
||||
.pause(pause),
|
||||
.flip(s_FLIP),
|
||||
.hcnt(hcnt),
|
||||
.vcnt(vcnt),
|
||||
.s_db_in(s_db_in),
|
||||
.sync(sync),
|
||||
.s_phi_2(s_phi_2),
|
||||
.s_phi_0(s_phi_0),
|
||||
.s_irq_n(s_irq_n),
|
||||
.s_READWRITE(s_READWRITE),
|
||||
.s_WRITE_n(s_WRITE_n),
|
||||
.s_br_w_n(s_br_w_n),
|
||||
.s_16FLIP(s_16FLIP),
|
||||
.s_INTACK_n(s_INTACK_n),
|
||||
.s_addr(s_addr),
|
||||
.s_db_out(s_db_out)
|
||||
);
|
||||
|
||||
|
||||
///////////////////////////////
|
||||
///// ADDRESS DECODING ////////
|
||||
// Page 1, Side B, Top right //
|
||||
///////////////////////////////
|
||||
|
||||
wire [9:0] s_N2;
|
||||
wire s_N3;
|
||||
|
||||
// N2 - 7442 address decoder
|
||||
// -------------------------
|
||||
ls42 N2 (
|
||||
.a(s_addr[12]),
|
||||
.b(s_addr[13]),
|
||||
.c(s_addr[14]),
|
||||
.d(s_MADSELDEL),
|
||||
.o(s_N2)
|
||||
);
|
||||
|
||||
assign s_PROGSEL_n = s_N2[7:5];
|
||||
assign s_N3 = s_N2[1] & s_N2[2] & s_N2[3];
|
||||
assign s_RAM_n = s_N3 & s_N2[0];
|
||||
assign s_POKEY_n = s_addr[11] | s_N2[4];
|
||||
assign s_NIO_n = (~s_addr[11]) | s_N2[4];
|
||||
|
||||
// E8 - 7442 address decoder
|
||||
// ----------------------------------
|
||||
wire s_mem_write = ~(s_WRITE_n | s_NIO_n);
|
||||
assign s_OUT_n = ~(s_mem_write && s_addr[15:8] == 8'b01001000);
|
||||
assign s_COLRAM_n = ~(s_mem_write && s_addr[15:8] == 8'b01001011);
|
||||
assign s_WDOG_n = ~(s_mem_write && (s_addr == 16'h4C00));
|
||||
assign s_INTACK_n = ~(s_mem_write && (s_addr == 16'h4D00));
|
||||
|
||||
// ROM upload enables
|
||||
// ----------------------------------
|
||||
wire dn_pgrom0_we = (dn_addr[13:12] == 2'b00) & dn_wr;
|
||||
wire dn_pgrom1_we = (dn_addr[13:12] == 2'b01) & dn_wr;
|
||||
wire dn_pgrom2_we = (dn_addr[13:12] == 2'b10) & dn_wr;
|
||||
wire dn_L6_prom_we = (dn_addr[15:12] == 4'b0011) & dn_wr;
|
||||
wire [4:0] dn_L6_prom_addr = dn_addr[4:0];
|
||||
|
||||
// Simplified address decodes for inputs
|
||||
// ----------------------------------
|
||||
// IN0 $4800-$48FF
|
||||
wire in0_cs = s_addr[14:8] == 7'b1001000;
|
||||
// IN1 $4900-$49FF
|
||||
wire in1_cs = s_addr[14:8] == 7'b1001001;
|
||||
// IN2 $4A00-$4AFF
|
||||
wire in2_cs = s_addr[14:8] == 7'b1001010;
|
||||
|
||||
assign s_db_in = ~s_PROGSEL_n[0] ? s_pgrom0_out :
|
||||
~s_PROGSEL_n[1] ? s_pgrom1_out :
|
||||
~s_PROGSEL_n[2] ? s_pgrom2_out :
|
||||
s_MADSEL ? s_VRAM_in :
|
||||
~s_POKEY_n ? s_pokey_out :
|
||||
~s_RAM_n ? vram_data_out :
|
||||
in0_cs ? in0 :
|
||||
in1_cs ? in1 :
|
||||
in2_cs ? in2 :
|
||||
~s_COLRAM_n ? { 4'b0, s_cram_out} :
|
||||
8'bXXXXXXXX;
|
||||
|
||||
localparam debug_counter_width = 20;
|
||||
|
||||
reg [debug_counter_width-1:0] debug_counter = {debug_counter_width{1'b0}};
|
||||
wire debug_data/*verilator public_flat*/;
|
||||
|
||||
|
||||
//////////////////////////////////
|
||||
///// PROGRAM MEMORY CIRCUIT /////
|
||||
//////////////////////////////////
|
||||
|
||||
//dpram #(12,8) pgrom0
|
||||
//(
|
||||
// .clock(clk_10M),
|
||||
//
|
||||
// .enable_a(dn_pgrom0_we),
|
||||
// .wren_a(dn_pgrom0_we),
|
||||
// .address_a(dn_addr[11:0]),
|
||||
// .data_a(dn_data),
|
||||
// .q_a(),
|
||||
//
|
||||
// .enable_b(1'b1),
|
||||
// .wren_b(1'b0),
|
||||
// .address_b(s_addr[11:0]),
|
||||
// .data_b(),
|
||||
// .q_b(s_pgrom0_out)
|
||||
//);
|
||||
|
||||
rom1 rom1(
|
||||
.clk(clk_10M),
|
||||
.addr(s_addr[11:0]),
|
||||
.data(s_pgrom0_out)
|
||||
);
|
||||
|
||||
//dpram #(12,8) pgrom1
|
||||
//(
|
||||
// .clock(clk_10M),
|
||||
//
|
||||
// .enable_a(dn_pgrom1_we),
|
||||
// .wren_a(dn_pgrom1_we),
|
||||
// .address_a(dn_addr[11:0]),
|
||||
// .data_a(dn_data),
|
||||
// .q_a(),
|
||||
//
|
||||
// .enable_b(1'b1),
|
||||
// .wren_b(1'b0),
|
||||
// .address_b(s_addr[11:0]),
|
||||
// .data_b(),
|
||||
// .q_b(s_pgrom1_out)
|
||||
//);
|
||||
|
||||
rom2 rom2(
|
||||
.clk(clk_10M),
|
||||
.addr(s_addr[11:0]),
|
||||
.data(s_pgrom1_out)
|
||||
);
|
||||
|
||||
//dpram #(12,8) pgrom2
|
||||
//(
|
||||
// .clock(clk_10M),
|
||||
//
|
||||
// .enable_a(dn_pgrom2_we),
|
||||
// .wren_a(dn_pgrom2_we),
|
||||
// .address_a(dn_addr[11:0]),
|
||||
// .data_a(dn_data),
|
||||
// .q_a(),
|
||||
//
|
||||
// .enable_b(1'b1),
|
||||
// .wren_b(1'b0),
|
||||
// .address_b(s_addr[11:0]),
|
||||
// .data_b(),
|
||||
// .q_b(s_pgrom2_out)
|
||||
//);
|
||||
|
||||
rom3 rom3(
|
||||
.clk(clk_10M),
|
||||
.addr(s_addr[11:0]),
|
||||
.data(s_pgrom2_out)
|
||||
);
|
||||
|
||||
////////////////
|
||||
///// DRAM /////
|
||||
////////////////
|
||||
|
||||
wire [7:0] s_VRAM;
|
||||
reg [7:0] s_VRAM_in = 8'b0;
|
||||
wire [13:0] vram_addr = hs_access ? hs_address : dead_cpu;
|
||||
wire [7:0] vram_we_n = hs_access ? ~{8{hs_write}} : s_WP_n;
|
||||
wire [7:0] vram_data_in = hs_access ? hs_data_in : s_MD;
|
||||
wire [7:0] vram_data_out;
|
||||
|
||||
assign hs_data_out = vram_data_out;
|
||||
|
||||
dpvram #(14,8) ram
|
||||
(
|
||||
.clock_a(clk_10M),
|
||||
.wren_a(vram_we_n),
|
||||
.address_a(vram_addr),
|
||||
.data_a(vram_data_in),
|
||||
.q_a(vram_data_out),
|
||||
|
||||
.clock_b(clk_10M),
|
||||
.address_b(dead_vid),
|
||||
.q_b(s_VRAM)
|
||||
);
|
||||
|
||||
///////////////////////////////
|
||||
//// DRAM ADDRESS SELECTOR ////
|
||||
// Page 2, Side A, Top left ///
|
||||
///////////////////////////////
|
||||
|
||||
// When an instruction matching the bit pattern xxx00001 syncs and no IRQ is underway, start the MADSEL countdown
|
||||
// - This should send MADSEL high ready for the read/write 5 cycles later
|
||||
reg [3:0] MADSEL_count = 4'b0;
|
||||
always @(posedge s_phi_0)
|
||||
begin
|
||||
if(s_db_in[4:0] == 5'b00001 && s_irq_n && sync) MADSEL_count <= 4'd3;
|
||||
|
||||
if(MADSEL_count > 4'd0)
|
||||
begin
|
||||
MADSEL_count <= MADSEL_count - 4'b1;
|
||||
if(MADSEL_count == 4'd1) s_MADSEL <= 1'b1;
|
||||
end
|
||||
else
|
||||
s_MADSEL <= 1'b0;
|
||||
end
|
||||
|
||||
///////////////////////////////
|
||||
/// 3RD COLOUR BIT SELECTOR ///
|
||||
/// Page 2, Side A, Top mid //
|
||||
///////////////////////////////
|
||||
|
||||
// Latch PHI EXTEND signal when MADSEL active and 3rd colour bit area is addressed
|
||||
always @(posedge clk_10M)
|
||||
begin
|
||||
if(s_phi_x)
|
||||
begin
|
||||
if(s_MADSEL & s_addr[15:13] == 3'b111) s_phi_extend <= 1'b1;
|
||||
end
|
||||
else
|
||||
begin
|
||||
s_phi_extend <= 1'b0;
|
||||
end
|
||||
end
|
||||
|
||||
// Latch PHI EXTEND into MUSHROOM on next falling edge of PHI X
|
||||
always @(negedge clk_10M)
|
||||
begin
|
||||
reg s_phi_x_last;
|
||||
s_phi_x_last <= s_phi_x;
|
||||
if(!s_phi_x && s_phi_x_last) s_MUSHROOM <= s_phi_extend;
|
||||
end
|
||||
|
||||
////////////////////////////////
|
||||
// DRAM PICTURE OUTPUT ENABLE //
|
||||
// Page 2, Side A, Top right ///
|
||||
////////////////////////////////
|
||||
always @(posedge clk_10M)
|
||||
begin
|
||||
reg ce_5M_last;
|
||||
ce_5M_last <= ce_5M;
|
||||
if(ce_5M && !ce_5M_last) s_MADSELDEL <= s_MADSEL;
|
||||
end
|
||||
|
||||
////////////////////////////////
|
||||
// DRAM ADDRESS CONTROLLER /////
|
||||
// Page 2, Side A, Lower left //
|
||||
////////////////////////////////
|
||||
|
||||
wire [1:0] s_MADSEL_mode = {s_MUSHROOM, s_MADSEL};
|
||||
|
||||
wire [13:0] dead_cpu_2col = s_addr[15:2];
|
||||
wire [13:0] dead_cpu_3col = { 3'b0, s_addr[11], ~s_addr[11], s_addr[10:3], s_addr[12] };
|
||||
wire [13:0] dead_cpu = s_MADSEL_mode == 2'b00 ? s_addr[13:0] : // Standard RAM addressing
|
||||
s_MADSEL_mode == 2'b01 ? dead_cpu_2col : // 2 colour VRAM addressing
|
||||
s_MADSEL_mode == 2'b11 ? dead_cpu_3col : // 3 colour VRAM addressing
|
||||
14'h00;
|
||||
reg [13:0] dead_vid = 14'b0;
|
||||
|
||||
reg s_phi_0_last = 1'b0;
|
||||
always @(posedge clk_10M)
|
||||
begin
|
||||
s_phi_0_last <= s_phi_0;
|
||||
|
||||
// CPU only reads VRAM data when MADSEL is high
|
||||
if(s_MADSEL)
|
||||
begin
|
||||
if(s_MUSHROOM)
|
||||
begin
|
||||
// Latch 3rd colour bit data from VRAM when MUSHROOM is high (last 32 lines)
|
||||
s_VRAM_in[5] <= vram_data_out[s_addr[2:0]];
|
||||
end
|
||||
else
|
||||
begin
|
||||
if(ce_5M)
|
||||
begin
|
||||
// Latch 2 colour bits from VRAM when MUSHROOM is low
|
||||
s_VRAM_in[7] <= vram_data_out[s_addr[1:0]+4];
|
||||
s_VRAM_in[6] <= vram_data_out[s_addr[1:0]+0];
|
||||
end
|
||||
end
|
||||
end
|
||||
else
|
||||
begin
|
||||
// Clear VRAM data when MADSEL is low
|
||||
if(s_phi_0 && !s_phi_0_last) s_VRAM_in <= 8'hFF;
|
||||
end
|
||||
end
|
||||
|
||||
|
||||
// L6 PROM (DRAM write mask)
|
||||
wire [7:0] s_L6;
|
||||
//dpram #(5,8) L6
|
||||
//(
|
||||
// // a - download from HPS
|
||||
// .clock(clk_10M),
|
||||
//
|
||||
// .enable_a(dn_L6_prom_we),
|
||||
// .wren_a(dn_L6_prom_we),
|
||||
// .address_a(dn_L6_prom_addr),
|
||||
// .data_a(dn_data),
|
||||
// .q_a(),
|
||||
//
|
||||
// .enable_b(1'b1),
|
||||
// .address_b({s_MADSEL, s_MUSHROOM, s_addr[2:0]}),
|
||||
// .data_b(),
|
||||
// .wren_b(),
|
||||
// .q_b(s_L6)
|
||||
//);
|
||||
|
||||
L6 L6(
|
||||
.clk(clk_10M),
|
||||
.addr({s_MADSEL, s_MUSHROOM, s_addr[2:0]}),
|
||||
.data(s_L6)
|
||||
);
|
||||
|
||||
wire s_MADSEL_write = (s_MADSEL & ~s_br_w_n & hcnt[0]);
|
||||
wire s_RAM_write = (~s_RAM_n & ~s_br_w_n);
|
||||
wire [7:0] s_WP_n = ~(s_MADSEL ? (s_MADSEL_write ? ~s_L6 : 8'h00) : s_RAM_write ? 8'hFF : 8'h00);
|
||||
|
||||
// DRAM DATA INPUT SELECTOR
|
||||
reg [7:0] s_MD = 8'b0;
|
||||
always @(posedge clk_10M)
|
||||
begin
|
||||
case ({s_MUSHROOM, s_MADSEL})
|
||||
2'b00 : s_MD = s_db_out[7:0];
|
||||
2'b01 : s_MD = {{4{s_db_out[7]}}, {4{s_db_out[6]}}};
|
||||
2'b11 : s_MD = {8{s_db_out[5]}};
|
||||
default : s_MD = 8'b0;
|
||||
endcase
|
||||
end
|
||||
|
||||
/// PICTURE BIT CONVERTER
|
||||
wire [2:0] s_COLNUM;
|
||||
reg [3:0] s_N7 = 4'b0;
|
||||
reg [3:0] s_M6 = 4'b0;
|
||||
reg [7:0] s_P6 = 8'b0;
|
||||
|
||||
// This part diverges from the original schematics quite a bit.
|
||||
// We need to offset the lookups to give the BRAM enough time to return colour index data then look it up in the paletta RAM
|
||||
// I'm sure this could be better but I'm scared to touch it because it works!
|
||||
wire [8:0] hcnt_off_2col = h_blank ? (hcnt + 8'd192) : hcnt + 8'd4;
|
||||
wire [8:0] hcnt_off_3col = h_blank ? (hcnt + 8'd192) : hcnt + 8'd8;
|
||||
wire [8:0] hcnt_address_2col = h_blank ? ((hcnt == 9'd319) ? 9'd4 : 9'd0): (hcnt + 8'd4);
|
||||
wire [8:0] hcnt_address_3col = h_blank ? ((hcnt == 9'd319) ? 9'd4 : 9'd0): (hcnt + 8'd2);
|
||||
|
||||
reg [7:0] vram_2col = 8'b0;
|
||||
wire [1:0] pixel_index_2col = hcnt_off_2col[1:0];
|
||||
wire [2:0] pixel_index_3col = hcnt_off_3col[2:0];
|
||||
|
||||
always @(posedge clk_10M)
|
||||
begin
|
||||
//$display("%d)\tVID: ce5=%b hcnt=%d hco2=%d hco3=%d pi2=%d pi3=%d vcnt=%d hb=%b vb=%b dead_vid=%x colnum=%x", debug_counter, ce_5M, hcnt, hcnt_off_2col, hcnt_off_3col, pixel_index_2col, pixel_index_3col, vcnt, h_blank, v_blank, dead_vid, s_COLNUM);
|
||||
|
||||
// 2 Colour bits
|
||||
// - Set read address 3 10Mhz cycles before ce_5M goes high
|
||||
// - Latch data 2 10Mhz cycles before ce_5M goes high
|
||||
// - Select 2 bit colour index 1 10Mhz cycle before ce_5M goes high
|
||||
// - Shift data right every 5Mhz cycle except load cycle
|
||||
|
||||
// 1st 2 colour bits
|
||||
|
||||
// Set address to read 2 colour bits data from VRAM
|
||||
if(pixel_index_2col == 2'd2 && ce_5M) dead_vid <= {vcnt[7:0], hcnt_address_2col[7:2]};
|
||||
|
||||
// Latch 3rd colour bit data from VRAM
|
||||
if(pixel_index_2col == 2'd3 && ~ce_5M) vram_2col <= s_VRAM;
|
||||
|
||||
// Load 2 colour bits data from latch
|
||||
if(pixel_index_2col == 2'd3 && ce_5M)
|
||||
begin
|
||||
s_N7 <= vram_2col[7:4];
|
||||
s_M6 <= vram_2col[3:0];
|
||||
end
|
||||
|
||||
// Shift 2 colour bits data along
|
||||
if(pixel_index_2col != 2'd3 && ce_5M)
|
||||
begin
|
||||
s_N7 <= s_N7 >> 1;
|
||||
s_M6 <= s_M6 >> 1;
|
||||
end
|
||||
|
||||
// 3rd colour bit
|
||||
if(~s_3INH)
|
||||
begin
|
||||
// Clear 3rd colour bit if we are outside the last 32 lines
|
||||
s_P6 <= 8'h00;
|
||||
end
|
||||
else
|
||||
begin
|
||||
|
||||
// Set address to read 3rd colour bit data from VRAM
|
||||
if(pixel_index_3col == 3'd7 && ~ce_5M) dead_vid <= { 3'b0, vcnt[3], ~vcnt[3], vcnt[2:0], hcnt_address_3col[7:3], vcnt[4] };
|
||||
|
||||
// Load 3rd colour bit data from VRAM
|
||||
if(pixel_index_3col == 3'd7 && ce_5M) s_P6 <= s_VRAM;
|
||||
|
||||
// Shift 3rd colour bit data along
|
||||
if(pixel_index_3col != 3'd7 && ce_5M) s_P6 <= s_P6 >> 1;
|
||||
end
|
||||
end
|
||||
|
||||
assign s_COLNUM = {s_N7[0],s_M6[0],s_P6[0]};
|
||||
|
||||
reg [2:0] rgbtemp = 0;
|
||||
assign r = rgbtemp[2];
|
||||
assign g = rgbtemp[1];
|
||||
assign b = rgbtemp[0];
|
||||
|
||||
/// COLOR RAM
|
||||
wire [2:0] s_M7 = ~v_blank ? s_COLNUM[2:0] : s_addr[2:0];
|
||||
wire [3:0] s_cram_out;
|
||||
wire s_cram_we = ~s_COLRAM_n && v_blank;
|
||||
|
||||
spram #(3,4) L7 (
|
||||
.clock(clk_10M),
|
||||
.address(s_M7[2:0]),
|
||||
.data(s_MD[3:0]),
|
||||
.wren(s_cram_we),
|
||||
.q(s_cram_out)
|
||||
);
|
||||
|
||||
// Latch RGB out from colour ram
|
||||
always @(posedge clk_10M)
|
||||
begin
|
||||
if(ce_5M) rgbtemp <= (~h_blank && ~v_blank) ? ~s_cram_out[3:1] : 3'b0;
|
||||
end
|
||||
|
||||
// POKEY
|
||||
wire s_J7 = s_phi_2 | hcnt[1];
|
||||
|
||||
wire [3:0] pokey_ch0, pokey_ch1, pokey_ch2, pokey_ch3;
|
||||
pokey pokey(
|
||||
.clk(s_J7),
|
||||
.enable_179(1'b1),
|
||||
.addr(s_addr[3:0]),
|
||||
.data_in(s_db_out),
|
||||
.wr_en(~s_br_w_n & ~s_POKEY_n),
|
||||
.reset_n(~reset),
|
||||
.data_out(s_pokey_out),
|
||||
.pot_in(switches),
|
||||
.channel_0_out(pokey_ch0),
|
||||
.channel_1_out(pokey_ch1),
|
||||
.channel_2_out(pokey_ch2),
|
||||
.channel_3_out(pokey_ch3)
|
||||
);
|
||||
assign audio_o = ({1'b0,pokey_ch0,1'b0}+{1'b0,pokey_ch1,1'b0})+({1'b0,pokey_ch2,1'b0}+{1'b0,pokey_ch3,1'b0});
|
||||
|
||||
|
||||
// Outputs
|
||||
// -------
|
||||
reg [7:0] s_F9 = 8'b0;
|
||||
always @(posedge s_OUT_n or posedge reset) // F9 latch
|
||||
begin
|
||||
s_F9 <= reset ? 8'b0 : s_db_out;
|
||||
end
|
||||
|
||||
//wire s_FLIP = s_F9[6];
|
||||
wire s_FLIP = 1'b1;
|
||||
wire s_CTRLD_n = s_F9[0];
|
||||
assign flip = s_FLIP;
|
||||
|
||||
// Inputs
|
||||
// ------
|
||||
wire [7:0] in0 = !s_CTRLD_n ? { ~coin, 2'b11, ~p1_start, ~p2_start, ~p2_fire_l, ~p2_fire_c, ~p2_fire_r } : {tb_count_v, tb_count_h};
|
||||
wire [7:0] in1 = { v_blank, ~self_test, ~slam, 1'b1, 1'b1, ~p1_fire_l, ~p1_fire_c, ~p1_fire_r };
|
||||
|
||||
wire tb_dir_v, tb_clk_v, tb_dir_h, tb_clk_h;
|
||||
reg [3:0] tb_count_v;
|
||||
reg [3:0] tb_count_h;
|
||||
|
||||
assign {tb_dir_v, tb_clk_v, tb_dir_h, tb_clk_h} = { vtb_dir1, vtb_clk1, htb_dir1, htb_clk1 };
|
||||
// assign {tb_dir_v, tb_clk_v, tb_dir_h, tb_clk_h} = (flip_n == 0) ? { vtb_dir1, vtb_clk1, htb_dir1, htb_clk1 } :
|
||||
// { vtb_dir2, vtb_clk2, htb_dir2, htb_clk2 };
|
||||
|
||||
always @(posedge clk_10M)
|
||||
begin
|
||||
reg tb_clk_v_last;
|
||||
reg tb_clk_h_last;
|
||||
tb_clk_v_last <= tb_clk_v;
|
||||
tb_clk_h_last <= tb_clk_h;
|
||||
|
||||
if (s_CTRLD_n)
|
||||
begin
|
||||
if(tb_clk_v && !tb_clk_v_last)
|
||||
begin
|
||||
if (!tb_dir_v)
|
||||
tb_count_v <= tb_count_v + 4'b1;
|
||||
else
|
||||
tb_count_v <= tb_count_v - 4'b1;
|
||||
end
|
||||
|
||||
if(tb_clk_h && !tb_clk_h_last)
|
||||
begin
|
||||
if (!tb_dir_h)
|
||||
tb_count_h <= tb_count_h + 4'b1;
|
||||
else
|
||||
tb_count_h <= tb_count_h - 4'b1;
|
||||
end
|
||||
end
|
||||
end
|
||||
|
||||
|
||||
endmodule
|
||||
376
Arcade_MiST/Atari MissileCommand/rtl/pll_mist.v
Normal file
376
Arcade_MiST/Atari MissileCommand/rtl/pll_mist.v
Normal file
@@ -0,0 +1,376 @@
|
||||
// megafunction wizard: %ALTPLL%
|
||||
// GENERATION: STANDARD
|
||||
// VERSION: WM1.0
|
||||
// MODULE: altpll
|
||||
|
||||
// ============================================================
|
||||
// File Name: pll_mist.v
|
||||
// Megafunction Name(s):
|
||||
// altpll
|
||||
//
|
||||
// Simulation Library Files(s):
|
||||
// altera_mf
|
||||
// ============================================================
|
||||
// ************************************************************
|
||||
// THIS IS A WIZARD-GENERATED FILE. DO NOT EDIT THIS FILE!
|
||||
//
|
||||
// 13.1.4 Build 182 03/12/2014 SJ Full Version
|
||||
// ************************************************************
|
||||
|
||||
|
||||
//Copyright (C) 1991-2014 Altera Corporation
|
||||
//Your use of Altera Corporation's design tools, logic functions
|
||||
//and other software and tools, and its AMPP partner logic
|
||||
//functions, and any output files from any of the foregoing
|
||||
//(including device programming or simulation files), and any
|
||||
//associated documentation or information are expressly subject
|
||||
//to the terms and conditions of the Altera Program License
|
||||
//Subscription Agreement, Altera MegaCore Function License
|
||||
//Agreement, or other applicable license agreement, including,
|
||||
//without limitation, that your use is for the sole purpose of
|
||||
//programming logic devices manufactured by Altera and sold by
|
||||
//Altera or its authorized distributors. Please refer to the
|
||||
//applicable agreement for further details.
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||||
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||||
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||||
// synopsys translate_off
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||||
`timescale 1 ps / 1 ps
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||||
// synopsys translate_on
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||||
module pll_mist (
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||||
areset,
|
||||
inclk0,
|
||||
c0,
|
||||
c1,
|
||||
c2,
|
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locked);
|
||||
|
||||
input areset;
|
||||
input inclk0;
|
||||
output c0;
|
||||
output c1;
|
||||
output c2;
|
||||
output locked;
|
||||
`ifndef ALTERA_RESERVED_QIS
|
||||
// synopsys translate_off
|
||||
`endif
|
||||
tri0 areset;
|
||||
`ifndef ALTERA_RESERVED_QIS
|
||||
// synopsys translate_on
|
||||
`endif
|
||||
|
||||
wire [4:0] sub_wire0;
|
||||
wire sub_wire2;
|
||||
wire [0:0] sub_wire7 = 1'h0;
|
||||
wire [2:2] sub_wire4 = sub_wire0[2:2];
|
||||
wire [0:0] sub_wire3 = sub_wire0[0:0];
|
||||
wire [1:1] sub_wire1 = sub_wire0[1:1];
|
||||
wire c1 = sub_wire1;
|
||||
wire locked = sub_wire2;
|
||||
wire c0 = sub_wire3;
|
||||
wire c2 = sub_wire4;
|
||||
wire sub_wire5 = inclk0;
|
||||
wire [1:0] sub_wire6 = {sub_wire7, sub_wire5};
|
||||
|
||||
altpll altpll_component (
|
||||
.areset (areset),
|
||||
.inclk (sub_wire6),
|
||||
.clk (sub_wire0),
|
||||
.locked (sub_wire2),
|
||||
.activeclock (),
|
||||
.clkbad (),
|
||||
.clkena ({6{1'b1}}),
|
||||
.clkloss (),
|
||||
.clkswitch (1'b0),
|
||||
.configupdate (1'b0),
|
||||
.enable0 (),
|
||||
.enable1 (),
|
||||
.extclk (),
|
||||
.extclkena ({4{1'b1}}),
|
||||
.fbin (1'b1),
|
||||
.fbmimicbidir (),
|
||||
.fbout (),
|
||||
.fref (),
|
||||
.icdrclk (),
|
||||
.pfdena (1'b1),
|
||||
.phasecounterselect ({4{1'b1}}),
|
||||
.phasedone (),
|
||||
.phasestep (1'b1),
|
||||
.phaseupdown (1'b1),
|
||||
.pllena (1'b1),
|
||||
.scanaclr (1'b0),
|
||||
.scanclk (1'b0),
|
||||
.scanclkena (1'b1),
|
||||
.scandata (1'b0),
|
||||
.scandataout (),
|
||||
.scandone (),
|
||||
.scanread (1'b0),
|
||||
.scanwrite (1'b0),
|
||||
.sclkout0 (),
|
||||
.sclkout1 (),
|
||||
.vcooverrange (),
|
||||
.vcounderrange ());
|
||||
defparam
|
||||
altpll_component.bandwidth_type = "AUTO",
|
||||
altpll_component.clk0_divide_by = 27,
|
||||
altpll_component.clk0_duty_cycle = 50,
|
||||
altpll_component.clk0_multiply_by = 20,
|
||||
altpll_component.clk0_phase_shift = "0",
|
||||
altpll_component.clk1_divide_by = 27,
|
||||
altpll_component.clk1_duty_cycle = 50,
|
||||
altpll_component.clk1_multiply_by = 10,
|
||||
altpll_component.clk1_phase_shift = "0",
|
||||
altpll_component.clk2_divide_by = 27,
|
||||
altpll_component.clk2_duty_cycle = 50,
|
||||
altpll_component.clk2_multiply_by = 5,
|
||||
altpll_component.clk2_phase_shift = "0",
|
||||
altpll_component.compensate_clock = "CLK0",
|
||||
altpll_component.inclk0_input_frequency = 37037,
|
||||
altpll_component.intended_device_family = "Cyclone III",
|
||||
altpll_component.lpm_hint = "CBX_MODULE_PREFIX=pll_mist",
|
||||
altpll_component.lpm_type = "altpll",
|
||||
altpll_component.operation_mode = "NORMAL",
|
||||
altpll_component.pll_type = "AUTO",
|
||||
altpll_component.port_activeclock = "PORT_UNUSED",
|
||||
altpll_component.port_areset = "PORT_USED",
|
||||
altpll_component.port_clkbad0 = "PORT_UNUSED",
|
||||
altpll_component.port_clkbad1 = "PORT_UNUSED",
|
||||
altpll_component.port_clkloss = "PORT_UNUSED",
|
||||
altpll_component.port_clkswitch = "PORT_UNUSED",
|
||||
altpll_component.port_configupdate = "PORT_UNUSED",
|
||||
altpll_component.port_fbin = "PORT_UNUSED",
|
||||
altpll_component.port_inclk0 = "PORT_USED",
|
||||
altpll_component.port_inclk1 = "PORT_UNUSED",
|
||||
altpll_component.port_locked = "PORT_USED",
|
||||
altpll_component.port_pfdena = "PORT_UNUSED",
|
||||
altpll_component.port_phasecounterselect = "PORT_UNUSED",
|
||||
altpll_component.port_phasedone = "PORT_UNUSED",
|
||||
altpll_component.port_phasestep = "PORT_UNUSED",
|
||||
altpll_component.port_phaseupdown = "PORT_UNUSED",
|
||||
altpll_component.port_pllena = "PORT_UNUSED",
|
||||
altpll_component.port_scanaclr = "PORT_UNUSED",
|
||||
altpll_component.port_scanclk = "PORT_UNUSED",
|
||||
altpll_component.port_scanclkena = "PORT_UNUSED",
|
||||
altpll_component.port_scandata = "PORT_UNUSED",
|
||||
altpll_component.port_scandataout = "PORT_UNUSED",
|
||||
altpll_component.port_scandone = "PORT_UNUSED",
|
||||
altpll_component.port_scanread = "PORT_UNUSED",
|
||||
altpll_component.port_scanwrite = "PORT_UNUSED",
|
||||
altpll_component.port_clk0 = "PORT_USED",
|
||||
altpll_component.port_clk1 = "PORT_USED",
|
||||
altpll_component.port_clk2 = "PORT_USED",
|
||||
altpll_component.port_clk3 = "PORT_UNUSED",
|
||||
altpll_component.port_clk4 = "PORT_UNUSED",
|
||||
altpll_component.port_clk5 = "PORT_UNUSED",
|
||||
altpll_component.port_clkena0 = "PORT_UNUSED",
|
||||
altpll_component.port_clkena1 = "PORT_UNUSED",
|
||||
altpll_component.port_clkena2 = "PORT_UNUSED",
|
||||
altpll_component.port_clkena3 = "PORT_UNUSED",
|
||||
altpll_component.port_clkena4 = "PORT_UNUSED",
|
||||
altpll_component.port_clkena5 = "PORT_UNUSED",
|
||||
altpll_component.port_extclk0 = "PORT_UNUSED",
|
||||
altpll_component.port_extclk1 = "PORT_UNUSED",
|
||||
altpll_component.port_extclk2 = "PORT_UNUSED",
|
||||
altpll_component.port_extclk3 = "PORT_UNUSED",
|
||||
altpll_component.self_reset_on_loss_lock = "OFF",
|
||||
altpll_component.width_clock = 5;
|
||||
|
||||
|
||||
endmodule
|
||||
|
||||
// ============================================================
|
||||
// CNX file retrieval info
|
||||
// ============================================================
|
||||
// Retrieval info: PRIVATE: ACTIVECLK_CHECK STRING "0"
|
||||
// Retrieval info: PRIVATE: BANDWIDTH STRING "1.000"
|
||||
// Retrieval info: PRIVATE: BANDWIDTH_FEATURE_ENABLED STRING "1"
|
||||
// Retrieval info: PRIVATE: BANDWIDTH_FREQ_UNIT STRING "MHz"
|
||||
// Retrieval info: PRIVATE: BANDWIDTH_PRESET STRING "Low"
|
||||
// Retrieval info: PRIVATE: BANDWIDTH_USE_AUTO STRING "1"
|
||||
// Retrieval info: PRIVATE: BANDWIDTH_USE_PRESET STRING "0"
|
||||
// Retrieval info: PRIVATE: CLKBAD_SWITCHOVER_CHECK STRING "0"
|
||||
// Retrieval info: PRIVATE: CLKLOSS_CHECK STRING "0"
|
||||
// Retrieval info: PRIVATE: CLKSWITCH_CHECK STRING "0"
|
||||
// Retrieval info: PRIVATE: CNX_NO_COMPENSATE_RADIO STRING "0"
|
||||
// Retrieval info: PRIVATE: CREATE_CLKBAD_CHECK STRING "0"
|
||||
// Retrieval info: PRIVATE: CREATE_INCLK1_CHECK STRING "0"
|
||||
// Retrieval info: PRIVATE: CUR_DEDICATED_CLK STRING "c0"
|
||||
// Retrieval info: PRIVATE: CUR_FBIN_CLK STRING "c0"
|
||||
// Retrieval info: PRIVATE: DEVICE_SPEED_GRADE STRING "8"
|
||||
// Retrieval info: PRIVATE: DIV_FACTOR0 NUMERIC "27"
|
||||
// Retrieval info: PRIVATE: DIV_FACTOR1 NUMERIC "27"
|
||||
// Retrieval info: PRIVATE: DIV_FACTOR2 NUMERIC "27"
|
||||
// Retrieval info: PRIVATE: DUTY_CYCLE0 STRING "50.00000000"
|
||||
// Retrieval info: PRIVATE: DUTY_CYCLE1 STRING "50.00000000"
|
||||
// Retrieval info: PRIVATE: DUTY_CYCLE2 STRING "50.00000000"
|
||||
// Retrieval info: PRIVATE: EFF_OUTPUT_FREQ_VALUE0 STRING "20.000000"
|
||||
// Retrieval info: PRIVATE: EFF_OUTPUT_FREQ_VALUE1 STRING "10.000000"
|
||||
// Retrieval info: PRIVATE: EFF_OUTPUT_FREQ_VALUE2 STRING "5.000000"
|
||||
// Retrieval info: PRIVATE: EXPLICIT_SWITCHOVER_COUNTER STRING "0"
|
||||
// Retrieval info: PRIVATE: EXT_FEEDBACK_RADIO STRING "0"
|
||||
// Retrieval info: PRIVATE: GLOCKED_COUNTER_EDIT_CHANGED STRING "1"
|
||||
// Retrieval info: PRIVATE: GLOCKED_FEATURE_ENABLED STRING "0"
|
||||
// Retrieval info: PRIVATE: GLOCKED_MODE_CHECK STRING "0"
|
||||
// Retrieval info: PRIVATE: GLOCK_COUNTER_EDIT NUMERIC "1048575"
|
||||
// Retrieval info: PRIVATE: HAS_MANUAL_SWITCHOVER STRING "1"
|
||||
// Retrieval info: PRIVATE: INCLK0_FREQ_EDIT STRING "27.000"
|
||||
// Retrieval info: PRIVATE: INCLK0_FREQ_UNIT_COMBO STRING "MHz"
|
||||
// Retrieval info: PRIVATE: INCLK1_FREQ_EDIT STRING "100.000"
|
||||
// Retrieval info: PRIVATE: INCLK1_FREQ_EDIT_CHANGED STRING "1"
|
||||
// Retrieval info: PRIVATE: INCLK1_FREQ_UNIT_CHANGED STRING "1"
|
||||
// Retrieval info: PRIVATE: INCLK1_FREQ_UNIT_COMBO STRING "MHz"
|
||||
// Retrieval info: PRIVATE: INTENDED_DEVICE_FAMILY STRING "Cyclone III"
|
||||
// Retrieval info: PRIVATE: INT_FEEDBACK__MODE_RADIO STRING "1"
|
||||
// Retrieval info: PRIVATE: LOCKED_OUTPUT_CHECK STRING "1"
|
||||
// Retrieval info: PRIVATE: LONG_SCAN_RADIO STRING "1"
|
||||
// Retrieval info: PRIVATE: LVDS_MODE_DATA_RATE STRING "Not Available"
|
||||
// Retrieval info: PRIVATE: LVDS_MODE_DATA_RATE_DIRTY NUMERIC "0"
|
||||
// Retrieval info: PRIVATE: LVDS_PHASE_SHIFT_UNIT0 STRING "deg"
|
||||
// Retrieval info: PRIVATE: LVDS_PHASE_SHIFT_UNIT1 STRING "deg"
|
||||
// Retrieval info: PRIVATE: LVDS_PHASE_SHIFT_UNIT2 STRING "ps"
|
||||
// Retrieval info: PRIVATE: MIG_DEVICE_SPEED_GRADE STRING "Any"
|
||||
// Retrieval info: PRIVATE: MIRROR_CLK0 STRING "0"
|
||||
// Retrieval info: PRIVATE: MIRROR_CLK1 STRING "0"
|
||||
// Retrieval info: PRIVATE: MIRROR_CLK2 STRING "0"
|
||||
// Retrieval info: PRIVATE: MULT_FACTOR0 NUMERIC "20"
|
||||
// Retrieval info: PRIVATE: MULT_FACTOR1 NUMERIC "10"
|
||||
// Retrieval info: PRIVATE: MULT_FACTOR2 NUMERIC "5"
|
||||
// Retrieval info: PRIVATE: NORMAL_MODE_RADIO STRING "1"
|
||||
// Retrieval info: PRIVATE: OUTPUT_FREQ0 STRING "20.00000000"
|
||||
// Retrieval info: PRIVATE: OUTPUT_FREQ1 STRING "10.00000000"
|
||||
// Retrieval info: PRIVATE: OUTPUT_FREQ2 STRING "5.00000000"
|
||||
// Retrieval info: PRIVATE: OUTPUT_FREQ_MODE0 STRING "0"
|
||||
// Retrieval info: PRIVATE: OUTPUT_FREQ_MODE1 STRING "0"
|
||||
// Retrieval info: PRIVATE: OUTPUT_FREQ_MODE2 STRING "0"
|
||||
// Retrieval info: PRIVATE: OUTPUT_FREQ_UNIT0 STRING "MHz"
|
||||
// Retrieval info: PRIVATE: OUTPUT_FREQ_UNIT1 STRING "MHz"
|
||||
// Retrieval info: PRIVATE: OUTPUT_FREQ_UNIT2 STRING "MHz"
|
||||
// Retrieval info: PRIVATE: PHASE_RECONFIG_FEATURE_ENABLED STRING "1"
|
||||
// Retrieval info: PRIVATE: PHASE_RECONFIG_INPUTS_CHECK STRING "0"
|
||||
// Retrieval info: PRIVATE: PHASE_SHIFT0 STRING "0.00000000"
|
||||
// Retrieval info: PRIVATE: PHASE_SHIFT1 STRING "0.00000000"
|
||||
// Retrieval info: PRIVATE: PHASE_SHIFT2 STRING "0.00000000"
|
||||
// Retrieval info: PRIVATE: PHASE_SHIFT_STEP_ENABLED_CHECK STRING "0"
|
||||
// Retrieval info: PRIVATE: PHASE_SHIFT_UNIT0 STRING "deg"
|
||||
// Retrieval info: PRIVATE: PHASE_SHIFT_UNIT1 STRING "deg"
|
||||
// Retrieval info: PRIVATE: PHASE_SHIFT_UNIT2 STRING "deg"
|
||||
// Retrieval info: PRIVATE: PLL_ADVANCED_PARAM_CHECK STRING "0"
|
||||
// Retrieval info: PRIVATE: PLL_ARESET_CHECK STRING "1"
|
||||
// Retrieval info: PRIVATE: PLL_AUTOPLL_CHECK NUMERIC "1"
|
||||
// Retrieval info: PRIVATE: PLL_ENHPLL_CHECK NUMERIC "0"
|
||||
// Retrieval info: PRIVATE: PLL_FASTPLL_CHECK NUMERIC "0"
|
||||
// Retrieval info: PRIVATE: PLL_FBMIMIC_CHECK STRING "0"
|
||||
// Retrieval info: PRIVATE: PLL_LVDS_PLL_CHECK NUMERIC "0"
|
||||
// Retrieval info: PRIVATE: PLL_PFDENA_CHECK STRING "0"
|
||||
// Retrieval info: PRIVATE: PLL_TARGET_HARCOPY_CHECK NUMERIC "0"
|
||||
// Retrieval info: PRIVATE: PRIMARY_CLK_COMBO STRING "inclk0"
|
||||
// Retrieval info: PRIVATE: RECONFIG_FILE STRING "pll_mist.mif"
|
||||
// Retrieval info: PRIVATE: SACN_INPUTS_CHECK STRING "0"
|
||||
// Retrieval info: PRIVATE: SCAN_FEATURE_ENABLED STRING "1"
|
||||
// Retrieval info: PRIVATE: SELF_RESET_LOCK_LOSS STRING "0"
|
||||
// Retrieval info: PRIVATE: SHORT_SCAN_RADIO STRING "0"
|
||||
// Retrieval info: PRIVATE: SPREAD_FEATURE_ENABLED STRING "0"
|
||||
// Retrieval info: PRIVATE: SPREAD_FREQ STRING "50.000"
|
||||
// Retrieval info: PRIVATE: SPREAD_FREQ_UNIT STRING "KHz"
|
||||
// Retrieval info: PRIVATE: SPREAD_PERCENT STRING "0.500"
|
||||
// Retrieval info: PRIVATE: SPREAD_USE STRING "0"
|
||||
// Retrieval info: PRIVATE: SRC_SYNCH_COMP_RADIO STRING "0"
|
||||
// Retrieval info: PRIVATE: STICKY_CLK0 STRING "1"
|
||||
// Retrieval info: PRIVATE: STICKY_CLK1 STRING "1"
|
||||
// Retrieval info: PRIVATE: STICKY_CLK2 STRING "1"
|
||||
// Retrieval info: PRIVATE: SWITCHOVER_COUNT_EDIT NUMERIC "1"
|
||||
// Retrieval info: PRIVATE: SWITCHOVER_FEATURE_ENABLED STRING "1"
|
||||
// Retrieval info: PRIVATE: SYNTH_WRAPPER_GEN_POSTFIX STRING "0"
|
||||
// Retrieval info: PRIVATE: USE_CLK0 STRING "1"
|
||||
// Retrieval info: PRIVATE: USE_CLK1 STRING "1"
|
||||
// Retrieval info: PRIVATE: USE_CLK2 STRING "1"
|
||||
// Retrieval info: PRIVATE: USE_CLKENA0 STRING "0"
|
||||
// Retrieval info: PRIVATE: USE_CLKENA1 STRING "0"
|
||||
// Retrieval info: PRIVATE: USE_CLKENA2 STRING "0"
|
||||
// Retrieval info: PRIVATE: USE_MIL_SPEED_GRADE NUMERIC "0"
|
||||
// Retrieval info: PRIVATE: ZERO_DELAY_RADIO STRING "0"
|
||||
// Retrieval info: LIBRARY: altera_mf altera_mf.altera_mf_components.all
|
||||
// Retrieval info: CONSTANT: BANDWIDTH_TYPE STRING "AUTO"
|
||||
// Retrieval info: CONSTANT: CLK0_DIVIDE_BY NUMERIC "27"
|
||||
// Retrieval info: CONSTANT: CLK0_DUTY_CYCLE NUMERIC "50"
|
||||
// Retrieval info: CONSTANT: CLK0_MULTIPLY_BY NUMERIC "20"
|
||||
// Retrieval info: CONSTANT: CLK0_PHASE_SHIFT STRING "0"
|
||||
// Retrieval info: CONSTANT: CLK1_DIVIDE_BY NUMERIC "27"
|
||||
// Retrieval info: CONSTANT: CLK1_DUTY_CYCLE NUMERIC "50"
|
||||
// Retrieval info: CONSTANT: CLK1_MULTIPLY_BY NUMERIC "10"
|
||||
// Retrieval info: CONSTANT: CLK1_PHASE_SHIFT STRING "0"
|
||||
// Retrieval info: CONSTANT: CLK2_DIVIDE_BY NUMERIC "27"
|
||||
// Retrieval info: CONSTANT: CLK2_DUTY_CYCLE NUMERIC "50"
|
||||
// Retrieval info: CONSTANT: CLK2_MULTIPLY_BY NUMERIC "5"
|
||||
// Retrieval info: CONSTANT: CLK2_PHASE_SHIFT STRING "0"
|
||||
// Retrieval info: CONSTANT: COMPENSATE_CLOCK STRING "CLK0"
|
||||
// Retrieval info: CONSTANT: INCLK0_INPUT_FREQUENCY NUMERIC "37037"
|
||||
// Retrieval info: CONSTANT: INTENDED_DEVICE_FAMILY STRING "Cyclone III"
|
||||
// Retrieval info: CONSTANT: LPM_TYPE STRING "altpll"
|
||||
// Retrieval info: CONSTANT: OPERATION_MODE STRING "NORMAL"
|
||||
// Retrieval info: CONSTANT: PLL_TYPE STRING "AUTO"
|
||||
// Retrieval info: CONSTANT: PORT_ACTIVECLOCK STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_ARESET STRING "PORT_USED"
|
||||
// Retrieval info: CONSTANT: PORT_CLKBAD0 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_CLKBAD1 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_CLKLOSS STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_CLKSWITCH STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_CONFIGUPDATE STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_FBIN STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_INCLK0 STRING "PORT_USED"
|
||||
// Retrieval info: CONSTANT: PORT_INCLK1 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_LOCKED STRING "PORT_USED"
|
||||
// Retrieval info: CONSTANT: PORT_PFDENA STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_PHASECOUNTERSELECT STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_PHASEDONE STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_PHASESTEP STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_PHASEUPDOWN STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_PLLENA STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_SCANACLR STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_SCANCLK STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_SCANCLKENA STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_SCANDATA STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_SCANDATAOUT STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_SCANDONE STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_SCANREAD STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_SCANWRITE STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_clk0 STRING "PORT_USED"
|
||||
// Retrieval info: CONSTANT: PORT_clk1 STRING "PORT_USED"
|
||||
// Retrieval info: CONSTANT: PORT_clk2 STRING "PORT_USED"
|
||||
// Retrieval info: CONSTANT: PORT_clk3 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_clk4 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_clk5 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_clkena0 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_clkena1 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_clkena2 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_clkena3 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_clkena4 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_clkena5 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_extclk0 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_extclk1 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_extclk2 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: PORT_extclk3 STRING "PORT_UNUSED"
|
||||
// Retrieval info: CONSTANT: SELF_RESET_ON_LOSS_LOCK STRING "OFF"
|
||||
// Retrieval info: CONSTANT: WIDTH_CLOCK NUMERIC "5"
|
||||
// Retrieval info: USED_PORT: @clk 0 0 5 0 OUTPUT_CLK_EXT VCC "@clk[4..0]"
|
||||
// Retrieval info: USED_PORT: areset 0 0 0 0 INPUT GND "areset"
|
||||
// Retrieval info: USED_PORT: c0 0 0 0 0 OUTPUT_CLK_EXT VCC "c0"
|
||||
// Retrieval info: USED_PORT: c1 0 0 0 0 OUTPUT_CLK_EXT VCC "c1"
|
||||
// Retrieval info: USED_PORT: c2 0 0 0 0 OUTPUT_CLK_EXT VCC "c2"
|
||||
// Retrieval info: USED_PORT: inclk0 0 0 0 0 INPUT_CLK_EXT GND "inclk0"
|
||||
// Retrieval info: USED_PORT: locked 0 0 0 0 OUTPUT GND "locked"
|
||||
// Retrieval info: CONNECT: @areset 0 0 0 0 areset 0 0 0 0
|
||||
// Retrieval info: CONNECT: @inclk 0 0 1 1 GND 0 0 0 0
|
||||
// Retrieval info: CONNECT: @inclk 0 0 1 0 inclk0 0 0 0 0
|
||||
// Retrieval info: CONNECT: c0 0 0 0 0 @clk 0 0 1 0
|
||||
// Retrieval info: CONNECT: c1 0 0 0 0 @clk 0 0 1 1
|
||||
// Retrieval info: CONNECT: c2 0 0 0 0 @clk 0 0 1 2
|
||||
// Retrieval info: CONNECT: locked 0 0 0 0 @locked 0 0 0 0
|
||||
// Retrieval info: GEN_FILE: TYPE_NORMAL pll_mist.v TRUE
|
||||
// Retrieval info: GEN_FILE: TYPE_NORMAL pll_mist.ppf TRUE
|
||||
// Retrieval info: GEN_FILE: TYPE_NORMAL pll_mist.inc FALSE
|
||||
// Retrieval info: GEN_FILE: TYPE_NORMAL pll_mist.cmp FALSE
|
||||
// Retrieval info: GEN_FILE: TYPE_NORMAL pll_mist.bsf FALSE
|
||||
// Retrieval info: GEN_FILE: TYPE_NORMAL pll_mist_inst.v FALSE
|
||||
// Retrieval info: GEN_FILE: TYPE_NORMAL pll_mist_bb.v FALSE
|
||||
// Retrieval info: LIB_FILE: altera_mf
|
||||
// Retrieval info: CBX_MODULE_PREFIX: ON
|
||||
24
Arcade_MiST/Atari MissileCommand/rtl/rom/L6.vhd
Normal file
24
Arcade_MiST/Atari MissileCommand/rtl/rom/L6.vhd
Normal file
@@ -0,0 +1,24 @@
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all,ieee.numeric_std.all;
|
||||
|
||||
entity L6 is
|
||||
port (
|
||||
clk : in std_logic;
|
||||
addr : in std_logic_vector(4 downto 0);
|
||||
data : out std_logic_vector(7 downto 0)
|
||||
);
|
||||
end entity;
|
||||
|
||||
architecture prom of L6 is
|
||||
type rom is array(0 to 31) of std_logic_vector(7 downto 0);
|
||||
signal rom_data: rom := (
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",
|
||||
X"EE",X"DD",X"BB",X"77",X"EE",X"DD",X"BB",X"77",X"FE",X"FD",X"FB",X"F7",X"EF",X"DF",X"BF",X"7F");
|
||||
begin
|
||||
process(clk)
|
||||
begin
|
||||
if rising_edge(clk) then
|
||||
data <= rom_data(to_integer(unsigned(addr)));
|
||||
end if;
|
||||
end process;
|
||||
end architecture;
|
||||
278
Arcade_MiST/Atari MissileCommand/rtl/rom/rom1.vhd
Normal file
278
Arcade_MiST/Atari MissileCommand/rtl/rom/rom1.vhd
Normal file
@@ -0,0 +1,278 @@
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all,ieee.numeric_std.all;
|
||||
|
||||
entity rom1 is
|
||||
port (
|
||||
clk : in std_logic;
|
||||
addr : in std_logic_vector(11 downto 0);
|
||||
data : out std_logic_vector(7 downto 0)
|
||||
);
|
||||
end entity;
|
||||
|
||||
architecture prom of rom1 is
|
||||
type rom is array(0 to 4095) of std_logic_vector(7 downto 0);
|
||||
signal rom_data: rom := (
|
||||
X"29",X"58",X"20",X"E1",X"74",X"20",X"2F",X"67",X"20",X"0C",X"7B",X"A9",X"14",X"85",X"91",X"46",
|
||||
X"9F",X"90",X"FC",X"A9",X"00",X"85",X"9F",X"20",X"3E",X"50",X"20",X"A6",X"50",X"A5",X"F2",X"29",
|
||||
X"40",X"D0",X"EC",X"4C",X"4B",X"7B",X"20",X"FB",X"55",X"20",X"5A",X"52",X"20",X"46",X"61",X"20",
|
||||
X"D0",X"53",X"20",X"21",X"53",X"20",X"58",X"54",X"20",X"32",X"51",X"4C",X"EE",X"59",X"A6",X"91",
|
||||
X"BD",X"4A",X"50",X"48",X"BD",X"49",X"50",X"48",X"60",X"D0",X"5A",X"0F",X"5B",X"25",X"50",X"6C",
|
||||
X"5D",X"E9",X"5B",X"1F",X"5C",X"81",X"5C",X"A9",X"5C",X"0B",X"5D",X"A1",X"5D",X"81",X"5A",X"B8",
|
||||
X"5A",X"3E",X"75",X"44",X"76",X"FF",X"76",X"85",X"77",X"9E",X"77",X"6C",X"50",X"A5",X"CA",X"29",
|
||||
X"03",X"D0",X"30",X"A4",X"AF",X"F0",X"02",X"C6",X"AF",X"D0",X"28",X"A5",X"92",X"85",X"91",X"C9",
|
||||
X"04",X"D0",X"20",X"A5",X"93",X"F0",X"1C",X"A9",X"00",X"20",X"49",X"6A",X"A9",X"06",X"20",X"49",
|
||||
X"6A",X"A9",X"1E",X"20",X"49",X"6A",X"A9",X"15",X"20",X"49",X"6A",X"A9",X"00",X"85",X"FA",X"85",
|
||||
X"95",X"85",X"94",X"4C",X"32",X"51",X"A5",X"93",X"D0",X"55",X"20",X"5D",X"5F",X"A5",X"66",X"F0",
|
||||
X"32",X"A0",X"00",X"C9",X"02",X"A5",X"F1",X"49",X"FF",X"29",X"18",X"F0",X"23",X"B0",X"05",X"29",
|
||||
X"10",X"B8",X"50",X"05",X"C8",X"C6",X"66",X"29",X"08",X"F0",X"03",X"C6",X"66",X"C8",X"98",X"85",
|
||||
X"AE",X"F0",X"0D",X"A0",X"FF",X"84",X"93",X"C8",X"84",X"68",X"A9",X"00",X"85",X"91",X"C6",X"AE",
|
||||
X"B8",X"50",X"12",X"A5",X"67",X"F0",X"0E",X"A5",X"91",X"C9",X"20",X"F0",X"08",X"C9",X"12",X"F0",
|
||||
X"04",X"A9",X"1E",X"85",X"91",X"A5",X"F3",X"29",X"03",X"D0",X"04",X"A9",X"02",X"85",X"66",X"E6",
|
||||
X"CA",X"A5",X"9F",X"D0",X"1C",X"A5",X"D4",X"F0",X"05",X"A4",X"B9",X"20",X"FC",X"5F",X"A5",X"D8",
|
||||
X"D0",X"0F",X"20",X"52",X"5A",X"A5",X"D7",X"49",X"01",X"85",X"D7",X"AA",X"BD",X"30",X"51",X"85",
|
||||
X"D8",X"A5",X"5F",X"F0",X"04",X"A9",X"F0",X"85",X"E0",X"A5",X"E0",X"F0",X"02",X"C6",X"E0",X"60",
|
||||
X"0A",X"32",X"A5",X"A6",X"F0",X"1E",X"A5",X"93",X"D0",X"06",X"20",X"55",X"51",X"B8",X"50",X"0E",
|
||||
X"A0",X"00",X"A5",X"95",X"84",X"95",X"85",X"B1",X"A5",X"94",X"84",X"94",X"85",X"B0",X"20",X"39",
|
||||
X"52",X"20",X"D3",X"64",X"60",X"A9",X"00",X"85",X"B1",X"85",X"B0",X"A6",X"D0",X"BD",X"65",X"01",
|
||||
X"D0",X"03",X"20",X"E7",X"51",X"A6",X"D0",X"BD",X"65",X"01",X"C5",X"A6",X"B0",X"05",X"A9",X"FE",
|
||||
X"B8",X"50",X"12",X"38",X"E5",X"A6",X"C9",X"0E",X"D0",X"05",X"A9",X"00",X"B8",X"50",X"06",X"A9",
|
||||
X"02",X"B0",X"02",X"A9",X"FE",X"85",X"B1",X"BD",X"18",X"06",X"85",X"98",X"BD",X"08",X"06",X"46",
|
||||
X"98",X"6A",X"46",X"98",X"6A",X"46",X"98",X"6A",X"46",X"98",X"6A",X"18",X"7D",X"30",X"01",X"C5",
|
||||
X"A5",X"B0",X"05",X"A9",X"FE",X"B8",X"50",X"09",X"D0",X"05",X"A9",X"00",X"B8",X"50",X"02",X"A9",
|
||||
X"02",X"85",X"B0",X"05",X"B1",X"D0",X"2F",X"A5",X"BC",X"C9",X"02",X"B0",X"29",X"A2",X"02",X"A5",
|
||||
X"A5",X"C9",X"60",X"B0",X"05",X"A2",X"00",X"B8",X"50",X"06",X"C9",X"A0",X"B0",X"02",X"A2",X"01",
|
||||
X"A5",X"BC",X"18",X"65",X"8E",X"C5",X"8C",X"B0",X"0D",X"20",X"BD",X"52",X"A0",X"00",X"84",X"B0",
|
||||
X"88",X"84",X"B1",X"20",X"E7",X"51",X"60",X"A6",X"D0",X"CA",X"10",X"02",X"A2",X"07",X"E4",X"D0",
|
||||
X"D0",X"01",X"60",X"BD",X"65",X"01",X"F0",X"F1",X"86",X"D0",X"60",X"A0",X"00",X"B5",X"B0",X"10",
|
||||
X"01",X"88",X"94",X"9D",X"A0",X"06",X"A5",X"FC",X"0A",X"A5",X"F4",X"29",X"08",X"6A",X"25",X"93",
|
||||
X"F0",X"01",X"C8",X"16",X"B0",X"36",X"9D",X"88",X"10",X"F9",X"B5",X"A3",X"18",X"75",X"B0",X"95",
|
||||
X"A3",X"B5",X"A5",X"75",X"9D",X"D5",X"A5",X"F0",X"0F",X"B4",X"9D",X"10",X"07",X"90",X"02",X"A9",
|
||||
X"00",X"B8",X"50",X"04",X"B0",X"02",X"A9",X"FF",X"60",X"A2",X"00",X"20",X"40",X"52",X"A2",X"01",
|
||||
X"20",X"FB",X"51",X"DD",X"56",X"52",X"B0",X"03",X"BD",X"56",X"52",X"DD",X"58",X"52",X"90",X"03",
|
||||
X"BD",X"58",X"52",X"95",X"A5",X"60",X"08",X"2D",X"F7",X"CE",X"A5",X"93",X"F0",X"57",X"A5",X"8D",
|
||||
X"05",X"8C",X"05",X"DB",X"05",X"DA",X"0D",X"6D",X"01",X"F0",X"47",X"A5",X"8F",X"18",X"65",X"BC",
|
||||
X"C9",X"10",X"B0",X"10",X"65",X"8C",X"18",X"65",X"DA",X"18",X"AE",X"6D",X"01",X"F0",X"01",X"38",
|
||||
X"65",X"90",X"C9",X"14",X"B0",X"1E",X"A2",X"02",X"A5",X"FA",X"3D",X"BA",X"52",X"F0",X"0F",X"B5",
|
||||
X"A0",X"F0",X"06",X"20",X"BD",X"52",X"B8",X"50",X"05",X"A9",X"80",X"20",X"EC",X"79",X"CA",X"10",
|
||||
X"E7",X"B8",X"50",X"0B",X"A5",X"FA",X"29",X"07",X"F0",X"05",X"A9",X"80",X"20",X"EC",X"79",X"B8",
|
||||
X"50",X"03",X"20",X"72",X"65",X"A9",X"00",X"85",X"FA",X"60",X"04",X"02",X"01",X"A0",X"07",X"B9",
|
||||
X"5D",X"01",X"D0",X"59",X"84",X"97",X"A9",X"00",X"99",X"4D",X"01",X"99",X"18",X"01",X"BD",X"E8",
|
||||
X"60",X"99",X"82",X"01",X"99",X"28",X"01",X"BD",X"F4",X"60",X"99",X"92",X"01",X"99",X"5D",X"01",
|
||||
X"A5",X"A5",X"99",X"A2",X"01",X"A5",X"A6",X"99",X"B2",X"01",X"20",X"7C",X"65",X"20",X"F6",X"58",
|
||||
X"A5",X"93",X"F0",X"14",X"B5",X"A0",X"C9",X"04",X"D0",X"09",X"8A",X"20",X"24",X"68",X"A9",X"01",
|
||||
X"B8",X"50",X"02",X"A9",X"04",X"20",X"EC",X"79",X"D6",X"A0",X"D0",X"08",X"A5",X"93",X"F0",X"04",
|
||||
X"8A",X"20",X"36",X"68",X"8A",X"A8",X"20",X"D1",X"67",X"98",X"AA",X"A0",X"00",X"88",X"10",X"9F",
|
||||
X"60",X"A5",X"B3",X"F0",X"05",X"C6",X"B3",X"B8",X"50",X"4E",X"A5",X"B2",X"18",X"65",X"B7",X"85",
|
||||
X"B2",X"A5",X"B3",X"65",X"B8",X"85",X"B3",X"A2",X"07",X"86",X"DC",X"A9",X"FF",X"85",X"BD",X"85",
|
||||
X"C2",X"A9",X"00",X"85",X"8C",X"85",X"DA",X"85",X"BE",X"A6",X"DC",X"BD",X"65",X"01",X"F0",X"1A",
|
||||
X"8A",X"18",X"69",X"08",X"85",X"97",X"BD",X"65",X"01",X"C5",X"BD",X"B0",X"02",X"85",X"BD",X"C5",
|
||||
X"BE",X"90",X"02",X"85",X"BE",X"25",X"93",X"20",X"79",X"53",X"C6",X"DC",X"10",X"DB",X"A4",X"8E",
|
||||
X"C0",X"0C",X"90",X"04",X"A9",X"FF",X"85",X"C2",X"60",X"A8",X"A5",X"D9",X"3D",X"F7",X"60",X"D0",
|
||||
X"13",X"C0",X"80",X"90",X"06",X"C0",X"A0",X"B0",X"02",X"86",X"C2",X"20",X"F7",X"66",X"20",X"11",
|
||||
X"54",X"B8",X"50",X"06",X"20",X"AC",X"77",X"20",X"0D",X"63",X"A6",X"DC",X"90",X"1D",X"A5",X"D9",
|
||||
X"3D",X"F7",X"60",X"F0",X"06",X"20",X"E9",X"7A",X"B8",X"50",X"07",X"A6",X"97",X"20",X"86",X"66",
|
||||
X"A6",X"DC",X"20",X"6B",X"58",X"20",X"9F",X"55",X"B8",X"50",X"14",X"A5",X"D9",X"3D",X"F7",X"60",
|
||||
X"D0",X"08",X"20",X"F0",X"66",X"E6",X"8C",X"B8",X"50",X"05",X"20",X"A8",X"77",X"E6",X"DA",X"60",
|
||||
X"A9",X"00",X"85",X"BC",X"A2",X"07",X"BD",X"5D",X"01",X"F0",X"32",X"86",X"97",X"A0",X"02",X"BD",
|
||||
X"82",X"01",X"C9",X"7B",X"D0",X"02",X"A0",X"06",X"84",X"D5",X"20",X"F7",X"66",X"20",X"11",X"54",
|
||||
X"90",X"0D",X"20",X"92",X"65",X"20",X"86",X"66",X"20",X"6B",X"58",X"A9",X"00",X"85",X"D5",X"C6",
|
||||
X"D5",X"10",X"E7",X"BD",X"5D",X"01",X"F0",X"05",X"20",X"F0",X"66",X"E6",X"BC",X"CA",X"10",X"C6",
|
||||
X"60",X"A4",X"97",X"B9",X"18",X"01",X"18",X"79",X"00",X"06",X"99",X"18",X"01",X"B9",X"28",X"01",
|
||||
X"79",X"10",X"06",X"99",X"28",X"01",X"B9",X"4D",X"01",X"18",X"79",X"20",X"06",X"99",X"4D",X"01",
|
||||
X"B9",X"5D",X"01",X"79",X"30",X"06",X"99",X"5D",X"01",X"D9",X"B2",X"01",X"F0",X"08",X"6A",X"59",
|
||||
X"30",X"06",X"10",X"02",X"38",X"60",X"B9",X"28",X"01",X"D9",X"A2",X"01",X"F0",X"08",X"6A",X"59",
|
||||
X"10",X"06",X"10",X"02",X"38",X"60",X"18",X"60",X"A4",X"B4",X"88",X"10",X"02",X"A0",X"04",X"84",
|
||||
X"B4",X"A5",X"8E",X"F0",X"4B",X"BE",X"B2",X"54",X"BD",X"6E",X"01",X"F0",X"3A",X"85",X"9C",X"FE",
|
||||
X"C2",X"01",X"BD",X"C2",X"01",X"29",X"7F",X"A8",X"C9",X"1B",X"90",X"16",X"BD",X"C2",X"01",X"30",
|
||||
X"05",X"C6",X"8F",X"B8",X"50",X"02",X"C6",X"90",X"C6",X"8E",X"A9",X"00",X"9D",X"6E",X"01",X"B8",
|
||||
X"50",X"15",X"BD",X"39",X"01",X"85",X"9B",X"B9",X"B7",X"54",X"85",X"B5",X"B9",X"B8",X"54",X"85",
|
||||
X"9A",X"20",X"71",X"5E",X"20",X"D4",X"54",X"CA",X"A4",X"B4",X"8A",X"D9",X"B1",X"54",X"D0",X"B8",
|
||||
X"60",X"FF",X"03",X"07",X"0B",X"0F",X"13",X"00",X"00",X"02",X"03",X"04",X"05",X"06",X"07",X"08",
|
||||
X"09",X"0A",X"0B",X"0C",X"0D",X"0D",X"0C",X"0B",X"0A",X"09",X"08",X"07",X"06",X"05",X"04",X"03",
|
||||
X"02",X"01",X"00",X"00",X"8A",X"48",X"A5",X"9A",X"85",X"D5",X"A0",X"08",X"A5",X"9C",X"C9",X"21",
|
||||
X"90",X"5E",X"B9",X"65",X"01",X"F0",X"56",X"85",X"9E",X"B9",X"30",X"01",X"85",X"9D",X"C0",X"08",
|
||||
X"D0",X"05",X"A9",X"06",X"B8",X"50",X"0E",X"A5",X"D9",X"39",X"F7",X"60",X"D0",X"05",X"A9",X"01",
|
||||
X"B8",X"50",X"02",X"A9",X"03",X"18",X"65",X"D5",X"85",X"9A",X"20",X"AB",X"58",X"B0",X"2E",X"98",
|
||||
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|
||||
X"00",X"85",X"DF",X"85",X"C1",X"85",X"C6",X"85",X"C3",X"85",X"C4",X"A9",X"01",X"85",X"A7",X"A6",
|
||||
X"AE",X"A5",X"F4",X"29",X"03",X"A8",X"B9",X"08",X"5B",X"95",X"C0",X"B9",X"0C",X"5B",X"95",X"C5",
|
||||
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|
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X"A5",X"DF",X"85",X"B9",X"20",X"0C",X"7B",X"A9",X"10",X"20",X"EC",X"79",X"A5",X"93",X"D0",X"09",
|
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|
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|
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|
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|
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|
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|
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|
||||
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|
||||
X"85",X"E1",X"B9",X"D9",X"60",X"85",X"E2",X"85",X"E3",X"60",X"20",X"37",X"5E",X"20",X"72",X"65",
|
||||
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|
||||
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|
||||
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|
||||
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|
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|
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|
||||
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|
||||
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|
||||
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|
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|
||||
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|
||||
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|
||||
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|
||||
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|
||||
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|
||||
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|
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|
||||
X"85",X"91",X"A9",X"0F",X"85",X"AF",X"A4",X"B9",X"20",X"13",X"60",X"60",X"A9",X"02",X"85",X"92",
|
||||
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|
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|
||||
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|
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|
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|
||||
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|
||||
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|
||||
X"EA",X"85",X"EB",X"A9",X"80",X"85",X"CE",X"20",X"E1",X"5F",X"A9",X"20",X"20",X"EC",X"79",X"A2",
|
||||
X"12",X"86",X"91",X"A0",X"00",X"8C",X"C3",X"01",X"84",X"AE",X"84",X"93",X"A0",X"01",X"8C",X"C2",
|
||||
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|
||||
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|
||||
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|
||||
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|
||||
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|
||||
X"45",X"20",X"40",X"60",X"A4",X"B9",X"B6",X"C0",X"E0",X"06",X"90",X"02",X"A2",X"06",X"B9",X"C5",
|
||||
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|
||||
X"B9",X"B9",X"C5",X"00",X"49",X"FC",X"A0",X"00",X"20",X"1D",X"58",X"A6",X"B9",X"B5",X"C5",X"19",
|
||||
X"F7",X"60",X"95",X"C5",X"C6",X"DC",X"D0",X"E7",X"A9",X"40",X"20",X"EC",X"79",X"A9",X"05",X"20",
|
||||
X"55",X"6A",X"A9",X"2D",X"85",X"AF",X"60",X"A5",X"8C",X"05",X"DA",X"F0",X"2C",X"A2",X"07",X"86",
|
||||
X"DC",X"A6",X"DC",X"BD",X"65",X"01",X"F0",X"1D",X"8A",X"18",X"69",X"08",X"85",X"97",X"A5",X"D9",
|
||||
X"3D",X"F7",X"60",X"D0",X"06",X"20",X"86",X"66",X"B8",X"50",X"0A",X"20",X"AC",X"77",X"A9",X"00",
|
||||
X"85",X"DA",X"20",X"E9",X"7A",X"C6",X"DC",X"10",X"D8",X"20",X"0C",X"7B",X"A9",X"0F",X"4C",X"49",
|
||||
X"6A",X"86",X"AC",X"A5",X"9A",X"C5",X"B5",X"F0",X"23",X"B0",X"12",X"A9",X"00",X"85",X"B6",X"20",
|
||||
X"9F",X"5E",X"A5",X"B5",X"C6",X"B5",X"C5",X"9A",X"D0",X"F5",X"B8",X"50",X"0F",X"A9",X"80",X"85",
|
||||
X"B6",X"20",X"9F",X"5E",X"A5",X"B5",X"C5",X"9A",X"E6",X"B5",X"90",X"F5",X"A6",X"AC",X"60",X"A6",
|
||||
X"B5",X"86",X"9D",X"A2",X"00",X"86",X"9E",X"20",X"CD",X"5E",X"A6",X"9D",X"A5",X"9E",X"86",X"9E",
|
||||
X"85",X"9D",X"20",X"CD",X"5E",X"E6",X"9D",X"A5",X"9D",X"85",X"9E",X"4A",X"18",X"65",X"9E",X"4A",
|
||||
X"4A",X"49",X"FF",X"38",X"65",X"B5",X"85",X"9D",X"C5",X"9E",X"B0",X"DB",X"60",X"A2",X"00",X"A5",
|
||||
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|
||||
X"B1",X"A1",X"B0",X"29",X"20",X"05",X"B6",X"81",X"B0",X"A5",X"9B",X"38",X"E5",X"9D",X"85",X"B0",
|
||||
X"A1",X"B0",X"29",X"20",X"05",X"B6",X"81",X"B0",X"A5",X"9C",X"38",X"E5",X"9E",X"49",X"FF",X"85",
|
||||
X"B1",X"A1",X"B0",X"29",X"20",X"05",X"B6",X"81",X"B0",X"A5",X"98",X"85",X"B0",X"A1",X"B0",X"29",
|
||||
X"20",X"05",X"B6",X"81",X"B0",X"60",X"A5",X"93",X"F0",X"1D",X"20",X"48",X"5F",X"A9",X"06",X"20",
|
||||
X"55",X"6A",X"A5",X"DD",X"A2",X"40",X"86",X"0B",X"A2",X"58",X"A0",X"70",X"20",X"9D",X"6A",X"A9",
|
||||
X"1E",X"20",X"55",X"6A",X"B8",X"50",X"03",X"20",X"33",X"6C",X"A5",X"A7",X"C9",X"04",X"B0",X"05",
|
||||
X"A9",X"15",X"20",X"51",X"6A",X"4C",X"23",X"75",X"A9",X"00",X"20",X"55",X"6A",X"A5",X"B9",X"18",
|
||||
X"69",X"01",X"A2",X"40",X"86",X"0B",X"A2",X"9C",X"A0",X"90",X"4C",X"9D",X"6A",X"A5",X"CA",X"4A",
|
||||
X"B0",X"03",X"20",X"66",X"5F",X"60",X"20",X"8C",X"6B",X"A2",X"00",X"8A",X"29",X"3F",X"C9",X"3E",
|
||||
X"D0",X"08",X"38",X"7E",X"01",X"04",X"38",X"B8",X"50",X"0B",X"BD",X"03",X"04",X"4A",X"7E",X"01",
|
||||
X"04",X"BD",X"03",X"05",X"4A",X"7E",X"01",X"05",X"8A",X"18",X"69",X"40",X"AA",X"90",X"DC",X"E8",
|
||||
X"E8",X"E0",X"40",X"90",X"D6",X"60",X"A9",X"00",X"85",X"D1",X"85",X"D2",X"85",X"D3",X"60",X"20",
|
||||
X"96",X"5F",X"F8",X"A5",X"BA",X"18",X"65",X"D1",X"85",X"D1",X"A5",X"D2",X"65",X"BB",X"85",X"D2",
|
||||
X"A5",X"D3",X"69",X"00",X"85",X"D3",X"CA",X"10",X"EA",X"D8",X"60",X"A6",X"DD",X"F8",X"A9",X"05",
|
||||
X"18",X"65",X"D1",X"85",X"D1",X"A9",X"00",X"65",X"D2",X"85",X"D2",X"A5",X"D3",X"69",X"00",X"85",
|
||||
X"D3",X"CA",X"D0",X"EA",X"D8",X"60",X"A9",X"00",X"A2",X"05",X"9D",X"D6",X"01",X"CA",X"10",X"FA",
|
||||
X"60",X"A5",X"93",X"D0",X"0C",X"AD",X"D7",X"01",X"0D",X"D9",X"01",X"0D",X"DB",X"01",X"B8",X"50",
|
||||
X"02",X"A5",X"AE",X"F0",X"05",X"A0",X"01",X"20",X"FC",X"5F",X"A0",X"00",X"20",X"96",X"5F",X"20");
|
||||
begin
|
||||
process(clk)
|
||||
begin
|
||||
if rising_edge(clk) then
|
||||
data <= rom_data(to_integer(unsigned(addr)));
|
||||
end if;
|
||||
end process;
|
||||
end architecture;
|
||||
278
Arcade_MiST/Atari MissileCommand/rtl/rom/rom2.vhd
Normal file
278
Arcade_MiST/Atari MissileCommand/rtl/rom/rom2.vhd
Normal file
@@ -0,0 +1,278 @@
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all,ieee.numeric_std.all;
|
||||
|
||||
entity rom2 is
|
||||
port (
|
||||
clk : in std_logic;
|
||||
addr : in std_logic_vector(11 downto 0);
|
||||
data : out std_logic_vector(7 downto 0)
|
||||
);
|
||||
end entity;
|
||||
|
||||
architecture prom of rom2 is
|
||||
type rom is array(0 to 4095) of std_logic_vector(7 downto 0);
|
||||
signal rom_data: rom := (
|
||||
X"13",X"60",X"B9",X"11",X"60",X"AA",X"A9",X"00",X"85",X"D4",X"A0",X"E2",X"A5",X"CE",X"4C",X"F6",
|
||||
X"6A",X"1D",X"B0",X"A5",X"93",X"D0",X"03",X"20",X"96",X"5F",X"F8",X"A5",X"D1",X"18",X"79",X"D6",
|
||||
X"01",X"99",X"D6",X"01",X"85",X"D1",X"B9",X"D8",X"01",X"65",X"D2",X"99",X"D8",X"01",X"85",X"D2",
|
||||
X"B9",X"DA",X"01",X"65",X"D3",X"99",X"DA",X"01",X"85",X"D3",X"A9",X"FF",X"85",X"D4",X"D8",X"60",
|
||||
X"A5",X"F4",X"29",X"70",X"4A",X"4A",X"4A",X"4A",X"A8",X"B9",X"7B",X"60",X"85",X"99",X"F0",X"EF",
|
||||
X"A6",X"B9",X"BD",X"D8",X"01",X"4A",X"4A",X"4A",X"4A",X"85",X"98",X"BD",X"DA",X"01",X"0A",X"0A",
|
||||
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X"07",X"B1",X"06",X"BC",X"42",X"6C",X"C0",X"02",X"D0",X"06",X"20",X"7F",X"6C",X"B8",X"50",X"03",
|
||||
X"20",X"56",X"6C",X"A5",X"27",X"C9",X"FF",X"D0",X"15",X"A6",X"25",X"BD",X"4C",X"6C",X"85",X"27",
|
||||
X"E8",X"BD",X"42",X"6C",X"C9",X"03",X"D0",X"04",X"BD",X"38",X"6C",X"AA",X"86",X"25",X"60",X"25",
|
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X"0A",X"0B",X"0C",X"A9",X"FF",X"85",X"29",X"60",X"03",X"0D",X"29",X"1E",X"00",X"0E",X"04",X"28",
|
||||
X"1E",X"05",X"00",X"00",X"01",X"00",X"03",X"00",X"00",X"02",X"00",X"03",X"20",X"08",X"20",X"20",
|
||||
X"20",X"20",X"20",X"20",X"20",X"20",X"A4",X"26",X"F0",X"0A",X"A0",X"FF",X"84",X"27",X"C8",X"84",
|
||||
X"26",X"B8",X"50",X"0E",X"A0",X"07",X"84",X"27",X"E6",X"26",X"4A",X"4A",X"4A",X"4A",X"D0",X"02",
|
||||
X"A9",X"FF",X"29",X"0F",X"C9",X"0A",X"B0",X"06",X"18",X"69",X"30",X"20",X"9C",X"6C",X"60",X"85",
|
||||
X"1D",X"0A",X"18",X"65",X"1D",X"A8",X"20",X"26",X"6A",X"A4",X"26",X"E6",X"26",X"A9",X"07",X"85",
|
||||
X"27",X"B1",X"1D",X"10",X"07",X"A0",X"FF",X"84",X"27",X"C8",X"84",X"26",X"20",X"9D",X"69",X"A9",
|
||||
X"FC",X"85",X"00",X"A9",X"03",X"85",X"01",X"A9",X"00",X"85",X"08",X"A9",X"00",X"85",X"0B",X"A9",
|
||||
X"20",X"85",X"0C",X"4C",X"27",X"66",X"A0",X"00",X"A9",X"FF",X"99",X"01",X"04",X"99",X"01",X"05",
|
||||
X"C8",X"C8",X"D0",X"F6",X"60",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"3A",X"21",X"11",
|
||||
X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"11",
|
||||
X"11",X"44",X"44",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"11",X"90",X"D0",X"03",
|
||||
X"03",X"03",X"40",X"70",X"A0",X"A0",X"80",X"40",X"40",X"40",X"03",X"A0",X"03",X"03",X"03",X"70",
|
||||
X"60",X"50",X"38",X"03",X"03",X"03",X"58",X"58",X"58",X"A0",X"70",X"03",X"70",X"90",X"70",X"90",
|
||||
X"80",X"80",X"40",X"34",X"80",X"95",X"60",X"D2",X"6F",X"40",X"BB",X"70",X"06",X"D8",X"6F",X"90",
|
||||
X"E5",X"6F",X"78",X"F6",X"6F",X"5C",X"0B",X"70",X"68",X"22",X"70",X"50",X"16",X"70",X"60",X"2A",
|
||||
X"70",X"10",X"5F",X"70",X"40",X"2D",X"70",X"40",X"3E",X"70",X"40",X"4E",X"70",X"B0",X"F6",X"6E",
|
||||
X"54",X"D8",X"6F",X"04",X"E1",X"70",X"70",X"E1",X"70",X"E4",X"E1",X"70",X"24",X"6E",X"70",X"04",
|
||||
X"86",X"70",X"04",X"A1",X"70",X"34",X"CB",X"70",X"0C",X"DE",X"70",X"74",X"DE",X"70",X"E8",X"DE",
|
||||
X"70",X"88",X"E5",X"70",X"C8",X"24",X"70",X"28",X"0B",X"70",X"54",X"E6",X"70",X"50",X"D0",X"71",
|
||||
X"06",X"ED",X"70",X"90",X"F6",X"70",X"78",X"09",X"71",X"5C",X"17",X"71",X"68",X"2C",X"71",X"58",
|
||||
X"21",X"71",X"54",X"34",X"71",X"14",X"6E",X"71",X"40",X"38",X"71",X"40",X"47",X"71",X"40",X"56",
|
||||
X"71",X"B0",X"66",X"71",X"58",X"ED",X"70",X"04",X"F7",X"71",X"70",X"F7",X"71",X"E4",X"F7",X"71",
|
||||
X"14",X"7C",X"71",X"04",X"98",X"71",X"04",X"B7",X"71",X"30",X"DC",X"71",X"04",X"F2",X"71",X"6C",
|
||||
X"F2",X"71",X"DC",X"F2",X"71",X"70",X"FB",X"71",X"C8",X"2E",X"71",X"18",X"17",X"71",X"5C",X"FF",
|
||||
X"71",X"64",X"EB",X"72",X"06",X"06",X"72",X"90",X"15",X"72",X"78",X"21",X"72",X"5C",X"2F",X"72",
|
||||
X"68",X"51",X"72",X"30",X"3B",X"72",X"60",X"2A",X"70",X"24",X"94",X"72",X"40",X"59",X"72",X"40",
|
||||
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|
||||
X"73",X"E8",X"0B",X"73",X"38",X"A0",X"72",X"04",X"B3",X"72",X"04",X"D3",X"72",X"30",X"F2",X"72",
|
||||
X"04",X"07",X"73",X"70",X"07",X"73",X"E4",X"07",X"73",X"70",X"0E",X"73",X"C8",X"53",X"72",X"08",
|
||||
X"2F",X"72",X"60",X"8A",X"6E",X"54",X"78",X"6F",X"06",X"90",X"6E",X"90",X"99",X"6E",X"78",X"A4",
|
||||
X"6E",X"5C",X"B0",X"6E",X"68",X"22",X"70",X"50",X"BA",X"6E",X"36",X"C6",X"6E",X"2C",X"20",X"6F",
|
||||
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|
||||
X"A6",X"6F",X"74",X"A6",X"6F",X"E8",X"A6",X"6F",X"38",X"2B",X"6F",X"04",X"3E",X"6F",X"04",X"59",
|
||||
X"6F",X"38",X"83",X"6F",X"0C",X"96",X"6F",X"74",X"96",X"6F",X"E8",X"96",X"6F",X"68",X"C4",X"6F",
|
||||
X"C8",X"24",X"70",X"10",X"B0",X"6E",X"20",X"B6",X"6F",X"20",X"BD",X"6F",X"50",X"A9",X"6F",X"5C",
|
||||
X"FE",X"6E",X"5C",X"04",X"6F",X"5C",X"0A",X"6F",X"5C",X"11",X"6F",X"5C",X"9F",X"6F",X"5C",X"99",
|
||||
X"6F",X"40",X"C9",X"6F",X"50",X"90",X"6F",X"10",X"18",X"6F",X"50",X"4C",X"41",X"59",X"45",X"D2",
|
||||
X"47",X"41",X"4D",X"45",X"20",X"4F",X"56",X"45",X"D2",X"50",X"52",X"45",X"53",X"53",X"20",X"53",
|
||||
X"54",X"41",X"52",X"D4",X"49",X"4E",X"53",X"45",X"52",X"54",X"20",X"43",X"4F",X"49",X"4E",X"D3",
|
||||
X"42",X"4F",X"4E",X"55",X"53",X"20",X"43",X"49",X"54",X"D9",X"42",X"4F",X"4E",X"55",X"53",X"20",
|
||||
X"50",X"4F",X"49",X"4E",X"54",X"D3",X"54",X"48",X"45",X"20",X"45",X"4E",X"C4",X"31",X"20",X"43",
|
||||
X"4F",X"49",X"4E",X"20",X"32",X"20",X"50",X"4C",X"41",X"59",X"D3",X"31",X"20",X"43",X"4F",X"49",
|
||||
X"4E",X"20",X"31",X"20",X"50",X"4C",X"41",X"D9",X"32",X"20",X"43",X"4F",X"49",X"4E",X"53",X"20",
|
||||
X"31",X"20",X"50",X"4C",X"41",X"D9",X"43",X"52",X"45",X"44",X"49",X"54",X"53",X"BA",X"52",X"41",
|
||||
X"4D",X"20",X"4F",X"CB",X"52",X"4F",X"4D",X"20",X"4F",X"CB",X"42",X"41",X"44",X"20",X"52",X"41",
|
||||
X"CD",X"42",X"41",X"44",X"20",X"52",X"4F",X"CD",X"42",X"41",X"44",X"20",X"43",X"48",X"49",X"D0",
|
||||
X"47",X"52",X"45",X"41",X"54",X"20",X"53",X"43",X"4F",X"52",X"C5",X"45",X"4E",X"54",X"45",X"52",
|
||||
X"20",X"59",X"4F",X"55",X"52",X"20",X"49",X"4E",X"49",X"54",X"49",X"41",X"4C",X"D3",X"53",X"50",
|
||||
X"49",X"4E",X"20",X"42",X"41",X"4C",X"4C",X"20",X"54",X"4F",X"20",X"43",X"48",X"41",X"4E",X"47",
|
||||
X"45",X"20",X"4C",X"45",X"54",X"54",X"45",X"52",X"D3",X"50",X"52",X"45",X"53",X"53",X"20",X"41",
|
||||
X"4E",X"59",X"20",X"46",X"49",X"52",X"45",X"20",X"53",X"57",X"49",X"54",X"43",X"48",X"20",X"54",
|
||||
X"4F",X"20",X"53",X"45",X"4C",X"45",X"43",X"D4",X"48",X"49",X"47",X"48",X"20",X"53",X"43",X"4F",
|
||||
X"52",X"45",X"D3",X"44",X"45",X"46",X"45",X"4E",X"44",X"20",X"20",X"20",X"20",X"20",X"20",X"20",
|
||||
X"43",X"49",X"54",X"49",X"45",X"D3",X"4C",X"4F",X"D7",X"4D",X"41",X"50",X"20",X"4F",X"CB",X"42",
|
||||
X"41",X"44",X"20",X"4D",X"41",X"D0",X"4F",X"55",X"D4",X"41",X"54",X"41",X"52",X"49",X"20",X"40",
|
||||
X"3F",X"20",X"31",X"39",X"38",X"B0",X"4D",X"49",X"53",X"53",X"49",X"4C",X"C5",X"43",X"4F",X"4D",
|
||||
X"4D",X"41",X"4E",X"C4",X"45",X"56",X"45",X"52",X"D9",X"46",X"52",X"45",X"45",X"20",X"50",X"4C",
|
||||
X"41",X"D9",X"4A",X"4F",X"55",X"45",X"55",X"D2",X"46",X"49",X"4E",X"20",X"44",X"45",X"20",X"50",
|
||||
X"41",X"52",X"54",X"49",X"C5",X"41",X"50",X"50",X"55",X"59",X"45",X"5A",X"20",X"53",X"55",X"52",
|
||||
X"20",X"53",X"54",X"41",X"52",X"D4",X"49",X"4E",X"54",X"52",X"4F",X"44",X"55",X"49",X"52",X"45");
|
||||
begin
|
||||
process(clk)
|
||||
begin
|
||||
if rising_edge(clk) then
|
||||
data <= rom_data(to_integer(unsigned(addr)));
|
||||
end if;
|
||||
end process;
|
||||
end architecture;
|
||||
278
Arcade_MiST/Atari MissileCommand/rtl/rom/rom3.vhd
Normal file
278
Arcade_MiST/Atari MissileCommand/rtl/rom/rom3.vhd
Normal file
@@ -0,0 +1,278 @@
|
||||
library ieee;
|
||||
use ieee.std_logic_1164.all,ieee.numeric_std.all;
|
||||
|
||||
entity rom3 is
|
||||
port (
|
||||
clk : in std_logic;
|
||||
addr : in std_logic_vector(11 downto 0);
|
||||
data : out std_logic_vector(7 downto 0)
|
||||
);
|
||||
end entity;
|
||||
|
||||
architecture prom of rom3 is
|
||||
type rom is array(0 to 4095) of std_logic_vector(7 downto 0);
|
||||
signal rom_data: rom := (
|
||||
X"20",X"4C",X"45",X"53",X"20",X"50",X"49",X"45",X"43",X"45",X"D3",X"42",X"4F",X"4E",X"55",X"53",
|
||||
X"20",X"56",X"49",X"4C",X"4C",X"C5",X"42",X"4F",X"4E",X"55",X"53",X"20",X"50",X"4F",X"49",X"4E",
|
||||
X"54",X"D3",X"58",X"20",X"50",X"4F",X"49",X"4E",X"54",X"D3",X"46",X"49",X"CE",X"31",X"20",X"50",
|
||||
X"49",X"45",X"43",X"45",X"20",X"32",X"20",X"4A",X"4F",X"55",X"45",X"55",X"52",X"D3",X"31",X"20",
|
||||
X"50",X"49",X"45",X"43",X"45",X"20",X"31",X"20",X"4A",X"4F",X"55",X"45",X"55",X"D2",X"32",X"20",
|
||||
X"50",X"49",X"45",X"43",X"45",X"53",X"20",X"31",X"20",X"4A",X"4F",X"55",X"45",X"55",X"D2",X"53",
|
||||
X"50",X"4C",X"45",X"4E",X"44",X"49",X"44",X"45",X"20",X"53",X"43",X"4F",X"52",X"C5",X"53",X"56",
|
||||
X"50",X"20",X"45",X"4E",X"54",X"52",X"45",X"5A",X"20",X"56",X"4F",X"53",X"20",X"49",X"4E",X"49",
|
||||
X"54",X"49",X"41",X"4C",X"45",X"D3",X"54",X"4F",X"55",X"52",X"4E",X"45",X"5A",X"20",X"42",X"4F",
|
||||
X"55",X"4C",X"45",X"20",X"50",X"4F",X"55",X"52",X"20",X"49",X"4E",X"49",X"54",X"49",X"41",X"4C",
|
||||
X"C5",X"50",X"4F",X"55",X"53",X"53",X"45",X"5A",X"20",X"46",X"45",X"55",X"20",X"51",X"55",X"41",
|
||||
X"4E",X"44",X"20",X"43",X"4F",X"52",X"52",X"45",X"43",X"54",X"C5",X"4D",X"45",X"49",X"4C",X"4C",
|
||||
X"45",X"55",X"52",X"53",X"20",X"53",X"43",X"4F",X"52",X"45",X"D3",X"44",X"45",X"46",X"45",X"4E",
|
||||
X"53",X"45",X"5A",X"20",X"20",X"20",X"20",X"20",X"56",X"49",X"4C",X"4C",X"45",X"D3",X"42",X"41",
|
||||
X"D3",X"56",X"49",X"44",X"C5",X"C1",X"53",X"50",X"49",X"45",X"4C",X"45",X"D2",X"53",X"50",X"49",
|
||||
X"45",X"4C",X"45",X"4E",X"44",X"C5",X"53",X"54",X"41",X"52",X"54",X"4B",X"4E",X"24",X"50",X"46",
|
||||
X"45",X"20",X"44",X"52",X"25",X"43",X"4B",X"45",X"CE",X"47",X"45",X"4C",X"44",X"20",X"45",X"49",
|
||||
X"4E",X"57",X"45",X"52",X"46",X"45",X"CE",X"42",X"4F",X"4E",X"55",X"53",X"53",X"54",X"41",X"44",
|
||||
X"D4",X"42",X"4F",X"4E",X"55",X"53",X"50",X"55",X"4E",X"4B",X"54",X"C5",X"58",X"20",X"50",X"55",
|
||||
X"4E",X"4B",X"54",X"C5",X"45",X"4E",X"44",X"C5",X"31",X"20",X"4D",X"25",X"4E",X"5A",X"20",X"32",
|
||||
X"20",X"53",X"50",X"49",X"45",X"4C",X"C5",X"31",X"20",X"4D",X"25",X"4E",X"5A",X"45",X"20",X"31",
|
||||
X"20",X"53",X"50",X"49",X"45",X"CC",X"32",X"20",X"4D",X"25",X"4E",X"5A",X"45",X"4E",X"20",X"31",
|
||||
X"20",X"53",X"50",X"49",X"45",X"CC",X"4B",X"52",X"45",X"44",X"49",X"54",X"45",X"BA",X"50",X"52",
|
||||
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|
||||
X"00",X"49",X"10",X"FB",X"8D",X"00",X"4C",X"88",X"10",X"F0",X"A0",X"00",X"8C",X"01",X"40",X"A0",
|
||||
X"14",X"2C",X"00",X"49",X"30",X"FB",X"2C",X"00",X"49",X"10",X"FB",X"8D",X"00",X"4C",X"88",X"10",
|
||||
X"F0",X"BA",X"CA",X"9A",X"10",X"C2",X"4C",X"4B",X"7B",X"A2",X"00",X"86",X"06",X"86",X"8D",X"9A",
|
||||
X"A9",X"50",X"85",X"07",X"A2",X"2F",X"A9",X"12",X"85",X"99",X"A0",X"00",X"8E",X"00",X"4C",X"51",
|
||||
X"06",X"C8",X"D0",X"FB",X"A8",X"8A",X"29",X"07",X"C9",X"01",X"98",X"B0",X"18",X"F0",X"10",X"48",
|
||||
X"8A",X"48",X"4A",X"4A",X"4A",X"AA",X"BD",X"F9",X"60",X"05",X"8D",X"85",X"8D",X"68",X"AA",X"A5",
|
||||
X"99",X"69",X"22",X"85",X"99",X"E6",X"07",X"CA",X"10",X"D0",X"58",X"20",X"86",X"69",X"20",X"2F",
|
||||
X"67",X"A9",X"00",X"85",X"EA",X"A9",X"0E",X"85",X"E4",X"85",X"93",X"A9",X"22",X"BA",X"D0",X"02",
|
||||
X"A9",X"20",X"A2",X"FF",X"9A",X"20",X"3B",X"7F",X"A9",X"80",X"85",X"00",X"85",X"01",X"A2",X"00",
|
||||
X"A9",X"C0",X"81",X"00",X"A0",X"24",X"AD",X"20",X"20",X"29",X"11",X"C9",X"11",X"F0",X"02",X"A0",
|
||||
X"23",X"98",X"20",X"51",X"6A",X"AD",X"0A",X"40",X"85",X"FD",X"A0",X"10",X"AD",X"0A",X"40",X"C5",
|
||||
X"FD",X"D0",X"0A",X"85",X"FD",X"88",X"10",X"F4",X"A9",X"27",X"20",X"51",X"6A",X"A9",X"1F",X"20",
|
||||
X"51",X"6A",X"A9",X"02",X"85",X"AE",X"A9",X"00",X"85",X"B9",X"20",X"5C",X"65",X"A5",X"F3",X"49",
|
||||
X"FF",X"85",X"FD",X"A9",X"01",X"85",X"FF",X"8D",X"08",X"40",X"46",X"9F",X"90",X"FC",X"A5",X"F2",
|
||||
X"29",X"24",X"D0",X"05",X"85",X"FF",X"20",X"7F",X"7F",X"A5",X"F2",X"29",X"21",X"D0",X"05",X"85",
|
||||
X"FF",X"20",X"62",X"7F",X"A9",X"00",X"8D",X"01",X"40",X"8D",X"03",X"40",X"A5",X"F2",X"29",X"22",
|
||||
X"D0",X"05",X"85",X"FF",X"20",X"EB",X"7E",X"20",X"32",X"51",X"A5",X"F1",X"49",X"FF",X"8D",X"00",
|
||||
X"40",X"F0",X"07",X"A9",X"A8",X"8D",X"01",X"40",X"E6",X"E4",X"A5",X"F2",X"49",X"FF",X"29",X"27",
|
||||
X"8D",X"02",X"40",X"F0",X"07",X"A9",X"A8",X"8D",X"03",X"40",X"E6",X"E4",X"A5",X"FA",X"29",X"07",
|
||||
X"F0",X"17",X"A5",X"B9",X"49",X"01",X"85",X"B9",X"A9",X"00",X"85",X"FA",X"20",X"86",X"69",X"A5",
|
||||
X"FD",X"49",X"FF",X"85",X"FD",X"A9",X"01",X"85",X"FF",X"20",X"6B",X"7E",X"24",X"F2",X"50",X"8A",
|
||||
X"4C",X"4B",X"7B",X"11",X"14",X"15",X"16",X"21",X"24",X"25",X"26",X"A5",X"FF",X"F0",X"7B",X"A5",
|
||||
X"F3",X"C5",X"FD",X"85",X"FD",X"D0",X"06",X"A5",X"F4",X"C5",X"FE",X"85",X"FE",X"F0",X"6B",X"A9",
|
||||
X"25",X"20",X"49",X"6A",X"A9",X"1B",X"20",X"49",X"6A",X"20",X"2F",X"67",X"A5",X"F3",X"29",X"03",
|
||||
X"AA",X"BD",X"2F",X"6C",X"20",X"51",X"6A",X"A5",X"F3",X"29",X"1C",X"4A",X"4A",X"AA",X"BD",X"63",
|
||||
X"7E",X"48",X"4A",X"4A",X"4A",X"4A",X"A2",X"40",X"A0",X"28",X"20",X"9D",X"6A",X"68",X"29",X"07",
|
||||
X"A2",X"50",X"20",X"9D",X"6A",X"A9",X"70",X"85",X"1D",X"A9",X"28",X"85",X"1E",X"A5",X"F4",X"29",
|
||||
X"08",X"F0",X"02",X"A9",X"46",X"20",X"BA",X"76",X"A5",X"F4",X"29",X"04",X"F0",X"02",X"A9",X"58",
|
||||
X"20",X"BA",X"76",X"A5",X"F4",X"29",X"03",X"AA",X"BD",X"08",X"5B",X"A2",X"40",X"A0",X"34",X"20",
|
||||
X"9D",X"6A",X"A9",X"26",X"20",X"51",X"6A",X"20",X"AA",X"74",X"60",X"20",X"62",X"7F",X"20",X"86",
|
||||
X"69",X"78",X"A9",X"00",X"85",X"8D",X"A9",X"1F",X"85",X"99",X"A9",X"02",X"85",X"07",X"A9",X"AA",
|
||||
X"91",X"06",X"C8",X"B1",X"06",X"F0",X"03",X"20",X"32",X"7F",X"C8",X"D0",X"F6",X"B1",X"06",X"C9",
|
||||
X"AA",X"F0",X"03",X"20",X"30",X"7F",X"A9",X"00",X"91",X"06",X"85",X"9F",X"8D",X"00",X"4C",X"E6",
|
||||
X"06",X"D0",X"DB",X"E6",X"07",X"A5",X"07",X"C9",X"3F",X"D0",X"D3",X"A5",X"99",X"4C",X"3B",X"7F",
|
||||
X"49",X"AA",X"05",X"8D",X"85",X"8D",X"A9",X"21",X"85",X"99",X"60",X"58",X"20",X"51",X"6A",X"A5",
|
||||
X"8D",X"A2",X"08",X"0A",X"90",X"18",X"48",X"86",X"C5",X"A9",X"E0",X"85",X"0B",X"8A",X"0A",X"0A",
|
||||
X"0A",X"18",X"69",X"88",X"A8",X"8A",X"A2",X"A0",X"20",X"9D",X"6A",X"A6",X"C5",X"68",X"CA",X"D0",
|
||||
X"E2",X"60",X"A2",X"07",X"8A",X"0A",X"95",X"E4",X"CA",X"10",X"F9",X"E8",X"86",X"06",X"A0",X"18",
|
||||
X"84",X"07",X"A5",X"06",X"81",X"06",X"E6",X"07",X"D0",X"F8",X"E6",X"06",X"D0",X"F0",X"60",X"A9",
|
||||
X"0E",X"A2",X"07",X"95",X"E4",X"CA",X"10",X"FB",X"A9",X"00",X"85",X"E6",X"20",X"86",X"69",X"A2",
|
||||
X"00",X"A0",X"05",X"A9",X"19",X"85",X"07",X"B9",X"E2",X"7F",X"85",X"06",X"A9",X"40",X"81",X"06",
|
||||
X"E6",X"07",X"D0",X"FA",X"88",X"10",X"EC",X"A0",X"05",X"B9",X"E8",X"7F",X"85",X"07",X"86",X"06",
|
||||
X"A9",X"40",X"81",X"06",X"E6",X"06",X"D0",X"FA",X"88",X"10",X"EE",X"A0",X"04",X"B9",X"E2",X"7F",
|
||||
X"18",X"79",X"E3",X"7F",X"6A",X"85",X"06",X"84",X"98",X"A0",X"04",X"B9",X"E8",X"7F",X"18",X"79",
|
||||
X"E9",X"7F",X"6A",X"85",X"07",X"A9",X"40",X"81",X"06",X"88",X"10",X"EF",X"A4",X"98",X"88",X"10",
|
||||
X"DC",X"60",X"00",X"33",X"66",X"99",X"CC",X"FF",X"19",X"46",X"74",X"A2",X"D0",X"FF",X"D8",X"00",
|
||||
X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"00",X"4B",X"7B",X"4B",X"7B",X"2A",X"7B");
|
||||
begin
|
||||
process(clk)
|
||||
begin
|
||||
if rising_edge(clk) then
|
||||
data <= rom_data(to_integer(unsigned(addr)));
|
||||
end if;
|
||||
end process;
|
||||
end architecture;
|
||||
51
Arcade_MiST/Atari MissileCommand/rtl/spram.v
Normal file
51
Arcade_MiST/Atari MissileCommand/rtl/spram.v
Normal file
@@ -0,0 +1,51 @@
|
||||
/*============================================================================
|
||||
Generic single-port RAM module
|
||||
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Copyright (C) 2022 - Jim Gregory - https://github.com/JimmyStones/
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===========================================================================*/
|
||||
|
||||
`timescale 1 ps / 1 ps
|
||||
`default_nettype none
|
||||
|
||||
module spram # (
|
||||
parameter address_width = 8,
|
||||
parameter data_width = 8
|
||||
)
|
||||
(
|
||||
input clock,
|
||||
input [(address_width-1):0] address,
|
||||
input [(data_width-1):0] data,
|
||||
output reg [(data_width-1):0] q,
|
||||
input wren
|
||||
);
|
||||
|
||||
localparam ramLength = (2**address_width);
|
||||
reg [(data_width-1):0] mem [ramLength-1:0];
|
||||
|
||||
always @(posedge clock)
|
||||
begin
|
||||
if (wren)
|
||||
begin
|
||||
mem[address] <= data;
|
||||
q <= data;
|
||||
end
|
||||
else
|
||||
begin
|
||||
q <= mem[address];
|
||||
end
|
||||
end
|
||||
|
||||
endmodule
|
||||
98
Arcade_MiST/Atari MissileCommand/rtl/sync.v
Normal file
98
Arcade_MiST/Atari MissileCommand/rtl/sync.v
Normal file
@@ -0,0 +1,98 @@
|
||||
/*============================================================================
|
||||
Missile Command for MiSTer FPGA - Sync circuit
|
||||
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Copyright (C) 2022 - Jim Gregory - https://github.com/JimmyStones/
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===========================================================================*/
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|
||||
`timescale 1 ps / 1 ps
|
||||
`default_nettype none
|
||||
|
||||
module sync
|
||||
(
|
||||
input wire clk_10M,
|
||||
input wire ce_5M,
|
||||
input wire reset,
|
||||
input wire flip,
|
||||
output reg h_sync,
|
||||
output reg v_sync,
|
||||
output reg h_blank,
|
||||
output reg v_blank/*verilator public_flat*/,
|
||||
output wire s_phi_x,
|
||||
output wire s_3INH,
|
||||
output reg [8:0] hcnt/*verilator public_flat*/,
|
||||
output reg [7:0] vcnt/*verilator public_flat*/
|
||||
);
|
||||
|
||||
|
||||
///// CLOCKS
|
||||
reg s_A7_1;
|
||||
reg s_A7_2_n;
|
||||
reg s_B8;
|
||||
|
||||
always @(posedge clk_10M)
|
||||
begin
|
||||
reg h_sync_last;
|
||||
reg ce_5M_last;
|
||||
reg s_1h_last;
|
||||
|
||||
///// HORIZONTAL COUNTER AND SYNC
|
||||
if(ce_5M == 1'b1)
|
||||
begin
|
||||
hcnt <= hcnt + 9'b1;
|
||||
begin
|
||||
case (hcnt)
|
||||
256: h_blank <= 1;
|
||||
260: h_sync <= 1;
|
||||
288: h_sync <= 0;
|
||||
319:
|
||||
begin
|
||||
hcnt <= 0;
|
||||
h_blank <=0;
|
||||
end
|
||||
endcase
|
||||
end
|
||||
///// VERTICAL COUNTER AND SYNC
|
||||
if (h_sync == 1'b1 && h_sync_last == 1'b0) begin
|
||||
if(flip)
|
||||
vcnt <= vcnt + 8'b1;
|
||||
else
|
||||
vcnt <= vcnt - 8'b1;
|
||||
end
|
||||
h_sync_last <= h_sync;
|
||||
|
||||
case (vcnt)
|
||||
0: v_blank <= flip;
|
||||
25: v_blank <= ~flip;
|
||||
4: if(flip) v_sync <= 1;
|
||||
8: if(flip) v_sync <= 0;
|
||||
20: if(~flip) v_sync <= 1;
|
||||
16: if(~flip) v_sync <= 0;
|
||||
endcase
|
||||
end
|
||||
|
||||
ce_5M_last <= ce_5M;
|
||||
if(ce_5M && !ce_5M_last) s_A7_1 <= ~s_3INH;
|
||||
|
||||
s_1h_last <= hcnt[0];
|
||||
if(hcnt[0] && !s_1h_last) s_A7_2_n <= (~hcnt[1] & hcnt[2]);
|
||||
if(!hcnt[0] && s_1h_last) s_B8 <= s_A7_2_n;
|
||||
|
||||
end
|
||||
|
||||
assign s_3INH = (vcnt[7:5] == 3'b111);
|
||||
assign s_phi_x = (~(s_B8 & ~s_A7_1)) & (~(s_A7_1 & hcnt[1]));
|
||||
|
||||
endmodule
|
||||
216
Arcade_MiST/Atari MissileCommand/rtl/trackball.v
Normal file
216
Arcade_MiST/Atari MissileCommand/rtl/trackball.v
Normal file
@@ -0,0 +1,216 @@
|
||||
/*============================================================================
|
||||
Missile Command for MiSTer FPGA - Trackball emulator
|
||||
|
||||
Copyright (C) 2022 - Jim Gregory - https://github.com/JimmyStones/
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===========================================================================*/
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||||
|
||||
`timescale 1 ps / 1 ps
|
||||
`default_nettype none
|
||||
|
||||
module trackball(
|
||||
input clk,
|
||||
input flip,
|
||||
input [3:0] joystick,
|
||||
input [15:0] joystick_analog,
|
||||
input joystick_mode, // 0 = digital, 1 = analog
|
||||
input joystick_sensitivity,
|
||||
input [1:0] mouse_speed,
|
||||
input [24:0] ps2_mouse,
|
||||
output reg v_dir,
|
||||
output reg v_clk,
|
||||
output reg h_dir,
|
||||
output reg h_clk
|
||||
|
||||
);
|
||||
|
||||
wire [7:0] joystick_speed = joystick_sensitivity ? 8'd32 : 8'd16;
|
||||
|
||||
localparam joystick_divider_width = 16;
|
||||
localparam [joystick_divider_width-1:0] joystick_divider_max = 60000;
|
||||
reg [joystick_divider_width-1:0] joystick_divider = joystick_divider_max;
|
||||
|
||||
localparam analog_divider_width = 19;
|
||||
localparam [analog_divider_width-1:0] analog_divider_max = 300000;
|
||||
reg [analog_divider_width-1:0] analog_divider = analog_divider_max;
|
||||
|
||||
// Trackball movement
|
||||
localparam trackball_falloff_width = 11;
|
||||
reg [trackball_falloff_width-1:0] trackball_falloff;
|
||||
|
||||
localparam analog_falloff_max = 1;
|
||||
|
||||
reg [7:0] mouse_mag_x /* synthesis preserve noprune */;
|
||||
reg [7:0] mouse_mag_y /* synthesis preserve noprune */;
|
||||
|
||||
wire mouse_clock /* synthesis keep */ = ps2_mouse[24];
|
||||
wire mouse_sign_x = /* synthesis preserve noprune */ ps2_mouse[4];
|
||||
wire mouse_sign_y = /* synthesis preserve noprune */ ps2_mouse[5];
|
||||
|
||||
localparam [15:0] clock_base = 16'd3000;
|
||||
|
||||
reg [15:0] h_clock_counter;
|
||||
reg [15:0] h_clock_max = 0;
|
||||
reg [15:0] v_clock_counter;
|
||||
reg [15:0] v_clock_max = 0;
|
||||
|
||||
// Trackball movement
|
||||
always @(posedge clk)
|
||||
begin
|
||||
reg old_mstate;
|
||||
|
||||
if(joystick_mode == 1'b0)
|
||||
begin
|
||||
joystick_divider <= joystick_divider - 1'b1;
|
||||
if(joystick_divider == 0)
|
||||
begin
|
||||
joystick_divider <= joystick_divider_max;
|
||||
|
||||
// Right
|
||||
if(joystick[0])
|
||||
begin
|
||||
h_dir <= 1'b0;
|
||||
mouse_mag_x = joystick_speed;
|
||||
trackball_falloff <= {trackball_falloff_width{1'b1}};
|
||||
end
|
||||
|
||||
// Left
|
||||
if(joystick[1])
|
||||
begin
|
||||
h_dir <= 1'b1;
|
||||
mouse_mag_x = joystick_speed;
|
||||
trackball_falloff <= {trackball_falloff_width{1'b1}};
|
||||
end
|
||||
|
||||
// Down
|
||||
if(joystick[2])
|
||||
begin
|
||||
v_dir <= 1'b1;
|
||||
mouse_mag_y = joystick_speed;
|
||||
trackball_falloff <= {trackball_falloff_width{1'b1}};
|
||||
end
|
||||
|
||||
// Up
|
||||
if(joystick[3])
|
||||
begin
|
||||
v_dir <= 1'b0;
|
||||
mouse_mag_y = joystick_speed;
|
||||
trackball_falloff <= {trackball_falloff_width{1'b1}};
|
||||
end
|
||||
|
||||
end
|
||||
end
|
||||
else
|
||||
begin
|
||||
analog_divider <= analog_divider - 1'b1;
|
||||
if(analog_divider == 0)
|
||||
begin
|
||||
analog_divider <= analog_divider_max;
|
||||
|
||||
// Horizontal analog joystick
|
||||
if(joystick_analog[7:0] != 0)
|
||||
begin
|
||||
h_dir <= joystick_analog[7];
|
||||
mouse_mag_x = {1'b0, joystick_analog[7] ? -joystick_analog[6:0] : joystick_analog[6:0]};
|
||||
if(mouse_mag_x < 10)
|
||||
mouse_mag_x = 0;
|
||||
else
|
||||
mouse_mag_x = mouse_mag_x >> (joystick_sensitivity ? 2 : 1);
|
||||
trackball_falloff <= analog_falloff_max;
|
||||
end
|
||||
// Vertical analog joystick
|
||||
if(joystick_analog[15:8] != 0)
|
||||
begin
|
||||
v_dir <= ~joystick_analog[15];
|
||||
mouse_mag_y = {1'b0, joystick_analog[15] ? -joystick_analog[14:8] : joystick_analog[14:8]};
|
||||
if(mouse_mag_y < 10)
|
||||
mouse_mag_y = 0;
|
||||
else
|
||||
mouse_mag_y = mouse_mag_y >> (joystick_sensitivity ? 2 : 1);
|
||||
trackball_falloff <= analog_falloff_max;
|
||||
end
|
||||
end
|
||||
end
|
||||
|
||||
old_mstate <= mouse_clock;
|
||||
if(old_mstate != mouse_clock)
|
||||
begin
|
||||
|
||||
h_dir <= mouse_sign_x;
|
||||
v_dir <= mouse_sign_y;
|
||||
|
||||
mouse_mag_x = mouse_sign_x ? -ps2_mouse[15:8] : ps2_mouse[15:8];
|
||||
mouse_mag_y = mouse_sign_y ? -ps2_mouse[23:16] : ps2_mouse[23:16];
|
||||
|
||||
if(mouse_speed == 2'd0) // 25% speed
|
||||
begin
|
||||
mouse_mag_x = mouse_mag_x >> 2;
|
||||
mouse_mag_y = mouse_mag_y >> 2;
|
||||
end
|
||||
else if(mouse_speed == 2'd1) // 50% speed
|
||||
begin
|
||||
mouse_mag_x = mouse_mag_x >> 1;
|
||||
mouse_mag_y = mouse_mag_y >> 1;
|
||||
end
|
||||
else if(mouse_speed == 2'd3) // 200% speed
|
||||
begin
|
||||
mouse_mag_x = mouse_mag_x << 1;
|
||||
mouse_mag_y = mouse_mag_y << 1;
|
||||
end
|
||||
|
||||
trackball_falloff <= {trackball_falloff_width{1'b1}};
|
||||
end
|
||||
|
||||
if(mouse_mag_x > 0) h_clock_max <= clock_base + ((16'd255 - {8'b0,mouse_mag_x}) << 4);
|
||||
else h_clock_max <= 0;
|
||||
if(mouse_mag_y > 0) v_clock_max <= clock_base + ((16'd255 - {8'b0,mouse_mag_y}) << 4);
|
||||
else v_clock_max <= 0;
|
||||
|
||||
if(trackball_falloff == 0)
|
||||
begin
|
||||
if (mouse_mag_x > 0) mouse_mag_x = mouse_mag_x - 1'b1;
|
||||
if (mouse_mag_y > 0) mouse_mag_y = mouse_mag_y - 1'b1;
|
||||
trackball_falloff <= {trackball_falloff_width{1'b1}};
|
||||
end
|
||||
else
|
||||
trackball_falloff <= trackball_falloff - 1'b1;
|
||||
|
||||
if(h_clock_max == 0)
|
||||
h_clock_counter <= 0;
|
||||
else
|
||||
begin
|
||||
h_clock_counter <= h_clock_counter + 1'b1;
|
||||
if(h_clock_counter >= h_clock_max)
|
||||
begin
|
||||
h_clock_counter <= 0;
|
||||
h_clk <= ~h_clk;
|
||||
end
|
||||
end
|
||||
|
||||
if(v_clock_max == 0)
|
||||
v_clock_counter <= 0;
|
||||
else
|
||||
begin
|
||||
v_clock_counter <= v_clock_counter + 1'b1;
|
||||
if(v_clock_counter >= v_clock_max)
|
||||
begin
|
||||
v_clock_counter <= 0;
|
||||
v_clk <= ~v_clk;
|
||||
end
|
||||
end
|
||||
|
||||
end
|
||||
|
||||
endmodule
|
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